JPH02298108A - 電圧制御型発振器 - Google Patents
電圧制御型発振器Info
- Publication number
- JPH02298108A JPH02298108A JP11736389A JP11736389A JPH02298108A JP H02298108 A JPH02298108 A JP H02298108A JP 11736389 A JP11736389 A JP 11736389A JP 11736389 A JP11736389 A JP 11736389A JP H02298108 A JPH02298108 A JP H02298108A
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- JP
- Japan
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- circuit board
- strip line
- printed circuit
- controlled oscillator
- voltage controlled
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000010355 oscillation Effects 0.000 claims description 10
- 230000001939 inductive effect Effects 0.000 claims description 7
- 239000000284 extract Substances 0.000 claims description 2
- 230000008878 coupling Effects 0.000 abstract description 11
- 238000010168 coupling process Methods 0.000 abstract description 11
- 238000005859 coupling reaction Methods 0.000 abstract description 11
- 230000006866 deterioration Effects 0.000 abstract description 3
- 239000003990 capacitor Substances 0.000 description 9
- 230000003321 amplification Effects 0.000 description 6
- 238000003199 nucleic acid amplification method Methods 0.000 description 6
- 238000010586 diagram Methods 0.000 description 2
- 230000000903 blocking effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/0213—Electrical arrangements not otherwise provided for
Landscapes
- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
- Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、自動車電話その他の高周波無線装毘の分野等
で利用できるストリップ線路を用いた電圧制御型発振器
に関する。
で利用できるストリップ線路を用いた電圧制御型発振器
に関する。
［従来の技術］
従来より、入力制御電圧に対応した周波数の高・周波（
例えば、ＵＨＦ帯域）信号を出力するようにしたストリ
ップ線路を用いた電圧制御型発振器（以下、ＶＣＯとい
う）は知られている（例えば、実開昭５６−１６７６０
８号公報参照）。
例えば、ＵＨＦ帯域）信号を出力するようにしたストリ
ップ線路を用いた電圧制御型発振器（以下、ＶＣＯとい
う）は知られている（例えば、実開昭５６−１６７６０
８号公報参照）。
この従来のＶＣＯは、周知のコレクタ接地型の） コ
ルピッツ発振回路において、共振回路を構成す； る
誘導素子を単純なストリップ共振線路で構成して諸特性
を安定化させたものである。
ルピッツ発振回路において、共振回路を構成す； る
誘導素子を単純なストリップ共振線路で構成して諸特性
を安定化させたものである。
、 ［発明が解決しようとする課題］ところで、上記
従来のＶＣＯは、一般に、ブリ） ント基板上に、ス
トリップ線路を含む回路素子を、 実装したものであ
る。
従来のＶＣＯは、一般に、ブリ） ント基板上に、ス
トリップ線路を含む回路素子を、 実装したものであ
る。
第２図は、従来のＶＣＯの実装状態を示す部分断面図で
ある。図において、符号１がプリント基板、符号Ｌａ
、Ｌｂがストリップ線路、符号２ａ。
ある。図において、符号１がプリント基板、符号Ｌａ
、Ｌｂがストリップ線路、符号２ａ。
ｉ ２ｔ）が他の回路素子である。
この従来のｖＣＯは、第２図に示されるように、ストリ
ップ線ｉＬａ 、Ｌｂと他の回路素子２ａ 、２ｂとの
間で、Ｃｓｌ、 Ｃｓ２． Ｌｓ等の電気的空間結合を
起し、特性劣化を生ずるおそれがあった。
ップ線ｉＬａ 、Ｌｂと他の回路素子２ａ 、２ｂとの
間で、Ｃｓｌ、 Ｃｓ２． Ｌｓ等の電気的空間結合を
起し、特性劣化を生ずるおそれがあった。
これは、この種の発振回路にあっては、所望の高周波特
性を確保し、併せて、外形寸法をできるだけ小型化する
なめに、プリント基板に実装する回路素子を可能な限り
近接して配置しなければならず、しかも、その帰結とし
て、空間結合を遮断するためのアースパターンを設ける
スペースを十分確保できない等という条件が重なってい
ることが原因である。すなわち、回路素子間の距離が短
い上に、空間結合遮断手段も十分設けることができない
ためである。それゆえ、従来は、この空間結合を防止す
るために回路素子の配置関係を種々工夫する必要があり
、回路設計及び基板設計等が著しく困難であるという問
題点があった。
性を確保し、併せて、外形寸法をできるだけ小型化する
なめに、プリント基板に実装する回路素子を可能な限り
近接して配置しなければならず、しかも、その帰結とし
て、空間結合を遮断するためのアースパターンを設ける
スペースを十分確保できない等という条件が重なってい
ることが原因である。すなわち、回路素子間の距離が短
い上に、空間結合遮断手段も十分設けることができない
ためである。それゆえ、従来は、この空間結合を防止す
るために回路素子の配置関係を種々工夫する必要があり
、回路設計及び基板設計等が著しく困難であるという問
題点があった。
本発明は、上述の背景のもとでなされたものであり、極
めて簡単な構成によってストリップ線路と他の回路素子
との空間結合を防止して良好な高周波特性を得ることで
き、併せて、回路素子を実装した状態での外形寸法を小
型化することを可能としたＶＣＯを提供することを目的
としたものである。
めて簡単な構成によってストリップ線路と他の回路素子
との空間結合を防止して良好な高周波特性を得ることで
き、併せて、回路素子を実装した状態での外形寸法を小
型化することを可能としたＶＣＯを提供することを目的
としたものである。
［課題を解決するための手段］
本発明は、以下の構成とすることで上述の課題を解決し
ている。
ている。
コルピッツ型発振回路の共振川波数を定める誘導リアク
タ７ス部の一部を可変容量型ダイオードで構成し、さら
に、前記誘導リアクタンス部の一部及び他のインダクタ
ンス部をストリップ線路で構成し、前記可変容重型ダイ
オードに制御電圧を加えることにより該制御電圧に対応
した周波数の出力信号を取り出すようにした電圧制御型
発振器において、 該電圧制御型発振器を構成する回路素子のうちストリッ
プ線路を除く主な回路素子をプリント基板の一方の側に
実装し、このプリント基板の他方の側に前記ストリップ
線路を形成したことを特徴とする構成。
タ７ス部の一部を可変容量型ダイオードで構成し、さら
に、前記誘導リアクタンス部の一部及び他のインダクタ
ンス部をストリップ線路で構成し、前記可変容重型ダイ
オードに制御電圧を加えることにより該制御電圧に対応
した周波数の出力信号を取り出すようにした電圧制御型
発振器において、 該電圧制御型発振器を構成する回路素子のうちストリッ
プ線路を除く主な回路素子をプリント基板の一方の側に
実装し、このプリント基板の他方の側に前記ストリップ
線路を形成したことを特徴とする構成。
［作用］
上述の構成によれば、前記電圧制御型発振器を構成する
回路素子のうちストリップ線路を除く回路素子をプリン
ト基板の一方の側に実装し、前記ストリップ線路を前記
プリント基板の他方の側に形成している。すなわち、前
記プリント基板の前記ストリップ線路が形成される側に
は他の回路素子が配置されないから、このストリップ線
路の周囲には空間結合を遮断するに十分なアースパター
ンを形成させることができる。したがって、良好な高周
波特性を得ることができるとともに、基板設計等も容易
になる。しかも、前記プリント基板の他の回路素子が実
装される側にはストリップ線路を形成する必要がないか
らその分実装面積を節約でき、回路素子を実装した状態
での外形寸法を小型化することが可能となる。
回路素子のうちストリップ線路を除く回路素子をプリン
ト基板の一方の側に実装し、前記ストリップ線路を前記
プリント基板の他方の側に形成している。すなわち、前
記プリント基板の前記ストリップ線路が形成される側に
は他の回路素子が配置されないから、このストリップ線
路の周囲には空間結合を遮断するに十分なアースパター
ンを形成させることができる。したがって、良好な高周
波特性を得ることができるとともに、基板設計等も容易
になる。しかも、前記プリント基板の他の回路素子が実
装される側にはストリップ線路を形成する必要がないか
らその分実装面積を節約でき、回路素子を実装した状態
での外形寸法を小型化することが可能となる。
［実施例］
第３図は本発明の一実施例にかかる電圧制御型発振器の
回路図である。
回路図である。
第３図において、この回路は、コルピッツ型発振回路を
ベースにした発振部Ｏと、アンプ部（ＡＭＰ）Ａとから
構成されている。
ベースにした発振部Ｏと、アンプ部（ＡＭＰ）Ａとから
構成されている。
前記発振部Ｏは、増幅用トランジスタＱ１と、該増幅用
トランジスタＱ１のコレクタ・エミッタ間に接続された
第１のキャパシタｃ１と、同じくコレクタ・ベース間に
接続された第２のキャパシタＣ２と、同じくベースにそ
の一端が接続された第１のストリップ線路Ｌ１と、この
第１のストリップ線路Ｌ１の他端に直流カット用の第３
のキャパシタＣ３を介してそのカソードが接続された可
変容量型ダイオード（バラクタダイオード）ＶＤｌとか
ら構成されている。
トランジスタＱ１のコレクタ・エミッタ間に接続された
第１のキャパシタｃ１と、同じくコレクタ・ベース間に
接続された第２のキャパシタＣ２と、同じくベースにそ
の一端が接続された第１のストリップ線路Ｌ１と、この
第１のストリップ線路Ｌ１の他端に直流カット用の第３
のキャパシタＣ３を介してそのカソードが接続された可
変容量型ダイオード（バラクタダイオード）ＶＤｌとか
ら構成されている。
なお、前記増幅用トランジスタＱ１のコレクタはバイパ
ス用の第４のキャパシタｃ４を介して接地されていると
ともに、駆動用電源ＶＣＣに接続されている。また、そ
のエミッタは第１の抵抗Ｒ１を介して接地され、ベース
には第２及び第３の抵抗Ｒ２及びＲ３を通じて前記ＶＣ
Ｃがらベース電圧が供給されるようになっている。
ス用の第４のキャパシタｃ４を介して接地されていると
ともに、駆動用電源ＶＣＣに接続されている。また、そ
のエミッタは第１の抵抗Ｒ１を介して接地され、ベース
には第２及び第３の抵抗Ｒ２及びＲ３を通じて前記ＶＣ
Ｃがらベース電圧が供給されるようになっている。
前記ＡＭＰ部Ａは、増幅用のＦＥＴ （電界効果型トラ
ンジスタ＞Ｑ２と、インダクタンス部たる第２及び第３
のストリップ線路Ｌ２及びＬ３並びにバイパス用の第５
のキャパシタＣ５からなる出力整合回路と、ゲートバイ
アス用の第４の抵抗Ｒ４と、ソース用の第５の抵抗Ｒ５
と、ソースバイパス用の第６のキャパシタＣ６と、出力
直流カット用の第７のキャパシタＣ７とから構成されて
おり、前記整合回路を構成するストリップ線路Ｌ３から
ドレイン電圧ＶＤＯが供給されるようになっている。
ンジスタ＞Ｑ２と、インダクタンス部たる第２及び第３
のストリップ線路Ｌ２及びＬ３並びにバイパス用の第５
のキャパシタＣ５からなる出力整合回路と、ゲートバイ
アス用の第４の抵抗Ｒ４と、ソース用の第５の抵抗Ｒ５
と、ソースバイパス用の第６のキャパシタＣ６と、出力
直流カット用の第７のキャパシタＣ７とから構成されて
おり、前記整合回路を構成するストリップ線路Ｌ３から
ドレイン電圧ＶＤＯが供給されるようになっている。
そして、前記発振部Ｏの出力は、直流カット用の第８の
キャパシタＣ８を介して前記ＡＭＰ部Ａの入力に接続さ
れている。
キャパシタＣ８を介して前記ＡＭＰ部Ａの入力に接続さ
れている。
上述の回路において、前記ストリップ線路Ｌ１、第３の
キャパシタＣ３及びバラクタダイオード■Ｄ１が、コル
ピッツ型発振回路の共振周波数を定める誘導リアクタン
ス部Ｙである。
キャパシタＣ３及びバラクタダイオード■Ｄ１が、コル
ピッツ型発振回路の共振周波数を定める誘導リアクタン
ス部Ｙである。
したがって、前記バラクタダイオードＶＤ１のカソード
に制御電圧ｖｃｏｎｔを加えると、このバラクタダイオ
ードＶＤ１の容量が制御電圧ｖｃｏｎｔに対応して変化
し、これによりコルピッツ型発振回路の発振周波数が変
化するから、前記ＡＭＰ部Ａの出力部から前記制御電圧
ｖ ｃｏｎｔに対応した周波数を有する出力信号ｆが得
られる。
に制御電圧ｖｃｏｎｔを加えると、このバラクタダイオ
ードＶＤ１の容量が制御電圧ｖｃｏｎｔに対応して変化
し、これによりコルピッツ型発振回路の発振周波数が変
化するから、前記ＡＭＰ部Ａの出力部から前記制御電圧
ｖ ｃｏｎｔに対応した周波数を有する出力信号ｆが得
られる。
第１図は、上述の回路構成を有するＶＣＯをプリント基
板に実装した構成を示す部分断面図である。
板に実装した構成を示す部分断面図である。
第１図において、符号１０の一方の側、すなわち、図中
、上方側には、増幅用トランジスタＱ１と増幅用ＦＥＴ
Ｑ２が取り付けられている。また、前記プリント基板１
０の他方の側、すなわち、図中、下方側には回路バタン
で形成された第１及び第２のストリップ線路Ｌ１及びＬ
ｌ並びにアースバタンＥ１及びＥ２が形成されている。
、上方側には、増幅用トランジスタＱ１と増幅用ＦＥＴ
Ｑ２が取り付けられている。また、前記プリント基板１
０の他方の側、すなわち、図中、下方側には回路バタン
で形成された第１及び第２のストリップ線路Ｌ１及びＬ
ｌ並びにアースバタンＥ１及びＥ２が形成されている。
すなわち、この例では、前記プリント基板１０の図中上
方側にストリップ線路以外の回路素子を形成し、図中下
方側にストリップ線路を形成したものである。
方側にストリップ線路以外の回路素子を形成し、図中下
方側にストリップ線路を形成したものである。
なお、前記プリント基板１０の一方の側に取り付けられ
た回路素子と他方の側に形成されたストリップ線路とは
、第４図に示されるように、スルーホール１３ａ及び１
３ｂによって接続される。
た回路素子と他方の側に形成されたストリップ線路とは
、第４図に示されるように、スルーホール１３ａ及び１
３ｂによって接続される。
上述の一実施例にあっては、前記ＶＣＯを構成する回路
素子のうちストリップ線路を除く回路素子をプリント基
板の一方の側に実装し、前記ストリップ線路を前記プリ
ント基板の他方の側に形成している。すなわち、前記プ
リント基板の前記ストリップ線路が形成される側には他
の回路素子が配置されないから、このストリップ線路の
周囲には空間結合を遮断するに十分なアースバタンを形
成させることができる。空間結合による特性劣化を防止
して良好な高周波特性を得ることができるとともに、回
路設計及び基板設計等も容易になる。
素子のうちストリップ線路を除く回路素子をプリント基
板の一方の側に実装し、前記ストリップ線路を前記プリ
ント基板の他方の側に形成している。すなわち、前記プ
リント基板の前記ストリップ線路が形成される側には他
の回路素子が配置されないから、このストリップ線路の
周囲には空間結合を遮断するに十分なアースバタンを形
成させることができる。空間結合による特性劣化を防止
して良好な高周波特性を得ることができるとともに、回
路設計及び基板設計等も容易になる。
しかも、前記プリント基板の他の回路素子が実装される
側にはストリップ線路を形成する必要がないからその分
実装面積を節約でき、回路素子を実装した状態での外形
寸法を小型化することが可能となる。
側にはストリップ線路を形成する必要がないからその分
実装面積を節約でき、回路素子を実装した状態での外形
寸法を小型化することが可能となる。
［発明の効果°］
以上、詳述したように、本発明は、電圧制御型発振器を
構成する回路素子のうちストリップ線路を除く主な回路
素子をプリント基板の一方の側に実装し、前記ストリッ
プ線路を前記プリント基板の他方の側に形成したもので
、これにより、極めて簡単な構成によってストリップ線
路と他の回路素子との空間結合を遮断して良好な高周波
特性を得ることを可能とするとともに、基板設計等も容
易にし、併せて、回路素子を実装した状態での外形寸法
を小型化することを可能としたものである。
構成する回路素子のうちストリップ線路を除く主な回路
素子をプリント基板の一方の側に実装し、前記ストリッ
プ線路を前記プリント基板の他方の側に形成したもので
、これにより、極めて簡単な構成によってストリップ線
路と他の回路素子との空間結合を遮断して良好な高周波
特性を得ることを可能とするとともに、基板設計等も容
易にし、併せて、回路素子を実装した状態での外形寸法
を小型化することを可能としたものである。
第１図は本発明の一実施例にががる電圧制御型発振器を
プリント基板に実装した構成を示す部分断面図、第２図
は従来の電圧制御型発振器をプリント基板に実装した構
成を示す部分断面図、第３図は本発明の一実施例にがか
る電圧制御型発振器の回路図、第４図は一実施例のプリ
ント基板にスルーホールを形成した構成を示す部分断面
図である。 １．１０・・・プリント基板、２ａ、２ｂ・・・回路素
子、Ｙ・・・誘導リアクタンス部、Ｌｌ、、Ｌｌ、 Ｌ
３． Ｌａ。 Ｌｂ・・・ストリップ線路、ｆ・・・出力信号、ｖ ｃ
ｏｎｔ・・・制御電圧、ＶＤｌ・・・バラクタダイオー
ド。 第１図 従来例のｖｃＯを７°斡ト基板に実装した構成を示す部
分断面図第２図 第４図
プリント基板に実装した構成を示す部分断面図、第２図
は従来の電圧制御型発振器をプリント基板に実装した構
成を示す部分断面図、第３図は本発明の一実施例にがか
る電圧制御型発振器の回路図、第４図は一実施例のプリ
ント基板にスルーホールを形成した構成を示す部分断面
図である。 １．１０・・・プリント基板、２ａ、２ｂ・・・回路素
子、Ｙ・・・誘導リアクタンス部、Ｌｌ、、Ｌｌ、 Ｌ
３． Ｌａ。 Ｌｂ・・・ストリップ線路、ｆ・・・出力信号、ｖ ｃ
ｏｎｔ・・・制御電圧、ＶＤｌ・・・バラクタダイオー
ド。 第１図 従来例のｖｃＯを７°斡ト基板に実装した構成を示す部
分断面図第２図 第４図
Claims (1)
- 【特許請求の範囲】 コルピッツ型発振回路の共振周波数を定める誘導リアク
タンス部の一部を可変容量型ダイオードで構成し、さら
に、前記誘導リアクタンス部の一部及び他のインダクタ
ンス部をストリップ線路で構成し、前記可変容量型ダイ
オードに制御電圧を加えることにより該制御電圧に対応
した周波数の出力信号を取り出すようにした電圧制御型
発振器において、 該電圧制御型発振器を構成する回路素子のうちストリッ
プ線路を除く主な回路素子をプリント基板の一方の側に
実装し、該プリント基板の他方の側に前記ストリップ線
路を形成したことを特徴とする電圧制御型発振器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11736389A JPH02298108A (ja) | 1989-05-12 | 1989-05-12 | 電圧制御型発振器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11736389A JPH02298108A (ja) | 1989-05-12 | 1989-05-12 | 電圧制御型発振器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02298108A true JPH02298108A (ja) | 1990-12-10 |
Family
ID=14709819
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11736389A Pending JPH02298108A (ja) | 1989-05-12 | 1989-05-12 | 電圧制御型発振器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02298108A (ja) |
-
1989
- 1989-05-12 JP JP11736389A patent/JPH02298108A/ja active Pending
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