JPH0230199U - - Google Patents
Info
- Publication number
- JPH0230199U JPH0230199U JP10594688U JP10594688U JPH0230199U JP H0230199 U JPH0230199 U JP H0230199U JP 10594688 U JP10594688 U JP 10594688U JP 10594688 U JP10594688 U JP 10594688U JP H0230199 U JPH0230199 U JP H0230199U
- Authority
- JP
- Japan
- Prior art keywords
- memory
- block
- blocks
- designating
- data
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Static Random-Access Memory (AREA)
Description
第１図は本考案のメモリ制御装置の概要を表わ
したブロツク図、第２図および第３図は本考案の
一実施例を説明するためのもので、そのうち第２
図はＤＲＡＭの大容量メモリを用いたメモリ制御
装置の構成を表わした回路図、第３図はデータ書
き込み時の各信号のタイミングを表わしたタイミ
ング図である。 １……大容量メモリ、３……アドレスチツプイ
ネーブル回路、７……タイミングコントローラ。
したブロツク図、第２図および第３図は本考案の
一実施例を説明するためのもので、そのうち第２
図はＤＲＡＭの大容量メモリを用いたメモリ制御
装置の構成を表わした回路図、第３図はデータ書
き込み時の各信号のタイミングを表わしたタイミ
ング図である。 １……大容量メモリ、３……アドレスチツプイ
ネーブル回路、７……タイミングコントローラ。
Claims (1)
- 【実用新案登録請求の範囲】 複数のブロツクに区分けされたメモリと、 このメモリ内の前記ブロツクを同時に複数指定
するブロツク指定手段と、 このブロツク指定手段によつて指定されたブロ
ツク内のデータを消去するデータ消去手段 とを具備することを特徴とするメモリ制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10594688U JPH0230199U (ja) | 1988-08-12 | 1988-08-12 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10594688U JPH0230199U (ja) | 1988-08-12 | 1988-08-12 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0230199U true JPH0230199U (ja) | 1990-02-26 |
Family
ID=31339017
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10594688U Pending JPH0230199U (ja) | 1988-08-12 | 1988-08-12 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0230199U (ja) |
-
1988
- 1988-08-12 JP JP10594688U patent/JPH0230199U/ja active Pending