JPH0230284A - 復号化装置及び方法 - Google Patents
復号化装置及び方法Info
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- JPH0230284A JPH0230284A JP63179200A JP17920088A JPH0230284A JP H0230284 A JPH0230284 A JP H0230284A JP 63179200 A JP63179200 A JP 63179200A JP 17920088 A JP17920088 A JP 17920088A JP H0230284 A JPH0230284 A JP H0230284A
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- Compression Or Coding Systems Of Tv Signals (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、画像伝送システムにおける受信装置に関する
。
。
画像信号、具体的にはテレビジョン信号の伝送帯域を圧
縮する方法としては、１画像を所定数の画素からなる画
素ブロックに分割し、当該画素ブロックにおいてその画
素データの最大値と最小値の範囲を所定数の区画に分け
、各画素データをその所属する区画を示すコード（以下
、分割値という）に変換する符号化方式が公知である。
縮する方法としては、１画像を所定数の画素からなる画
素ブロックに分割し、当該画素ブロックにおいてその画
素データの最大値と最小値の範囲を所定数の区画に分け
、各画素データをその所属する区画を示すコード（以下
、分割値という）に変換する符号化方式が公知である。
この方式では、各画素ブロック毎に、その最大値、最小
値及びその差（ダイナミック・レンジ）の何れか２つの
データと、各画素に対する分割値データとを伝送するこ
とになる。
値及びその差（ダイナミック・レンジ）の何れか２つの
データと、各画素に対する分割値データとを伝送するこ
とになる。
第２図は、最大値及び最小値により各画素データを正規
化し、上記分割値データを伝送する画像伝送装置の従来
例の概略構成ブロック図を示す。
化し、上記分割値データを伝送する画像伝送装置の従来
例の概略構成ブロック図を示す。
なお、ここで扱う画像データは、１サンプル当たり８ビ
ツトで量子化されているとする。入力端子１０には、通
常の水平走査線の順番でディジタル画像データが入力さ
れ、画素ブロック化回路１２は、１フレーム又は１フイ
ールドの画像を、縦（垂直方向）ｍ″＃Ｉ素、横（水平
方向）ｎ画素からなる画素ブロックに区分し、各画素ブ
ロック毎にその構成画素データを順に出力する。
ツトで量子化されているとする。入力端子１０には、通
常の水平走査線の順番でディジタル画像データが入力さ
れ、画素ブロック化回路１２は、１フレーム又は１フイ
ールドの画像を、縦（垂直方向）ｍ″＃Ｉ素、横（水平
方向）ｎ画素からなる画素ブロックに区分し、各画素ブ
ロック毎にその構成画素データを順に出力する。
最大値検出器１４は各画素ブロック毎のｍ ｘ ｎ個の
画素から最大値を検出し、最小値検出器１６は最小値を
検出する。タイミング調整回路１８は、最大値検出器１
４及び最小値検出器１６における検出作業時間に相当す
る時間だけブロック化回路１２の出力を遅延させ、各画
素ブロック毎に所定の順序で画素データを出力する。分
割値変換回路２０は、最大値検出器１４の最大値と最小
値検出器１６の最小値との間を２に分割した場合のどの
分割区画に各画素データが所属するかを示す分割値（ｋ
ビット）を出力する。ｋは例えば３程度である。
画素から最大値を検出し、最小値検出器１６は最小値を
検出する。タイミング調整回路１８は、最大値検出器１
４及び最小値検出器１６における検出作業時間に相当す
る時間だけブロック化回路１２の出力を遅延させ、各画
素ブロック毎に所定の順序で画素データを出力する。分
割値変換回路２０は、最大値検出器１４の最大値と最小
値検出器１６の最小値との間を２に分割した場合のどの
分割区画に各画素データが所属するかを示す分割値（ｋ
ビット）を出力する。ｋは例えば３程度である。
２２．２４．２６はパラレル・シリアル変換器であり、
パラレル・データをシリアル・データに変換する。スイ
ッチ３０は、タイミング制御回路３２の制御下に、ｂ、
ｃ、ａ接点の順に接続する。
パラレル・データをシリアル・データに変換する。スイ
ッチ３０は、タイミング制御回路３２の制御下に、ｂ、
ｃ、ａ接点の順に接続する。
即ち、スイッチ３０により、各画素ブロックについて、
最大値データ、最小値データ、及び各画素の分割値デー
タがこの順に、ＦＩＦＯ型のバッファ３４に印加される
。バッファ３４は伝送ビット・レートとの調整用に設け
られている。同期付加回路３６はバッファ３６からのデ
ータ列の先頭に同期コードを付加し、出力端子３８から
伝送路や記録媒体に送出する。なおタイミング制御回路
３４は、スイッチ３０以外にも、上記各回路の動作タイ
ミングを統括制御する。
最大値データ、最小値データ、及び各画素の分割値デー
タがこの順に、ＦＩＦＯ型のバッファ３４に印加される
。バッファ３４は伝送ビット・レートとの調整用に設け
られている。同期付加回路３６はバッファ３６からのデ
ータ列の先頭に同期コードを付加し、出力端子３８から
伝送路や記録媒体に送出する。なおタイミング制御回路
３４は、スイッチ３０以外にも、上記各回路の動作タイ
ミングを統括制御する。
ｍ、 ｎが４、ｋが３とした場合には、１画素ブロッ
クのデータ量は１２８ビツト（＝８ビット×１６）であ
るが、この符号化により６４ビツト（＝８＋８＋３ｘ１
６）になり、１／２に圧縮できる。
クのデータ量は１２８ビツト（＝８ビット×１６）であ
るが、この符号化により６４ビツト（＝８＋８＋３ｘ１
６）になり、１／２に圧縮できる。
しかし、この符号化方法では、ダイナミック・レンジで
一旦画素データを正規化し、その正規化データを圧縮符
号化しているので、復号のためには、各画素ブロックに
ついてダイナミック・レンジの情報が必須である。例え
ば、最大値及び最小値のデータが各画素の圧縮コード（
分割値）と共に伝送されるとすると、最大値データ又は
最小値データに何らかの伝送エラーが生じると、その画
素ブロックについては画像データを復元できなくなる。
一旦画素データを正規化し、その正規化データを圧縮符
号化しているので、復号のためには、各画素ブロックに
ついてダイナミック・レンジの情報が必須である。例え
ば、最大値及び最小値のデータが各画素の圧縮コード（
分割値）と共に伝送されるとすると、最大値データ又は
最小値データに何らかの伝送エラーが生じると、その画
素ブロックについては画像データを復元できなくなる。
そこで本発明は、画素ブロック単位で符号化を行う画像
伝送システムにおいて、復号のための基準データが損な
われた場合であっても可能な限り該当画素ブロックの画
像を復元できる受信装置を提示することを目的とする。
伝送システムにおいて、復号のための基準データが損な
われた場合であっても可能な限り該当画素ブロックの画
像を復元できる受信装置を提示することを目的とする。
本発明に係る受信装置は、画像を構成する全画素を、複
数の画素からなる画素ブロックに分割し、画素ブロック
単位で所定の基準値に基づき各画素値を符号化し、当該
基準値及びその符号化画素データを伝送する画像伝送シ
ステムにおいて、受信した基準値に従い受信した符号化
画素データを復号して画像を復元する受信装置であって
、受信した基準値が所定規則に従い適正か否かを判定す
る判定手段と、当該判定手段により不適正と判定された
画素ブロック内の画素については当該画素と相関性の高
い画素のデータを用いて得た補間画素データで代替する
代替手段とを具備することを特徴とする。
数の画素からなる画素ブロックに分割し、画素ブロック
単位で所定の基準値に基づき各画素値を符号化し、当該
基準値及びその符号化画素データを伝送する画像伝送シ
ステムにおいて、受信した基準値に従い受信した符号化
画素データを復号して画像を復元する受信装置であって
、受信した基準値が所定規則に従い適正か否かを判定す
る判定手段と、当該判定手段により不適正と判定された
画素ブロック内の画素については当該画素と相関性の高
い画素のデータを用いて得た補間画素データで代替する
代替手段とを具備することを特徴とする。
上記判定手段により、復号に必要な基準値にエラーがあ
るか否かを知ることができる。また、基準値にエラーが
生じ、復元不能となった画素のデータについては、相関
性の強い画素を適切に選択すれば、充分に類似したデー
タが得られる。従って、基準値にエラーのあった画素ブ
ロック内の画素についてはこの相関性の強い画素を用い
て得た補間画素で代替することにより、当該画素ブロッ
クの部分について画質が著しく劣化するのを防止できる
。
るか否かを知ることができる。また、基準値にエラーが
生じ、復元不能となった画素のデータについては、相関
性の強い画素を適切に選択すれば、充分に類似したデー
タが得られる。従って、基準値にエラーのあった画素ブ
ロック内の画素についてはこの相関性の強い画素を用い
て得た補間画素で代替することにより、当該画素ブロッ
クの部分について画質が著しく劣化するのを防止できる
。
〔実施例〕
以下、図面を参照して本発明の一実施例を説明する。第
１図は、本発明の一実施例の構成ブロック図であって、
機能的には、第１図の送信装置に対応する受信装置であ
る。なお、ここでは常に、最大値データが最小値データ
に先行して入力するように約束されているものとする。
１図は、本発明の一実施例の構成ブロック図であって、
機能的には、第１図の送信装置に対応する受信装置であ
る。なお、ここでは常に、最大値データが最小値データ
に先行して入力するように約束されているものとする。
第１図において、入力端子４０には第２図の出力端子３
８から出力されるコード列が伝送路を介して入力される
。入力端子４０のコード列は、スイッチ４２及び同期分
離回路４４に印加され、同期分離回路４４は同期コード
を分離してタイミング制御回路４６に印加する。タイミ
ング制御回路４６は、同期コードに基づき、スイッチ４
２の切換を含んで各図示回路の動作タイングを制御する
。
８から出力されるコード列が伝送路を介して入力される
。入力端子４０のコード列は、スイッチ４２及び同期分
離回路４４に印加され、同期分離回路４４は同期コード
を分離してタイミング制御回路４６に印加する。タイミ
ング制御回路４６は、同期コードに基づき、スイッチ４
２の切換を含んで各図示回路の動作タイングを制御する
。
スイッチ４２の切換により、最大値ＭＡＸ及び最小値Ｍ
ＩＮはａ接点からシリアル・パラレル（Ｓ／Ｐ）変換器
４８に、分割値コードはｂ接点からＳ／Ｐ変換器５０に
印加される。Ｓ／Ｐ変換器４８の出力の内、最初のコー
ド（エラーが無ければ、最大値ＭＡＸ）は最大値ラッチ
回路、５２にラッチされ、その次のコード（エラーが無
ければ、最小値旧Ｎ）は最小値ラッチ回路５４にラッチ
される。ラッチ回路５２．５４は次の画素プロ・ツクの
最大値、最小値が入力されるまで、それぞれ最大値、最
小値を保持する。
ＩＮはａ接点からシリアル・パラレル（Ｓ／Ｐ）変換器
４８に、分割値コードはｂ接点からＳ／Ｐ変換器５０に
印加される。Ｓ／Ｐ変換器４８の出力の内、最初のコー
ド（エラーが無ければ、最大値ＭＡＸ）は最大値ラッチ
回路、５２にラッチされ、その次のコード（エラーが無
ければ、最小値旧Ｎ）は最小値ラッチ回路５４にラッチ
される。ラッチ回路５２．５４は次の画素プロ・ツクの
最大値、最小値が入力されるまで、それぞれ最大値、最
小値を保持する。
分割値逆変換回路５６は、ラッチ回路５２．５４にラッ
チされた最大値及び最小値を参照して、Ｓ／Ｐ変換器５
０の出力（分割値データ）を各分割領域の代表値に変換
して出力する。スキャン・コンバータ５８は、分割値逆
変換回路５６の画素ブロック単位の出力を、ラスター・
スキャンに変換する。
チされた最大値及び最小値を参照して、Ｓ／Ｐ変換器５
０の出力（分割値データ）を各分割領域の代表値に変換
して出力する。スキャン・コンバータ５８は、分割値逆
変換回路５６の画素ブロック単位の出力を、ラスター・
スキャンに変換する。
判定回路６０は、最大値ラッチ回路５２の出力が最小値
ラッチ回路の出力より大きいかどうかを調べる。即ち、
最大値ラッチ回路５２の出力が最小値ランチ回路の出力
より小さい場合には、最大値又は最小値に伝送エラーが
あったものと推測できる。判定回路５６による判定信号
は、タイミング調整回路６２により時間調整された後、
スキャン・コンバータ６４に印加される。スキャン・コ
ンバータ６４は、判定信号を、該当する画素ブロックに
含まれる画素データの、ラスター・スキャンにおける画
面位置を示す信号に変換する。そして、スキャン・コン
バータ６４は、エラーの無い画素ブロックの画素につい
ては、スイッチ６６をａ接点に接続し、エラーのあった
画素ブロックの画素についてはｂ接点に接続する。
ラッチ回路の出力より大きいかどうかを調べる。即ち、
最大値ラッチ回路５２の出力が最小値ランチ回路の出力
より小さい場合には、最大値又は最小値に伝送エラーが
あったものと推測できる。判定回路５６による判定信号
は、タイミング調整回路６２により時間調整された後、
スキャン・コンバータ６４に印加される。スキャン・コ
ンバータ６４は、判定信号を、該当する画素ブロックに
含まれる画素データの、ラスター・スキャンにおける画
面位置を示す信号に変換する。そして、スキャン・コン
バータ６４は、エラーの無い画素ブロックの画素につい
ては、スイッチ６６をａ接点に接続し、エラーのあった
画素ブロックの画素についてはｂ接点に接続する。
即チ、スイッチ６６は、エラーがあった画素ブロックの
画素については、フレーム・メモリの直前画面（又は、
更に以前）の画像信号で代替する。
画素については、フレーム・メモリの直前画面（又は、
更に以前）の画像信号で代替する。
従って、出力端子７０からは、エラーのない場合には、
受信データからの復元画像の信号が得られ、エラーがあ
る場合には、１フレーム前の画像で修整・補完された画
像信号が得られる。スイッチ６６の出力はフレーム・メ
モリ６８に入力され、これによりフレーム・メモリの記
憶画像が更新される。
受信データからの復元画像の信号が得られ、エラーがあ
る場合には、１フレーム前の画像で修整・補完された画
像信号が得られる。スイッチ６６の出力はフレーム・メ
モリ６８に入力され、これによりフレーム・メモリの記
憶画像が更新される。
本実施例では、ダイナミック・レンジ情報として最大値
及び最小値データを伝送する場合を例にとったが、本発
明はこれに限定されない。また、分割値変換の後にベク
トル量子化を行い伝送方式や、その他の伝送方式の場合
であっても、何らかの規則性の下で、伝送エラーを確認
できる伝送方式に対しては、その規則との整合性を調べ
ることにより、エラーの有無を画一的に判定できるので
、この判定結果に従い前画面を代替使用することができ
る。なお、相関性の強い画素として上記実′施例では、
前画面の画素を選択し、この画素のデータをそのまま補
間データとしたが、後の画面の画素や隣接する画素ブロ
ックの画素を用いて補間画素データを求めてもよい。
及び最小値データを伝送する場合を例にとったが、本発
明はこれに限定されない。また、分割値変換の後にベク
トル量子化を行い伝送方式や、その他の伝送方式の場合
であっても、何らかの規則性の下で、伝送エラーを確認
できる伝送方式に対しては、その規則との整合性を調べ
ることにより、エラーの有無を画一的に判定できるので
、この判定結果に従い前画面を代替使用することができ
る。なお、相関性の強い画素として上記実′施例では、
前画面の画素を選択し、この画素のデータをそのまま補
間データとしたが、後の画面の画素や隣接する画素ブロ
ックの画素を用いて補間画素データを求めてもよい。
以上の説明から容易に理解できるように、本発明によれ
ば、復号のための基準値にエラーが生じた場合には、こ
れを誤り訂正符号などの冗長データを付加することなく
検出でき、そのエラ一部分の画素ブロック内の画素を相
関性の高い画素から得た補間画素データで代替するので
、それだけ伝送エラーに強くなり、伝送エラーによる画
質劣化を軽減できる。
ば、復号のための基準値にエラーが生じた場合には、こ
れを誤り訂正符号などの冗長データを付加することなく
検出でき、そのエラ一部分の画素ブロック内の画素を相
関性の高い画素から得た補間画素データで代替するので
、それだけ伝送エラーに強くなり、伝送エラーによる画
質劣化を軽減できる。
第１図は本発明の一実施例の構成ブロック図、第２図は
画像送信装置の構成ブロック図である。 ４０・−・入力端子 ４４−同期分離回路 ４６・−・
りィミング制御回路 ５２−最大値ラッチ回路 ５４．
−０．最小値ラッチ回路 ５６〜・分割値逆変換回路５
８．６４−・−・スキャン・コンバータ ６〇−判定回
路６Ｌ−・フレーム・メモリ ７０−・−出力端子
画像送信装置の構成ブロック図である。 ４０・−・入力端子 ４４−同期分離回路 ４６・−・
りィミング制御回路 ５２−最大値ラッチ回路 ５４．
−０．最小値ラッチ回路 ５６〜・分割値逆変換回路５
８．６４−・−・スキャン・コンバータ ６〇−判定回
路６Ｌ−・フレーム・メモリ ７０−・−出力端子
Claims (1)
- 画像を構成する全画素を、複数の画素からなる画素ブロ
ックに分割し、画素ブロック単位で所定の基準値に基づ
き各画素値を符号化し、当該基準値及びその符号化画素
データを伝送する画像伝送システムにおいて、受信した
基準値に従い受信した符号化画素データを復号して画像
を復元する受信装置であって、受信した基準値が所定規
則に従い適正か否かを判定する判定手段と、当該判定手
段により不適正と判定された画素ブロック内の画素につ
いては当該画素と相関性の高い画素のデータを用いて得
た補間画素データで代替する代替手段とを具備すること
を特徴とする受信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17920088A JP2952875B2 (ja) | 1988-07-20 | 1988-07-20 | 復号化装置及び方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17920088A JP2952875B2 (ja) | 1988-07-20 | 1988-07-20 | 復号化装置及び方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0230284A true JPH0230284A (ja) | 1990-01-31 |
| JP2952875B2 JP2952875B2 (ja) | 1999-09-27 |
Family
ID=16061678
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17920088A Expired - Fee Related JP2952875B2 (ja) | 1988-07-20 | 1988-07-20 | 復号化装置及び方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2952875B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0479689A (ja) * | 1990-07-20 | 1992-03-13 | Matsushita Electric Ind Co Ltd | 画像の誤り修正方法 |
| US6304990B1 (en) | 1990-12-28 | 2001-10-16 | Canon Kabushiki Kaisha | Error correction and concealment technique |
| US7202580B2 (en) | 2003-05-16 | 2007-04-10 | Kabushiki Kaisha Toshiba | Permanent magnet type motor and x-ray computed tomography apparatus |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54148316A (en) * | 1978-05-12 | 1979-11-20 | Nec Corp | Decoding device for television signals |
| JPS6395791A (ja) * | 1986-10-09 | 1988-04-26 | Sony Corp | ディジタル画像信号の符号化装置及び符号化方法 |
-
1988
- 1988-07-20 JP JP17920088A patent/JP2952875B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54148316A (en) * | 1978-05-12 | 1979-11-20 | Nec Corp | Decoding device for television signals |
| JPS6395791A (ja) * | 1986-10-09 | 1988-04-26 | Sony Corp | ディジタル画像信号の符号化装置及び符号化方法 |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0479689A (ja) * | 1990-07-20 | 1992-03-13 | Matsushita Electric Ind Co Ltd | 画像の誤り修正方法 |
| US6304990B1 (en) | 1990-12-28 | 2001-10-16 | Canon Kabushiki Kaisha | Error correction and concealment technique |
| US7202580B2 (en) | 2003-05-16 | 2007-04-10 | Kabushiki Kaisha Toshiba | Permanent magnet type motor and x-ray computed tomography apparatus |
| US7406149B2 (en) | 2003-05-16 | 2008-07-29 | Kabushiki Kaisha Toshiba | Permanent magnet type motor and X-ray computed tomography apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2952875B2 (ja) | 1999-09-27 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |