JPH025627A - 符号化変復調回路 - Google Patents
符号化変復調回路Info
- Publication number
- JPH025627A JPH025627A JP63154923A JP15492388A JPH025627A JP H025627 A JPH025627 A JP H025627A JP 63154923 A JP63154923 A JP 63154923A JP 15492388 A JP15492388 A JP 15492388A JP H025627 A JPH025627 A JP H025627A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- coding
- speed
- signals
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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Landscapes
- Detection And Prevention Of Errors In Transmission (AREA)
- Error Detection And Correction (AREA)
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は符号化変復調回路に関するものである。
（従来の技術）
従来、符号化変調方式ではｍビット（ｍ−１、２。
−）の入力は畳み込み符号回路によりｎビットの（ｎ＝
１．２．−−−）の冗長ビットが付加されて（ｍ＋ｎ
）ビットに増加し、符号速度を変えずに２０＋ＩＩＩの
多値数の変調方式′を用いていた（Ｇ、Ｕｎｇｅｒｂｏ
ｅｃｋ。
１．２．−−−）の冗長ビットが付加されて（ｍ＋ｎ
）ビットに増加し、符号速度を変えずに２０＋ＩＩＩの
多値数の変調方式′を用いていた（Ｇ、Ｕｎｇｅｒｂｏ
ｅｃｋ。
“Ｔｒｅｌｌｉｓ−Ｃｏｄｅｄ Ｍｏｄｕｌａｔｉｏ
ｎ ｗｉｔｈ Ｒｅｄｕｎｄａｎｔ。
ｎ ｗｉｔｈ Ｒｅｄｕｎｄａｎｔ。
Ｓｉｇｎａｌ ５ｅｔｓ 、ＩＥＥＥ Ｃ：ｏｍ、Ｍ
ａｇ、Ｆｅｂ、１９８７ ｐｐ５−２１）。この従来の
符号化変調のブロック図を第３図に示す。この図で、１
は符号化回路、２は信号空間への配置回路、３は変調回
路、４は復調回路、５は復号回路、６はクロック再生回
路である。符号化変調方式は誤り訂正と変復調技術を融
合することにより信号空間上のユークリッド距離が最大
になるようにシンボル単位で符号化することにより、従
来のハミング距離が最大になるように信号毎に符号化す
る誤り訂正よりも大きな符号化利得を得ることができる
。
ａｇ、Ｆｅｂ、１９８７ ｐｐ５−２１）。この従来の
符号化変調のブロック図を第３図に示す。この図で、１
は符号化回路、２は信号空間への配置回路、３は変調回
路、４は復調回路、５は復号回路、６はクロック再生回
路である。符号化変調方式は誤り訂正と変復調技術を融
合することにより信号空間上のユークリッド距離が最大
になるようにシンボル単位で符号化することにより、従
来のハミング距離が最大になるように信号毎に符号化す
る誤り訂正よりも大きな符号化利得を得ることができる
。
（発明が解決しようとする課題）
しかし第４図の信号空間を示したｍ＝４．ｎ＝１の例の
ように、１６ＱＡＭから、符号化３２ＱＡＭに多値数が
増加し、信号点間隔が約１／２になり所要Ｃ／Ｈの３ｄ
Ｂ程度の劣化につながり、符号化利得が大幅に減少して
いた。また、多値数の増加にともない高精度のハードウ
ェアが要求され実現が困難になるという欠点もある。
ように、１６ＱＡＭから、符号化３２ＱＡＭに多値数が
増加し、信号点間隔が約１／２になり所要Ｃ／Ｈの３ｄ
Ｂ程度の劣化につながり、符号化利得が大幅に減少して
いた。また、多値数の増加にともない高精度のハードウ
ェアが要求され実現が困難になるという欠点もある。
本発明の目的は、上述の多値数の増加にともなう符号化
利得の減少、ハードウェア実現の困難を解決し、大きな
符号化利得を得る符号化変復調回路を提供することにあ
る。
利得の減少、ハードウェア実現の困難を解決し、大きな
符号化利得を得る符号化変復調回路を提供することにあ
る。
（課題を解決するための手段）
前記目的を達成するための本発明の特徴は、符号語間の
信号空間上でのユークリッド距離が最大になるようにシ
ンボル単位で符号化する符号化変復調において、送信側
に、（ｍ＋ｎ）ビット系列（ｍ、ｎｉ、２．−一−−）
で符号速度１／Ｔの信号を久方とじ、ｍビット系列で符
号速度１／Ｔ’（Ｔ’（ｍ／ （ｍ＋ｎ） ）・Ｔ）の
高速化された信号を出力とするスピード変換回路と、ｍ
ビット系列の該スピード変換回路の出力をクロック速度
１／Ｔ′で符号化された（ｍ＋ｎ）ビット系列の信号を
出力する符号回路と、該符号回路の出力を符号語間の信
号空間上でのユークリッド距離が最大となるように配置
する回路を具備し、受信側に、送信側からの（ｍ＋ｎ）
ビット系列の信号を入力してクロック速度１／Ｔ′で動
作しｍビット系列の復号信号を出力する復号回路と、該
復号出力である符号速度Ｔ′のｍビット信号系列を符号
速度１／Ｔの（ｍ＋ｎ）ビット信号系列へ変換するスピ
ード変換回路を具備する符号化変復調回路にある。
信号空間上でのユークリッド距離が最大になるようにシ
ンボル単位で符号化する符号化変復調において、送信側
に、（ｍ＋ｎ）ビット系列（ｍ、ｎｉ、２．−一−−）
で符号速度１／Ｔの信号を久方とじ、ｍビット系列で符
号速度１／Ｔ’（Ｔ’（ｍ／ （ｍ＋ｎ） ）・Ｔ）の
高速化された信号を出力とするスピード変換回路と、ｍ
ビット系列の該スピード変換回路の出力をクロック速度
１／Ｔ′で符号化された（ｍ＋ｎ）ビット系列の信号を
出力する符号回路と、該符号回路の出力を符号語間の信
号空間上でのユークリッド距離が最大となるように配置
する回路を具備し、受信側に、送信側からの（ｍ＋ｎ）
ビット系列の信号を入力してクロック速度１／Ｔ′で動
作しｍビット系列の復号信号を出力する復号回路と、該
復号出力である符号速度Ｔ′のｍビット信号系列を符号
速度１／Ｔの（ｍ＋ｎ）ビット信号系列へ変換するスピ
ード変換回路を具備する符号化変復調回路にある。
（作用）
本発明は、変復調器の多値数を増大せずに符号化変調を
行なうことで大きな符号化利得を得ることを特徴とする
。符号化変調において、符号化を行なうことにより付加
される冗長ビットによる必要伝送速度の増加を、伝送の
クロック速度を上げることによって補う。従来技術では
これを多値数の増加によって補っていた。このとき信号
点間隔が挟まり所要Ｃ／Ｎ値が増大する。本発明による
と帯域幅が拡大するが、それによる所要Ｃ／Ｎ値の劣化
はごくわずかであり、多値数を上げることによって劣化
する量より小さく結果として大きな符号化利得を得るも
のである。
行なうことで大きな符号化利得を得ることを特徴とする
。符号化変調において、符号化を行なうことにより付加
される冗長ビットによる必要伝送速度の増加を、伝送の
クロック速度を上げることによって補う。従来技術では
これを多値数の増加によって補っていた。このとき信号
点間隔が挟まり所要Ｃ／Ｎ値が増大する。本発明による
と帯域幅が拡大するが、それによる所要Ｃ／Ｎ値の劣化
はごくわずかであり、多値数を上げることによって劣化
する量より小さく結果として大きな符号化利得を得るも
のである。
（実施例）
第１図は本発明の実施例であって１はスピード変換回路
、２は符号化回路、３は信号空間への配置回路、４は変
調回路、５は復調回路、６は復号回路、７はスピード変
換回路、８．９はスピード変換にともない必要になるク
ロック速度変換回路、１０はクロック再生回路である。
、２は符号化回路、３は信号空間への配置回路、４は変
調回路、５は復調回路、６は復号回路、７はスピード変
換回路、８．９はスピード変換にともない必要になるク
ロック速度変換回路、１０はクロック再生回路である。
例えばこの実施例において２５６ＱＡＭの変調回路を用
いてｍ＝７．ｎ＝１としたとき、同図中のＴとＴ′はＴ
’ ＝７／８Ｔの関係がある。符号器に畳み込み符号器
、復号器にビタビ復号器を用いるときの例を考える。ま
ず、送信側において８ビツト／Ｔを７ビツト／Ｔ’ に
スピード変換する（Ｔ’・ＩＩｌ／ （ｍ＋ｎ）・Ｔ）
。この信号系列は畳み込み符号回路により、冗長ビット
が付加され８ビツト／Ｔ’の出力になる。この後２５６
ＱＡＭの信号空間へユークリッド距離と符号の関係を考
慮した５ｅｔ−Ｐａｒｊｉｔｉｏｎとよばれる最適配置
回路を通り、変調される。尚、５ｅｔ−Ｐａｒｔｉｔｉ
ｏｎは文献ｒＧ。
いてｍ＝７．ｎ＝１としたとき、同図中のＴとＴ′はＴ
’ ＝７／８Ｔの関係がある。符号器に畳み込み符号器
、復号器にビタビ復号器を用いるときの例を考える。ま
ず、送信側において８ビツト／Ｔを７ビツト／Ｔ’ に
スピード変換する（Ｔ’・ＩＩｌ／ （ｍ＋ｎ）・Ｔ）
。この信号系列は畳み込み符号回路により、冗長ビット
が付加され８ビツト／Ｔ’の出力になる。この後２５６
ＱＡＭの信号空間へユークリッド距離と符号の関係を考
慮した５ｅｔ−Ｐａｒｊｉｔｉｏｎとよばれる最適配置
回路を通り、変調される。尚、５ｅｔ−Ｐａｒｔｉｔｉ
ｏｎは文献ｒＧ。
Ｕｎｇ、ｅｒｂｏｅｃｋ、 ”にｈａｎｎｅｌ （１
：ｏｄｉｎｇ ｗｉｔｈ Ｍｕｌｔｉｌｅｖｅｌ／Ｐｈ
ａｓｅ Ｓｉｇｎａｌｓ″、ｒＥＥＥ ＩＴ、Ｊａｎ、
１９８２１）Ｐ５５−６７Ｊによる。受信側では、復調
回路の出力をビタビ復号回路を通し、７ビツト／Ｔ’の
信号系列を得る。
：ｏｄｉｎｇ ｗｉｔｈ Ｍｕｌｔｉｌｅｖｅｌ／Ｐｈ
ａｓｅ Ｓｉｇｎａｌｓ″、ｒＥＥＥ ＩＴ、Ｊａｎ、
１９８２１）Ｐ５５−６７Ｊによる。受信側では、復調
回路の出力をビタビ復号回路を通し、７ビツト／Ｔ’の
信号系列を得る。
これをスピード変換回路を通し８ビツト／Ｔの復調信号
系列を得る。このようにこの実施例では８ビツト／Ｔの
信号系列に符号化を施しても２５６ＱＡ閘変調を用いて
伝送できる。また第１図の破線で示す部分はスピード変
換回路と符号化変調回路及び、スピード変換回路と符号
化復調回路であり、これらはそれぞれ一体化が可能であ
る。
系列を得る。このようにこの実施例では８ビツト／Ｔの
信号系列に符号化を施しても２５６ＱＡ閘変調を用いて
伝送できる。また第１図の破線で示す部分はスピード変
換回路と符号化変調回路及び、スピード変換回路と符号
化復調回路であり、これらはそれぞれ一体化が可能であ
る。
（発明の効果）
以上説明したように本発明により変復調の多値数を増大
させずに符号化変復調が行なえるので、信号点間の距離
が減少しない。これはｎ＝１のとき３ｄＢの利得に相当
し、帯域拡大による劣化を考えても従来の符号化変調よ
り大きな符号化利得を得ることができる。またハードウ
ェアの実現も容易になる。
させずに符号化変復調が行なえるので、信号点間の距離
が減少しない。これはｎ＝１のとき３ｄＢの利得に相当
し、帯域拡大による劣化を考えても従来の符号化変調よ
り大きな符号化利得を得ることができる。またハードウ
ェアの実現も容易になる。
本発明の有効性を確認するために計算機シミュレーショ
ンの結果を第２図に示す。これは実施例のシミュレーシ
ョンの結果である。この図で符号化５１２ＱＡＭは従来
の技術によるものであり、本発明による符号化変調（符
号化２５６ＱＡＭ）では従来のものより２．４ｄＢ大き
な利得がある。こわは多値数が増大しないことによる３
ｄＢから帯域拡大による劣化０．６ｄＢを引いた値であ
る。この０．６ｄＢはクロックが８／７倍になり帯域も
８／７倍になることにより求まる劣化量である。なお、
第２図の実線は符号化をしないときの理論値である。又
、従来の５１２ＱＡＭと本発明の２５６ＱＡＭとは伝送
容量が同じである。
ンの結果を第２図に示す。これは実施例のシミュレーシ
ョンの結果である。この図で符号化５１２ＱＡＭは従来
の技術によるものであり、本発明による符号化変調（符
号化２５６ＱＡＭ）では従来のものより２．４ｄＢ大き
な利得がある。こわは多値数が増大しないことによる３
ｄＢから帯域拡大による劣化０．６ｄＢを引いた値であ
る。この０．６ｄＢはクロックが８／７倍になり帯域も
８／７倍になることにより求まる劣化量である。なお、
第２図の実線は符号化をしないときの理論値である。又
、従来の５１２ＱＡＭと本発明の２５６ＱＡＭとは伝送
容量が同じである。
第１図は本発明の実施例の符号化変調のブロック図であ
り本発明の特徴を最もよく表している。 第２図は本発明による効果を表すビット誤り率を従来の
ビット誤り率と共に示す図である。第３図は従来の符号
化変調のブロック図、第４図は従来の符号化変調を施し
たときに信号点の間隔が減少することを示した図で＋６
ＱＡＭと３２ＱＡＭの平均電力は同じである。 １；スピード変換回路、 ２：符号化回路、 ３；信号空間への配置回路、 ４：変調回路、 ５；復調回路、 ６；復号回路、 ７；スピード変換回路、 ８．９；クロック速度変換回路、 １０；クロック再生回路。 ．１０ ＮＲ 〔ｄＢ） 尾３凹 ビ、Ｆ誤１）Ｖ持・注 本２ｔ２１ ／＆ＱＡＭ 奇号１ヒ３２０ＡＭ 符号仕残より儂号龜嬰陥鼾へヤ も４図
り本発明の特徴を最もよく表している。 第２図は本発明による効果を表すビット誤り率を従来の
ビット誤り率と共に示す図である。第３図は従来の符号
化変調のブロック図、第４図は従来の符号化変調を施し
たときに信号点の間隔が減少することを示した図で＋６
ＱＡＭと３２ＱＡＭの平均電力は同じである。 １；スピード変換回路、 ２：符号化回路、 ３；信号空間への配置回路、 ４：変調回路、 ５；復調回路、 ６；復号回路、 ７；スピード変換回路、 ８．９；クロック速度変換回路、 １０；クロック再生回路。 ．１０ ＮＲ 〔ｄＢ） 尾３凹 ビ、Ｆ誤１）Ｖ持・注 本２ｔ２１ ／＆ＱＡＭ 奇号１ヒ３２０ＡＭ 符号仕残より儂号龜嬰陥鼾へヤ も４図
Claims (1)
- 【特許請求の範囲】 符号語間の信号空間上でのユークリッド距離が最大にな
るようにシンボル単位で符号化する符号化変復調回路に
おいて、 送信側に、（ｍ＋ｎ）ビット系列（ｍ、ｎ＝１、２、・
・・・）で符号速度１／Ｔの信号を入力とし、ｍビット
系列で符号速度１／Ｔ′（Ｔ′＝（ｍ／（ｍ＋ｎ））・
Ｔ）の高速化された信号を出力とするスピード変換回路
と、ｍビット系列の該スピード変換回路の出力をクロッ
ク速度１／Ｔ′で符号化された（ｍ＋ｎ）ビット系列の
信号を出力する符号回路と、該符号回路の出力を符号語
間の信号空間上でのユークリッド距離が最大となるよう
に配置する回路を具備し、 受信側に、送信側からの（ｍ＋ｎ）ビット系列の信号を
入力してクロック速度１／Ｔ′で動作しｍビット系列の
復号信号を出力する復号回路と、該復号出力である符号
速度Ｔ′のｍビット信号系列を符号速度１／Ｔの（ｍ＋
ｎ）ビット信号系列へ変換するスピード変換回路を具備
することを特徴とする符号化変復調回路。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63154923A JP2518355B2 (ja) | 1988-06-24 | 1988-06-24 | 符号化変復調回路 |
| US07/357,573 US4993046A (en) | 1988-06-24 | 1989-05-26 | Coded modulation communication system |
| EP89401793A EP0348305B1 (en) | 1988-06-24 | 1989-06-23 | Coded modulation communication system |
| DE68918010T DE68918010T2 (de) | 1988-06-24 | 1989-06-23 | Kodiertes Modulationsübertragungssystem. |
| CA000603849A CA1297159C (en) | 1988-06-24 | 1989-06-23 | Coded modulation communication system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63154923A JP2518355B2 (ja) | 1988-06-24 | 1988-06-24 | 符号化変復調回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH025627A true JPH025627A (ja) | 1990-01-10 |
| JP2518355B2 JP2518355B2 (ja) | 1996-07-24 |
Family
ID=15594904
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63154923A Expired - Fee Related JP2518355B2 (ja) | 1988-06-24 | 1988-06-24 | 符号化変復調回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2518355B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07288479A (ja) * | 1994-04-18 | 1995-10-31 | Nec Corp | 誤り訂正連接符号化方法及び装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6339240A (ja) * | 1986-08-05 | 1988-02-19 | Fujitsu Ltd | 符号化変調回路 |
| JPS6339239A (ja) * | 1986-08-05 | 1988-02-19 | Fujitsu Ltd | 符号化変復調回路 |
-
1988
- 1988-06-24 JP JP63154923A patent/JP2518355B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6339240A (ja) * | 1986-08-05 | 1988-02-19 | Fujitsu Ltd | 符号化変調回路 |
| JPS6339239A (ja) * | 1986-08-05 | 1988-02-19 | Fujitsu Ltd | 符号化変復調回路 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07288479A (ja) * | 1994-04-18 | 1995-10-31 | Nec Corp | 誤り訂正連接符号化方法及び装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2518355B2 (ja) | 1996-07-24 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |