JPH0280855U - - Google Patents

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JPH0280855U
JPH0280855U JP15850988U JP15850988U JPH0280855U JP H0280855 U JPH0280855 U JP H0280855U JP 15850988 U JP15850988 U JP 15850988U JP 15850988 U JP15850988 U JP 15850988U JP H0280855 U JPH0280855 U JP H0280855U
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JP
Japan
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control
central processing
ram
control data
control device
Prior art date
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JP15850988U
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【図面の簡単な説明】
第１図は、本考案の一実施例の構成を示す図、
第２図は、同上実施例のエンジン制御用ＣＰＵの
作動ルーチンを示すフローチヤート、第３図は、
同じくトルコン制御用ＣＰＵの作動ルーチンを示
すフローチヤート、第４図は同じくＲＡＭの記憶
領域を示す図である。 １……エンジン制御用ＣＰＵ、２……ＲＡＭ、
３……トルコン制御用ＣＰＵ、Ａ，Ｂ……領域。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の制御装置の中央処理装置間で共通のＲＡ
    Ｍを介して制御データを相互に通信させるように
    した制御装置の相互通信処理装置において、前記
    各中央処理装置からの制御データが、夫々ＲＡＭ
    の異なる領域に書き込まれるように、ＲＡＭの記
    憶領域を区分すると共に、各中央処理装置からＲ
    ＡＭに記憶された制御データの読み出しはＲＡＭ
    の全記憶領域から可能であるように設定したこと
    を特徴とする制御装置の相互通信装置。
JP15850988U 1988-12-07 1988-12-07 Pending JPH0280855U (ja)

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JP15850988U JPH0280855U (ja) 1988-12-07 1988-12-07

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JP15850988U JPH0280855U (ja) 1988-12-07 1988-12-07

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JPH0280855U true JPH0280855U (ja) 1990-06-21

Family

ID=31438903

Family Applications (1)

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JP15850988U Pending JPH0280855U (ja) 1988-12-07 1988-12-07

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