JPH0288A - 平板表示装置の駆動方法 - Google Patents
平板表示装置の駆動方法Info
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- JPH0288A JPH0288A JP63271299A JP27129988A JPH0288A JP H0288 A JPH0288 A JP H0288A JP 63271299 A JP63271299 A JP 63271299A JP 27129988 A JP27129988 A JP 27129988A JP H0288 A JPH0288 A JP H0288A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野］
本発明は、平板表示装置及びその駆動方法に係わり、特
に液晶表示装置の画質改善に有効な駆動方法に関する。
に液晶表示装置の画質改善に有効な駆動方法に関する。
従来の平板表示装置は、特開昭５３−３８９３５号、特
開昭５８−５２６８６号に示される様に駆動回路を透明
電極の片端に接続し、表示パネルを駆動するものであっ
た。
開昭５８−５２６８６号に示される様に駆動回路を透明
電極の片端に接続し、表示パネルを駆動するものであっ
た。
しかし、前述の従来技術では、ドツトマトリクス液晶パ
ネルが大容量化するにつれて、透明電極の幅が狭くなる
一方、長さは長くなる方向にあるので、駆動回路出力端
から電極先端までの電極抵抗Ｒとキャパシタ容量Ｃが大
きくなり、画質を低下させる大きな要因となっていた。
ネルが大容量化するにつれて、透明電極の幅が狭くなる
一方、長さは長くなる方向にあるので、駆動回路出力端
から電極先端までの電極抵抗Ｒとキャパシタ容量Ｃが大
きくなり、画質を低下させる大きな要因となっていた。
すなわち６４０Ｘ４００ドツト、１／２００デユーテイ
の液晶パネルでは、およそＲ＝１０〜６０にΩ１ Ｃ＝
８００〜２０００ｐＦである。このため駆動波形が変化
してから安定するまでの各画素の遅延時間は、数μｓか
ら数１０μｓに達し、液晶の−走査時間６０〜８０μＳ
に対して無視できない水準にあった。これが各画素に加
わる実効駆動電圧を電圧平均化法で与えられる理想値か
らずらし、第２図に示すような非点灯領域の濃淡ムラを
発生させ、表示内容によっては点灯画素と非点灯画素の
識別が困難になるほど画質を低下させていた。第２図で
は、横線を１ラインおきに交互に点灯したとき、非点灯
ｅＪｆＭ１１．１２の濃淡に差が出る一例を示したもの
である。１１の上方に示したように交互点灯を横に長く
すると１１のように淡い表示となり、１２の上方に示し
たように交互点灯領域を横に短くすると１２のように濃
い表示となる例である。このような濃淡の差は主に走査
電極の抵抗が高い場合に顕在化しやすい現象である。こ
れに対し、透明電極抵抗を下げるために電極薄膜の厚み
を増すと配向不良や生産上のスループットの低下による
パネルコスト高を誘発し、これにも限界があった。
の液晶パネルでは、およそＲ＝１０〜６０にΩ１ Ｃ＝
８００〜２０００ｐＦである。このため駆動波形が変化
してから安定するまでの各画素の遅延時間は、数μｓか
ら数１０μｓに達し、液晶の−走査時間６０〜８０μＳ
に対して無視できない水準にあった。これが各画素に加
わる実効駆動電圧を電圧平均化法で与えられる理想値か
らずらし、第２図に示すような非点灯領域の濃淡ムラを
発生させ、表示内容によっては点灯画素と非点灯画素の
識別が困難になるほど画質を低下させていた。第２図で
は、横線を１ラインおきに交互に点灯したとき、非点灯
ｅＪｆＭ１１．１２の濃淡に差が出る一例を示したもの
である。１１の上方に示したように交互点灯を横に長く
すると１１のように淡い表示となり、１２の上方に示し
たように交互点灯領域を横に短くすると１２のように濃
い表示となる例である。このような濃淡の差は主に走査
電極の抵抗が高い場合に顕在化しやすい現象である。こ
れに対し、透明電極抵抗を下げるために電極薄膜の厚み
を増すと配向不良や生産上のスループットの低下による
パネルコスト高を誘発し、これにも限界があった。
そこで本発明はこのような問題点を解決するもので、そ
の目的とするところは、液晶パネルの電極を両端から駆
動することにより、濃淡ムラの少ない高画質な液晶表示
装置を提供することにある。
の目的とするところは、液晶パネルの電極を両端から駆
動することにより、濃淡ムラの少ない高画質な液晶表示
装置を提供することにある。
〔課題を解決するための手段］
本発明の平板表示装置の駆動方法は、走査電極と信号電
極とがマトリクス状に配置され、それらの電極の交点に
表示画素が設けられた表示装置において、前記走査電極
と信号電極のうち少なくとも走査電極は、電極の両端か
ら駆動回路で駆動されるように構成したことを特徴とす
る。
極とがマトリクス状に配置され、それらの電極の交点に
表示画素が設けられた表示装置において、前記走査電極
と信号電極のうち少なくとも走査電極は、電極の両端か
ら駆動回路で駆動されるように構成したことを特徴とす
る。
本発明の上記の方法によれば、透明電極の抵抗が等価的
にＸになること、駆動回路の出力抵抗が等価的に２にな
ること、またある画素の電圧変動の影響を電極両端から
分担するので、その電極につながる全画素に電圧変動の
影響が伝播しにくくなることにより、片側駆動より大幅
に画質が向上するのである。
にＸになること、駆動回路の出力抵抗が等価的に２にな
ること、またある画素の電圧変動の影響を電極両端から
分担するので、その電極につながる全画素に電圧変動の
影響が伝播しにくくなることにより、片側駆動より大幅
に画質が向上するのである。
第１図は、本発明の一実施例における液晶駆動方法を示
す図であって、信号電極と走査電極の対向部分でマトリ
クス状に絵素が形成されるようにした液晶パネル１の透
明電極（ＩＴＯの薄膜等）の両端から対になった信号側
駆動回路と走査側駆動回路により同一波形で駆動するも
のである。信号側駆動回路は、表示データＸＤをシフト
クロックＸ５ＣＬにより動作するシフトレジスタ２によ
り直並列変換し、ラッチ３により信号ＬＰに同期化させ
、レベルシフタ４を介してドライバ５により電圧平均化
法による４値の電圧からなる液晶駆動波形に変換するも
のである。一方走査側駆動回路は、スタートパルスＹＤ
を受けてシフトクロックにより動作するシストレジスタ
６の出力をレベルシフタ７を介して、ドライバ８により
４値の電圧からなる液晶駆動波形に変換する構成である
。
す図であって、信号電極と走査電極の対向部分でマトリ
クス状に絵素が形成されるようにした液晶パネル１の透
明電極（ＩＴＯの薄膜等）の両端から対になった信号側
駆動回路と走査側駆動回路により同一波形で駆動するも
のである。信号側駆動回路は、表示データＸＤをシフト
クロックＸ５ＣＬにより動作するシフトレジスタ２によ
り直並列変換し、ラッチ３により信号ＬＰに同期化させ
、レベルシフタ４を介してドライバ５により電圧平均化
法による４値の電圧からなる液晶駆動波形に変換するも
のである。一方走査側駆動回路は、スタートパルスＹＤ
を受けてシフトクロックにより動作するシストレジスタ
６の出力をレベルシフタ７を介して、ドライバ８により
４値の電圧からなる液晶駆動波形に変換する構成である
。
この液晶表示装置に電源を印加したとき、回路が不安定
状態となって透明電極を介して接続された２つの駆動回
路の出力電圧が異なる場合が発生するが、このときの液
晶の駆動電圧は２０〜４０Ｖあるので、ｌ出力当り数１
００μＡ〜数ｍＡの電流が流れることになり、この大電
流が駆動回路や液晶パネルに悪影響を与える。そこで本
発明の液晶表示装置に使用される駆動回路のドライバに
は、禁止信号ＩＮＨにより電源印加時に駆動回路の状態
が同一に定まるまでの所定期間に、出力を同一にする回
路を備え、電源印加時のドライバ出力のショートを防止
する。
状態となって透明電極を介して接続された２つの駆動回
路の出力電圧が異なる場合が発生するが、このときの液
晶の駆動電圧は２０〜４０Ｖあるので、ｌ出力当り数１
００μＡ〜数ｍＡの電流が流れることになり、この大電
流が駆動回路や液晶パネルに悪影響を与える。そこで本
発明の液晶表示装置に使用される駆動回路のドライバに
は、禁止信号ＩＮＨにより電源印加時に駆動回路の状態
が同一に定まるまでの所定期間に、出力を同一にする回
路を備え、電源印加時のドライバ出力のショートを防止
する。
第３図は、ドツトマトリクス液晶表示装置の等価回路を
示したものである。図では、５×３マトリクス・パネル
を走査電極のみ両側駆動した場合を示している。図中の
と■の画素は、本発明と従来方法による駆動回路から最
も遠い位置にあるものをそれぞれ示したものである。従
来方法による■は左側から片側駆動した場合を示す。以
下にこのときの駆動回路との、■点間の抵抗値を示すと
、■： （３ｒｅ ＋Ｒｃ ） ｘ％ Ω■： ５
ｒｅ 十Ｒｃ Ωここでｒｃ、ｒｓは、画素
間の電極抵抗、Ｒｃ、Ｒｓは、駆動回路の出力抵抗 である。ＲｃはＩＫΩ前後であって、画素数が増えてｒ
ｃＯ数が数百以上になった場合はほぼ無視できる数値で
ある。従って、画素数が増えるほど■：■の抵抗比は１
：４に近づく。一方、電極に付いているキャパシタＣは
変わらないので、本発明の駆動方法を使えば、従来の駆
動方法において透明電極抵抗を２にしたのと等価な画質
が得られることを意味している。逆に従来と同一画質な
らば、２倍の大きさの液晶セルを実現することができる
ことを意味し、液晶表示装置の高解像度化を実現できる
。
示したものである。図では、５×３マトリクス・パネル
を走査電極のみ両側駆動した場合を示している。図中の
と■の画素は、本発明と従来方法による駆動回路から最
も遠い位置にあるものをそれぞれ示したものである。従
来方法による■は左側から片側駆動した場合を示す。以
下にこのときの駆動回路との、■点間の抵抗値を示すと
、■： （３ｒｅ ＋Ｒｃ ） ｘ％ Ω■： ５
ｒｅ 十Ｒｃ Ωここでｒｃ、ｒｓは、画素
間の電極抵抗、Ｒｃ、Ｒｓは、駆動回路の出力抵抗 である。ＲｃはＩＫΩ前後であって、画素数が増えてｒ
ｃＯ数が数百以上になった場合はほぼ無視できる数値で
ある。従って、画素数が増えるほど■：■の抵抗比は１
：４に近づく。一方、電極に付いているキャパシタＣは
変わらないので、本発明の駆動方法を使えば、従来の駆
動方法において透明電極抵抗を２にしたのと等価な画質
が得られることを意味している。逆に従来と同一画質な
らば、２倍の大きさの液晶セルを実現することができる
ことを意味し、液晶表示装置の高解像度化を実現できる
。
第４図は、走査側駆動回路の一実施例を示したものであ
る。破線枠４２で囲まれた回路は、駆動回路１ビット分
を示すもので、これを複数縦続接続して使用される。ま
た破線枠４３で示される部分は、ロジック部に対して高
電圧部になる回路を示したものである。図においてＤタ
イプ・フリップフロップ２１は、シフトクロックＳＣＫ
により動作するシフトレジスタを構成するものである。
る。破線枠４２で囲まれた回路は、駆動回路１ビット分
を示すもので、これを複数縦続接続して使用される。ま
た破線枠４３で示される部分は、ロジック部に対して高
電圧部になる回路を示したものである。図においてＤタ
イプ・フリップフロップ２１は、シフトクロックＳＣＫ
により動作するシフトレジスタを構成するものである。
シフトクロックＳＣＫには、第１図に示される信号ＬＰ
が入力される。従って出力Ｄ Ｉ’ｌ １１１はシフト
クロックＳＣＫに応じて次段のフリップフロップのＤｌ
に入力される。またシフトレジスタ初段を構成するフリ
ップフロップのＱ□１には、スタートパルスＹＤが入力
される。フリップフロップ２１の出力Ｑ７は、信号ＩＮ
Ｈにより強制的にドライバ出力ＯＵＴを同電位にするた
めのＮＯＲゲート２４を介して、レベルシフタ２３ａの
入力■。
が入力される。従って出力Ｄ Ｉ’ｌ １１１はシフト
クロックＳＣＫに応じて次段のフリップフロップのＤｌ
に入力される。またシフトレジスタ初段を構成するフリ
ップフロップのＱ□１には、スタートパルスＹＤが入力
される。フリップフロップ２１の出力Ｑ７は、信号ＩＮ
Ｈにより強制的にドライバ出力ＯＵＴを同電位にするた
めのＮＯＲゲート２４を介して、レベルシフタ２３ａの
入力■。
■に伝える。レベルシフタの出力０．σは、選択電位を
出力する相補型トランスファゲート２６゜２７のゲート
に接続されるとともに、非選択電位を交流化させるため
のＮＯＲゲート３２、ＮＡＮＤゲート３１の一方の入力
に接続される。ゲート３１．３２の他方の入力は、フレ
ーム信号ＦＲと信号ＩＮＨをＮＯＲゲート３６で合成し
た信号が、レベルシフタ２３ｂ１インバータ３８を介し
て入力される。ゲート３１．３２の出力は、それぞれト
ランスファゲート２８．２９のゲートに接続され、非選
択レベルＶ、、Ｖ４の出力制御を行う。
出力する相補型トランスファゲート２６゜２７のゲート
に接続されるとともに、非選択電位を交流化させるため
のＮＯＲゲート３２、ＮＡＮＤゲート３１の一方の入力
に接続される。ゲート３１．３２の他方の入力は、フレ
ーム信号ＦＲと信号ＩＮＨをＮＯＲゲート３６で合成し
た信号が、レベルシフタ２３ｂ１インバータ３８を介し
て入力される。ゲート３１．３２の出力は、それぞれト
ランスファゲート２８．２９のゲートに接続され、非選
択レベルＶ、、Ｖ４の出力制御を行う。
−力選択電位（Ｖｏ、Ｖ、）は、レベルシフタ２３ｂの
出力０から与えられるＦＲ倍信号ゲート入力とするトラ
ンスファゲート４０．４１によりマルチプレクスされた
後、相補型トランスファゲート２６．２７のソース電極
に与えられる。トランスファゲート２６．２７は、レベ
ルシフタ２３ａの出力０．σをゲート入力とし、シフト
レジスタ２１のＱｆｉの出力がＨ゛のときだけ導通し、
選択レベルを出力ＯＵＴに伝える。ところで信号ＩＮＨ
に“Ｈ°゛が入力されるとレベルシフタ２３ｂの入力■
は“ＨＩＩになり、トランスファゲート２６．２７のソ
ース電位は、強制的にＶ、電位となる。一方前述したよ
うに信号ＩＮＨが“Ｈｎのとき、トランスファゲート２
６，２７．２８．２９のうち導通しているゲートは、２
６．２７であるので、ドライバ出力ＯＵＴは、■、電位
に固定される。したがって第１図においてパワーオンの
ときにＩＮＨ信号を“ＨＩＩにしさえすれば、両側のド
ライバ８の出力が同電位となるので、透明電極を介して
ドライバ出力が互いにショートし、ドライバ間に大電流
が流れることを防止できる。ちなみに同電位レベルは、
■、の他にＶ、、Ｖ、。
出力０から与えられるＦＲ倍信号ゲート入力とするトラ
ンスファゲート４０．４１によりマルチプレクスされた
後、相補型トランスファゲート２６．２７のソース電極
に与えられる。トランスファゲート２６．２７は、レベ
ルシフタ２３ａの出力０．σをゲート入力とし、シフト
レジスタ２１のＱｆｉの出力がＨ゛のときだけ導通し、
選択レベルを出力ＯＵＴに伝える。ところで信号ＩＮＨ
に“Ｈ°゛が入力されるとレベルシフタ２３ｂの入力■
は“ＨＩＩになり、トランスファゲート２６．２７のソ
ース電位は、強制的にＶ、電位となる。一方前述したよ
うに信号ＩＮＨが“Ｈｎのとき、トランスファゲート２
６，２７．２８．２９のうち導通しているゲートは、２
６．２７であるので、ドライバ出力ＯＵＴは、■、電位
に固定される。したがって第１図においてパワーオンの
ときにＩＮＨ信号を“ＨＩＩにしさえすれば、両側のド
ライバ８の出力が同電位となるので、透明電極を介して
ドライバ出力が互いにショートし、ドライバ間に大電流
が流れることを防止できる。ちなみに同電位レベルは、
■、の他にＶ、、Ｖ、。
■４やハイインピーダンスにしても良いことはいうまで
もない。また信号側駆動回路のショート防止回路も走査
側駆動回路と同様の回路で実現することができる。
もない。また信号側駆動回路のショート防止回路も走査
側駆動回路と同様の回路で実現することができる。
ところで本発明の駆動方法は、駆動用半導体集積回路を
フレキシブルテープにボンディングしたＴＡＢ構造やＣ
ＯＧ［Ｃｈｉｐ Ｏｎ ＧｌａｓＳ］構造を用いれ
ば、駆動回路を液晶セルの両側に接続し、収納しやすい
。中でもＣＯＧ構造は、駆動回路と電極間の配線、接続
抵抗を最小にできる点で最も有利である。さらに本発明
の駆動方法は、走査電極のみに適用しても第２図の現象
を防止する効果がある。すなわち走査電極の駆動電圧振
幅は、信号電極の振幅より５〜１０倍大きいので、画素
への充放電遅延時間が画質に影響を与えやすいからであ
る。この方法は電極ピッチが狭くなるカラー液晶セルに
対して特に有効である。
フレキシブルテープにボンディングしたＴＡＢ構造やＣ
ＯＧ［Ｃｈｉｐ Ｏｎ ＧｌａｓＳ］構造を用いれ
ば、駆動回路を液晶セルの両側に接続し、収納しやすい
。中でもＣＯＧ構造は、駆動回路と電極間の配線、接続
抵抗を最小にできる点で最も有利である。さらに本発明
の駆動方法は、走査電極のみに適用しても第２図の現象
を防止する効果がある。すなわち走査電極の駆動電圧振
幅は、信号電極の振幅より５〜１０倍大きいので、画素
への充放電遅延時間が画質に影響を与えやすいからであ
る。この方法は電極ピッチが狭くなるカラー液晶セルに
対して特に有効である。
また信号電極は、透明電極膜の膜厚を厚くするなり、低
抵抗の異金属を透明電極に付けるなりして電極抵抗を下
げ、走査電極は本発明の方法を用いて等価的に低抵抗化
を図り、経済的に画質向上を図る応用展開が可能である
。
抵抗の異金属を透明電極に付けるなりして電極抵抗を下
げ、走査電極は本発明の方法を用いて等価的に低抵抗化
を図り、経済的に画質向上を図る応用展開が可能である
。
以上液晶表示装置のうち単純マトリクス型のＬＣＤにつ
いて説明してきたが、本発明の方法は、画素電極の抵抗
に起因する画質低下を改善するものであるから、ＩＴＯ
やネサ膜以外を配線材料に使うＴＦＴ （″ＹｉＪ膜ト
ランジスタ）やＭＩＭ （金属−絶縁物−金属）などの
構成を有するアクティブタイプのＬＣＤや電流を多く流
す必要のあるＦＤＰ（プラズマデイスプレィパネル）や
ＥＬ−Ｄ （エレクトロルミネッセンヌディスプレイ）
までのフラットデイスプレィに広く応用できるものであ
る。
いて説明してきたが、本発明の方法は、画素電極の抵抗
に起因する画質低下を改善するものであるから、ＩＴＯ
やネサ膜以外を配線材料に使うＴＦＴ （″ＹｉＪ膜ト
ランジスタ）やＭＩＭ （金属−絶縁物−金属）などの
構成を有するアクティブタイプのＬＣＤや電流を多く流
す必要のあるＦＤＰ（プラズマデイスプレィパネル）や
ＥＬ−Ｄ （エレクトロルミネッセンヌディスプレイ）
までのフラットデイスプレィに広く応用できるものであ
る。
以上述べたように本発明によれば、透明電極抵抗が等価
的にＡになるので、以下のような効果を有する。
的にＡになるので、以下のような効果を有する。
（ａ）パッシブタイプの液晶セルでは、液晶に加わる電
圧が電圧平均化法による理想値に近づくので、中小容量
で従来から行われてきた２フレーム交流駆動方法でも濃
淡ムラが少なく、コントラストの高い表示が得られる。
圧が電圧平均化法による理想値に近づくので、中小容量
で従来から行われてきた２フレーム交流駆動方法でも濃
淡ムラが少なく、コントラストの高い表示が得られる。
（ｂ）ファインピッチ電極パネルを画質を落とさずに大
画面化しやすい。
画面化しやすい。
（Ｃ）駆動回路の出力抵抗をむやみに小さくする必要が
ないので、従来より多ビンでしかも低コストで駆動回路
を集積回路化しやすい。
ないので、従来より多ビンでしかも低コストで駆動回路
を集積回路化しやすい。
（ｄ）透明電極（ＩＴｏ）の厚みを薄くできるので低コ
ストのパネルができる。
ストのパネルができる。
第１図は、本発明の駆動方法の一実施例を示す図。
第２図は、従来のＬＣＤにおける濃淡ムラを説明する図
。 第３図は、ＬＣＤの等価回路図。 第４図は、ショート電流防止回路を有する液晶駆動回路
の一例を示す図。 ２１・・・・・・Ｄタイプフリップフロップ２３ａ、２
３ｂ・・・・・・レベルシフタ２６．２７．２Ｂ、２９
，４０．４１・・・トランスファゲート 第２図 第１図 第３図
。 第３図は、ＬＣＤの等価回路図。 第４図は、ショート電流防止回路を有する液晶駆動回路
の一例を示す図。 ２１・・・・・・Ｄタイプフリップフロップ２３ａ、２
３ｂ・・・・・・レベルシフタ２６．２７．２Ｂ、２９
，４０．４１・・・トランスファゲート 第２図 第１図 第３図
Claims (2)
- （１）走査電極と信号電極とがマトリクス状に配置され
、それらの電極の交点に表示画素が設けられた表示装置
において、前記走査電極と信号電極のうち少なくとも走
査電極は、電極の両端から別々の駆動回路で駆動される
ようにしたことを特徴とする平板表示装置の駆動方法。 - （２）前記走査電極と信号電極のうち少なくとも走査電
極の両端が一対の走査側駆動回路に接続され、対をなす
駆動回路には出力を強制的に同電位にする手段を有して
いることを特徴とする請求項１記載の平板表示装置の駆
動方法。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63271299A JP2625976B2 (ja) | 1987-11-10 | 1988-10-27 | 平板表示装置の駆動方法 |
| KR1019890701273A KR930005371B1 (ko) | 1987-11-10 | 1988-11-09 | 평판 표시장치 및 그 구동방법. |
| EP88909834A EP0344323B1 (en) | 1987-11-10 | 1988-11-09 | Flat liquid crystal display unit and method of driving the same |
| DE3853945T DE3853945T2 (de) | 1987-11-10 | 1988-11-09 | Flüssigkristall-flachanzeigeeinheit und ansteuerverfahren. |
| PCT/JP1988/001126 WO1989004533A1 (fr) | 1987-11-10 | 1988-11-09 | Unite d'affichage plate et procede de commande |
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| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP28402587 | 1987-11-10 | ||
| JP62-284025 | 1987-11-10 | ||
| JP63271299A JP2625976B2 (ja) | 1987-11-10 | 1988-10-27 | 平板表示装置の駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
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| JP2625976B2 JP2625976B2 (ja) | 1997-07-02 |
Family
ID=26549638
Family Applications (1)
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| KR (1) | KR930005371B1 (ja) |
| DE (1) | DE3853945T2 (ja) |
| WO (1) | WO1989004533A1 (ja) |
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1988
- 1988-10-27 JP JP63271299A patent/JP2625976B2/ja not_active Expired - Lifetime
- 1988-11-09 WO PCT/JP1988/001126 patent/WO1989004533A1/ja not_active Ceased
- 1988-11-09 DE DE3853945T patent/DE3853945T2/de not_active Expired - Lifetime
- 1988-11-09 EP EP88909834A patent/EP0344323B1/en not_active Expired - Lifetime
- 1988-11-09 KR KR1019890701273A patent/KR930005371B1/ko not_active Expired - Lifetime
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| KR890702175A (ko) | 1989-12-23 |
| KR930005371B1 (ko) | 1993-06-19 |
| WO1989004533A1 (fr) | 1989-05-18 |
| DE3853945T2 (de) | 1995-12-21 |
| JP2625976B2 (ja) | 1997-07-02 |
| EP0344323A1 (en) | 1989-12-06 |
| EP0344323A4 (en) | 1991-01-30 |
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