JPH0315023A - 液晶駆動回路 - Google Patents
液晶駆動回路Info
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- JPH0315023A JPH0315023A JP15095789A JP15095789A JPH0315023A JP H0315023 A JPH0315023 A JP H0315023A JP 15095789 A JP15095789 A JP 15095789A JP 15095789 A JP15095789 A JP 15095789A JP H0315023 A JPH0315023 A JP H0315023A
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- G09G3/3681—Details of drivers for scan electrodes suitable for passive matrices only
-
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明は、ＭＯＳ｝ランジスタによって構成される液晶
駆動回路に関するものである。
駆動回路に関するものである。
〈従来の技術〉
肢晶駆動回路は、第３図に示すように液晶表示装置１に
セグメント出力信号ｉ１，．．．，１ｎ を出力するセ
グメント信号出力回路２と、バノクプレート出力信号Ｈ
ｌ．・・・．Ｈｍを出力するバンクプレート信号出力回
路３とから収る。
セグメント出力信号ｉ１，．．．，１ｎ を出力するセ
グメント信号出力回路２と、バノクプレート出力信号Ｈ
ｌ．・・・．Ｈｍを出力するバンクプレート信号出力回
路３とから収る。
従来のセグメント及びバノクプレート出力信号は第４図
に示すようなものであり、これらの信号を出力するため
の回路として第５図に示すような構成をとっている。第
５図ｆａｔはセグメント信号出力回路，第５図（ｂｌは
バノクプレート信号出カ着路である。
に示すようなものであり、これらの信号を出力するため
の回路として第５図に示すような構成をとっている。第
５図ｆａｔはセグメント信号出力回路，第５図（ｂｌは
バノクプレート信号出カ着路である。
このセグメント信号出力回路のＶＡ．ＶＢｌ”ｌｌ．．
フレーム１（Ｓ＝Ｈ）で（ｄＶＡ ＝ＡＡ１ ． ｖｎ
＝ＶＢＢ，７Ｌ／−ム２（Ｓ＝Ｌ）ＴＵＶＡ＝ＡＡｚ
．Ｖｎ ＝ｖＤ２となるように制御される。各デュー
ティにて、信号ｌぎＨで，フレーム１の時にトランジス
タＰａ，Ｎｂがオンして− ＶＡＩ レベルを出力し
、フレーム２の時にトランジスタＰｂ１Ｎａがオンして
− Ｖｌｌｌ レベルを出力し，液晶表示点灯、信号
ｉ＝Ｌで，フレーム１の時にトランジスタＰｂ，Ｎａが
オンして−Ｖｌｌｌ レベルを出力し、フレーム２の
時にトランジスタＰａ，ＮｂがオンしてＶＡ２ レベル
全出力し、非点灯となる。
フレーム１（Ｓ＝Ｈ）で（ｄＶＡ ＝ＡＡ１ ． ｖｎ
＝ＶＢＢ，７Ｌ／−ム２（Ｓ＝Ｌ）ＴＵＶＡ＝ＡＡｚ
．Ｖｎ ＝ｖＤ２となるように制御される。各デュー
ティにて、信号ｌぎＨで，フレーム１の時にトランジス
タＰａ，Ｎｂがオンして− ＶＡＩ レベルを出力し
、フレーム２の時にトランジスタＰｂ１Ｎａがオンして
− Ｖｌｌｌ レベルを出力し，液晶表示点灯、信号
ｉ＝Ｌで，フレーム１の時にトランジスタＰｂ，Ｎａが
オンして−Ｖｌｌｌ レベルを出力し、フレーム２の
時にトランジスタＰａ，ＮｂがオンしてＶＡ２ レベル
全出力し、非点灯となる。
このセグメント信号出力回路にて，トランジスタＰａ．
Ｎｂ及びＰｂ．Ｎａが抱合せになっている。通常の出力
バノフｒＰａ．Ｎａのみでは、フレームｌの時にＮａが
オンしてＶＩＩ１ レベルを出？する時と、フレーム
２の時にＰａがオンしてＶＡ２ レベルを出力する時
に、Ｎａ，Ｐａのトランジスタにパノクゲートバイアス
がかかり（Ｎａの基板電位ＶＢ２ に対してＮａのソー
ス電位がＶＢＩ と高〈なる、筐たＰａの基板電位ＶＡ
Ｉ と対してＰａのソース電位がＶ人２と低くなるため
），トランジスタのオン抵抗が大きくなり、負荷である
夜晶を駆動しきらず，フレーム１の時にＶＡＩレベルか
らＶＢ レベル、フレーム２の時にＶＢ■ｌ レベルからＶ人２ レベルへの出力信号波形がなまり、
表示品位が悪化してしまうＣ第６図参照）。
Ｎｂ及びＰｂ．Ｎａが抱合せになっている。通常の出力
バノフｒＰａ．Ｎａのみでは、フレームｌの時にＮａが
オンしてＶＩＩ１ レベルを出？する時と、フレーム
２の時にＰａがオンしてＶＡ２ レベルを出力する時
に、Ｎａ，Ｐａのトランジスタにパノクゲートバイアス
がかかり（Ｎａの基板電位ＶＢ２ に対してＮａのソー
ス電位がＶＢＩ と高〈なる、筐たＰａの基板電位ＶＡ
Ｉ と対してＰａのソース電位がＶ人２と低くなるため
），トランジスタのオン抵抗が大きくなり、負荷である
夜晶を駆動しきらず，フレーム１の時にＶＡＩレベルか
らＶＢ レベル、フレーム２の時にＶＢ■ｌ レベルからＶ人２ レベルへの出力信号波形がなまり、
表示品位が悪化してしまうＣ第６図参照）。
このバノクゲートバイアスによるオン抵抗の悪化を補償
するために、Ｐｂ，Ｎｂの２つのトランジスタを付加し
，トランジスタゲートとして，いかなる場合にも小さい
オン抵抗でレベルを出力できるようにし，出力信号波形
のな１り金防ぎ、表示品位を良好に保−ている。
するために、Ｐｂ，Ｎｂの２つのトランジスタを付加し
，トランジスタゲートとして，いかなる場合にも小さい
オン抵抗でレベルを出力できるようにし，出力信号波形
のな１り金防ぎ、表示品位を良好に保−ている。
〈発明が解決しようとする課題〉
従来の方法では、セグメント信号出力回路の出カバノフ
ァ部に４つのトランジスタが必要であり非常に大きな面
積を必要としていた。
ァ部に４つのトランジスタが必要であり非常に大きな面
積を必要としていた。
本発明は、表示品位を悪化させることなく、通常の出力
ハノファと同様に２つのトランジスタにてセグメント信
号出力回路の出力バノファ部を構成できる方法を提供す
ることを目的としている。
ハノファと同様に２つのトランジスタにてセグメント信
号出力回路の出力バノファ部を構成できる方法を提供す
ることを目的としている。
く課題を解決するための手段〉
本発明の液晶駆動回路は、セグメント出力信号とパノク
プレート出力信号の各出力回路を持ち、その出力信号の
各デューティの初期に短いディスチャージ期間を持たせ
る構成としたことを特徴とするものである。
プレート出力信号の各出力回路を持ち、その出力信号の
各デューティの初期に短いディスチャージ期間を持たせ
る構成としたことを特徴とするものである。
〈実施例〉
以下，実施例に基づいて本発明を詳細に説明する。
本発明に係るセグメント及びバノクプレート信号出力回
路を第１図（ａｌ及び（ｂｌに示す。この回路はＰ基院
，ＮウエルのＣＭＯＳプロセスにて考察したものである
。基本的にトランジスタＰａの基板電位（正確にはＮウ
ェルの電位）をＰａのソース電位と同じＶＡに固定し、
１た、信号Ｔによってセグメント及びバノクプレート出
力信号の各デ二ーテイの初期に短いデイスチャージ期間
を持つような構成としている。
路を第１図（ａｌ及び（ｂｌに示す。この回路はＰ基院
，ＮウエルのＣＭＯＳプロセスにて考察したものである
。基本的にトランジスタＰａの基板電位（正確にはＮウ
ェルの電位）をＰａのソース電位と同じＶＡに固定し、
１た、信号Ｔによってセグメント及びバノクプレート出
力信号の各デ二ーテイの初期に短いデイスチャージ期間
を持つような構成としている。
本回路による出力信号を第２図に示す。
セグメント信号出力回路のトランジスタＰａのバノクゲ
ートバイアス対策として．Ｐａの基板電位Ｃ正確にぱＮ
ウェルの電位）をＰａのソースと同電位にｖ人に固定し
てある。内部のＯジノクとは分離してＰａのみを単独の
ウエルにて構成すればウェルの電位をＶＡにすることが
可能であり、Ｖ人がＶＡＩ ． ＶＡ２ と変化しても
基板（ウエル）とンースが同電位となるのでバノクゲー
トバイアスがかからない構戊とすることができる。しか
し、トランジスタＮａの基板電位ｉＶｎ２ レベルに固
定であるため、Ｐａのように、基板（Ｎウェル）とソー
スの電位を同一にすることができず，バ・ノクゲートバ
イアスを防ぐことができない。そこで回路構底を第１図
のようにし、信号Ｔによって、セグメント及びバノクプ
レート出力信号の各デューティの初期に短いデイスチセ
ージ期間を持たせる。つまり，第２図に示すセグメント
及びバノクプレート信号を出力するようにする。このよ
うな信号が出力されれば、Ｖ人１ レベル出力時ニ，液
晶にチャージアノブされた電荷は、ディスチャージ期間
に，バノクゲートバイアスのかからない状ａ（Ｔ＝Ｈの
時に、■ｎ＝ＶＢ２であるため）で小さいオン抵抗のＮ
ａにて短時間にディスチャージされ、その後ｖｎ＝Ｖｎ
＋ となり、ＮａによーてＶＢ１ レベルが出力さ
れる。このため、バノクゲートバイアスのかかった状態
での大きなオン抵抗であるＮａにて負荷である液晶を駆
動する必要がなくなり，波形がな１ることぱ無く，表示
品位も良好となる。
ートバイアス対策として．Ｐａの基板電位Ｃ正確にぱＮ
ウェルの電位）をＰａのソースと同電位にｖ人に固定し
てある。内部のＯジノクとは分離してＰａのみを単独の
ウエルにて構成すればウェルの電位をＶＡにすることが
可能であり、Ｖ人がＶＡＩ ． ＶＡ２ と変化しても
基板（ウエル）とンースが同電位となるのでバノクゲー
トバイアスがかからない構戊とすることができる。しか
し、トランジスタＮａの基板電位ｉＶｎ２ レベルに固
定であるため、Ｐａのように、基板（Ｎウェル）とソー
スの電位を同一にすることができず，バ・ノクゲートバ
イアスを防ぐことができない。そこで回路構底を第１図
のようにし、信号Ｔによって、セグメント及びバノクプ
レート出力信号の各デューティの初期に短いデイスチセ
ージ期間を持たせる。つまり，第２図に示すセグメント
及びバノクプレート信号を出力するようにする。このよ
うな信号が出力されれば、Ｖ人１ レベル出力時ニ，液
晶にチャージアノブされた電荷は、ディスチャージ期間
に，バノクゲートバイアスのかからない状ａ（Ｔ＝Ｈの
時に、■ｎ＝ＶＢ２であるため）で小さいオン抵抗のＮ
ａにて短時間にディスチャージされ、その後ｖｎ＝Ｖｎ
＋ となり、ＮａによーてＶＢ１ レベルが出力さ
れる。このため、バノクゲートバイアスのかかった状態
での大きなオン抵抗であるＮａにて負荷である液晶を駆
動する必要がなくなり，波形がな１ることぱ無く，表示
品位も良好となる。
く発明の効果〉
以上述べてきたように，本発明によれば、表示品位を悪
化させることなく、セグメント信号出力回路の出力バノ
ファ部を２つのトランジスタで構成することができ、よ
り小さな面積にて液晶駆動回路を構成でき、実用的には
極めて有効である。
化させることなく、セグメント信号出力回路の出力バノ
ファ部を２つのトランジスタで構成することができ、よ
り小さな面積にて液晶駆動回路を構成でき、実用的には
極めて有効である。
？１図は木発明に係るセグメント信号出力回路及びバノ
クプレート信号出力回路の回路図，第２図は本発明に係
るセグメント出力信号及びバノクプレート出力信号の波
形図、第３図は液晶表示システムのブロノク図，第４図
は従来のセグメント出力信号及びバノクプレート出力信
号の波形図、第５図は従来のセグメント信号出力回路及
びバノクプレート信号出力回路の回路図、第６図ｉｄＰ
ａ，Ｎａのみの詩のセグメ■ント出力信号波形図である
。
クプレート信号出力回路の回路図，第２図は本発明に係
るセグメント出力信号及びバノクプレート出力信号の波
形図、第３図は液晶表示システムのブロノク図，第４図
は従来のセグメント出力信号及びバノクプレート出力信
号の波形図、第５図は従来のセグメント信号出力回路及
びバノクプレート信号出力回路の回路図、第６図ｉｄＰ
ａ，Ｎａのみの詩のセグメ■ント出力信号波形図である
。
Claims (1)
- １、セグメント出力信号とバックプレート出力信号の各
出力回路を持ち、その出力信号の各デューティの初期に
短いディスチャージ期間を持たせる構成としたことを特
徴とする液晶駆動回路。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1150957A JP2502152B2 (ja) | 1989-06-13 | 1989-06-13 | 液晶駆動回路 |
| DE19904018805 DE4018805A1 (de) | 1989-06-13 | 1990-06-12 | Ansteuerschaltung fuer ein lcd |
| US07/839,703 US5220313A (en) | 1989-06-13 | 1992-02-24 | Device for driving a liquid crystal display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1150957A JP2502152B2 (ja) | 1989-06-13 | 1989-06-13 | 液晶駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0315023A true JPH0315023A (ja) | 1991-01-23 |
| JP2502152B2 JP2502152B2 (ja) | 1996-05-29 |
Family
ID=15508129
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1150957A Expired - Fee Related JP2502152B2 (ja) | 1989-06-13 | 1989-06-13 | 液晶駆動回路 |
Country Status (2)
| Country | Link |
|---|---|
| JP (1) | JP2502152B2 (ja) |
| DE (1) | DE4018805A1 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07160216A (ja) * | 1993-12-07 | 1995-06-23 | Komatsu Ltd | 透過形液晶マスクマーカ及びその液晶マスク駆動方法 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS509395A (ja) * | 1973-05-23 | 1975-01-30 | ||
| JPS5474330A (en) * | 1977-11-25 | 1979-06-14 | Sanyo Electric Co Ltd | Dynamic driving method for liquid crystal |
| JPH026921A (ja) * | 1988-06-25 | 1990-01-11 | Fujitsu Ltd | 液晶表示装置の駆動方法 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6059389A (ja) * | 1983-09-12 | 1985-04-05 | シャープ株式会社 | 液晶表示装置の駆動回路 |
-
1989
- 1989-06-13 JP JP1150957A patent/JP2502152B2/ja not_active Expired - Fee Related
-
1990
- 1990-06-12 DE DE19904018805 patent/DE4018805A1/de active Granted
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS509395A (ja) * | 1973-05-23 | 1975-01-30 | ||
| JPS5474330A (en) * | 1977-11-25 | 1979-06-14 | Sanyo Electric Co Ltd | Dynamic driving method for liquid crystal |
| JPH026921A (ja) * | 1988-06-25 | 1990-01-11 | Fujitsu Ltd | 液晶表示装置の駆動方法 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07160216A (ja) * | 1993-12-07 | 1995-06-23 | Komatsu Ltd | 透過形液晶マスクマーカ及びその液晶マスク駆動方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| DE4018805C2 (ja) | 1992-09-10 |
| DE4018805A1 (de) | 1990-12-20 |
| JP2502152B2 (ja) | 1996-05-29 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080313 Year of fee payment: 12 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090313 Year of fee payment: 13 |
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| LAPS | Cancellation because of no payment of annual fees |