JPH03165668A - 同期分離回路 - Google Patents
同期分離回路Info
- Publication number
- JPH03165668A JPH03165668A JP1305401A JP30540189A JPH03165668A JP H03165668 A JPH03165668 A JP H03165668A JP 1305401 A JP1305401 A JP 1305401A JP 30540189 A JP30540189 A JP 30540189A JP H03165668 A JPH03165668 A JP H03165668A
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- JP
- Japan
- Prior art keywords
- circuit
- signal
- clamp
- synchronizing
- comparator
- Prior art date
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- Granted
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- Synchronizing For Television (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、テレビジョン、ビデオテープレコーダー等に
使用されるテレビ信号から同期信号を分離する回路に関
するものである。
使用されるテレビ信号から同期信号を分離する回路に関
するものである。
従来の技術
第３図に従来の同期分離回路を示し、第４図にその動作
波形を示す。第３図に於いて、１は入力端子でテレビジ
ョン信号が入力される。２はクランプ用コンデンサで、
テレビジョン信号の同期信号の最低電位（シンクチップ
）を基準電圧にクランプするためのものである。３は低
域通過フィルター（ＬＰＦ）で、入力テレビジョン信号
の高周波成分をカットオフする。４は分離回路で、端子
４から入力される基準電圧ＶＩとＬＰＦ３から入力され
るテレビジョン信号を比較し、同期信号のみを出力端子
６及びクランプ回路７に出力する。
波形を示す。第３図に於いて、１は入力端子でテレビジ
ョン信号が入力される。２はクランプ用コンデンサで、
テレビジョン信号の同期信号の最低電位（シンクチップ
）を基準電圧にクランプするためのものである。３は低
域通過フィルター（ＬＰＦ）で、入力テレビジョン信号
の高周波成分をカットオフする。４は分離回路で、端子
４から入力される基準電圧ＶＩとＬＰＦ３から入力され
るテレビジョン信号を比較し、同期信号のみを出力端子
６及びクランプ回路７に出力する。
クランプ回路７は、入力される同期信号期間のみ動作し
、クランプ回路７に内蔵される基準電圧ｖＲに、入力テ
レビジョン信号のシンクチップをクランプする。次に第
４図の動作波形を参考にして、第３図に示す従来例の説
明をする。
、クランプ回路７に内蔵される基準電圧ｖＲに、入力テ
レビジョン信号のシンクチップをクランプする。次に第
４図の動作波形を参考にして、第３図に示す従来例の説
明をする。
第４図に於いて、ａは入力端子１に入力されるテレビジ
ョン信号で、ｂはＬＰＦ３の出力波形で、テレビジョン
信号の高周波成分が減衰していることがわかる。
ョン信号で、ｂはＬＰＦ３の出力波形で、テレビジョン
信号の高周波成分が減衰していることがわかる。
ＬＰＦ３の出力として得られる波形は、高周波成分が減
衰すると同時に、入力信号ａに対して、遅延時間ｔｄを
持つ。従って、分離回路５に於いて、端子４から入力さ
れる基準電圧ｖ１とＬＰＦ３の出力を比較分離して得ら
れる同期信号Ｃも、入力信号ａに対して、遅延時間ｔｄ
を持つことになる。その結果、理想的にはｄに示したよ
うに、クランプ回路７．コンデンサ２．ＬＰＦ３の接続
点に於けるテレビジョン信号のシンクチップがクランプ
回路７に内蔵されている基準電圧ｖＲにクランプされる
はずであるが、実際には、クランプパルスＣが入力信号
ａよりも遅れているために、クランプパルスＣの後端が
、入力信号ａの同期信号を越して、ペデスタル部分まで
伸びることになる。従って、クランプ回路７．コンデン
サ２゜ＬＰＦ３の接続点の波形は、ｅに示すように、シ
ンクチップが基準電圧よりも下がることになる。
衰すると同時に、入力信号ａに対して、遅延時間ｔｄを
持つ。従って、分離回路５に於いて、端子４から入力さ
れる基準電圧ｖ１とＬＰＦ３の出力を比較分離して得ら
れる同期信号Ｃも、入力信号ａに対して、遅延時間ｔｄ
を持つことになる。その結果、理想的にはｄに示したよ
うに、クランプ回路７．コンデンサ２．ＬＰＦ３の接続
点に於けるテレビジョン信号のシンクチップがクランプ
回路７に内蔵されている基準電圧ｖＲにクランプされる
はずであるが、実際には、クランプパルスＣが入力信号
ａよりも遅れているために、クランプパルスＣの後端が
、入力信号ａの同期信号を越して、ペデスタル部分まで
伸びることになる。従って、クランプ回路７．コンデン
サ２゜ＬＰＦ３の接続点の波形は、ｅに示すように、シ
ンクチップが基準電圧よりも下がることになる。
ＬＰＦ３は、テレビジョン信号中の特に高周波のノイズ
を除去するためのもので、同期分離回路を構成するため
には、不可決のものである。
を除去するためのもので、同期分離回路を構成するため
には、不可決のものである。
発明が解決しようとする課題
上記説明のとおり、従来の同期分離回路では、ＬＰＦの
ためテレビジョン信号全体が遅延し、同期分離出力も遅
延するために、クランプ回路は同期信号部分以後のペデ
スタル部分もクランプしようと動作し、正確なりランプ
が実現できない問題があった。すなわち、入力テレビジ
ョン信号のシンクチップが、実際には基準電圧ｖＲより
も下がるという誤動作を発生し、同期分離回路の精度を
悪化していた。
ためテレビジョン信号全体が遅延し、同期分離出力も遅
延するために、クランプ回路は同期信号部分以後のペデ
スタル部分もクランプしようと動作し、正確なりランプ
が実現できない問題があった。すなわち、入力テレビジ
ョン信号のシンクチップが、実際には基準電圧ｖＲより
も下がるという誤動作を発生し、同期分離回路の精度を
悪化していた。
課題を解決するための手段
本発明の同期分離回路は、分離された同期信号と、同期
信号から作られた充放電波形をコンパレータにより分離
した信号をロジック処理することにより、クランプパル
スの後部をカットし、クランプパルス長を短くする。従
って、テレビジョン信号よりも同期信号出力が遅延して
も、パルスの後部がカットされているため、クランプパ
ルスが、同期信号を越えて、ペデスタル部まで伸びるこ
とがない。
信号から作られた充放電波形をコンパレータにより分離
した信号をロジック処理することにより、クランプパル
スの後部をカットし、クランプパルス長を短くする。従
って、テレビジョン信号よりも同期信号出力が遅延して
も、パルスの後部がカットされているため、クランプパ
ルスが、同期信号を越えて、ペデスタル部まで伸びるこ
とがない。
作用
本発明の同期分離回路は、分離された同期信号よりも短
いクランプパルスを作すクランブするため、正確なりラ
ンプが行なわれ、従って、テレビジョン信号から同期信
号を分離する精度を悪化させることがない。
いクランプパルスを作すクランブするため、正確なりラ
ンプが行なわれ、従って、テレビジョン信号から同期信
号を分離する精度を悪化させることがない。
実施例
第１図に本発明の同期分離回路を示す。第１図に於いて
、１１は入力端子でテレビジョン信号が入力される。１
２はクランプ用コンデンサ、１３はＬＰＦ、１４は基準
電圧入力、１５は分離回路、１６は同期分離出力端子、
１７は充放電回路、１８はコンパレータ、１９はコンパ
レータ１８の出力と同期分離出力を論理演算するロジッ
ク回路、２０はクランプ回路である。第１図に示した本
発明の同期分離回路は、第３図の従来例に、充放電回路
１７、コンパレータ１８．ロジック回路１９を付加した
ことが異なり、他は同じである。すなわち第１図及び第
３図に於いて、１と１１，３と１３゜４とＬＬ、５と１
５，６と１６，７と２０はそれぞれ同じものである。
、１１は入力端子でテレビジョン信号が入力される。１
２はクランプ用コンデンサ、１３はＬＰＦ、１４は基準
電圧入力、１５は分離回路、１６は同期分離出力端子、
１７は充放電回路、１８はコンパレータ、１９はコンパ
レータ１８の出力と同期分離出力を論理演算するロジッ
ク回路、２０はクランプ回路である。第１図に示した本
発明の同期分離回路は、第３図の従来例に、充放電回路
１７、コンパレータ１８．ロジック回路１９を付加した
ことが異なり、他は同じである。すなわち第１図及び第
３図に於いて、１と１１，３と１３゜４とＬＬ、５と１
５，６と１６，７と２０はそれぞれ同じものである。
次に第２図に示した本発明の動作波形について説明する
。第２図に於いて、ｇは入力端子１１に入力されるテレ
ビジョン信号、ｈは出力端子１６に得られる同期信号で
、ＬＰＦ１３のために時間遅れｔｄを持つ。ｉは充放電
回路１７の波形で、同期分離出力りの立上がりで充電を
開始し、立下がりで充電状態から放電状態に変化する。
。第２図に於いて、ｇは入力端子１１に入力されるテレ
ビジョン信号、ｈは出力端子１６に得られる同期信号で
、ＬＰＦ１３のために時間遅れｔｄを持つ。ｉは充放電
回路１７の波形で、同期分離出力りの立上がりで充電を
開始し、立下がりで充電状態から放電状態に変化する。
ｉに示したｖ２は、コンパレータ１８の内部に設定され
ている基準電圧で、コンパレータ１８はｊに示したよう
に、充放電波形ｉがｖ２より高い期間低電位じＬ−）と
なり、ｉがＶ２より低い期間高電位（”Ｈ−）となる。
ている基準電圧で、コンパレータ１８はｊに示したよう
に、充放電波形ｉがｖ２より高い期間低電位じＬ−）と
なり、ｉがＶ２より低い期間高電位（”Ｈ−）となる。
ｋはロジック回路１９の出力波形で、ｈとｊの論理積を
出力する。すなわちｈとｊが共１ｎ−Ｈ”の時だけ“Ｈ
゛を出力する。第２図に示したように、ｋは入力テレビ
ジョン信号ｇの同期信号より必らず″Ｈ″期間が短くな
ることがわかる。更にクランプパルスには、充放電回路
１７の充放電特性を変えることによって、容易に“Ｈ−
期間を変えることができる。従ってクランプ回路２゜は
、入力テレビジョン信号ｇの同期信号期間を越えて動作
することはありえず、クランプ回路２０及びクランプ用
コンデンサによって、入力テレビジョン信号のシンクチ
ップは、クランプ回路２０内に設定されている基準電圧
ｖＲに正確にクランプされ、ＬＰＦ１３を経て、分離回
路１５によって、精度の良い同期分離を行なうことがで
きる。
出力する。すなわちｈとｊが共１ｎ−Ｈ”の時だけ“Ｈ
゛を出力する。第２図に示したように、ｋは入力テレビ
ジョン信号ｇの同期信号より必らず″Ｈ″期間が短くな
ることがわかる。更にクランプパルスには、充放電回路
１７の充放電特性を変えることによって、容易に“Ｈ−
期間を変えることができる。従ってクランプ回路２゜は
、入力テレビジョン信号ｇの同期信号期間を越えて動作
することはありえず、クランプ回路２０及びクランプ用
コンデンサによって、入力テレビジョン信号のシンクチ
ップは、クランプ回路２０内に設定されている基準電圧
ｖＲに正確にクランプされ、ＬＰＦ１３を経て、分離回
路１５によって、精度の良い同期分離を行なうことがで
きる。
発明の詳細
な説明してきたように、第１図に示した本発明の同期分
離回路は、入力テレビジョン信号のシンクチップを精度
良くクランプすることができるため、分離回路に入力さ
れるテレビジョン信号のシンクチップが常に一定電圧に
制御され、正確な同期分離を行なうことができる。
離回路は、入力テレビジョン信号のシンクチップを精度
良くクランプすることができるため、分離回路に入力さ
れるテレビジョン信号のシンクチップが常に一定電圧に
制御され、正確な同期分離を行なうことができる。
第１図は本発明の同期分離回路の回路図、第２図は第１
図の動作波形を示す図、第３図は従来の同期分離回路の
回路図、第４図は従来例の動作波形を示す図である。 １．１１・・・・・・入力端子、６，１６・・・・・・
同期分離出力端子、２，１２・・・・・・クランプ用コ
ンデンサ、３．１３・・・・・・低域通過フィルタ、４
，１４・・・・・・基準電圧入力端子、５，１５・・・
・・・分離回路、７．２０・・・・・・クランプ回路、
１７・・・・・・充放電回路、１８・・・・・・コンパ
レータ、１９・・・・・・ロジック回路。
図の動作波形を示す図、第３図は従来の同期分離回路の
回路図、第４図は従来例の動作波形を示す図である。 １．１１・・・・・・入力端子、６，１６・・・・・・
同期分離出力端子、２，１２・・・・・・クランプ用コ
ンデンサ、３．１３・・・・・・低域通過フィルタ、４
，１４・・・・・・基準電圧入力端子、５，１５・・・
・・・分離回路、７．２０・・・・・・クランプ回路、
１７・・・・・・充放電回路、１８・・・・・・コンパ
レータ、１９・・・・・・ロジック回路。
Claims (1)
- クランプ用コンデンサにクランプ回路及び低域通過フィ
ルター（ＬＰＦ）が接続され、前記ＬＰＦの出力端子は
分離回路に接続され、前記分離回路には基準電圧が入力
され、前記分離回路の出力端子は、充放電回路及びロジ
ック回路に接続され、前記充放電回路の出力端子はコン
パレータに接続され、前記コンパレータの出力端子は、
前記ロジック回路に接続され、前記ロジック回路の出力
端子は、前記クランプ回路に接続されたことを特徴とす
る同期分離回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1305401A JP2993018B2 (ja) | 1989-11-24 | 1989-11-24 | 同期分離回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1305401A JP2993018B2 (ja) | 1989-11-24 | 1989-11-24 | 同期分離回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03165668A true JPH03165668A (ja) | 1991-07-17 |
| JP2993018B2 JP2993018B2 (ja) | 1999-12-20 |
Family
ID=17944683
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1305401A Expired - Fee Related JP2993018B2 (ja) | 1989-11-24 | 1989-11-24 | 同期分離回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2993018B2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61174883A (ja) * | 1985-01-30 | 1986-08-06 | Sony Corp | クランプ回路 |
-
1989
- 1989-11-24 JP JP1305401A patent/JP2993018B2/ja not_active Expired - Fee Related
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61174883A (ja) * | 1985-01-30 | 1986-08-06 | Sony Corp | クランプ回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2993018B2 (ja) | 1999-12-20 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |