JPH03185987A - 画像受信再生装置 - Google Patents
画像受信再生装置Info
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- JPH03185987A JPH03185987A JP1324587A JP32458789A JPH03185987A JP H03185987 A JPH03185987 A JP H03185987A JP 1324587 A JP1324587 A JP 1324587A JP 32458789 A JP32458789 A JP 32458789A JP H03185987 A JPH03185987 A JP H03185987A
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- H04N5/44—Receiver circuitry for the reception of television signals according to analogue transmission standards
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- H04N19/00—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals
- H04N19/42—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals characterised by implementation details or hardware specially adapted for video compression or decompression, e.g. dedicated software implementation
- H04N19/423—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals characterised by implementation details or hardware specially adapted for video compression or decompression, e.g. dedicated software implementation characterised by memory arrangements
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- H04N19/61—Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using transform coding in combination with predictive coding
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- Signal Processing (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は画像受信再生装置に関し、より具体的には、伝
送媒体から受信した画像情報又は記録媒体からの再生画
像情報から画像信号を再生するＥｊｊｉ像受信再受信再
生装置る。
送媒体から受信した画像情報又は記録媒体からの再生画
像情報から画像信号を再生するＥｊｊｉ像受信再受信再
生装置る。
［従来の技術］
テレビ会議システム、テレビ電話等で使用される従来の
画像受信再生装置の構成を第３図に示す。
画像受信再生装置の構成を第３図に示す。
衛星放送回線や通信回線などからの画像情報は、受信回
路１０により、被圧縮ディジタル信号に嚢換され、圧縮
画像デコーダ１２により逐次デコードされ元の画像信号
に伸長復元される。デコーダ１２により復元された画像
信号は、２つのフレーム・メモリ１４．１６の内、モニ
タ表示に使用していない方に書き込まれる。２つのフレ
ーム・メモリ１４．１６の一方はモニタ表示（読出しモ
ード）用に使用され、他方は受信画像信号の書込み用に
使用される。モニタ表示用メモリと受信画像書込み用メ
モリとは交互に切り換えわるようになっている。例えば
フレーム・メモリ１４への受イ。
路１０により、被圧縮ディジタル信号に嚢換され、圧縮
画像デコーダ１２により逐次デコードされ元の画像信号
に伸長復元される。デコーダ１２により復元された画像
信号は、２つのフレーム・メモリ１４．１６の内、モニ
タ表示に使用していない方に書き込まれる。２つのフレ
ーム・メモリ１４．１６の一方はモニタ表示（読出しモ
ード）用に使用され、他方は受信画像信号の書込み用に
使用される。モニタ表示用メモリと受信画像書込み用メ
モリとは交互に切り換えわるようになっている。例えば
フレーム・メモリ１４への受イ。
画像信号の書き込みが終了すると、フレーム・メモリ１
４がモニタ表示用になり、フレーム・メモリ１６には次
の受信画像信号が書き込まれる。
４がモニタ表示用になり、フレーム・メモリ１６には次
の受信画像信号が書き込まれる。
表示用のフレーム・メモリからモニタ装置で表示するた
めにレート、即ちビデオ・レートで読み出されたデータ
は、Ｄ／Ａ変換器１８によりアナログ信号に変換され、
同期信号を付加されてモニタ装置２０に供給される。こ
れにより、受信画像が表示される。なお、２２は表示用
のフレーム・メモリの読出しアドレス及び読出しタイミ
ング（１号を発生する読出しアドレス及びタイミング発
７回路である。
めにレート、即ちビデオ・レートで読み出されたデータ
は、Ｄ／Ａ変換器１８によりアナログ信号に変換され、
同期信号を付加されてモニタ装置２０に供給される。こ
れにより、受信画像が表示される。なお、２２は表示用
のフレーム・メモリの読出しアドレス及び読出しタイミ
ング（１号を発生する読出しアドレス及びタイミング発
７回路である。
このように、２つのフレーム・メモリを表示用と書込み
用に切換えて使用するのは、以下の理１１１による。即
ち、第１に、表示用のメモリに、デコードした受信画像
を逐次書き込むと、表示系の１０Ｌ出しタイミングと競
合し、タイミング制御が極めて困難になる。第２にフレ
ーム・メモリとしてマルチポートＤＲＡＭを使用すれば
、書き込みタイミングと読出しタイミングの競合を避け
ることができるが、受信画像の書込みの進行に伴い、大
小画面が端から徐々に変化していき、非常に見苦しい画
面になる。
用に切換えて使用するのは、以下の理１１１による。即
ち、第１に、表示用のメモリに、デコードした受信画像
を逐次書き込むと、表示系の１０Ｌ出しタイミングと競
合し、タイミング制御が極めて困難になる。第２にフレ
ーム・メモリとしてマルチポートＤＲＡＭを使用すれば
、書き込みタイミングと読出しタイミングの競合を避け
ることができるが、受信画像の書込みの進行に伴い、大
小画面が端から徐々に変化していき、非常に見苦しい画
面になる。
また、２つのフレーム・メモリの切換えタイミングを垂
直帰線期間内に行なうことにより、画一上に見苦しい横
線が一瞬入るのを防止する方法も知られている。
直帰線期間内に行なうことにより、画一上に見苦しい横
線が一瞬入るのを防止する方法も知られている。
［発明が解決しようとする課題］
しかし、上記従来例では、現在表示中の画面の一部を更
新する部分伝送を行なう場合に、塩７１：表示中のフレ
ーム・メモリのデータを読み出し、ｙｓｌ＜分伝送領域
のみを更新して書き込み側のフレーム・メモリに書き込
む必要がある。従って、部分イム送領域が極めて小さい
場合でも、全画面領域のイム送を行なわざるを得す、こ
の伝送時間が長＜１！！（１＆な待ち時間になっていた
。例えばハイビジョンの場合、Ｒ，Ｇ、Ｂ同時に伝送で
きたとして、また、Ｄ Ｍ Ａ （Ｄｉｒｅｃｔ Ｍｅ
ｍｏｒｙ Ａｃｃｅｓｓ）用のハードウェアを追加した
としても、全画面の伝送には約０．８秒かかる計算にな
る。即ち、水平方向画素数を１９２０、垂直方向画素数
を１０３５、ＤＲＡＭパラレルポー１・・サイクルタイ
ムを２００ｎｓ、読出し書き込みに２→ノ。
新する部分伝送を行なう場合に、塩７１：表示中のフレ
ーム・メモリのデータを読み出し、ｙｓｌ＜分伝送領域
のみを更新して書き込み側のフレーム・メモリに書き込
む必要がある。従って、部分イム送領域が極めて小さい
場合でも、全画面領域のイム送を行なわざるを得す、こ
の伝送時間が長＜１！！（１＆な待ち時間になっていた
。例えばハイビジョンの場合、Ｒ，Ｇ、Ｂ同時に伝送で
きたとして、また、Ｄ Ｍ Ａ （Ｄｉｒｅｃｔ Ｍｅ
ｍｏｒｙ Ａｃｃｅｓｓ）用のハードウェアを追加した
としても、全画面の伝送には約０．８秒かかる計算にな
る。即ち、水平方向画素数を１９２０、垂直方向画素数
を１０３５、ＤＲＡＭパラレルポー１・・サイクルタイ
ムを２００ｎｓ、読出し書き込みに２→ノ。
イクルであるとすると、１９２０Ｘ １０３５Ｘ ２ｎ
ｓＸ ２＝ ７９４ｍ５である。
ｓＸ ２＝ ７９４ｍ５である。
また、ＤＭＡ用ハードウェアを用いないで圧縮画像デコ
ーダ内のＤ ＳＰ （Ｄｉｇｉｔａｌ Ｓｉｇｎａｌ
Ｐｒｏｃｅｓｓｏｒ）等のプロセッサが全画面伝送を行
なったＪｉｍ （’ｒには、更にこの数倍の時間がかか
り実用的でない。
ーダ内のＤ ＳＰ （Ｄｉｇｉｔａｌ Ｓｉｇｎａｌ
Ｐｒｏｃｅｓｓｏｒ）等のプロセッサが全画面伝送を行
なったＪｉｍ （’ｒには、更にこの数倍の時間がかか
り実用的でない。
そこで本発明は、このような課題を解決する両像受信再
生装置を提示することを目的とする。
生装置を提示することを目的とする。
［課題を解決するための手段］
本発明に係る画像受信再生装置は、伝送媒体や記憶媒体
から受信した画像情報から画像を再生する画像受信再生
装置であって、マルチポート・ランダム・アクセス・メ
モリからなる少なくとも２つのフレーム・メモリ手段と
、一方のフレーム・メモリ手段からシリアル・ポートを
経由してビデオ・レートで読み出した信号を他方のフレ
ーム・メモリ手段に書き込むメモリ制御手段とを設けた
ことを特徴とする。
から受信した画像情報から画像を再生する画像受信再生
装置であって、マルチポート・ランダム・アクセス・メ
モリからなる少なくとも２つのフレーム・メモリ手段と
、一方のフレーム・メモリ手段からシリアル・ポートを
経由してビデオ・レートで読み出した信号を他方のフレ
ーム・メモリ手段に書き込むメモリ制御手段とを設けた
ことを特徴とする。
［作用］
上記手段により、一方のフレーム・メモリの今内容を１
フレ一ム期間で他方のフレーム・メモリにコピーできる
。従って、受信画像の一部を更新する場合でも、その更
新部分の伝送に要する時間に、メモリ間コピーのための
１フレ一ム期間を力Ｉえた時間で、更新された画像を得
ることができる。
フレ一ム期間で他方のフレーム・メモリにコピーできる
。従って、受信画像の一部を更新する場合でも、その更
新部分の伝送に要する時間に、メモリ間コピーのための
１フレ一ム期間を力Ｉえた時間で、更新された画像を得
ることができる。
［実施例］
以下、図面を参照して本発明の詳細な説明する。
第１図は本発明の一実施例の構成ブロック図を示す。受
信回路３０は、衛星放送回線や通信同線などからの画像
情報を、被圧縮ディジタル信号に変換し、圧縮画像デコ
ーダ３２は受信回路３０の出力を逐次デコードし、元の
画像信号に伸長複元する。フレーム・メモリ８４．３６
は比較的一連（３０ｎｓ程度）にアクセスできるシリア
ルポートを持つマルチポートＤＲＡＭからなり、一方に
受信画像が書き込まれているときには、他方がｐｌｉ像
表示用に使用される。画像表示用のフレーム・メモリか
らビデオ・レートで読み出された画像データは、Ｄ／Ａ
変換器３８によりアナログ信８に変換され、同期信号を
付加されてモニタ装置４０に供給される。これにより、
受信画像が表示される。
信回路３０は、衛星放送回線や通信同線などからの画像
情報を、被圧縮ディジタル信号に変換し、圧縮画像デコ
ーダ３２は受信回路３０の出力を逐次デコードし、元の
画像信号に伸長複元する。フレーム・メモリ８４．３６
は比較的一連（３０ｎｓ程度）にアクセスできるシリア
ルポートを持つマルチポートＤＲＡＭからなり、一方に
受信画像が書き込まれているときには、他方がｐｌｉ像
表示用に使用される。画像表示用のフレーム・メモリか
らビデオ・レートで読み出された画像データは、Ｄ／Ａ
変換器３８によりアナログ信８に変換され、同期信号を
付加されてモニタ装置４０に供給される。これにより、
受信画像が表示される。
また、４２は走査線ライン番号を記憶・比較するレジス
タ及びコンパレータ等からなる伝送路ｊ′検知回路であ
り、ハイビジョン・システムの場合１１２５本の走査線
があるので、１１ビツトのレジスタ及びコンパレータで
よい。４４は、フレーム・メモリ８４．３６の読出しア
ドレス及び読出し・１１：込みタイミング信号を発生す
る読出しアドレス及び読出し・書込みタイミング発生回
路である。
タ及びコンパレータ等からなる伝送路ｊ′検知回路であ
り、ハイビジョン・システムの場合１１２５本の走査線
があるので、１１ビツトのレジスタ及びコンパレータで
よい。４４は、フレーム・メモリ８４．３６の読出しア
ドレス及び読出し・１１：込みタイミング信号を発生す
る読出しアドレス及び読出し・書込みタイミング発生回
路である。
次に、フレーム・メモリ３４を画像表示用に他用し、フ
レーム・メモリ３６に受信画像信号を１１：き込んでい
る状態で、フレーム・メモリ３４の記憶内容を部分伝送
により一部書き換える場合の動作を説明する。
レーム・メモリ３６に受信画像信号を１１：き込んでい
る状態で、フレーム・メモリ３４の記憶内容を部分伝送
により一部書き換える場合の動作を説明する。
圧縮画像デコーダ３２は、部分伝送の指令を迭信側から
受信すると、読出しアドレス及び読出し・書込みタイミ
ング発生回路４４及び伝送終了検知回路４２にフレーム
・メモリ間伝送の指令を出力する。読出しアドレス及び
読出し・書込みタイミング発生回路４４はこの指令に応
答して、フレーム・メモリ３６を、フレーム・メモリ読
出しハスに接続するシリアル・ポートから書き込むライ
ト転送モードにし、伝送終了検知回路４２は現在走査中
の走査線ライン番号を保持する。
受信すると、読出しアドレス及び読出し・書込みタイミ
ング発生回路４４及び伝送終了検知回路４２にフレーム
・メモリ間伝送の指令を出力する。読出しアドレス及び
読出し・書込みタイミング発生回路４４はこの指令に応
答して、フレーム・メモリ３６を、フレーム・メモリ読
出しハスに接続するシリアル・ポートから書き込むライ
ト転送モードにし、伝送終了検知回路４２は現在走査中
の走査線ライン番号を保持する。
フレーム・メモリ３６の書込みアドレスはフレーム・メ
モリ３４の読出しアドレスと同一なので、フレーム・メ
モリ３４から読み出された画像データが、フレーム・メ
モリ読出しバスを経由してフレーム・メモリ３６の同じ
アドレス位置に書き込まれる。１フレ一ム期間経過した
後、伝送終了検知回路４２は、先に保持したのと同じ走
査線ライン番号を検知すると、読出しアドレス及び読出
し・書込みタイミング発生回路４４に対してフレーム・
メモリ８６へのライト転送モード指示を中１１゜させ、
圧縮画像デコーダ３２に伝送終了割込みを掛ける。圧縮
画像デコーダ３２は、この伝送路ｒ割込みにより、フレ
ーム・メモリ３４の内容が令でフレーム・メモリ３６に
コピーされたことをｔ４る。ここまでの動作は、約１フ
レーム期間（約３３．３ｍ５）で終了する。
モリ３４の読出しアドレスと同一なので、フレーム・メ
モリ３４から読み出された画像データが、フレーム・メ
モリ読出しバスを経由してフレーム・メモリ３６の同じ
アドレス位置に書き込まれる。１フレ一ム期間経過した
後、伝送終了検知回路４２は、先に保持したのと同じ走
査線ライン番号を検知すると、読出しアドレス及び読出
し・書込みタイミング発生回路４４に対してフレーム・
メモリ８６へのライト転送モード指示を中１１゜させ、
圧縮画像デコーダ３２に伝送終了割込みを掛ける。圧縮
画像デコーダ３２は、この伝送路ｒ割込みにより、フレ
ーム・メモリ３４の内容が令でフレーム・メモリ３６に
コピーされたことをｔ４る。ここまでの動作は、約１フ
レーム期間（約３３．３ｍ５）で終了する。
その後、圧縮画像デコーダ３２は、部分伝送された部分
画像を伸長復元し、フレーム・メモリ３６の対応記憶位
置に重ね書きする。その後、ａ／、ｉ側の指示により、
今度はフレーム・メモリ３６を表示用に切り換える。
画像を伸長復元し、フレーム・メモリ３６の対応記憶位
置に重ね書きする。その後、ａ／、ｉ側の指示により、
今度はフレーム・メモリ３６を表示用に切り換える。
第２図は、本発明の別の実施例の構成ブロック図を示す
。第１図と同じ構成要素には同じ初号を付しである。フ
レーム・メモリ３４の内容を全てフレーム・メモリ３６
にコピーするのに要するＩＩ！ｊ間は１フレ一ム期間で
あるから、伝送終了検知回路４２の代わりに、圧縮画像
デコーダ３２からの伝送要求信号から１フレ一ム期間後
に圧縮画像デコーダ３２に伝送終了割込み要求を掛ける
タイマを設ければよい。４６がそのインターバル・タイ
マである。即ち、インターバル・タイマ４６は、圧縮画
像デコーダ３２の伝送要求出力から１フレ一ム期間後に
、第１図に関連して説明した伝送終了割込み要求を圧縮
画像デコーダ３２に掛ける。
。第１図と同じ構成要素には同じ初号を付しである。フ
レーム・メモリ３４の内容を全てフレーム・メモリ３６
にコピーするのに要するＩＩ！ｊ間は１フレ一ム期間で
あるから、伝送終了検知回路４２の代わりに、圧縮画像
デコーダ３２からの伝送要求信号から１フレ一ム期間後
に圧縮画像デコーダ３２に伝送終了割込み要求を掛ける
タイマを設ければよい。４６がそのインターバル・タイ
マである。即ち、インターバル・タイマ４６は、圧縮画
像デコーダ３２の伝送要求出力から１フレ一ム期間後に
、第１図に関連して説明した伝送終了割込み要求を圧縮
画像デコーダ３２に掛ける。
放送衛星や光ファイバなどを経由して受信した画像情報
を再生表示する場合を例に説明したが、本発明は勿論、
光ディスク、光磁気ディスクなどの大容量記録媒体に圧
縮記録した画像情報をｉｌｉ １表示する場合にも適用
できることはいうまでもない。
を再生表示する場合を例に説明したが、本発明は勿論、
光ディスク、光磁気ディスクなどの大容量記録媒体に圧
縮記録した画像情報をｉｌｉ １表示する場合にも適用
できることはいうまでもない。
［発明の効果］
以上の説明から容易に理解できるように、本発明によれ
ば、受信画像の一部を更新する場合、その更新部分が少
ない場合には、短時間で、更新された画像を得ることが
できる。
ば、受信画像の一部を更新する場合、その更新部分が少
ない場合には、短時間で、更新された画像を得ることが
できる。
第１図は本発明の一実施例の構成ブロック図、第２図は
本発明の別の実施例の構成ブロック図、第３図は従来例
の構成ブロック図である。
本発明の別の実施例の構成ブロック図、第３図は従来例
の構成ブロック図である。
Claims (1)
- 伝送媒体や記憶媒体から受信した画像情報から画像を再
生する画像受信再生装置であって、マルチポート・ラン
ダム・アクセス・メモリからなる少なくとも２つのフレ
ーム・メモリ手段と、一方のフレーム・メモリ手段から
シリアル・ポートを経由してビデオ・レートで読み出し
た信号を他方のフレーム・メモリ手段に書き込むメモリ
制御手段とを具備することを特徴とする画像受信再生装
置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32458789A JP3020528B2 (ja) | 1989-12-14 | 1989-12-14 | 画像処理装置 |
| US08/320,821 US5438376A (en) | 1989-12-14 | 1994-10-06 | Image processing apparatus and image reception apparatus using the same |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP32458789A JP3020528B2 (ja) | 1989-12-14 | 1989-12-14 | 画像処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03185987A true JPH03185987A (ja) | 1991-08-13 |
| JP3020528B2 JP3020528B2 (ja) | 2000-03-15 |
Family
ID=18167482
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP32458789A Expired - Fee Related JP3020528B2 (ja) | 1989-12-14 | 1989-12-14 | 画像処理装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5438376A (ja) |
| JP (1) | JP3020528B2 (ja) |
Families Citing this family (13)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06276520A (ja) * | 1993-03-22 | 1994-09-30 | Sony Corp | 画像処理装置 |
| KR100363588B1 (ko) * | 1993-03-25 | 2003-02-17 | 세이코 엡슨 가부시키가이샤 | 화상처리장치 |
| US6300963B1 (en) * | 1993-11-30 | 2001-10-09 | Texas Instruments Incorporated | Single-frame display memory for spatial light modulator |
| JPH07261734A (ja) * | 1994-03-17 | 1995-10-13 | Fujitsu Ltd | マルチウィンドウ表示装置 |
| WO1995033255A1 (en) * | 1994-05-27 | 1995-12-07 | Hughes Aircraft Company | Low latency update of graphic objects in an air traffic control display |
| JPH08147479A (ja) * | 1994-11-17 | 1996-06-07 | Hitachi Ltd | 画像出力装置並びに画像復号化装置 |
| TW395137B (en) * | 1997-06-06 | 2000-06-21 | Matsushita Electric Industrial Co Ltd | Image processing device |
| US6633344B1 (en) * | 1999-07-15 | 2003-10-14 | Thomson Licensing S.A. | Processing of progressive video signals in digital TV receivers |
| JP3613514B2 (ja) * | 2000-06-12 | 2005-01-26 | 三菱電機株式会社 | ディジタル画像データ出力装置及びディジタル画像データ出力方法 |
| KR100440405B1 (ko) * | 2001-11-19 | 2004-07-14 | 삼성전자주식회사 | 더블 버퍼링을 이용한 화상 데이터 출력 제어장치 |
| CN100551074C (zh) * | 2005-01-17 | 2009-10-14 | 松下电器产业株式会社 | 图像解码方法、图像解码装置和集成电路 |
| US9716852B2 (en) | 2015-04-03 | 2017-07-25 | Semiconductor Energy Laboratory Co., Ltd. | Broadcast system |
| US20250005704A1 (en) * | 2023-06-28 | 2025-01-02 | Texas Instruments Incorporated | Methods and apparatus to animate a splash screen |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63128884A (ja) * | 1986-11-19 | 1988-06-01 | Canon Inc | テレビジヨン会議システム |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4562435A (en) * | 1982-09-29 | 1985-12-31 | Texas Instruments Incorporated | Video display system using serial/parallel access memories |
| JPS6247786A (ja) * | 1985-08-27 | 1987-03-02 | Hamamatsu Photonics Kk | 近傍画像処理専用メモリ |
| US4742350A (en) * | 1986-02-14 | 1988-05-03 | International Business Machines Corporation | Software managed video synchronization generation |
| US4891788A (en) * | 1988-05-09 | 1990-01-02 | Kreifels Gerard A | FIFO with almost full/almost empty flag |
| JPH02246087A (ja) * | 1989-03-20 | 1990-10-01 | Hitachi Ltd | 半導体記憶装置ならびにその冗長方式及びレイアウト方式 |
-
1989
- 1989-12-14 JP JP32458789A patent/JP3020528B2/ja not_active Expired - Fee Related
-
1994
- 1994-10-06 US US08/320,821 patent/US5438376A/en not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63128884A (ja) * | 1986-11-19 | 1988-06-01 | Canon Inc | テレビジヨン会議システム |
Also Published As
| Publication number | Publication date |
|---|---|
| US5438376A (en) | 1995-08-01 |
| JP3020528B2 (ja) | 2000-03-15 |
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