JPH03217172A - ビデオ信号処理回路 - Google Patents
ビデオ信号処理回路Info
- Publication number
- JPH03217172A JPH03217172A JP2013243A JP1324390A JPH03217172A JP H03217172 A JPH03217172 A JP H03217172A JP 2013243 A JP2013243 A JP 2013243A JP 1324390 A JP1324390 A JP 1324390A JP H03217172 A JPH03217172 A JP H03217172A
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- Japan
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- signal
- multiplier
- electric field
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は走査線補間を行うビデオ信号処理回路に関し、
特にディジタル化されたビデオデータにより、走査線補
関するものに関する。
特にディジタル化されたビデオデータにより、走査線補
関するものに関する。
［従来の技術］
いわゆる工ＤＴ’Ｖ，ディジタルテレビと呼ばれるもの
は、３次元Ｙ ／ Ｏ分離とともに走査線補間を行いイ
ンターレースを行う技術から成り立っている。特に走査
線補間は垂直解像度が上がる。ラインフリッカが目立た
な《なる等画像の品質向上には重要である。走査線補間
の方法としては１水平走査期間（以下ＩＲと略す）画像
データを記憶する１Ｈラインメモリまたは１Ｈ遅延させ
る遅延回路により、現在の信号と１Ｈ前の信号との平均
値を作り、その平均値により走査線補間を行う方法があ
る。
は、３次元Ｙ ／ Ｏ分離とともに走査線補間を行いイ
ンターレースを行う技術から成り立っている。特に走査
線補間は垂直解像度が上がる。ラインフリッカが目立た
な《なる等画像の品質向上には重要である。走査線補間
の方法としては１水平走査期間（以下ＩＲと略す）画像
データを記憶する１Ｈラインメモリまたは１Ｈ遅延させ
る遅延回路により、現在の信号と１Ｈ前の信号との平均
値を作り、その平均値により走査線補間を行う方法があ
る。
［発明が解決しようとする課題コ
ところが、このような走査線補間を行うと次の事が問題
となって《る。ノイズの少ないビデオソース、例えば光
学式読み取りディスクや高画質ＶＴＲなどを再生する場
合、または安定して良好なテレビジョン受信が行える場
合は走査線補間を行なう効果もでてくる。しかし電界強
度が弱い地域でのテレビジョン受信の様な場合゛は、充
分にＳ／Ｎがとれないため、走査線補間による画質向上
よりも、Ｓ ／ Ｎの改善の方が望まれる。
となって《る。ノイズの少ないビデオソース、例えば光
学式読み取りディスクや高画質ＶＴＲなどを再生する場
合、または安定して良好なテレビジョン受信が行える場
合は走査線補間を行なう効果もでてくる。しかし電界強
度が弱い地域でのテレビジョン受信の様な場合゛は、充
分にＳ／Ｎがとれないため、走査線補間による画質向上
よりも、Ｓ ／ Ｎの改善の方が望まれる。
本発明では、ＩＨ以上遅延できる遅延回路を用いて、走
査線補間と、現在の信号の平均とを適応的に加算したこ
とにより、ノイズの少ない画面では走査線補間を選択し
、垂直方向の解像度を上げノイズの多い画面では現在の
信号とメモリの平均値を選択するように切シ替えを行な
えるようにしたことで、ノイズの少ない画面では垂直方
向の解像度を向上させ、ノイズの多い画面ではノイズ量
を減らすことを目的とする。
査線補間と、現在の信号の平均とを適応的に加算したこ
とにより、ノイズの少ない画面では走査線補間を選択し
、垂直方向の解像度を上げノイズの多い画面では現在の
信号とメモリの平均値を選択するように切シ替えを行な
えるようにしたことで、ノイズの少ない画面では垂直方
向の解像度を向上させ、ノイズの多い画面ではノイズ量
を減らすことを目的とする。
［課題を解決するための手段］
前記目的を達成するために本発明のビデオ信号処理回路
は、 （１）α） 走査線補間を行うビデオ信号処理回路にお
いて、 ｂ） 少なくとも１水平走査期間遅延できる遅延装置と
、 Ｃ） 前記遅延装置の出力と現在の信号の平均を出力す
る演算器と、 ｄ） 現在の信号を係数Ｋ倍する乗算器１と、ｅ） 前
記演算器の出力を係数（ １ −Ｋ ）倍する乗算器２
と ｆ） 前記乗算器１の出力と前記乗算器２の出力を加算
する加算器と ！１） 前記加算器の出力と前記演算器の出力により走
査線補間を行う補間回路と、 ん） 前記乗算器１と前記乗算器２の係数Ｋ゛を制御す
る制御回路を備えたことを特徴とする。
は、 （１）α） 走査線補間を行うビデオ信号処理回路にお
いて、 ｂ） 少なくとも１水平走査期間遅延できる遅延装置と
、 Ｃ） 前記遅延装置の出力と現在の信号の平均を出力す
る演算器と、 ｄ） 現在の信号を係数Ｋ倍する乗算器１と、ｅ） 前
記演算器の出力を係数（ １ −Ｋ ）倍する乗算器２
と ｆ） 前記乗算器１の出力と前記乗算器２の出力を加算
する加算器と ！１） 前記加算器の出力と前記演算器の出力により走
査線補間を行う補間回路と、 ん） 前記乗算器１と前記乗算器２の係数Ｋ゛を制御す
る制御回路を備えたことを特徴とする。
（２）（Ｚ） テｖビジ目ン放送の受信を行うチュー
ナと、 ｂ） 前記チューナより電界強度の検出を行い、前記制
御回路に出力する検出回路を備えたことを特徴とする。
ナと、 ｂ） 前記チューナより電界強度の検出を行い、前記制
御回路に出力する検出回路を備えたことを特徴とする。
［実施例コ
以下本発明の一構成例を図面に基づき説明するｍｌ１図
は本発明によるビデオ信号処理回路の構成図である。
は本発明によるビデオ信号処理回路の構成図である。
１０１インターレース信号は、例えばコンボジットビデ
オ信号、輝度信号、色信号等である。１０２１Ｈ遅延回
路はＩＨの遅延ができるシフトレジスタであればよく、
また１Ｈのラインメモリで構成してもよい。１０６加算
器は現在の信号と１０２１Ｈ遅延回路の出力信号を加算
するもので、１０４シフトレジスタで１／２倍すること
と合わせて、現在の信号と１０２１Ｈ遅延回路の出力信
号の平均値（以下この信号を平均値信号と略す）を取る
ものである。この構成は現在の信号と１０２１Ｈ遅延回
路の出力信号の平均値が得られればどの様なものでもよ
《、例えばシフトレジスタにて各々の信号を１／２倍し
、その後加算する構成でもよい。１０５乗算器１は現在
の信号と１１３制御回路により決められる乗数Ｋとを掛
け合わせるものである。１０６乗算器２は１０４７７ト
レジスタの出力信号と１１３制御回路により決められる
乗数（１−Ｋ）を掛け合わせるものである１０７加算器
は１０５乗算器１と１０６乗算器２の出力を加算するも
のである。１０８補間回路は１０７加算回路の出力と１
０４シフトレジスタの出力、すなわち平均値信号を基に
倍速補間を行い、１０９倍速補間信号を得る。１１０ア
ンテナ，１１１チューナはテレビジョン放送を受信する
もので、この受信信号より、１１０電界強度検出回路に
て現在受信を行っているチャンネルの電界強度を検出す
る。これは１０９チューナのＲＦＡＧＯ、色復調回路で
用いられるカラーキラー信号等により簡単に実現できる
。１１２電界強度検出回路の出力は１１６制御回路に送
られ、１１４ビデオ／ Ｒ Ｆ判別信号と合わせて、先
程述べた１０５乗算器１と１０６乗算器２の乗数Ｋを決
める。
オ信号、輝度信号、色信号等である。１０２１Ｈ遅延回
路はＩＨの遅延ができるシフトレジスタであればよく、
また１Ｈのラインメモリで構成してもよい。１０６加算
器は現在の信号と１０２１Ｈ遅延回路の出力信号を加算
するもので、１０４シフトレジスタで１／２倍すること
と合わせて、現在の信号と１０２１Ｈ遅延回路の出力信
号の平均値（以下この信号を平均値信号と略す）を取る
ものである。この構成は現在の信号と１０２１Ｈ遅延回
路の出力信号の平均値が得られればどの様なものでもよ
《、例えばシフトレジスタにて各々の信号を１／２倍し
、その後加算する構成でもよい。１０５乗算器１は現在
の信号と１１３制御回路により決められる乗数Ｋとを掛
け合わせるものである。１０６乗算器２は１０４７７ト
レジスタの出力信号と１１３制御回路により決められる
乗数（１−Ｋ）を掛け合わせるものである１０７加算器
は１０５乗算器１と１０６乗算器２の出力を加算するも
のである。１０８補間回路は１０７加算回路の出力と１
０４シフトレジスタの出力、すなわち平均値信号を基に
倍速補間を行い、１０９倍速補間信号を得る。１１０ア
ンテナ，１１１チューナはテレビジョン放送を受信する
もので、この受信信号より、１１０電界強度検出回路に
て現在受信を行っているチャンネルの電界強度を検出す
る。これは１０９チューナのＲＦＡＧＯ、色復調回路で
用いられるカラーキラー信号等により簡単に実現できる
。１１２電界強度検出回路の出力は１１６制御回路に送
られ、１１４ビデオ／ Ｒ Ｆ判別信号と合わせて、先
程述べた１０５乗算器１と１０６乗算器２の乗数Ｋを決
める。
１１３制御回路はその他に、１０２１Ｈ遅延回路１０４
シフトレジスタ、１０８補間回路を制御するが、この制
御は他に制御部を設け、そこで行ってもよい。
シフトレジスタ、１０８補間回路を制御するが、この制
御は他に制御部を設け、そこで行ってもよい。
第１図のビデオ信号処理回路の動作を第２図により説明
する。１１４ビデオ／ Ｒ Ｆ判別信号は今ＲＦ信号を
判別しているとする。１０２１Ｈ遅延回路は１０１イン
ターレース信号を１Ｈ遅延させたもので、その出力はす
なわち、現在の信号より１Ｈ前の画像信号である。１０
４シフトレジスタの出力は現在の信号と１０２１Ｈ遅延
回路の出力信号の平均値信号である。平均を取ることは
、情報を減らすことになるが、ノイズの低減に対しては
有効な手段である。例えば１Ｈ前の画像信号と現在の画
像信号の相関が強いとすれば平均値をとることで、ノイ
ズ量は電力で１／２、振幅で１／ごになる。従って平均
値を用いた方が、原信号よりもノイズに強いことが分る
。
する。１１４ビデオ／ Ｒ Ｆ判別信号は今ＲＦ信号を
判別しているとする。１０２１Ｈ遅延回路は１０１イン
ターレース信号を１Ｈ遅延させたもので、その出力はす
なわち、現在の信号より１Ｈ前の画像信号である。１０
４シフトレジスタの出力は現在の信号と１０２１Ｈ遅延
回路の出力信号の平均値信号である。平均を取ることは
、情報を減らすことになるが、ノイズの低減に対しては
有効な手段である。例えば１Ｈ前の画像信号と現在の画
像信号の相関が強いとすれば平均値をとることで、ノイ
ズ量は電力で１／２、振幅で１／ごになる。従って平均
値を用いた方が、原信号よりもノイズに強いことが分る
。
今、１１０アンテナ、１１１チューナにてテレビジョン
放送を受信しているとき、１１０電界強度検出回路は電
界強と出力しているとする。１１３制御回路は１０５乗
算器１の係数Ｋを１にするこの結果、１０６乗算器２の
係数（ １ −Ｋ ）は０となるため、１０７加算器の
出力は現在の信号がそのまま出力される。従って１０９
倍速補間信号は平均値信号と１０１インターレース信号
が交互に出力される型となる。
放送を受信しているとき、１１０電界強度検出回路は電
界強と出力しているとする。１１３制御回路は１０５乗
算器１の係数Ｋを１にするこの結果、１０６乗算器２の
係数（ １ −Ｋ ）は０となるため、１０７加算器の
出力は現在の信号がそのまま出力される。従って１０９
倍速補間信号は平均値信号と１０１インターレース信号
が交互に出力される型となる。
次に電界が除々に弱くなっていくとする。１１２電界強
度検出回路は電界弱になってきたことを１１３制御回路
に出力する。１１３制御回路はこれにより係数Ｋを小さ
《する。従って１・０６乗算器２の係数（ １ −Ｋ
）はしだいに太き《なる。１０７の加算器の出力結果は
図２から分るように１０１インターレース信号と平均値
信号の加算となりその絶対値は１のまま、その割合いは
電界が弱《なるにともなって、平均値信号の方が増加す
る１０９倍速補間信号は１０１インターレース信号と平
均値信号の加算結果と平均値信号が交互に出力される型
となる。電界が弱いところから強くなる場合はこの逆の
動作を行う。
度検出回路は電界弱になってきたことを１１３制御回路
に出力する。１１３制御回路はこれにより係数Ｋを小さ
《する。従って１・０６乗算器２の係数（ １ −Ｋ
）はしだいに太き《なる。１０７の加算器の出力結果は
図２から分るように１０１インターレース信号と平均値
信号の加算となりその絶対値は１のまま、その割合いは
電界が弱《なるにともなって、平均値信号の方が増加す
る１０９倍速補間信号は１０１インターレース信号と平
均値信号の加算結果と平均値信号が交互に出力される型
となる。電界が弱いところから強くなる場合はこの逆の
動作を行う。
電界が弱《なり、１１２電界強度検出回路が、完全に電
界弱と判断すれば１１３制御回路は係数Ｋを０にし１０
６乗算器２の係数（１−Ｘ）は１となるため、厠算器の
出力結果は平均値信号だけとなる。１０９倍速補間信号
はこの結果平均値信号が２回繰り返えされる型となる。
界弱と判断すれば１１３制御回路は係数Ｋを０にし１０
６乗算器２の係数（１−Ｘ）は１となるため、厠算器の
出力結果は平均値信号だけとなる。１０９倍速補間信号
はこの結果平均値信号が２回繰り返えされる型となる。
以上の動作を行うことにより、電界が強い時は垂直解像
度が上がり、電界が弱い時にはノイズの少ない鋏像が得
られる。この切シ替えは１ １ ３ｉｔｌｌ御回路は係
数Ｋの制御精度が上がるほどにより目立たな《なるが、
もしその精度を落して目立つようになると、この切ク替
えを帰線期間で行う、切シ替えにある期間ヒステリシス
を持たせるようにする等で目障わりをな《すことができ
る。
度が上がり、電界が弱い時にはノイズの少ない鋏像が得
られる。この切シ替えは１ １ ３ｉｔｌｌ御回路は係
数Ｋの制御精度が上がるほどにより目立たな《なるが、
もしその精度を落して目立つようになると、この切ク替
えを帰線期間で行う、切シ替えにある期間ヒステリシス
を持たせるようにする等で目障わりをな《すことができ
る。
また、乗算器の係数Ｋを１から０．５までの間で変化さ
せることで１０３加算器、１０４シフトレジスタを省略
できることは言うまでもない。
せることで１０３加算器、１０４シフトレジスタを省略
できることは言うまでもない。
［発明・の効果コ
以上のように本発明によれば、ノイズの少ない画面では
垂直方向の解像度が上がり、ノイズの多い画面ではノイ
ズを減少させるような走査補間回路が簡拳な構成で実現
できるため、コストダウンが図れ、小型化も容易となる
。
垂直方向の解像度が上がり、ノイズの多い画面ではノイ
ズを減少させるような走査補間回路が簡拳な構成で実現
できるため、コストダウンが図れ、小型化も容易となる
。
更に、電界強度により、補間モードが自動的にかつ段階
的に変化するため、テレビジョン受信時にユーザは何ら
操作をすることなしに、常に良好な画質が得られ、小型
携帯用テレビ受信機に最適である。
的に変化するため、テレビジョン受信時にユーザは何ら
操作をすることなしに、常に良好な画質が得られ、小型
携帯用テレビ受信機に最適である。
第１図は、本発明によるビデオ信号処理回路の構成図。
第２図は、第１図の制御を表わす動作図。
１０１・・・・・・インターレース信号１０２・・・・
・・１Ｈ遅延回路 １０３・・・・・・加算器 １０４・・・・・・シフトレジスタ １０５・・・・・・乗算器１ １０６・・・・・・乗算器２ １０７・・・・・・加算器 １０８・・・・・・補間回路 １０９・・・・・・倍速補間回路 １１０・・・・・・アンテナ １１１・・・・・・チューナ １１２・・・・・・電界強度検出回路 １１６・・・・・・制御回路
・・１Ｈ遅延回路 １０３・・・・・・加算器 １０４・・・・・・シフトレジスタ １０５・・・・・・乗算器１ １０６・・・・・・乗算器２ １０７・・・・・・加算器 １０８・・・・・・補間回路 １０９・・・・・・倍速補間回路 １１０・・・・・・アンテナ １１１・・・・・・チューナ １１２・・・・・・電界強度検出回路 １１６・・・・・・制御回路
Claims (2)
- （１）ａ）走査線補間を行うビデオ信号処理回路におい
て、 ｂ）少なくとも１水平走査期間遅延できる遅延装置と、 ｃ）前記遅延装置の出力と現在の信号の平均を出力する
演算器と ｄ）現在の信号を係数ｋ倍する乗算器１と、 ｅ）前記演算器の出力を係数（１−ｋ）倍する乗算器２
と ｆ）前記乗算器１の出力と前記乗算器２の出力を加算す
る加算器と、 ｇ）前記加算器の出力と前記演算器の出力により走査線
補間を行う補間回路と、 ｈ）前記乗算器１と前記乗算器２の係数ｋを制御する制
御回路を備えたことを特徴とするビデオ信号処理回路。 - （２）ａ）テレビジョン放送の受信を行うチューナと、 ｂ）前記チューナより電界強度の検出を行い、前記制御
回路に出力する検出回路を備えたことを特徴とする請求
項１記載のビデオ信号処理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2013243A JPH03217172A (ja) | 1990-01-23 | 1990-01-23 | ビデオ信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2013243A JPH03217172A (ja) | 1990-01-23 | 1990-01-23 | ビデオ信号処理回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03217172A true JPH03217172A (ja) | 1991-09-24 |
Family
ID=11827762
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2013243A Pending JPH03217172A (ja) | 1990-01-23 | 1990-01-23 | ビデオ信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03217172A (ja) |
-
1990
- 1990-01-23 JP JP2013243A patent/JPH03217172A/ja active Pending
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