JPH03230639A - データ通信装置 - Google Patents
データ通信装置Info
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- JPH03230639A JPH03230639A JP2025601A JP2560190A JPH03230639A JP H03230639 A JPH03230639 A JP H03230639A JP 2025601 A JP2025601 A JP 2025601A JP 2560190 A JP2560190 A JP 2560190A JP H03230639 A JPH03230639 A JP H03230639A
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- data transmission
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/42—Loop networks
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/40—Bus networks
- H04L12/40006—Architecture of a communication node
- H04L12/40032—Details regarding a bus interface enhancer
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Small-Scale Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
この発明はリング状のデータ伝送ラインを介して親局と
の間でデータ通信を行なうデータ通信装置に関するもの
である。
の間でデータ通信を行なうデータ通信装置に関するもの
である。
［従来の技術］
親局と複数の子局間でリング状のデータ伝送ラインを介
してシリアルデータからなるデータ列の伝送により情報
を送受信するループ式データ通信システムが多用されて
いる。
してシリアルデータからなるデータ列の伝送により情報
を送受信するループ式データ通信システムが多用されて
いる。
第５図はデータ通信システムを形成したデータ通信装置
の概略を示す図である。図において、＋１）は親局、（
２Ａ）〜（２Ｄ）は接続箱、（３＾）および（３Ｃ）、
（３Ｄ）は子局としての可搬形のデータ通信ターミナル
（以下子局と記す）であり、それぞれ接続箱（２Ａ）お
よび（２Ｃ）、（２Ｄ）に対し、取り付け、取り外し自
在に接続されている。なお、データ通信装置は上記子局
と接続箱にて構成される。（４Ａ）〜（４Ｅ）は親局（
１）と接続箱（２Ａ）〜（２Ｄ）を直列に、かつリング
状に接続するデータ伝送ラインとしての伝送ケプルであ
る。
の概略を示す図である。図において、＋１）は親局、（
２Ａ）〜（２Ｄ）は接続箱、（３＾）および（３Ｃ）、
（３Ｄ）は子局としての可搬形のデータ通信ターミナル
（以下子局と記す）であり、それぞれ接続箱（２Ａ）お
よび（２Ｃ）、（２Ｄ）に対し、取り付け、取り外し自
在に接続されている。なお、データ通信装置は上記子局
と接続箱にて構成される。（４Ａ）〜（４Ｅ）は親局（
１）と接続箱（２Ａ）〜（２Ｄ）を直列に、かつリング
状に接続するデータ伝送ラインとしての伝送ケプルであ
る。
第６図は第５図に示した接続箱（２＾）および子局（３
＾）からなる従来のデータ通信装置の構成を示すブロッ
ク図である。図において、（６）は接続箱（２＾）に内
蔵され、データ伝送ラインを切り換える切り換え器であ
り、コイル（６Ｂ）が励磁されると接点（６Ａ）を八個
からＢ側に切換える。（７）は子局（３Ａ）に内蔵され
た通信インターフェース回路であり、この回路（７）に
より、親局（１）とデータの送受信を行なう。（１０＾
）〜ｆｌＯＥｌは接続箱（２人）と各信号の接続を行な
う端子、（８）は接続箱（２＾）に内蔵され接続箱（２
Ａ）の端子（１００） （ＩＯＥＩ を短絡する短絡片
である。（９）は外部より供給される切り換え器（６）
を駆動する為の電源である。第７図は親局（１）から送
信されるデータ列の伝送フレームを示す。
＾）からなる従来のデータ通信装置の構成を示すブロッ
ク図である。図において、（６）は接続箱（２＾）に内
蔵され、データ伝送ラインを切り換える切り換え器であ
り、コイル（６Ｂ）が励磁されると接点（６Ａ）を八個
からＢ側に切換える。（７）は子局（３Ａ）に内蔵され
た通信インターフェース回路であり、この回路（７）に
より、親局（１）とデータの送受信を行なう。（１０＾
）〜ｆｌＯＥｌは接続箱（２人）と各信号の接続を行な
う端子、（８）は接続箱（２＾）に内蔵され接続箱（２
Ａ）の端子（１００） （ＩＯＥＩ を短絡する短絡片
である。（９）は外部より供給される切り換え器（６）
を駆動する為の電源である。第７図は親局（１）から送
信されるデータ列の伝送フレームを示す。
データ列は、データ伝送開始を表わすフラグ（６０）と
、１局当りｎビットで構成され、ｍ局分のｎ×ｍビット
のデータ（６エ）と、伝送の休止中、即ち無通信状態を
表わすアイドル（６２）から構成される。
、１局当りｎビットで構成され、ｍ局分のｎ×ｍビット
のデータ（６エ）と、伝送の休止中、即ち無通信状態を
表わすアイドル（６２）から構成される。
第８図は第７図の伝送フレームの詳細を表わす図であり
、フラグ（６Ｇ）、データ（６１）はｌ″、−〇−から
なるシリアルデータ列から構成され、無通信状態を表わ
すアイドル（６２）は連続する−０−にて示される。即
ち、データ列は＝ １１１１０１〜で構成されるフラグ
波形（６０Ａｌ と、グイパルスで構成されるデータ部
波形（６１＾）とデータの休止状態を表す４ビット以上
−〇′の連続するアイドル波形（６２Ａ）に分かれる。
、フラグ（６Ｇ）、データ（６１）はｌ″、−〇−から
なるシリアルデータ列から構成され、無通信状態を表わ
すアイドル（６２）は連続する−０−にて示される。即
ち、データ列は＝ １１１１０１〜で構成されるフラグ
波形（６０Ａｌ と、グイパルスで構成されるデータ部
波形（６１＾）とデータの休止状態を表す４ビット以上
−〇′の連続するアイドル波形（６２Ａ）に分かれる。
次に、第６図〜第８図により従来例のデータ通信装置の
動作について説明する。第６図において接続箱（２＾）
に子局（３Ａ）を接続しない場合、接続箱の端子（ＩＯ
ＤＩ と端子（ＩＯＥＩ間は開放状態となっている。切
り換え器（６） に対し、端子（１００１および（ＩＯ
ＥＩ間が開放状態であるため切り換え器駆動用の電ｉｆ
！ （９）の電圧が切り換え器（６）に印加されず切り
換え器（６）の接点（６＾）はＡ側と接触している。
動作について説明する。第６図において接続箱（２＾）
に子局（３Ａ）を接続しない場合、接続箱の端子（ＩＯ
ＤＩ と端子（ＩＯＥＩ間は開放状態となっている。切
り換え器（６） に対し、端子（１００１および（ＩＯ
ＥＩ間が開放状態であるため切り換え器駆動用の電ｉｆ
！ （９）の電圧が切り換え器（６）に印加されず切り
換え器（６）の接点（６＾）はＡ側と接触している。
従ってデータ伝送ライン（４Ａ）は切り換え器（６）の
接点（６Ａ）を通して次局へのデータ伝送ライン（４Ｂ
）に接続される。即ち、接続箱（２Ａ）は子局バイパス
状態にあり、親局から送られて来るデータ列はそのまま
次局へ送出される。
接点（６Ａ）を通して次局へのデータ伝送ライン（４Ｂ
）に接続される。即ち、接続箱（２Ａ）は子局バイパス
状態にあり、親局から送られて来るデータ列はそのまま
次局へ送出される。
次に子局Ｃ３＾）を接続箱〔２Ａ）に接続した場合の動
作について説明する。子局（３＾）を接続箱（２＾）に
接続すると、子局（３Ａ）内の短絡片（８）により端子
（１００）とｆＩＯＥＩ間が短絡され、切り換え器駆動
用の電源（９）から切り換え器（６）へ電圧が印加され
、切り換え器（６）の接点（６＾）が八個からＢ側へ切
り換わる。接点（６Ａ）がＢ側へ切り換わることにより
、接続箱（２人）は子局挿入状態となり、上記子局（３
Ａ）のデータ受信端子が前局から来るデータ伝送ライン
（４Ａ）に接続され、子局（３Ａ）は親局からのデータ
を受信可能となる。
作について説明する。子局（３＾）を接続箱（２＾）に
接続すると、子局（３Ａ）内の短絡片（８）により端子
（１００）とｆＩＯＥＩ間が短絡され、切り換え器駆動
用の電源（９）から切り換え器（６）へ電圧が印加され
、切り換え器（６）の接点（６＾）が八個からＢ側へ切
り換わる。接点（６Ａ）がＢ側へ切り換わることにより
、接続箱（２人）は子局挿入状態となり、上記子局（３
Ａ）のデータ受信端子が前局から来るデータ伝送ライン
（４Ａ）に接続され、子局（３Ａ）は親局からのデータ
を受信可能となる。
この状態において、親局（１１から第７図および第８図
に示すごとき、データ列としてのデータ伝送フレームが
送出され、自局に該当するデータ部からデータを読み取
ったり、このデータ部に自局のデータを乗せたりして親
局とデータ通信を行なう。１回の通信、即ち（フラグ）
＋ （ｎＸｍ局）のデータの後ろにはアイドル（６２）
と呼ばれるデータ無通信状態が存在し、このアイドル（
６２）は４ビット以上″０″が連続し、最低でも数ｍｓ
の時間を持つ。
に示すごとき、データ列としてのデータ伝送フレームが
送出され、自局に該当するデータ部からデータを読み取
ったり、このデータ部に自局のデータを乗せたりして親
局とデータ通信を行なう。１回の通信、即ち（フラグ）
＋ （ｎＸｍ局）のデータの後ろにはアイドル（６２）
と呼ばれるデータ無通信状態が存在し、このアイドル（
６２）は４ビット以上″０″が連続し、最低でも数ｍｓ
の時間を持つ。
［発明が解決しようとする課題］
従来のデータ通信装置は以上のように構成されているの
で、接続箱に子局が接続された場合において、親局かも
伝送されるデータ伝送ライン上のデータ列とは無関係に
上記データ伝送ラインは子局バイパス状態から子局挿入
状態に切り換わるので、上記データ列を破壊し、この破
壊されたデータ列を次段以降の子局および上記親局が受
信し、通信エラーとなるなどの問題点があった。
で、接続箱に子局が接続された場合において、親局かも
伝送されるデータ伝送ライン上のデータ列とは無関係に
上記データ伝送ラインは子局バイパス状態から子局挿入
状態に切り換わるので、上記データ列を破壊し、この破
壊されたデータ列を次段以降の子局および上記親局が受
信し、通信エラーとなるなどの問題点があった。
この発明は、上記のような問題点を解消するためになさ
れたもので、 接続箱に子局が接続された場合において
、親局かも伝送されるデータ列を破壊することなしにデ
ータ伝送ラインを子局バイパス状態から子局挿入状態に
切り換えることができるデータ通信装置を得ることを目
的とする。
れたもので、 接続箱に子局が接続された場合において
、親局かも伝送されるデータ列を破壊することなしにデ
ータ伝送ラインを子局バイパス状態から子局挿入状態に
切り換えることができるデータ通信装置を得ることを目
的とする。
［課題を解決するための手段］
この発明に係わるデータ通信装置は、リング状のデータ
伝送ラインに直列に接続された接続箱と、上記接続箱に
取り外し自在に接続され、上記データ伝送ラインを介し
て親局とデータ通信を行なう子局とを備え、上記接続箱
は上記接続箱に上記子局が接続されたことを検出する子
局接続検出手段と、上記子局接続検出手段による子局接
続の検出結果に基づき上記親局から上記データ伝送ライ
ンを介して伝送されるデータ列より無通信状態を検出す
る無通信状態検出手段と、上記無通信状態検出手段によ
る無通信状態の検出結果に基づき上記データ伝送ライン
を子局バイパス状態から子局挿入状態に切り換えるデー
タ伝送ライン切換手段とを有するものである。
伝送ラインに直列に接続された接続箱と、上記接続箱に
取り外し自在に接続され、上記データ伝送ラインを介し
て親局とデータ通信を行なう子局とを備え、上記接続箱
は上記接続箱に上記子局が接続されたことを検出する子
局接続検出手段と、上記子局接続検出手段による子局接
続の検出結果に基づき上記親局から上記データ伝送ライ
ンを介して伝送されるデータ列より無通信状態を検出す
る無通信状態検出手段と、上記無通信状態検出手段によ
る無通信状態の検出結果に基づき上記データ伝送ライン
を子局バイパス状態から子局挿入状態に切り換えるデー
タ伝送ライン切換手段とを有するものである。
［作 用］
この発明における、リング状のデータ伝送ラインに直列
に接続された接続箱に備わる子局接続検出手段は上記接
続箱に取り外し自在に接続可能な子局が上記接続箱に接
続されたことを検出し、無通信状態検出手段は上記子局
接続検出手段による子局接続の検出結果に基づき親局か
ら上記データ伝送ラインを介して伝送されるデー夕列よ
り無通信状態を検出し、データ伝送ライン切換手段は上
記無通信状態検出手段による無通信状態の検出結果に基
づき上記データ伝送ラインを子局バイパス状態から子局
挿入状態に切り換える。
に接続された接続箱に備わる子局接続検出手段は上記接
続箱に取り外し自在に接続可能な子局が上記接続箱に接
続されたことを検出し、無通信状態検出手段は上記子局
接続検出手段による子局接続の検出結果に基づき親局か
ら上記データ伝送ラインを介して伝送されるデー夕列よ
り無通信状態を検出し、データ伝送ライン切換手段は上
記無通信状態検出手段による無通信状態の検出結果に基
づき上記データ伝送ラインを子局バイパス状態から子局
挿入状態に切り換える。
［発明の実施例〕
以下、この発明の一実施例を第１図乃至第３図により説
明する。図中、従来例と同じ符合で示されたものは従来
例のそれと同一、もしくは同等なものを示す。なお、ル
ープ式データリンクシステムの構成は従来例において説
明した第５図のものと同一であり、改めて説明すること
を省略する。
明する。図中、従来例と同じ符合で示されたものは従来
例のそれと同一、もしくは同等なものを示す。なお、ル
ープ式データリンクシステムの構成は従来例において説
明した第５図のものと同一であり、改めて説明すること
を省略する。
第１図はデータ通信装置の構成を示すブロック図であり
、あらかじめデータ伝送ライン（４＾）、（４Ｂ）間に
直列に接続された接続箱（２）とこの接続箱（２）に接
続された取り外し自在な子局（データ通信タミナル）（
３）からなる。図において、（１１）は親局より送信さ
れるデータ伝送ラインに接続されデータ列を監視してア
イドル、即ち、無通信状態を検出する無通信状態検出手
段としての無通信状態検出回路（以下、検出回路と記す
）である。 （１２）は検出回路の出力により開閉され
、切り換え器（６）をＯＮ、ＯＦＦさせる開閉手段であ
る。開閉手段（１２）として応答の速いスイッチング特
性を有する電界効果トランジスタ（ＦＥＴ）を用いてお
り、検出回路（１１）の出力信号は上記電界効果トラン
ジスタのゲート端子（Ｇ）に入力されている。
、あらかじめデータ伝送ライン（４＾）、（４Ｂ）間に
直列に接続された接続箱（２）とこの接続箱（２）に接
続された取り外し自在な子局（データ通信タミナル）（
３）からなる。図において、（１１）は親局より送信さ
れるデータ伝送ラインに接続されデータ列を監視してア
イドル、即ち、無通信状態を検出する無通信状態検出手
段としての無通信状態検出回路（以下、検出回路と記す
）である。 （１２）は検出回路の出力により開閉され
、切り換え器（６）をＯＮ、ＯＦＦさせる開閉手段であ
る。開閉手段（１２）として応答の速いスイッチング特
性を有する電界効果トランジスタ（ＦＥＴ）を用いてお
り、検出回路（１１）の出力信号は上記電界効果トラン
ジスタのゲート端子（Ｇ）に入力されている。
なお、接続箱（２）ニ設ケタ端子（ｌｏＤ）、（ｌｏＥ
）ト子局（３）に設けた短絡片（８）により子局（３）
が接続箱（２）に接続されたことを検出する子局接続検
出手段を、切り換え器（６）と開閉手段（１２）により
ブタ伝送ライン切り換え手段を構成する。（９）は接続
箱（２）に子局（３）を接続したときに検出回路（１１
）、および開閉手段（１２）を介して切り換え器（６）
のコイル（６＾）に電圧を印加する電源である。
）ト子局（３）に設けた短絡片（８）により子局（３）
が接続箱（２）に接続されたことを検出する子局接続検
出手段を、切り換え器（６）と開閉手段（１２）により
ブタ伝送ライン切り換え手段を構成する。（９）は接続
箱（２）に子局（３）を接続したときに検出回路（１１
）、および開閉手段（１２）を介して切り換え器（６）
のコイル（６＾）に電圧を印加する電源である。
第２図に上記接続箱（２）に内蔵される検出回路（１１
）の内部ブロック図を示す、図において、（３ｏ）は前
局からのデータ伝送ラインに接続され、親局から送出さ
れるデータ列におけるフラグ部分を検出するフラグ検出
回路、（３１）は検出回路（１１）の動作の基本となる
クロックを発生させる水晶発振子であり、フラグ検出回
路（３ｏ）からフラグ検出信号（３０＾）とシステムク
ロック（３０８１が出方される。
）の内部ブロック図を示す、図において、（３ｏ）は前
局からのデータ伝送ラインに接続され、親局から送出さ
れるデータ列におけるフラグ部分を検出するフラグ検出
回路、（３１）は検出回路（１１）の動作の基本となる
クロックを発生させる水晶発振子であり、フラグ検出回
路（３ｏ）からフラグ検出信号（３０＾）とシステムク
ロック（３０８１が出方される。
（３２）は上記フラグ検出回路（３０）の出力信号であ
るフラグ検出信号（３０＾）とシステムクロック（３０
Ｂ）を入力し、親局（１）から送出されるデータ列［４
０Ａ）に同期した同期クロック（４１）を発生させる同
期クロック発生回路である。（３３）は同期クロック（
４１）によりデータ列（４０Ａ）をシフトさせパラレル
データに変更して出力するレジスタである。（３４）は
４個のＮＯＲゲート入力端子を有するＮＯＲゲート素子
（以下、ＮＯＲゲートと記す）であり、シフトレジスタ
（３３）が出力するパラレルデータのそれぞれが上記Ｎ
ＯＲゲート端子に入力され上記パラレルデータが全て０
−のときのみ、ＮＯＲゲート（３４）の出力信号は１−
となる。（３５）はＤ−Ｔ形フリップフロップ回路Ｃ以
下、フリップフロップと記す）であり、端子りは電源電
圧が印加されて−１−に保持され、ＮＯＲゲート（３４
）の出力信号がＦ／Ｆクロック（４２）として端子Ｔに
入力されている。 次に第１図〜第３図によりこの実施
例のデータ通信装置の動作について説明する。第１図に
おいて、接続箱（２）に子局（３）が接続されていない
状態では第６図に示した従来例の場合と同様に端子（Ｉ
ＯＤ）、 （ＩＯＥ）間が開放状態である為に電源（９
）の電圧が切り換え器（６）に印加されず、切り換え器
（６）の接点（６Ａ）はＡ側と接触している。従ってデ
ータ伝送ライン（４＾）は切り換え器（６）の接点（６
Ａ）を介して次局へのデータ伝送ライン（４Ｂ）と接続
される。即ち、接続箱（２）は子局バイパス状態にあり
、親局から送られて来るデータ列はそのまま次局へ送出
されることになる。
るフラグ検出信号（３０＾）とシステムクロック（３０
Ｂ）を入力し、親局（１）から送出されるデータ列［４
０Ａ）に同期した同期クロック（４１）を発生させる同
期クロック発生回路である。（３３）は同期クロック（
４１）によりデータ列（４０Ａ）をシフトさせパラレル
データに変更して出力するレジスタである。（３４）は
４個のＮＯＲゲート入力端子を有するＮＯＲゲート素子
（以下、ＮＯＲゲートと記す）であり、シフトレジスタ
（３３）が出力するパラレルデータのそれぞれが上記Ｎ
ＯＲゲート端子に入力され上記パラレルデータが全て０
−のときのみ、ＮＯＲゲート（３４）の出力信号は１−
となる。（３５）はＤ−Ｔ形フリップフロップ回路Ｃ以
下、フリップフロップと記す）であり、端子りは電源電
圧が印加されて−１−に保持され、ＮＯＲゲート（３４
）の出力信号がＦ／Ｆクロック（４２）として端子Ｔに
入力されている。 次に第１図〜第３図によりこの実施
例のデータ通信装置の動作について説明する。第１図に
おいて、接続箱（２）に子局（３）が接続されていない
状態では第６図に示した従来例の場合と同様に端子（Ｉ
ＯＤ）、 （ＩＯＥ）間が開放状態である為に電源（９
）の電圧が切り換え器（６）に印加されず、切り換え器
（６）の接点（６Ａ）はＡ側と接触している。従ってデ
ータ伝送ライン（４＾）は切り換え器（６）の接点（６
Ａ）を介して次局へのデータ伝送ライン（４Ｂ）と接続
される。即ち、接続箱（２）は子局バイパス状態にあり
、親局から送られて来るデータ列はそのまま次局へ送出
されることになる。
次に、子局（３）を接続箱（２）へ接続した場合におい
て、子局（３）内の短絡片（８）により端子［１００１
とＦＩＯＥ１間が短絡され、電ｉｆ！ （９１から検出
回路（ｌｌ）に電圧が印加され、検出回路（１１）が動
作を開始する。一方、切り換え器（６）は開閉手段（１
２）が開放状態にある為、動作しない。親局ｆｌ）から
送出されるデータ列は、前述の通り第７図に示す構成に
なっている。即ち、フラグ（６０）とデータ部（６１）
から構成され、送出されるデータ列の間に無通信状態を
表わすアイドル（６２）が存在する。検出回路［１１１
では、このアイドル（６２）を検出し、開閉手段（１２
）を駆動する検出信号を出力する。開閉手段（１２）が
検出回路（１１）の出力信号によってＯＮされると切り
換λ器（６）に電＃！（９）の電圧が印加され、切り換
え器（６）を動作させ、切り換え器（６）の接点（６Ａ
）は接点Ｂ側と接触し、データ伝送ライン（４Ａ）を子
局（３）側へ切り換えて子局挿入状態とする。
て、子局（３）内の短絡片（８）により端子［１００１
とＦＩＯＥ１間が短絡され、電ｉｆ！ （９１から検出
回路（ｌｌ）に電圧が印加され、検出回路（１１）が動
作を開始する。一方、切り換え器（６）は開閉手段（１
２）が開放状態にある為、動作しない。親局ｆｌ）から
送出されるデータ列は、前述の通り第７図に示す構成に
なっている。即ち、フラグ（６０）とデータ部（６１）
から構成され、送出されるデータ列の間に無通信状態を
表わすアイドル（６２）が存在する。検出回路［１１１
では、このアイドル（６２）を検出し、開閉手段（１２
）を駆動する検出信号を出力する。開閉手段（１２）が
検出回路（１１）の出力信号によってＯＮされると切り
換λ器（６）に電＃！（９）の電圧が印加され、切り換
え器（６）を動作させ、切り換え器（６）の接点（６Ａ
）は接点Ｂ側と接触し、データ伝送ライン（４Ａ）を子
局（３）側へ切り換えて子局挿入状態とする。
切り換え器（６）は切り換え動作をアイドル（６２）の
期間に完了する必要がある為、応答の速いスイッチング
特性が要求される。しかし、アイドル（６２）が充分長
ければ切り換え器（６）の応答時間はそれほど速くなく
ても良い。
期間に完了する必要がある為、応答の速いスイッチング
特性が要求される。しかし、アイドル（６２）が充分長
ければ切り換え器（６）の応答時間はそれほど速くなく
ても良い。
次に第２図に示した検出回路［１１）の動作について説
明する。検出回路（１１）は前述の如（親局［１１から
送出されるデータ列からアイドル（６２１（無通信状態
）を検出し、開閉手段（１２）を動作させる為の回路で
ある。接続箱（２）に子局（３）を接続すると前述の如
くこの検出回路ｆｉｌ）を動作させる電源（９）が供給
され、検出回路（１１）は動作可能状態となる。親局（
］）からデータ列（４０Ａ＋が送出され、データ伝送ラ
イン（４Ａ）を通して検出回路［１１１に入力されると
、フラグ検出回路（３０）では上記データ列（４０＾）
からフラグ部（６０）を検出し、フラグ検出信号（３０
Ａ）を同期クロック発生回路（３２）へ出力する。また
、フラグ検出回路（３０）では水晶発振子（３１）によ
り、検出回路（１１）全体のシステムクロック（３０Ｂ
）を発生して同期クロック発生回路（３２）へ出力する
。同期クロック発生回路（３２）ではフラグ検出信号（
３０＾）およびシステムクロック（３０Ｂｌの入力によ
り親局（１）より送出されるデータ列（４０＾）に同期
した同期クロック（４１）を発生する。同期クロック（
４１）はデータ列（４０Ａ）のｌダイパルスあたり１回
の立ち上がり（変化）があるクロックである。一方、デ
ータ列（４０Ａ）は、シフトレジスタ（３３）にも入力
され、同期クロック発生回路（３２）から入力された同
期クロック（４１）によりシフトされパラレルデータに
変換されて出力される。このパラレルデータはＮＯＲゲ
ート（３４１に入力される。第２図に示したＮＯＲゲー
ト（３４）はシフトレジスタ（３３）からのパラレルデ
ータが４ビット以上連続で一〇−のとき出力が一１″と
なる。即ち、アイドル検出により′１−となる。このＮ
ＯＲゲート（３４）の出力信号がフリップフロップ（３
５）のＦ／Ｆクロック（４２）となり、フリップフロッ
プ（３５）をセットしてその出力端子Ｑから持続したＯ
Ｎ信号を出力する。このフリップフロップ（３５）の出
力信号をアイドル検出信号（４４）とし、この信号（４
４）により開閉手段（１２）を動作させる。
明する。検出回路（１１）は前述の如（親局［１１から
送出されるデータ列からアイドル（６２１（無通信状態
）を検出し、開閉手段（１２）を動作させる為の回路で
ある。接続箱（２）に子局（３）を接続すると前述の如
くこの検出回路ｆｉｌ）を動作させる電源（９）が供給
され、検出回路（１１）は動作可能状態となる。親局（
］）からデータ列（４０Ａ＋が送出され、データ伝送ラ
イン（４Ａ）を通して検出回路［１１１に入力されると
、フラグ検出回路（３０）では上記データ列（４０＾）
からフラグ部（６０）を検出し、フラグ検出信号（３０
Ａ）を同期クロック発生回路（３２）へ出力する。また
、フラグ検出回路（３０）では水晶発振子（３１）によ
り、検出回路（１１）全体のシステムクロック（３０Ｂ
）を発生して同期クロック発生回路（３２）へ出力する
。同期クロック発生回路（３２）ではフラグ検出信号（
３０＾）およびシステムクロック（３０Ｂｌの入力によ
り親局（１）より送出されるデータ列（４０＾）に同期
した同期クロック（４１）を発生する。同期クロック（
４１）はデータ列（４０Ａ）のｌダイパルスあたり１回
の立ち上がり（変化）があるクロックである。一方、デ
ータ列（４０Ａ）は、シフトレジスタ（３３）にも入力
され、同期クロック発生回路（３２）から入力された同
期クロック（４１）によりシフトされパラレルデータに
変換されて出力される。このパラレルデータはＮＯＲゲ
ート（３４１に入力される。第２図に示したＮＯＲゲー
ト（３４）はシフトレジスタ（３３）からのパラレルデ
ータが４ビット以上連続で一〇−のとき出力が一１″と
なる。即ち、アイドル検出により′１−となる。このＮ
ＯＲゲート（３４）の出力信号がフリップフロップ（３
５）のＦ／Ｆクロック（４２）となり、フリップフロッ
プ（３５）をセットしてその出力端子Ｑから持続したＯ
Ｎ信号を出力する。このフリップフロップ（３５）の出
力信号をアイドル検出信号（４４）とし、この信号（４
４）により開閉手段（１２）を動作させる。
第３図に、第２図に示した検出回路ブロック図における
各代表部の波形を示す。図において、上段より親局から
送出されるデータ列（４０＾）、フラグ検出信号（３０
＾）とシステムクロック（３０Ｂｌの入力により同期ク
ロック発生回路（３２）で生成される１ダイパルス当り
１回の立ち上がり（変化）を有する同期クロック（４１
）、ＮＯＲゲート（３４）の出力信号であるＦ／Ｆクロ
ック（４２）の波形である。フリップフロップ（３５）
はＦ／Ｆクロック（４２）の入力によってセットされ、
アイドル検出信号（４４）をセット（出力）する。前述
の様に、接続箱（２）に子局（３）を接続し、アイドル
（６２）を１度検出するとアイドル検出信号（４４）は
セットされたままの状態となり、その後データ通信が開
始され、フラグあるいはデータ部を受けてシフトレジス
タ（３３）の出力が４ビツト連続″Ｏ′の状態が得られ
なくても、フリップフロップ（３５）はりセントされる
ことはなく開閉手段（１２）を動作させたままの状態を
維持する。このフリップフロップ（３５）のリセットは
、子局（３）を接続箱（２）より取り外し、電＃（９）
が供給されなくなることによる。
各代表部の波形を示す。図において、上段より親局から
送出されるデータ列（４０＾）、フラグ検出信号（３０
＾）とシステムクロック（３０Ｂｌの入力により同期ク
ロック発生回路（３２）で生成される１ダイパルス当り
１回の立ち上がり（変化）を有する同期クロック（４１
）、ＮＯＲゲート（３４）の出力信号であるＦ／Ｆクロ
ック（４２）の波形である。フリップフロップ（３５）
はＦ／Ｆクロック（４２）の入力によってセットされ、
アイドル検出信号（４４）をセット（出力）する。前述
の様に、接続箱（２）に子局（３）を接続し、アイドル
（６２）を１度検出するとアイドル検出信号（４４）は
セットされたままの状態となり、その後データ通信が開
始され、フラグあるいはデータ部を受けてシフトレジス
タ（３３）の出力が４ビツト連続″Ｏ′の状態が得られ
なくても、フリップフロップ（３５）はりセントされる
ことはなく開閉手段（１２）を動作させたままの状態を
維持する。このフリップフロップ（３５）のリセットは
、子局（３）を接続箱（２）より取り外し、電＃（９）
が供給されなくなることによる。
第４図は別の実施例としての検出回路（ＩＩＡＩを示す
ブロック図であり、電！ （９１の入力回路部に電＃投
入時のリセット回路（３６）を設けた点が第２図に示し
た回路（１１）と異なる。接続箱（２）に子局（３）を
接続する時、接続部臼ＯＢＩ、（ＩＯｃＩの接触状態に
より検出回路＋ＩＩＡ＋の電源供給状態が不安定となる
場合があり、それを防止する為、電源（９）を監視し、
電源供給後ある一定時間、各回路にリセット信号を出力
することにより、アイドル検出信号（４４）を安定に保
持するものである。以下、第４図について簡単に説明す
る。接続箱〔２）に子局（３）を接続し、電源（９）が
供給されてから一定期間、リセット回路（３６）は同期
クロック発生回路（３２）、フリップフロップ（３５）
の出力を各々クリアしてシフトレジスタ（３３）の出力
を全てセットするためのリセット信号（４３）を発生す
る。この結果、接続箱（２）と子局（３）の接続時の不
安定領域から逃げることができる効果が得られる。
ブロック図であり、電！ （９１の入力回路部に電＃投
入時のリセット回路（３６）を設けた点が第２図に示し
た回路（１１）と異なる。接続箱（２）に子局（３）を
接続する時、接続部臼ＯＢＩ、（ＩＯｃＩの接触状態に
より検出回路＋ＩＩＡ＋の電源供給状態が不安定となる
場合があり、それを防止する為、電源（９）を監視し、
電源供給後ある一定時間、各回路にリセット信号を出力
することにより、アイドル検出信号（４４）を安定に保
持するものである。以下、第４図について簡単に説明す
る。接続箱〔２）に子局（３）を接続し、電源（９）が
供給されてから一定期間、リセット回路（３６）は同期
クロック発生回路（３２）、フリップフロップ（３５）
の出力を各々クリアしてシフトレジスタ（３３）の出力
を全てセットするためのリセット信号（４３）を発生す
る。この結果、接続箱（２）と子局（３）の接続時の不
安定領域から逃げることができる効果が得られる。
なお、第２図および第４図に示した検出回路（１１１、
（ＩＩＡＩはいずれもシフトレジスタ（３３）からＮＯ
Ｒゲート（３４）へのパラレルデータが４ビツトである
が、このパラレルデータ数は４ビツトに限定する必要は
なく、必要に応じてより大きなビット数としても良い。
（ＩＩＡＩはいずれもシフトレジスタ（３３）からＮＯ
Ｒゲート（３４）へのパラレルデータが４ビツトである
が、このパラレルデータ数は４ビツトに限定する必要は
なく、必要に応じてより大きなビット数としても良い。
さらに、上記実施例における開閉手段（１２）として応
答性の早い電界効果トランジスタ（ＦＥＴ）を用いたが
、特に電界効果トランジスタに限定する必要はなく、検
出回路＋１１１の出力で制御でき、かつ、切り換え器（
６）の通電電流をＯＮ、ＯＦＦ制御できるスイッチング
手段であれば良い。
答性の早い電界効果トランジスタ（ＦＥＴ）を用いたが
、特に電界効果トランジスタに限定する必要はなく、検
出回路＋１１１の出力で制御でき、かつ、切り換え器（
６）の通電電流をＯＮ、ＯＦＦ制御できるスイッチング
手段であれば良い。
［発明の効果］
以上のように、この発明によれば、子局接続検出手段に
より接続箱に子局が接続されたことを検出し、無通信状
態検出手段により、リング状のデータ伝送ラインの無通
信状態を検出し、データ伝送ライン切換手段により上記
データ伝送ラインを子局バイパス状態から子局挿入状態
に切り換えるようにしたので５接続箱に子局を接続した
場合においてデータ伝送ラインをデータ列を破壊するこ
となく子局バイパス状態から子局挿入状態に切り換える
ることができ、効率的にデータ通信を行なうものが得ら
れる効果がある。
より接続箱に子局が接続されたことを検出し、無通信状
態検出手段により、リング状のデータ伝送ラインの無通
信状態を検出し、データ伝送ライン切換手段により上記
データ伝送ラインを子局バイパス状態から子局挿入状態
に切り換えるようにしたので５接続箱に子局を接続した
場合においてデータ伝送ラインをデータ列を破壊するこ
となく子局バイパス状態から子局挿入状態に切り換える
ることができ、効率的にデータ通信を行なうものが得ら
れる効果がある。
第１図はこの発明の一実施例によるデータ通信装置の構
成を示すブロック図、第２図は第１図に示したデータ通
信装置における無通信状態検出回路の構成を示すブロッ
ク図、第３図は第２図に示した無通信状態検出回路にお
ける主要構成回路の出力波形を示す図、第４図は無通信
状態検出回路の別の実施例を示す図、第５図はこの発明
の実施例および従来例に共通なデータ通信システムの概
略図、第６図は従来のデータ通信装置の接続箱と子局の
構成図、第７図はこの発明の実施例及び従来例に共通な
データ伝送フレームのフォーマットを示す図、第８図は
第７図に示すデータ伝送フレムフォーマットの詳細を示
す図である６図において、（１）は親局、（２）および
（２人）〜（２Ｄ）は接続箱、（３）および（３＾１、
（３Ｃ）、（３Ｄ）は子局、（４＾）〜（４Ｅ）および
（４０）、（４２）はデータ伝送ライン、（６）は切り
換え器、（７）は通信１７Ｆ回路、（８）は短絡片、（
９）は電源、（１０＾）〜（ＩＯＧ）は端子、（ｌｌ）
は無通信状態検出回路、（１２）は開閉手段、（３０）
はフラグ検出回路、（３１）は水晶発振子、（３２）は
同期クロック発生回路、（３３）はシフトレジスタ、（
３４）はＮＯＲゲート素子、（３５）はフリップフロッ
プ回路、（３６）はリセット回路、（４０Ａ）はデータ
列、（４１）は同期クロック、（４２）はＦ／Ｆクロッ
ク、（６０）はフラグ、（６１）はデータ部、（６２）
は無通信状態であるアイドル部を示す。 なお、図中、同一符合は同一、または相当部分を示す。
成を示すブロック図、第２図は第１図に示したデータ通
信装置における無通信状態検出回路の構成を示すブロッ
ク図、第３図は第２図に示した無通信状態検出回路にお
ける主要構成回路の出力波形を示す図、第４図は無通信
状態検出回路の別の実施例を示す図、第５図はこの発明
の実施例および従来例に共通なデータ通信システムの概
略図、第６図は従来のデータ通信装置の接続箱と子局の
構成図、第７図はこの発明の実施例及び従来例に共通な
データ伝送フレームのフォーマットを示す図、第８図は
第７図に示すデータ伝送フレムフォーマットの詳細を示
す図である６図において、（１）は親局、（２）および
（２人）〜（２Ｄ）は接続箱、（３）および（３＾１、
（３Ｃ）、（３Ｄ）は子局、（４＾）〜（４Ｅ）および
（４０）、（４２）はデータ伝送ライン、（６）は切り
換え器、（７）は通信１７Ｆ回路、（８）は短絡片、（
９）は電源、（１０＾）〜（ＩＯＧ）は端子、（ｌｌ）
は無通信状態検出回路、（１２）は開閉手段、（３０）
はフラグ検出回路、（３１）は水晶発振子、（３２）は
同期クロック発生回路、（３３）はシフトレジスタ、（
３４）はＮＯＲゲート素子、（３５）はフリップフロッ
プ回路、（３６）はリセット回路、（４０Ａ）はデータ
列、（４１）は同期クロック、（４２）はＦ／Ｆクロッ
ク、（６０）はフラグ、（６１）はデータ部、（６２）
は無通信状態であるアイドル部を示す。 なお、図中、同一符合は同一、または相当部分を示す。
Claims (1)
- リング状のデータ伝送ラインに直列に接続された接続箱
と、上記接続箱に取り外し自在に接続され、上記データ
伝送ラインを介して親局とデータ通信を行なう子局とを
備え、上記接続箱は上記接続箱に上記子局が接続された
ことを検出する子局接続検出手段と、上記子局接続検出
手段による子局接続の検出結果に基づき上記親局から上
記データ伝送ラインを介して伝送されるデータ列より無
通信状態を検出する無通信状態検出手段と、上記無通信
状態検出手段による無通信状態の検出結果に基づき上記
データ伝送ラインを子局バイパス状態から子局挿入状態
に切替えるデータ伝送ライン切り換え手段とを有するこ
とを特徴とするデータ通信装置。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2025601A JPH03230639A (ja) | 1990-02-05 | 1990-02-05 | データ通信装置 |
| US07/606,974 US5151898A (en) | 1990-02-05 | 1990-10-31 | Synchronized slave station connection apparatus for a data communication network |
| EP19900125478 EP0440982A3 (en) | 1990-02-05 | 1990-12-24 | A data communication network with a synchronized slave station connection apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2025601A JPH03230639A (ja) | 1990-02-05 | 1990-02-05 | データ通信装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03230639A true JPH03230639A (ja) | 1991-10-14 |
Family
ID=12170430
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2025601A Pending JPH03230639A (ja) | 1990-02-05 | 1990-02-05 | データ通信装置 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US5151898A (ja) |
| EP (1) | EP0440982A3 (ja) |
| JP (1) | JPH03230639A (ja) |
Families Citing this family (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5461617A (en) * | 1989-12-26 | 1995-10-24 | Kabushiki Kaisha Komatsu Seisakusho | Serial controller |
| DE19653823A1 (de) * | 1996-12-21 | 1998-06-25 | Alsthom Cge Alcatel | Übertragungsnetz zum bidirektionalen Transport von Daten |
| US5991891A (en) * | 1996-12-23 | 1999-11-23 | Lsi Logic Corporation | Method and apparatus for providing loop coherency |
| US6055228A (en) * | 1996-12-23 | 2000-04-25 | Lsi Logic Corporation | Methods and apparatus for dynamic topology configuration in a daisy-chained communication environment |
| JPH10290251A (ja) * | 1997-04-15 | 1998-10-27 | Yazaki Corp | ネットワークにおける異常復旧装置 |
| DE19726763C2 (de) * | 1997-06-24 | 1999-06-10 | Phoenix Contact Gmbh & Co | Kopplungsanordnung für ein Master-Slave-Bussystem |
| US8301822B2 (en) * | 2009-09-23 | 2012-10-30 | Sandisk Il Ltd. | Multi-protocol storage device bridge |
| US8942108B2 (en) | 2012-12-14 | 2015-01-27 | General Electric Company | Method and system for current differential protection |
| DE102017208836A1 (de) * | 2017-05-24 | 2018-11-29 | Wago Verwaltungsgesellschaft Mbh | Statussignalausgabe |
| DE102022124702A1 (de) * | 2022-09-26 | 2024-03-28 | Phoenix Contact Gmbh & Co. Kg | Netzwerk zum Austausch von Daten zwischen Netzwerkgeräten mit Bypass-Option |
Family Cites Families (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| SE442070B (sv) * | 1981-07-10 | 1985-11-25 | Ericsson Telefon Ab L M | Sett for att i ett telekommunikationssystem, vid overforing av information mellan terminaler vilka er anslutna till varandra genom en gemensam ringbuss, astadkomma en anpassning i overgangen mellan ringbussen och respek |
| US4468767A (en) * | 1981-12-07 | 1984-08-28 | Coastcom | Drop-and-insert multiplex digital communications system |
| JPS6038950A (ja) * | 1983-08-11 | 1985-02-28 | Sumitomo Electric Ind Ltd | 伝送路制御方式 |
| US4594724A (en) * | 1984-02-10 | 1986-06-10 | Prime Computer, Inc. | Bypass method and apparatus for debouncing a mechanical switching element in a data communications network |
| US4779261A (en) * | 1985-09-24 | 1988-10-18 | Kabushiki Kaisha Toshiba | Loop network |
| JPH0630517B2 (ja) * | 1985-10-31 | 1994-04-20 | 日立電線株式会社 | ル−プネツトワ−クのノ−ドステ−シヨンバイパス法 |
| EP0528442B1 (en) * | 1986-05-02 | 1997-09-17 | Hitachi, Ltd. | Network configuration control method |
| GB2207580A (en) * | 1987-07-22 | 1989-02-01 | Gec Avionics | Ring-shaped local area network |
| US4956836A (en) * | 1988-03-28 | 1990-09-11 | Par Microsystems Corp. | Automatic bypass system for ring type local area network |
| JP2564375B2 (ja) * | 1988-09-28 | 1996-12-18 | 株式会社日立製作所 | 分岐挿入型多重変換装置 |
-
1990
- 1990-02-05 JP JP2025601A patent/JPH03230639A/ja active Pending
- 1990-10-31 US US07/606,974 patent/US5151898A/en not_active Expired - Fee Related
- 1990-12-24 EP EP19900125478 patent/EP0440982A3/en not_active Withdrawn
Also Published As
| Publication number | Publication date |
|---|---|
| EP0440982A2 (en) | 1991-08-14 |
| EP0440982A3 (en) | 1992-12-16 |
| US5151898A (en) | 1992-09-29 |
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