JPH03267876A - ピーク補正回路 - Google Patents
ピーク補正回路Info
- Publication number
- JPH03267876A JPH03267876A JP2066221A JP6622190A JPH03267876A JP H03267876 A JPH03267876 A JP H03267876A JP 2066221 A JP2066221 A JP 2066221A JP 6622190 A JP6622190 A JP 6622190A JP H03267876 A JPH03267876 A JP H03267876A
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- Japan
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- peak
- value
- circuit
- image signal
- correction
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
原稿から読み取った信号のピーク補正を行うピーク補正
回路に関し、 原稿を読み取った画信号のレベルの幅が急激に変化して
も、ディジタル信号処理によって徐々に画信号が変化す
るようにピーク補正を行い、装置間のバラツキを無くす
と共にコンデンサなどを削除して実装密度を高めること
を目的とし、原稿から読み取ったアナログの画信号を変
換したディジタルの画信号について、ライン毎に画素の
ピーク値を検出するピーク検出回路と、このピーク検出
回路によって検出したライン毎の画素のピーク値（Ｐ１
）および保持するピーク補正値（Ｐ）を比較して前者が
ある一定値より外れる値を示すときに予め設定した値（
ΔＰ）を当該ピーク補正値（Ｐ）に演算処理して更新す
ることを繰り返すピーク補正値算出回路とを備え、この
ピーク補正値真出回路によって求めたピーク補正値で現
在のディジタルの両信号を除算してピーク補正を行うよ
うに構成する。
回路に関し、 原稿を読み取った画信号のレベルの幅が急激に変化して
も、ディジタル信号処理によって徐々に画信号が変化す
るようにピーク補正を行い、装置間のバラツキを無くす
と共にコンデンサなどを削除して実装密度を高めること
を目的とし、原稿から読み取ったアナログの画信号を変
換したディジタルの画信号について、ライン毎に画素の
ピーク値を検出するピーク検出回路と、このピーク検出
回路によって検出したライン毎の画素のピーク値（Ｐ１
）および保持するピーク補正値（Ｐ）を比較して前者が
ある一定値より外れる値を示すときに予め設定した値（
ΔＰ）を当該ピーク補正値（Ｐ）に演算処理して更新す
ることを繰り返すピーク補正値算出回路とを備え、この
ピーク補正値真出回路によって求めたピーク補正値で現
在のディジタルの両信号を除算してピーク補正を行うよ
うに構成する。
って徐々に画信号が変化するようにピーク補正を行い、
装置間のバラツキを無くすと共にコンデンサなどを削除
して実装密度を高めることを目的としている。
装置間のバラツキを無くすと共にコンデンサなどを削除
して実装密度を高めることを目的としている。
本発明は、原稿から読み取った信号のピーク補正を行う
ピーク補正回路に関するものである。
ピーク補正回路に関するものである。
〔従来の技術と発明が解決しようとする課題〕従来、フ
ァクシミリ装置における画像補正は、イメージセンサで
原稿を走査して読み取った画信号について、アナログ回
路を用いて各種補正を行っていた。このため、アナログ
回路を構成する素子のバラツキによるファクシミリ装置
間で特性にバラツキが発生すると共に、コンデンサなど
のアナログ部品が必要となり実装面積が大きくなってし
まうという問題があった。
ァクシミリ装置における画像補正は、イメージセンサで
原稿を走査して読み取った画信号について、アナログ回
路を用いて各種補正を行っていた。このため、アナログ
回路を構成する素子のバラツキによるファクシミリ装置
間で特性にバラツキが発生すると共に、コンデンサなど
のアナログ部品が必要となり実装面積が大きくなってし
まうという問題があった。
本発明は、原稿を読み取った画信号のレベルの幅が急激
に変化しても、ディジタル信号処理によ〔課題を解決す
る手段〕 第１図を参照して課題を解決する手段を説明する。
に変化しても、ディジタル信号処理によ〔課題を解決す
る手段〕 第１図を参照して課題を解決する手段を説明する。
第１図において、Ａ／Ｄコンバータ３は、イメージセン
サ２などで原稿を読み取ったアナログの画信号をディジ
タルの画信号に変換するものである。
サ２などで原稿を読み取ったアナログの画信号をディジ
タルの画信号に変換するものである。
ピーク検出回路５−１は、ディジタルの画信号について
、ライン毎に画素のピーク値Ｐ、を検出する回路である
。
、ライン毎に画素のピーク値Ｐ、を検出する回路である
。
ピーク補正値算出回路５−２は、ピーク検出回路５−１
によって検出したライン毎の画素のピーク値Ｐ、および
保持するピーク補正値Ｐを比較して前者がある一定値よ
り外れる値を示すときに予め設定した値ΔＰを当該ピー
ク補正ＭＰに演夏処理して更新することを繰り返す回路
である。
によって検出したライン毎の画素のピーク値Ｐ、および
保持するピーク補正値Ｐを比較して前者がある一定値よ
り外れる値を示すときに予め設定した値ΔＰを当該ピー
ク補正ＭＰに演夏処理して更新することを繰り返す回路
である。
が可能となる。
本発明は、第１図に示すように、Ａ／Ｄコンバータ３が
イメージセンサ２などで原稿を読み取ったアナログの画
信号をディジタルの画信号に変換し、ピーク検出回路５
−１がディジタルの画信号についてライン毎に画素のピ
ーク値Ｐ１を検出し、ピーク補正値検出回路５−２がこ
の検出したライン毎の画素のピーク値Ｐ、および保持す
るピーク補正値Ｐを比較して前者がある一定値より外れ
る値を示すときに予め設定した値ΔＰを当該ピーク補正
値Ｐに演算処理して更新し、このピーク補正値Ｐで現在
のディジタルの画信号を除算してピーク補正を行うよう
にしている。
イメージセンサ２などで原稿を読み取ったアナログの画
信号をディジタルの画信号に変換し、ピーク検出回路５
−１がディジタルの画信号についてライン毎に画素のピ
ーク値Ｐ１を検出し、ピーク補正値検出回路５−２がこ
の検出したライン毎の画素のピーク値Ｐ、および保持す
るピーク補正値Ｐを比較して前者がある一定値より外れ
る値を示すときに予め設定した値ΔＰを当該ピーク補正
値Ｐに演算処理して更新し、このピーク補正値Ｐで現在
のディジタルの画信号を除算してピーク補正を行うよう
にしている。
従って、原稿を読み取った画信号のレベルの幅が急激に
変化しても、ディジタル信号処理によって徐々に画信号
が変化するようにピーク補正を行うことにより、装置間
のバラツキを無くすと共にコンデンサなどを削除して実
装密度を高めること〔実施例〕 次に、第１図および第２図を用いて本発明の１実施例の
構成および動作を順次詳細に説明する。
変化しても、ディジタル信号処理によって徐々に画信号
が変化するようにピーク補正を行うことにより、装置間
のバラツキを無くすと共にコンデンサなどを削除して実
装密度を高めること〔実施例〕 次に、第１図および第２図を用いて本発明の１実施例の
構成および動作を順次詳細に説明する。
第１図において、読取部１は、原稿を読み取ってアナロ
グの画信号を生成するイメージセンサ２、アナログの画
信号をディジタルの画信号に変換するＡ／Ｄコンバータ
３、ディジタル信号処理によって画信号の補正を行う補
正回路から構成されるものである。
グの画信号を生成するイメージセンサ２、アナログの画
信号をディジタルの画信号に変換するＡ／Ｄコンバータ
３、ディジタル信号処理によって画信号の補正を行う補
正回路から構成されるものである。
記録部８は、記録した画信号を用紙に印字するものであ
る。
る。
制御部９は、各種制御を行うものである。
モデム１０ば、画信号を変調／復調するものである。
ＮＣＵＩＩは、回線を制御するものである。
操作部１２は、各種操作を行うものである。
補正回路４は、ピーク補正を行うピーク補正回路５、イ
メージセンサ２の各素子の特性のパラツキを補正するシ
ェーディング補正回路６、および画素の強調補正を行う
ＭＴＦ補正回路７などから構成される補正回路である。
メージセンサ２の各素子の特性のパラツキを補正するシ
ェーディング補正回路６、および画素の強調補正を行う
ＭＴＦ補正回路７などから構成される補正回路である。
ピーク補正回路５は、本発明に係るディジタルの画信号
のピーク補正を行うものであって、ピーク検出回路５−
１、ピーク補正値算出回路５−２、および除算回Ｂ５−
３から構成されるものである。
のピーク補正を行うものであって、ピーク検出回路５−
１、ピーク補正値算出回路５−２、および除算回Ｂ５−
３から構成されるものである。
シェーディング補正回路６は、ピーク補正後のラインの
各画素に対して予め求めておいた各画素のシェーディン
グ値で除算し、イメージセンサ２の各素子の特性のバラ
ツキを補正する回路である。
各画素に対して予め求めておいた各画素のシェーディン
グ値で除算し、イメージセンサ２の各素子の特性のバラ
ツキを補正する回路である。
ＭＴＦ補正回路７は、シェーディング補正後のラインの
各画素の両隣接画素との差分を加算し、画信号を強調す
るＭＴＦ（輪郭強調）補正を行う回路である。
各画素の両隣接画素との差分を加算し、画信号を強調す
るＭＴＦ（輪郭強調）補正を行う回路である。
以下、本実施例に係るピーク検出回路５−１、ピーク補
正値算出回路５−２および除算回路５−３について詳細
に説明する。
正値算出回路５−２および除算回路５−３について詳細
に説明する。
ピーク検出回路５−１は、ディジタルの画信号のライン
毎の画素のピーク値を検出する回路である。１ｉｔｉａ
号と、ＦＰ Ａに保持されているライン内の画素のピー
ク値Ｐ１とをＣＯ？ＩＰ八に入力し、画信号が大きいと
きには当該百人力をＦＦ Ａがラッチしてピーク値Ｐ、
を更新し、一方、画信号が小さいときにはなにもしなく
もとのピーク値Ｐ、をＦＦ Ａがそのまま保持する。こ
れをライン内の全画素について繰り返し行うことにより
、ライン内の画素のピーク値をＦＦ Ａが保持し、ピー
ク値Ｐ１として検出する。
毎の画素のピーク値を検出する回路である。１ｉｔｉａ
号と、ＦＰ Ａに保持されているライン内の画素のピー
ク値Ｐ１とをＣＯ？ＩＰ八に入力し、画信号が大きいと
きには当該百人力をＦＦ Ａがラッチしてピーク値Ｐ、
を更新し、一方、画信号が小さいときにはなにもしなく
もとのピーク値Ｐ、をＦＦ Ａがそのまま保持する。こ
れをライン内の全画素について繰り返し行うことにより
、ライン内の画素のピーク値をＦＦ Ａが保持し、ピー
ク値Ｐ１として検出する。
ピーク補正値算出回路５−２は、ピーク検出回路５−１
によって検出したライン内の画素のピーク値Ｐ１と、Ｆ
Ｆ Ｂが保持するピーク補正値ＰとをＣＯＭＰ Ｒが比
較し、ピーク値Ｐ１ ＋ある一定値〉ピーク補正値Ｐの
とき（ピーク値Ｐ１−ある一定値くピーク補正値Ｐのと
き）にＲＥＧに保持されているΔＰの値をＡＤＤ／ＳＯ
Ｂによって加算しく減電し）、ＳＥＬを介してＦＦ Ｂ
に更新する態様で新たなピーク補正値Ｐとして保持させ
る。このある一定値は、ピーク値のこまかい変動により
、ラインごとにピーク値Ｐが変わることを防ぐためのも
のである。
によって検出したライン内の画素のピーク値Ｐ１と、Ｆ
Ｆ Ｂが保持するピーク補正値ＰとをＣＯＭＰ Ｒが比
較し、ピーク値Ｐ１ ＋ある一定値〉ピーク補正値Ｐの
とき（ピーク値Ｐ１−ある一定値くピーク補正値Ｐのと
き）にＲＥＧに保持されているΔＰの値をＡＤＤ／ＳＯ
Ｂによって加算しく減電し）、ＳＥＬを介してＦＦ Ｂ
に更新する態様で新たなピーク補正値Ｐとして保持させ
る。このある一定値は、ピーク値のこまかい変動により
、ラインごとにピーク値Ｐが変わることを防ぐためのも
のである。
これを繰り返しライン毎に行い、ピーク補正値Ｐを算出
する。尚、ＦＦ Ｂは、ＦＦＡが保持するピーク値Ｐ、
についてＳＥＬを介して初期値として設定する。
する。尚、ＦＦ Ｂは、ＦＦＡが保持するピーク値Ｐ、
についてＳＥＬを介して初期値として設定する。
除算回路５−３は、ピーク補正値真出回路５２によって
算出したピーク補正値Ｐで、ディジタルの画信号をＤＥ
Ｖで除算し、ピーク補正を行うものである。
算出したピーク補正値Ｐで、ディジタルの画信号をＤＥ
Ｖで除算し、ピーク補正を行うものである。
次に、第２図を用いてピーク補正回路４の動作を具体的
に説明する。
に説明する。
第２図（イ）、（ロ）、（ハ）の左側のＰｌ、Ｐ ＠＊
ｌ ％ Ｐ ｍａｔはＮ行目、Ｎ＋１行目、Ｎ＋２行目
に示すように急激に小さくなったときのピークｆＩＬＰ
ｌ （ピーク検出回路５−１で検出したピーク［）の変
化の様子を示す。
ｌ ％ Ｐ ｍａｔはＮ行目、Ｎ＋１行目、Ｎ＋２行目
に示すように急激に小さくなったときのピークｆＩＬＰ
ｌ （ピーク検出回路５−１で検出したピーク［）の変
化の様子を示す。
第２図（イ）、（ロ）、（ハ）の右側は、第１図ピーク
補正回路４（ピーク検出回路５−１、ピーク補正値算出
回路５−２、除算回路５−３）によってピーク補正して
出力する画信号の変化の様子を示す、これらの変化から
判明するように、入力の画信号のピーク値Ｐ、 、Ｐ、
。（、Ｐ ＠＋ｚが急激に小さくなっても、本発明によ
ってピーク補正されて出力される画信号が徐々に小さく
なる。このときの様子を判り易く表すと第２図（ニ）に
示すようになる。
補正回路４（ピーク検出回路５−１、ピーク補正値算出
回路５−２、除算回路５−３）によってピーク補正して
出力する画信号の変化の様子を示す、これらの変化から
判明するように、入力の画信号のピーク値Ｐ、 、Ｐ、
。（、Ｐ ＠＋ｚが急激に小さくなっても、本発明によ
ってピーク補正されて出力される画信号が徐々に小さく
なる。このときの様子を判り易く表すと第２図（ニ）に
示すようになる。
第２図（ニ）は、画信号のピーク補正例を示す。
ここで、Ｐ−、Ｐ、ｌ−＋ 、Ｐ−ｚは第２図（イ）、
（ロ）、（ハ）のＮ行目、Ｎ＋１行目、Ｎ＋２行目のと
きの入力信号（画信号）のピーク値を表し、Ｑ−、Ｑ−
＋ 、Ｑ−ｚは第１図除算回路５−３から出力されるピ
ーク補正後の出力信号（画信号）を表す、このように入
力信号（ｉｉ！信号）のピーク値がライン毎に急激にＰ
、 、Ｐ、。Ｉ 、Ｐ ｗ＋＋ｔ と小さくなっても、
第１図ピーク検出回路５−１、ピーク補正値算出回路５
−２および除算回路５−３によって出力信号（画信号）
Ｑお、Ｑ、、、、Ｑ、。
（ロ）、（ハ）のＮ行目、Ｎ＋１行目、Ｎ＋２行目のと
きの入力信号（画信号）のピーク値を表し、Ｑ−、Ｑ−
＋ 、Ｑ−ｚは第１図除算回路５−３から出力されるピ
ーク補正後の出力信号（画信号）を表す、このように入
力信号（ｉｉ！信号）のピーク値がライン毎に急激にＰ
、 、Ｐ、。Ｉ 、Ｐ ｗ＋＋ｔ と小さくなっても、
第１図ピーク検出回路５−１、ピーク補正値算出回路５
−２および除算回路５−３によって出力信号（画信号）
Ｑお、Ｑ、、、、Ｑ、。
□に示すように徐々に緩やかに小さくなるようにピーク
補正され、光源の変動や原稿の地の色の変化があっても
、徐々に緩やかに追従するように補正される。この追従
の度合は、第１図設定値ΔＰの値を調整することによつ
て可変できる。
補正され、光源の変動や原稿の地の色の変化があっても
、徐々に緩やかに追従するように補正される。この追従
の度合は、第１図設定値ΔＰの値を調整することによつ
て可変できる。
以上説明したように、本発明によれば、原稿を読み取っ
た画信号が急激に変化しても、ディジタル信号処理によ
って徐々に画信号が変化するようにピーク補正を行う構
成を採用しているため、装置間のバラツキを無くすと共
にコンデンサなどを削除して実装密度を高めることがで
きる。
た画信号が急激に変化しても、ディジタル信号処理によ
って徐々に画信号が変化するようにピーク補正を行う構
成を採用しているため、装置間のバラツキを無くすと共
にコンデンサなどを削除して実装密度を高めることがで
きる。
第１図は本発明の１実施例構成図、第２図は本発明の詳
細な説明図を示す。 図中、１は読取部、２はイメージセンサ、３はＡ／Ｄコ
ンバータ、４は補正回路、５はピーク補正回路、５−１
はピーク検出回路、５−２はピーク補正値算出回路、５
’−３はｗｋＸ回路を表す。
細な説明図を示す。 図中、１は読取部、２はイメージセンサ、３はＡ／Ｄコ
ンバータ、４は補正回路、５はピーク補正回路、５−１
はピーク検出回路、５−２はピーク補正値算出回路、５
’−３はｗｋＸ回路を表す。
Claims (1)
- 【特許請求の範囲】 原稿から読み取った信号のピーク補正を行うピーク補正
回路において、 原稿から読み取ったアナログの画信号を変換したディジ
タルの画信号について、ライン毎に画素のピーク値を検
出するピーク検出回路（５−１）と、このピーク検出回
路（５−１）によって検出したライン毎の画素のピーク
値（Ｐ＿１）および保持するピーク補正値（Ｐ）を比較
して前者がある一定値より外れる値を示すときに予め設
定した値（ΔＰ）を当該ピーク補正値（Ｐ）に演算処理
して更新することを繰り返すピーク補正値算出回路（５
−２）とを備え、 このピーク補正値算出回路（５−２）によって求めたピ
ーク補正値（Ｐ）で現在のディジタルの画信号を除算し
てピーク補正を行うように構成したことを特徴とするピ
ーク補正回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2066221A JPH03267876A (ja) | 1990-03-16 | 1990-03-16 | ピーク補正回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2066221A JPH03267876A (ja) | 1990-03-16 | 1990-03-16 | ピーク補正回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03267876A true JPH03267876A (ja) | 1991-11-28 |
Family
ID=13309564
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2066221A Pending JPH03267876A (ja) | 1990-03-16 | 1990-03-16 | ピーク補正回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03267876A (ja) |
-
1990
- 1990-03-16 JP JP2066221A patent/JPH03267876A/ja active Pending
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