JPH033018A - 電源装置 - Google Patents
電源装置Info
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- JPH033018A JPH033018A JP13619189A JP13619189A JPH033018A JP H033018 A JPH033018 A JP H033018A JP 13619189 A JP13619189 A JP 13619189A JP 13619189 A JP13619189 A JP 13619189A JP H033018 A JPH033018 A JP H033018A
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- protection
- output
- power supply
- circuit
- supply device
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- Control Of Voltage And Current In General (AREA)
- Continuous-Control Power Sources That Use Transistors (AREA)
- Dc-Dc Converters (AREA)
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
この発明ば電源装置、特に電源装置の保護回路に関する
ものである。
ものである。
（従来の技ｆｉ）
従来、電源袋Ｎ（以下装置という）は、負荷に電力を供
給する能動素子や、負荷に過電流や過電圧が発生した場
合、装置の破壊を防止するために動作する保護回路を有
していた。
給する能動素子や、負荷に過電流や過電圧が発生した場
合、装置の破壊を防止するために動作する保護回路を有
していた。
（発明が解決しようとする課題）
しかしながら、前記従来例で複数の出力を持つ場合には
、複数のそれぞれの出力に対し、前記のように装置の破
壊を防止するために保護を行わなければならない。この
ため、例えば電源装置に複数の過電流検知回路を配設す
る必要があり、また、それぞれの異なる出力に対応した
保護を行わなければならない。
、複数のそれぞれの出力に対し、前記のように装置の破
壊を防止するために保護を行わなければならない。この
ため、例えば電源装置に複数の過電流検知回路を配設す
る必要があり、また、それぞれの異なる出力に対応した
保護を行わなければならない。
また、前記従来例ののような異状を検知し、電源装置に
保護を行った後、再び、規定出方を発生するまでに、出
力ダウンを保持しなければならない場合は、コンデンサ
やシュミットトリガ回路などを有する時定数回路が必要
である。
保護を行った後、再び、規定出方を発生するまでに、出
力ダウンを保持しなければならない場合は、コンデンサ
やシュミットトリガ回路などを有する時定数回路が必要
である。
以上のことから、電源装置における回路が複雑化し、信
頼性が悪くなり、又装置が大型化し、コスト高となるな
どの問題点があった。
頼性が悪くなり、又装置が大型化し、コスト高となるな
どの問題点があった。
この発明は上記のような従来例の問題点を解消するため
になされたもので、電源装置において、過電流または過
電圧等の異状が発生した場合、電源装置を保護し、又出
力に応じて保護の状態を変え、複数の出力の場合はそれ
ぞれの出力に応じた保護を行うことができる電源装置を
得ることを目的とする。
になされたもので、電源装置において、過電流または過
電圧等の異状が発生した場合、電源装置を保護し、又出
力に応じて保護の状態を変え、複数の出力の場合はそれ
ぞれの出力に応じた保護を行うことができる電源装置を
得ることを目的とする。
このため、この発明においては、電源装置において、過
電流または過電圧などの異状を検知する検知手段（Ｉ）
と、前記検知手段（Ｉ）の出力により、前記電源装置に
保護をかける保護信号を送る第１保護手段（ＩＩ ）と
、前記保護信号により電源装置を保護する第２保護手段
（ＩＩＩ）とを有し、かつ前記第１保護手段（Ｉりに前
記保護の解除信号を送り、第２保護手段（ｍ）の保護を
解除し、前記電源の再スタートを行う制御手段（ＩＶ）
を具備することにより、前記目的を達成しようとするも
のである。
電流または過電圧などの異状を検知する検知手段（Ｉ）
と、前記検知手段（Ｉ）の出力により、前記電源装置に
保護をかける保護信号を送る第１保護手段（ＩＩ ）と
、前記保護信号により電源装置を保護する第２保護手段
（ＩＩＩ）とを有し、かつ前記第１保護手段（Ｉりに前
記保護の解除信号を送り、第２保護手段（ｍ）の保護を
解除し、前記電源の再スタートを行う制御手段（ＩＶ）
を具備することにより、前記目的を達成しようとするも
のである。
尚、前記電源装置において前記制御手段（ｒＶ）は、第
１保護手段（ＩＩ）の状態を監視し保護状態を検知した
場合、所定時間保護状態を保持し、保護解除信号を発生
し電源の再スタートをかける手段であることにより前記
目的を達成しようとするものであり、又、前記電源装置
において検知手段（１）は、複数の異状を検知する手段
であり、制御手段（ｒＶ）は、前記それぞれの検知手段
（Ｉ）の出力に応じた所定時間を保持後、解除信号を発
生する手段であることにより前記目的を達成しようとす
るものである。
１保護手段（ＩＩ）の状態を監視し保護状態を検知した
場合、所定時間保護状態を保持し、保護解除信号を発生
し電源の再スタートをかける手段であることにより前記
目的を達成しようとするものであり、又、前記電源装置
において検知手段（１）は、複数の異状を検知する手段
であり、制御手段（ｒＶ）は、前記それぞれの検知手段
（Ｉ）の出力に応じた所定時間を保持後、解除信号を発
生する手段であることにより前記目的を達成しようとす
るものである。
（作用）
この発明における電源装置は、検知手段（Ｉ）で過電流
または過電圧などの異状を検知し、検知手段（Ｉ）より
の出力を受けた第１保護手段（ＩＩ）で電源装置に保護
をかける保護信号を送り、該保護信号を受けた第２保護
手段（ＩＩＩ）で電源装置を保護する。又５制御手段（
ＩＶ）で第１保護手段（ｎ）に保護の解除信号を送り、
第２保護手段（ＩＩＩ）の保護を解除し、電源の再スタ
ートをする。
または過電圧などの異状を検知し、検知手段（Ｉ）より
の出力を受けた第１保護手段（ＩＩ）で電源装置に保護
をかける保護信号を送り、該保護信号を受けた第２保護
手段（ＩＩＩ）で電源装置を保護する。又５制御手段（
ＩＶ）で第１保護手段（ｎ）に保護の解除信号を送り、
第２保護手段（ＩＩＩ）の保護を解除し、電源の再スタ
ートをする。
尚、前記電源装置は、制御手段（ｒＶ）で、第１保護手
段（ｎ）の状態を監視し、保護を行っている状態を検知
した場合、予め設定された所定時間保護状態を保持後、
保護の解除信号を発生し、電源の再スタートを行う。
段（ｎ）の状態を監視し、保護を行っている状態を検知
した場合、予め設定された所定時間保護状態を保持後、
保護の解除信号を発生し、電源の再スタートを行う。
又、前記電源装置は、検知手段（Ｉ）で、複数の異状を
検知し、制御手段（ＩＶ）でそれぞれの検知手段（４）
の出力に応じた所定時間を保持後、解除信号を発生し、
電源の再スタートを行う。
検知し、制御手段（ＩＶ）でそれぞれの検知手段（４）
の出力に応じた所定時間を保持後、解除信号を発生し、
電源の再スタートを行う。
以下、この発明の三実施例を図面に基づいて説明する。
（１）先ずこの発明の第１実施例を第１図乃至第２図を
用いて説明する。
用いて説明する。
第１図はこの発明の第１実施例である電源装置のシーケ
ンスを示す回路図、第２図はこの第１実施例の動作波形
図であり、第１図中、Ｄｌはライン人力を整流する整流
ダイオード、Ｃ９はダイオードＤ、の出力を平滑するコ
ンデンサ、Ｔ１はコンバータトランス、Ｑｌはスイッチ
ング素子である例えばパワーＭＯ５ＦＥＴ、Ｔ３はスイ
ッチング素子（ＦＥＴ）Ｑ＋に流れる電流を検知する検
知トランス、ＤｌはコンバータトランスＴＩの２次側出
力を整流する整流ダイオード、Ｃ２はダイオードＤ２の
出力を平滑するコンデンサ、１はフライバック型のスイ
ッチングレギュレータを構成している電源装置、２は通
常使用されている過電流検知回路、３は過電流検知回路
２より出力を受け、ＰＷＭ回路５に保護信号を送りＰＷ
Ｍ回路５を制御するレジスタ、４はレジスタ３に電源装
置の保護の解除信号を送り電源の再スタートを行うこと
、および装置を制御するＣＰＵ、５はコンバータトラン
スＴ、で所望の２次側出力を得るためのパルス信号を生
成し、そのパルス信号によりドライブ回路６はスイッチ
ング素子Ｑ１を駆動し、コンバータトランスＴ１の２次
側巻線に電圧変換した出力を発生させるＰＷＭ回路であ
り、以上の構成において、検知手段（Ｉ）は２次側負荷
に従ってスイッチング素子Ｑ、のソーストレイン間に流
れる電流を検知する検知トランスＴ３と、過電流検知回
路２とより構成さね、過電流または過電圧などの異状を
検知する手段であり、第１保護手段（ＩＩ）はレジスタ
３で構成され、過”Ｉｆｆ、ｔｆＬ検知回路２よりの出
力により、７ｔｔｊｆ９ｊ装置１に保護をかける保護信
号をＰＷＭ回路５に送る手段であり、第２保護手段（ｍ
）はＰＷＭ回路５と、スイッチング素子Ｑｌを駆動する
ドライブ回路６と、スイッチング素子Ｑ、とより構成さ
れレジスタ３よりの保護信号により電源装置を保護する
１段であり、制御手段（ＴＶ）はＣＰＵ４で構成され、
レジスタ３に保護の解除信号を送り、第２保護手段（ｍ
）の保護を解除し、電源の再スタートを制御する手段で
ある。
ンスを示す回路図、第２図はこの第１実施例の動作波形
図であり、第１図中、Ｄｌはライン人力を整流する整流
ダイオード、Ｃ９はダイオードＤ、の出力を平滑するコ
ンデンサ、Ｔ１はコンバータトランス、Ｑｌはスイッチ
ング素子である例えばパワーＭＯ５ＦＥＴ、Ｔ３はスイ
ッチング素子（ＦＥＴ）Ｑ＋に流れる電流を検知する検
知トランス、ＤｌはコンバータトランスＴＩの２次側出
力を整流する整流ダイオード、Ｃ２はダイオードＤ２の
出力を平滑するコンデンサ、１はフライバック型のスイ
ッチングレギュレータを構成している電源装置、２は通
常使用されている過電流検知回路、３は過電流検知回路
２より出力を受け、ＰＷＭ回路５に保護信号を送りＰＷ
Ｍ回路５を制御するレジスタ、４はレジスタ３に電源装
置の保護の解除信号を送り電源の再スタートを行うこと
、および装置を制御するＣＰＵ、５はコンバータトラン
スＴ、で所望の２次側出力を得るためのパルス信号を生
成し、そのパルス信号によりドライブ回路６はスイッチ
ング素子Ｑ１を駆動し、コンバータトランスＴ１の２次
側巻線に電圧変換した出力を発生させるＰＷＭ回路であ
り、以上の構成において、検知手段（Ｉ）は２次側負荷
に従ってスイッチング素子Ｑ、のソーストレイン間に流
れる電流を検知する検知トランスＴ３と、過電流検知回
路２とより構成さね、過電流または過電圧などの異状を
検知する手段であり、第１保護手段（ＩＩ）はレジスタ
３で構成され、過”Ｉｆｆ、ｔｆＬ検知回路２よりの出
力により、７ｔｔｊｆ９ｊ装置１に保護をかける保護信
号をＰＷＭ回路５に送る手段であり、第２保護手段（ｍ
）はＰＷＭ回路５と、スイッチング素子Ｑｌを駆動する
ドライブ回路６と、スイッチング素子Ｑ、とより構成さ
れレジスタ３よりの保護信号により電源装置を保護する
１段であり、制御手段（ＴＶ）はＣＰＵ４で構成され、
レジスタ３に保護の解除信号を送り、第２保護手段（ｍ
）の保護を解除し、電源の再スタートを制御する手段で
ある。
次に第２図中、２ａは過電流検知回路２の出力波形、Ｈ
ｉは過電流検知期間の出力、Ｌｏは通常電流の出力、２
ｂはＣＰＵ４から常に一定周期のクロックを発振してレ
ジスタ３に入力される波形、２ｃはレジスタ３の出力波
形である。
ｉは過電流検知期間の出力、Ｌｏは通常電流の出力、２
ｂはＣＰＵ４から常に一定周期のクロックを発振してレ
ジスタ３に入力される波形、２ｃはレジスタ３の出力波
形である。
次にこの第１実施例の動作を第１図乃至第２図を用いて
説明する。第１図において、通常の状態で出力する場合
は、所望の２次側出力を得るためのパルス信号はＰＷＭ
回路５で生成し、そのパルス信号を受けたドライブ回路
６はスイッチング素子Ｑ１を駆動し、コンバータトラン
スＴ、の２次側巻線に電圧変換した出力を発生させ、整
流ダイオードＤ２で整流し、コンデンサＣ２で平滑にし
、負荷へ電力を供給する。
説明する。第１図において、通常の状態で出力する場合
は、所望の２次側出力を得るためのパルス信号はＰＷＭ
回路５で生成し、そのパルス信号を受けたドライブ回路
６はスイッチング素子Ｑ１を駆動し、コンバータトラン
スＴ、の２次側巻線に電圧変換した出力を発生させ、整
流ダイオードＤ２で整流し、コンデンサＣ２で平滑にし
、負荷へ電力を供給する。
上記は通常の状態であるが、異状が発生した場合の検知
を検知手段（Ｉ）を中心に説明する。
を検知手段（Ｉ）を中心に説明する。
２次側に例えばショートしたり、過負荷がかかる等の異
状が発生した場合は、コンバータトランスＴ１の一次側
に連結しているスイッチング素子Ｑ１のドレイン・ソー
ス間には過大な電流が流れる。この電流を検知トランス
Ｔ、を介して過電流検知回路（以下Ｍ回路という）に人
力し、Ｍ回路で過電流を検知する。
状が発生した場合は、コンバータトランスＴ１の一次側
に連結しているスイッチング素子Ｑ１のドレイン・ソー
ス間には過大な電流が流れる。この電流を検知トランス
Ｔ、を介して過電流検知回路（以下Ｍ回路という）に人
力し、Ｍ回路で過電流を検知する。
このように、Ｍ回路で過電流を検知した場合の電源の保
護および該保護の解除について、第１図、第２図を用い
て、第１保護手段（ｎ）と第２保護手段（Ｉ［ｌ）を中
心にして説明する。
護および該保護の解除について、第１図、第２図を用い
て、第１保護手段（ｎ）と第２保護手段（Ｉ［ｌ）を中
心にして説明する。
図面第１図および第２図において、Ｍ回路が過電流を検
知すると、Ｍ回路２はレジスタ３に第２図２８に示すＨ
ｉの保護信号を出力する。この出力によりレジスタ３は
セットされ、第２図２０に示すＨｉの信号をＰＷＭ回路
５に出力し、この出力によりＰＷＭ回路５は出力を遮断
して電源の保護をかけるようにＰＷＭ出力を制御する。
知すると、Ｍ回路２はレジスタ３に第２図２８に示すＨ
ｉの保護信号を出力する。この出力によりレジスタ３は
セットされ、第２図２０に示すＨｉの信号をＰＷＭ回路
５に出力し、この出力によりＰＷＭ回路５は出力を遮断
して電源の保護をかけるようにＰＷＭ出力を制御する。
このとき、第２図２ｂに示すように、ＣＰＵ４は常に一
定周期のクロックを発振し、レジスタ３に人力する。面
記Ｍ回路２におけるレジスタ３のセット信号２ａがＨｉ
からＬｏになった後、ＣＰＵの人力信号２ｂによりレジ
スタの出力信号２ｃはＬｏとなる。面記のようにこの信
号によりＰＷＭ回路５は再びＰＷＭ出力を発生し、ＦＥ
ＴＱＩを駆動し、電源の保護は解除される。
定周期のクロックを発振し、レジスタ３に人力する。面
記Ｍ回路２におけるレジスタ３のセット信号２ａがＨｉ
からＬｏになった後、ＣＰＵの人力信号２ｂによりレジ
スタの出力信号２ｃはＬｏとなる。面記のようにこの信
号によりＰＷＭ回路５は再びＰＷＭ出力を発生し、ＦＥ
ＴＱＩを駆動し、電源の保護は解除される。
（２）次にこの発明の第２実施例について、第３図乃至
第５図を用いて説明する。
第５図を用いて説明する。
第３図はこの発明の第２実施例のシーケンスを示す回路
図、第４図はこの第２実施例の動作波形図、第５図はこ
の第２実施例の解除動作を制御するフローチャートであ
り、第３図において、第１保護手段（ＩＩ）であるレジ
スタの出力は制御手段（ｒＶ）であるＣＰＵ４の人力に
接続されており、ＣＰＵ４は一定周期でレジスタ３の状
態を監視できるように構成されている。
図、第４図はこの第２実施例の動作波形図、第５図はこ
の第２実施例の解除動作を制御するフローチャートであ
り、第３図において、第１保護手段（ＩＩ）であるレジ
スタの出力は制御手段（ｒＶ）であるＣＰＵ４の人力に
接続されており、ＣＰＵ４は一定周期でレジスタ３の状
態を監視できるように構成されている。
その他の構成は前記第１実施例（第１図）と同様である
から重複説明は省略する。
から重複説明は省略する。
次に第４図において、波形５ａは検知手段（Ｉ）の過電
流検知回路２の出力であり、その動作は前記第１実施例
におけると同様である。又この出力により、第２保護手
段（ｎ）であるレジスタ３はＰＷＭ回路５のＰＷＭ出力
を制御することも第１実施例と同様である。この場合、
制御手段（ＩＶ）のＣＰＬ１４は、第４図波形５ｂに示
すように一定周期で人力ボートｌ＋をチエツクしてレジ
スタ３の状態を監視し、レジスタ３がＨｉのとき、プロ
グラムによる所定の時間αを保持した後、レジスタ３へ
出力ボートＯ２からクロックを出力することにより、確
実に一定の時間α以上出力を止めた後に再スタートを行
う制御をする。波形５Ｃはこのときのレジスタ３の出力
波形である。
流検知回路２の出力であり、その動作は前記第１実施例
におけると同様である。又この出力により、第２保護手
段（ｎ）であるレジスタ３はＰＷＭ回路５のＰＷＭ出力
を制御することも第１実施例と同様である。この場合、
制御手段（ＩＶ）のＣＰＬ１４は、第４図波形５ｂに示
すように一定周期で人力ボートｌ＋をチエツクしてレジ
スタ３の状態を監視し、レジスタ３がＨｉのとき、プロ
グラムによる所定の時間αを保持した後、レジスタ３へ
出力ボートＯ２からクロックを出力することにより、確
実に一定の時間α以上出力を止めた後に再スタートを行
う制御をする。波形５Ｃはこのときのレジスタ３の出力
波形である。
次に、この第２実施例の保護解除動作制御を第５図を用
いて簡単に説明する。
いて簡単に説明する。
図面第５図において、スタートして、ステップ６ａでレ
ジスタは保護をかけているかを監視し、保護をかけてお
ればステップ６ｂに進み、所定時間αの経過するのを待
って、経過したらステップ６Ｃに進み、ステップ６Ｃで
レジスタに保護の解除信号を送り終了する。
ジスタは保護をかけているかを監視し、保護をかけてお
ればステップ６ｂに進み、所定時間αの経過するのを待
って、経過したらステップ６Ｃに進み、ステップ６Ｃで
レジスタに保護の解除信号を送り終了する。
（３）次にこの発明の第３実施例について、第６図乃至
第８図を用いて説明する。
第８図を用いて説明する。
第６図はこの発明の第３実施例のシーケンスを示す回路
図、第７図はこの第３実施例の動作波形図、第８図はこ
の第３実施例の動作を制御するフローチャートであり、
第６図中、Ｔ１は２次側に複数の出力巻線を有し、例え
ば２つの巻線が出力１、出力２を形成する。この場合、
例えばこの電源が複写機などに用いられる電源であれば
、出力１は数にＶ発生する高圧出力、出力２は５ｖ〜２
４Ｖ程度の低圧出力とする。
図、第７図はこの第３実施例の動作波形図、第８図はこ
の第３実施例の動作を制御するフローチャートであり、
第６図中、Ｔ１は２次側に複数の出力巻線を有し、例え
ば２つの巻線が出力１、出力２を形成する。この場合、
例えばこの電源が複写機などに用いられる電源であれば
、出力１は数にＶ発生する高圧出力、出力２は５ｖ〜２
４Ｖ程度の低圧出力とする。
Ｄ２．Ｃ２、Ｄ３ 、Ｃ３はそれぞれ、出力！。
出力２を整流し、平滑する整流ダイオードおよびコンデ
ンサである。Ｒ，は出力１より供給される電流を検出す
る検出抵抗であり、過電流検知回路２Ｂに接続され、過
電流検知回路２Ｂの出力はレジスタ３およびＣＰＵ４に
接続される。同様にＲ２は出力２の電流検知抵抗であり
、過電流検知回路２Ｃに接続され、出力はレジスタ３お
よびＣＰＬＩ４に接続される。その他の構成は第２実施
例と同様であるからその説明を省略する。
ンサである。Ｒ，は出力１より供給される電流を検出す
る検出抵抗であり、過電流検知回路２Ｂに接続され、過
電流検知回路２Ｂの出力はレジスタ３およびＣＰＵ４に
接続される。同様にＲ２は出力２の電流検知抵抗であり
、過電流検知回路２Ｃに接続され、出力はレジスタ３お
よびＣＰＬＩ４に接続される。その他の構成は第２実施
例と同様であるからその説明を省略する。
以上の構成において、検出手段（１）はトランスＴ３と
過電流検知回路２Ａ、２８．２Ｃより成り、第１保護手
段（ＩＩ）はレジスタ３であり、第２保護手段（ｍ）は
ＰＷＭ回路５とドライブ回路６とスイッチング素子Ｑ１
より成り、制御手段（■）はＣＰＵ４である。次に第７
図中、波形８ａ、８ｂ、８ｃはそれぞれ過電流検知回路
２Ａ、２Ｂ、２Ｃの出力を表わし、波形８ｄはＣＰＵ４
に入力されている過電流検知回路２Ａ。
過電流検知回路２Ａ、２８．２Ｃより成り、第１保護手
段（ＩＩ）はレジスタ３であり、第２保護手段（ｍ）は
ＰＷＭ回路５とドライブ回路６とスイッチング素子Ｑ１
より成り、制御手段（■）はＣＰＵ４である。次に第７
図中、波形８ａ、８ｂ、８ｃはそれぞれ過電流検知回路
２Ａ、２Ｂ、２Ｃの出力を表わし、波形８ｄはＣＰＵ４
に入力されている過電流検知回路２Ａ。
２Ｂ、２Ｃおよびレジスタ３の出力を監視する一定周期
を示している。
を示している。
次にこの第３実施例の動作を制御手段（ｒＶ）を中心に
して第６図乃至第８図を用いて説明する。
して第６図乃至第８図を用いて説明する。
第６図において、出力１に過電流が流れたとする。これ
により、過電流検知回路２Ｂの出力がＨｉになり、レジ
スタ３に入力され、レジスタ３はＰＷＭ回路５を制御す
る。このときＣＰＵ４は第７図波形８ｄで示すタイミン
グでレジスタ３の出力がＨｉになっているのを確認する
と同時に過電流制御回路２Ｂの出力がＨｉになっている
ことも確認する。そして、ＣＰＵ４はプログラムにより
所定の時間αを保持後、レジスタヘクロツクを入れ、再
スタートを行う。
により、過電流検知回路２Ｂの出力がＨｉになり、レジ
スタ３に入力され、レジスタ３はＰＷＭ回路５を制御す
る。このときＣＰＵ４は第７図波形８ｄで示すタイミン
グでレジスタ３の出力がＨｉになっているのを確認する
と同時に過電流制御回路２Ｂの出力がＨｉになっている
ことも確認する。そして、ＣＰＵ４はプログラムにより
所定の時間αを保持後、レジスタヘクロツクを入れ、再
スタートを行う。
又、出力２又はトランスＴ３に過電流が流れた場合は同
社にｃｐυ４は所定時間βを保持した後再スタートを行
う。
社にｃｐυ４は所定時間βを保持した後再スタートを行
う。
次にこの第３実施例の解除動作制御を第８図を用いて簡
単に説明する。スタートして、ステップ９ａでレジスタ
は保護をかけているかを人力ボート１１をチエツクする
ことにより監視し、保護をかけておればステップ９ｂに
進み、過電流検知回路（Ｍ回路）２Ｂの出力かを人力ボ
ート１２をチエツクすることにより判定し、２Ｂの出力
であればステップ９ｃに進み、所定時間αが経過するの
を待ち、α時間経過したらステップ９ｄでレジスタに保
護の解除信号を出力ボートＯ６から送る。
単に説明する。スタートして、ステップ９ａでレジスタ
は保護をかけているかを人力ボート１１をチエツクする
ことにより監視し、保護をかけておればステップ９ｂに
進み、過電流検知回路（Ｍ回路）２Ｂの出力かを人力ボ
ート１２をチエツクすることにより判定し、２Ｂの出力
であればステップ９ｃに進み、所定時間αが経過するの
を待ち、α時間経過したらステップ９ｄでレジスタに保
護の解除信号を出力ボートＯ６から送る。
前記ステップ９ｂで回路２Ｂの出力でないときはステッ
プ９ｅに進み、ステップ９ｅでＭ回路２ａ又は２Ｃの出
力か人力ボート１３，１４をチエツクすることにより判
定し、２ａ又は２Ｃの出力であればステップ９ｆに進み
、所定時間β経過するのを待ち、経過したらステップ９
ｄに進む。また、前記ステップ９ｅでＭ回路２ａ又は２
ｃの出力でないときは、ステップ９ａに戻る。この第３
実施例では特に出力１が前記のように高圧であるため、
保護を行い再スタートまでの所定時間αは通常の保護時
間より長く行なう間けつ発振としなくてはならない。又
、出力２は低圧出力であるから、保護を行った後再スタ
ートまでの所定時間βは短かくともよい。即ち、この発
明を用いることにより出力に応じた電源保護を行うこと
ができる。
プ９ｅに進み、ステップ９ｅでＭ回路２ａ又は２Ｃの出
力か人力ボート１３，１４をチエツクすることにより判
定し、２ａ又は２Ｃの出力であればステップ９ｆに進み
、所定時間β経過するのを待ち、経過したらステップ９
ｄに進む。また、前記ステップ９ｅでＭ回路２ａ又は２
ｃの出力でないときは、ステップ９ａに戻る。この第３
実施例では特に出力１が前記のように高圧であるため、
保護を行い再スタートまでの所定時間αは通常の保護時
間より長く行なう間けつ発振としなくてはならない。又
、出力２は低圧出力であるから、保護を行った後再スタ
ートまでの所定時間βは短かくともよい。即ち、この発
明を用いることにより出力に応じた電源保護を行うこと
ができる。
（発明の効果）
以上説明したように、この発明によれば、電源装置にお
いて、過電流または過電圧などの異状を検知する検知手
段（Ｉ）と、検知手段（Ｉ）により電源装置に保護をか
ける保護（３号を送る第１保護手段（■）と、保護信号
により電源装置を保護する第２保護手段（Ｉ［Ｉ）とを
有し、かつ第１保護手段（ｎ）に保護の解除信号を送り
、第２保護手段（ＩＩＩ）の保護を解除し、電源の再ス
タートを行う制御手段（ｒＶ）を具備することにより、
又は前記電源装置において制御手段（ＩＶ）は第１保護
手段（■）の状態を監視し、保護をかけている状態を検
知した場合、予め設定された所定時間保護状態を保持後
、保護の解除信号を発生し、電源の再スタートをかける
手段であることにより、又はｍｌ記電源装置において、
検知手段（１）は、複数の異状を検知する手段であり、
制御手段（ＩＶ）はそれぞれの検知手段（Ｉ）の出力に
応じた所定時間を保持後、解除信号を発生する手段であ
ることにより、電源装置を保護し、又、出力電圧等に応
じて保護の所定時間を変え、複数の出力の場合はそれぞ
れの出力に応じた保護を行うことができる電源装置が得
られる効果がある。
いて、過電流または過電圧などの異状を検知する検知手
段（Ｉ）と、検知手段（Ｉ）により電源装置に保護をか
ける保護（３号を送る第１保護手段（■）と、保護信号
により電源装置を保護する第２保護手段（Ｉ［Ｉ）とを
有し、かつ第１保護手段（ｎ）に保護の解除信号を送り
、第２保護手段（ＩＩＩ）の保護を解除し、電源の再ス
タートを行う制御手段（ｒＶ）を具備することにより、
又は前記電源装置において制御手段（ＩＶ）は第１保護
手段（■）の状態を監視し、保護をかけている状態を検
知した場合、予め設定された所定時間保護状態を保持後
、保護の解除信号を発生し、電源の再スタートをかける
手段であることにより、又はｍｌ記電源装置において、
検知手段（１）は、複数の異状を検知する手段であり、
制御手段（ＩＶ）はそれぞれの検知手段（Ｉ）の出力に
応じた所定時間を保持後、解除信号を発生する手段であ
ることにより、電源装置を保護し、又、出力電圧等に応
じて保護の所定時間を変え、複数の出力の場合はそれぞ
れの出力に応じた保護を行うことができる電源装置が得
られる効果がある。
第１図はこの発明の第１実施例である電源装置の回路図
、第２図は第１実施例の動作波形図、第３図はこの発明
の第２実施例の回路図、第４図は第２実施例の動作波形
図、第５図は第２実施例の解除動作を制御するフローチ
ャート、第６図はこの発明の第３実施例の回路図、第７
図は第３実施例の動作波形図、第８図は第３実施例の解
除動作を制御するフローチャートである。 （Ｉ ） −−−−−−検知手段 （ＩＩ ） −・・・・・第１保護手段（Ｏｌ）・・・
・・−第２保護手段 （ＴＶ）・−・・・制御手段 Ｑ＋””・−スイッチング素子 Ｔ、・・・−・コンバータトランス Ｔ３−一・・・検知トランス ト−・・・電源装置 ２．２Ａ、２Ｂ、２Ｃ−−−−−−過電流検知回路３・
・・・・・レジスタ ４・−・・・ＣＰＵ ５・・・−・ＰＷＭ回路 ６・・・・・・ドライブ回路 α、β・・・・−所定時間 りＣ３１自にミｌ晒ΣイうｉｉＪの１酬シしす乍’Ｊξ
化り戸」第２図
、第２図は第１実施例の動作波形図、第３図はこの発明
の第２実施例の回路図、第４図は第２実施例の動作波形
図、第５図は第２実施例の解除動作を制御するフローチ
ャート、第６図はこの発明の第３実施例の回路図、第７
図は第３実施例の動作波形図、第８図は第３実施例の解
除動作を制御するフローチャートである。 （Ｉ ） −−−−−−検知手段 （ＩＩ ） −・・・・・第１保護手段（Ｏｌ）・・・
・・−第２保護手段 （ＴＶ）・−・・・制御手段 Ｑ＋””・−スイッチング素子 Ｔ、・・・−・コンバータトランス Ｔ３−一・・・検知トランス ト−・・・電源装置 ２．２Ａ、２Ｂ、２Ｃ−−−−−−過電流検知回路３・
・・・・・レジスタ ４・−・・・ＣＰＵ ５・・・−・ＰＷＭ回路 ６・・・・・・ドライブ回路 α、β・・・・−所定時間 りＣ３１自にミｌ晒ΣイうｉｉＪの１酬シしす乍’Ｊξ
化り戸」第２図
Claims (3)
- （１）過電流または過電圧などの異状を検知する検知手
段と、前記検知手段の出力により、前記電源装置に保護
をかける保護信号を送る第１保護手段と、前記保護信号
により電源装置を保護する第２保護手段とを有し、かつ
前記第１保護手段に前記保護の解除信号を送り第２保護
手段の保護を解除し、前記電源の再スタートを行う制御
手段を具備したことを特徴とする電源装置。 - （２）前記制御手段は、第１保護手段の状態を監視し、
保護をかけている状態を検知した場合、予め設定された
所定時間前記保護状態を保持後、該保護の解除信号を発
生し、電源の再スタートをかける手段であることを特徴
とする請求項１記載の電源装置。 - （３）前記検知手段は、複数の異状を検知する手段であ
り、前記制御手段は前記それぞれの検知手段の出力に応
じた所定時間を保持後、解除信号を発生する手段である
ことを特徴とする請求項１もしくは２のいづれかの電源
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13619189A JP2829863B2 (ja) | 1989-05-31 | 1989-05-31 | 電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13619189A JP2829863B2 (ja) | 1989-05-31 | 1989-05-31 | 電源装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH033018A true JPH033018A (ja) | 1991-01-09 |
| JP2829863B2 JP2829863B2 (ja) | 1998-12-02 |
Family
ID=15169474
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13619189A Expired - Lifetime JP2829863B2 (ja) | 1989-05-31 | 1989-05-31 | 電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2829863B2 (ja) |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5268593A (en) * | 1991-02-21 | 1993-12-07 | Nec Corporation | Switching power source circuit |
| JPH10335999A (ja) * | 1997-06-02 | 1998-12-18 | Semiconductor Res Found | 過電流保護機能を持つゲート駆動回路 |
| JPH10336876A (ja) * | 1997-06-02 | 1998-12-18 | Semiconductor Res Found | 電流の遮断装置 |
| JP2002315321A (ja) * | 2001-04-10 | 2002-10-25 | Hitachi Koki Co Ltd | 直流電源装置の保護装置 |
| JP2003013954A (ja) * | 2001-06-28 | 2003-01-15 | Boc Edwards Technologies Ltd | 磁気軸受励磁回路及びターボ分子ポンプ装置 |
| JP2007025291A (ja) * | 2005-07-15 | 2007-02-01 | Fuji Xerox Co Ltd | 画像形成装置 |
| JP2008099440A (ja) * | 2006-10-12 | 2008-04-24 | Omron Corp | スイッチング電源装置 |
| JP2014155246A (ja) * | 2013-02-05 | 2014-08-25 | Tdk Corp | 電源装置の補助回路及びこの補助回路を備えた電源回路 |
-
1989
- 1989-05-31 JP JP13619189A patent/JP2829863B2/ja not_active Expired - Lifetime
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5268593A (en) * | 1991-02-21 | 1993-12-07 | Nec Corporation | Switching power source circuit |
| JPH10335999A (ja) * | 1997-06-02 | 1998-12-18 | Semiconductor Res Found | 過電流保護機能を持つゲート駆動回路 |
| JPH10336876A (ja) * | 1997-06-02 | 1998-12-18 | Semiconductor Res Found | 電流の遮断装置 |
| JP2002315321A (ja) * | 2001-04-10 | 2002-10-25 | Hitachi Koki Co Ltd | 直流電源装置の保護装置 |
| JP2003013954A (ja) * | 2001-06-28 | 2003-01-15 | Boc Edwards Technologies Ltd | 磁気軸受励磁回路及びターボ分子ポンプ装置 |
| JP2007025291A (ja) * | 2005-07-15 | 2007-02-01 | Fuji Xerox Co Ltd | 画像形成装置 |
| JP2008099440A (ja) * | 2006-10-12 | 2008-04-24 | Omron Corp | スイッチング電源装置 |
| JP2014155246A (ja) * | 2013-02-05 | 2014-08-25 | Tdk Corp | 電源装置の補助回路及びこの補助回路を備えた電源回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2829863B2 (ja) | 1998-12-02 |
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