JPH0331040Y2 - - Google Patents
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- Publication number
- JPH0331040Y2 JPH0331040Y2 JP5372985U JP5372985U JPH0331040Y2 JP H0331040 Y2 JPH0331040 Y2 JP H0331040Y2 JP 5372985 U JP5372985 U JP 5372985U JP 5372985 U JP5372985 U JP 5372985U JP H0331040 Y2 JPH0331040 Y2 JP H0331040Y2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- series
- capacitor
- discharge lamp
- timer circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 239000003990 capacitor Substances 0.000 claims description 33
- 230000002457 bidirectional effect Effects 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 6
- 230000001276 controlling effect Effects 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 238000007599 discharging Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000005284 excitation Effects 0.000 description 1
- 238000007429 general method Methods 0.000 description 1
- 230000002265 prevention Effects 0.000 description 1
- 230000001105 regulatory effect Effects 0.000 description 1
Landscapes
- Discharge-Lamp Control Circuits And Pulse- Feed Circuits (AREA)
Description
【考案の詳細な説明】
(a) 技術分野
この考案はサイリスタ等の流通角制御用スイツ
チング素子によつて調光を行うようにした放電灯
点灯装置に関する。
チング素子によつて調光を行うようにした放電灯
点灯装置に関する。
(b) 従来技術とその欠点
放電灯の調光を行う一般的な方法は、放電灯の
電源側に直列に双方向三端子サイリスタ等のスイ
ツチング素子を接続して、電源電圧を流通角制御
するようにしたものである。しかしながら、この
ようなスイツチング素子を用いた従来の放電灯点
灯装置は、調光状態を深く設定したまま電源を投
入した際、放電灯が起動しにくいといつた問題が
あつた。これは放電灯に対する電圧印加時間が短
く、フイラメントの予熱が十分成されないためで
ある。このような問題を解決するため、従来は電
源投入直後の数秒間は調光を行わない全点灯状態
となるように回路を構成している。第3図はこの
ような従来の放電灯調光装置の回路図を示すもの
である。図において1は放電灯、2は双方向三端
子サイリスタ(以下トライアツクという)3はタ
イマ回路、51および52は位相制御回路であ
る。通常の調光が可能な状態では位相制御回路5
2の出力によつてトライアツクのゲートが制御さ
れるが、電源投入直後は位相制御回路51によつ
てトライアツク2のゲートが制御される。すなわ
ち位相制御回路51はその時定数が小さく設定さ
れており、位相制御回路52の可変抵抗の値にか
かわらず位相制御回路51の時定数でオンタイミ
ングが定まる。電源投入後数秒間ののち前記タイ
マ回路3はP1とP2間を実質的に短絡するよう
に働き、位相制御回路51は無効となる。したが
つてその後は位相制御回路52によつて任意に調
光を行うことができるようになる。このような従
来の放電灯点灯装置は位相制御回路51の時定数
を小さくすることによつてフイラメントの予熱を
十分に行わなければならないが、スイツチング回
路のトリガを安定化させるためにそのコンデンサ
の容量はあまり小さくできない、またスイツチン
グ回路のゲート電流の上限を規制するため、抵抗
のは余り小さくできない。その結果起動時のスイ
ツチング回路の不導通角をある程度以下に出来な
かつた。またトリガ素子が2個必要であるといつ
た欠点もあつた。
電源側に直列に双方向三端子サイリスタ等のスイ
ツチング素子を接続して、電源電圧を流通角制御
するようにしたものである。しかしながら、この
ようなスイツチング素子を用いた従来の放電灯点
灯装置は、調光状態を深く設定したまま電源を投
入した際、放電灯が起動しにくいといつた問題が
あつた。これは放電灯に対する電圧印加時間が短
く、フイラメントの予熱が十分成されないためで
ある。このような問題を解決するため、従来は電
源投入直後の数秒間は調光を行わない全点灯状態
となるように回路を構成している。第3図はこの
ような従来の放電灯調光装置の回路図を示すもの
である。図において1は放電灯、2は双方向三端
子サイリスタ(以下トライアツクという)3はタ
イマ回路、51および52は位相制御回路であ
る。通常の調光が可能な状態では位相制御回路5
2の出力によつてトライアツクのゲートが制御さ
れるが、電源投入直後は位相制御回路51によつ
てトライアツク2のゲートが制御される。すなわ
ち位相制御回路51はその時定数が小さく設定さ
れており、位相制御回路52の可変抵抗の値にか
かわらず位相制御回路51の時定数でオンタイミ
ングが定まる。電源投入後数秒間ののち前記タイ
マ回路3はP1とP2間を実質的に短絡するよう
に働き、位相制御回路51は無効となる。したが
つてその後は位相制御回路52によつて任意に調
光を行うことができるようになる。このような従
来の放電灯点灯装置は位相制御回路51の時定数
を小さくすることによつてフイラメントの予熱を
十分に行わなければならないが、スイツチング回
路のトリガを安定化させるためにそのコンデンサ
の容量はあまり小さくできない、またスイツチン
グ回路のゲート電流の上限を規制するため、抵抗
のは余り小さくできない。その結果起動時のスイ
ツチング回路の不導通角をある程度以下に出来な
かつた。またトリガ素子が2個必要であるといつ
た欠点もあつた。
(c) 考案の目的
この考案は、前記従来の欠点を解消し、放電灯
の起動時にスイツチング回路の不導通角を極めて
小さくすることと、単一のトリガ素子を用いるこ
とを可能にした放電灯点灯装置を提供することに
ある。
の起動時にスイツチング回路の不導通角を極めて
小さくすることと、単一のトリガ素子を用いるこ
とを可能にした放電灯点灯装置を提供することに
ある。
(d) 考案の構成および効果
この考案は要約すれば、低抵抗の起動用抵抗に
直列に容量の比較的大きなコンデンサと小容量の
第2のコンデンサを直列に接続するとともに、前
記起動用抵抗および前記第1のコンデンサの直列
回路に並列に調光用可変抵抗を接続して構成し、
更に前記第1,第2のコンデンサの直列回路に並
列にタイマ回路を接続したことを特徴とする。
直列に容量の比較的大きなコンデンサと小容量の
第2のコンデンサを直列に接続するとともに、前
記起動用抵抗および前記第1のコンデンサの直列
回路に並列に調光用可変抵抗を接続して構成し、
更に前記第1,第2のコンデンサの直列回路に並
列にタイマ回路を接続したことを特徴とする。
この考案によれば、タイマ回路の作動時に実質
上前記起動用抵抗と第1,第2のコンデンサの直
列回路からなる時定数回路によつてスイツチング
素子が制御されるため、不導通角を極めて小さく
することができる。また前記タイマ回路の作動時
は第1と第2のコンデンサが並列に接続されるこ
とになるので従来通りの調光を行うことができ
る。またタイマの状態にかかわらずスイツチング
回路に出力すべき信号を同一点から取り出すこと
ができるため、トリガ素子は単一となる。
上前記起動用抵抗と第1,第2のコンデンサの直
列回路からなる時定数回路によつてスイツチング
素子が制御されるため、不導通角を極めて小さく
することができる。また前記タイマ回路の作動時
は第1と第2のコンデンサが並列に接続されるこ
とになるので従来通りの調光を行うことができ
る。またタイマの状態にかかわらずスイツチング
回路に出力すべき信号を同一点から取り出すこと
ができるため、トリガ素子は単一となる。
(e) 実施例
第1図はこの考案の実施例である放電灯点灯装
置の回路図である。放電灯1は安定器(チヨーク
コイル)Lとスイツチング回路であるトライアツ
ク2とともに商用電源6に直列に接続されてい
る。5は位相制御回路でありトリガ素子4を介し
て前記トライアツク2のゲートを制御する。3は
タイマ回路であり電源投入直後の数秒間はP1,
P2間が高インピーダンス状態である。数秒後は
P1,P2間が実質的に短絡される。
置の回路図である。放電灯1は安定器(チヨーク
コイル)Lとスイツチング回路であるトライアツ
ク2とともに商用電源6に直列に接続されてい
る。5は位相制御回路でありトリガ素子4を介し
て前記トライアツク2のゲートを制御する。3は
タイマ回路であり電源投入直後の数秒間はP1,
P2間が高インピーダンス状態である。数秒後は
P1,P2間が実質的に短絡される。
位相制御回路5は比較的低抵抗の起動用抵抗R
1と比較的容量の大きな第1のコンデンサC1と
小容量のコンデンサC2が直列に接続されてい
て、前記起動用抵抗および前記第1のコンデンサ
の直回路に並列に調光用の可変抵抗VRが接続さ
れている。更に前記第1,第2のコンデンサの直
列に回路に並列に前記タイマ回路が接続されてい
る。このため電源投入直後の数秒間は抵抗R1と
コンデンサC1およびC2の直列回路によつて時
定数回路が構成される。この場合抵抗R1が低抵
抗でありコンデンサC2が小容量であるため、そ
の時定数は小さく、トライアツク2を非常に速い
タイミングでオンさせることができる。即ちコン
デンサC2の充電電圧がトリガ素子4のスイツチ
ング電圧を越えた場合、コンデンサC2の電荷が
トリガ素子4を導通させるが、トライアツクをタ
ーンオンするには不十分である。しかし前記コン
デンサC1はその容量が大きいため、抵抗R1と
コンデンサC1の直列回路によりトライアツク2
のゲートに十分なゲート電流を流すことができ
る。このためスイツチング回路を安定に動作させ
ることができる。また、抵抗R1の値が小さくて
も、ゲート電流はコンデンサC1を充電するまで
の電流として制限される。尚、C1,C2,R
1,VRは例えば0.1μF,0.022μF,1.8kΩ,50k
Ωである。
1と比較的容量の大きな第1のコンデンサC1と
小容量のコンデンサC2が直列に接続されてい
て、前記起動用抵抗および前記第1のコンデンサ
の直回路に並列に調光用の可変抵抗VRが接続さ
れている。更に前記第1,第2のコンデンサの直
列に回路に並列に前記タイマ回路が接続されてい
る。このため電源投入直後の数秒間は抵抗R1と
コンデンサC1およびC2の直列回路によつて時
定数回路が構成される。この場合抵抗R1が低抵
抗でありコンデンサC2が小容量であるため、そ
の時定数は小さく、トライアツク2を非常に速い
タイミングでオンさせることができる。即ちコン
デンサC2の充電電圧がトリガ素子4のスイツチ
ング電圧を越えた場合、コンデンサC2の電荷が
トリガ素子4を導通させるが、トライアツクをタ
ーンオンするには不十分である。しかし前記コン
デンサC1はその容量が大きいため、抵抗R1と
コンデンサC1の直列回路によりトライアツク2
のゲートに十分なゲート電流を流すことができ
る。このためスイツチング回路を安定に動作させ
ることができる。また、抵抗R1の値が小さくて
も、ゲート電流はコンデンサC1を充電するまで
の電流として制限される。尚、C1,C2,R
1,VRは例えば0.1μF,0.022μF,1.8kΩ,50k
Ωである。
電源投入後数秒間経過してタイマ回路3が作動
し、P1,P2間が実質的に短絡状態になるが第
2図はその場合の位相制御回路の構成を示すもの
である。図より明らかなようにコンデンサC1と
C2が並列に接続され、調光用可変抵抗VRと直
列回路が構成される。コンデンサC2はその容量
が大きいため実質的に可変抵抗VRとコンデンサ
C2の値によつて時定数が定まる。この場合コン
デンサC1およびC2の充電電圧がトリガ素子4
のスイツチング電圧を越えた場合コンデンサC1
およびC2の電荷はトライアツクのゲートに放電
され、トライアツクを十分にターンオンすること
ができる。尚、上記動作説明はトライアツクのT
2端子を正電位として説明したが、逆位相の場合
は勿論コンデンサの充電・放電の方向が逆とな
る。
し、P1,P2間が実質的に短絡状態になるが第
2図はその場合の位相制御回路の構成を示すもの
である。図より明らかなようにコンデンサC1と
C2が並列に接続され、調光用可変抵抗VRと直
列回路が構成される。コンデンサC2はその容量
が大きいため実質的に可変抵抗VRとコンデンサ
C2の値によつて時定数が定まる。この場合コン
デンサC1およびC2の充電電圧がトリガ素子4
のスイツチング電圧を越えた場合コンデンサC1
およびC2の電荷はトライアツクのゲートに放電
され、トライアツクを十分にターンオンすること
ができる。尚、上記動作説明はトライアツクのT
2端子を正電位として説明したが、逆位相の場合
は勿論コンデンサの充電・放電の方向が逆とな
る。
タイマ回路3においてDはダイオードブリツジ
であり、P1,P2を入力としてこれを整流し、
P3に正電圧を出力する。コンデンサC3と抵抗
R2によつて時定数回路が構成されその出力が
PUTのゲートに接続されている。このため電源
投入直後はPUTがオフ状態にありコンデンサC
3にある一定以上の電荷が溜りPUTのゲート電
圧が下がればPUTがオンする。LEDはP3と
PUTのアノード間の逆バイアスをかけるために
挿入されており、PUTがオンすることにより前
記P1,P2間がこのLEDとPUTによつて実質
的短絡されることになる。尚、LEDは調光可能
な状態にあることを表す表示体としても働く。
であり、P1,P2を入力としてこれを整流し、
P3に正電圧を出力する。コンデンサC3と抵抗
R2によつて時定数回路が構成されその出力が
PUTのゲートに接続されている。このため電源
投入直後はPUTがオフ状態にありコンデンサC
3にある一定以上の電荷が溜りPUTのゲート電
圧が下がればPUTがオンする。LEDはP3と
PUTのアノード間の逆バイアスをかけるために
挿入されており、PUTがオンすることにより前
記P1,P2間がこのLEDとPUTによつて実質
的短絡されることになる。尚、LEDは調光可能
な状態にあることを表す表示体としても働く。
第1図において抵抗R0はトライアツク2がオ
フのとき放電灯の励起状態を一定状態に保つため
の管電流を流すためのものであり、またコンデン
サC0は雑音防止用コンデンサである。
フのとき放電灯の励起状態を一定状態に保つため
の管電流を流すためのものであり、またコンデン
サC0は雑音防止用コンデンサである。
第1図はこの考案の実施例である放電灯点灯装
置の回路図、第2図はタイマ回路が非作動状態に
ある場合の位相制御回路の等価的な回路図、第3
図は従来の放電灯点灯装置の回路図をそれぞれ示
している。
置の回路図、第2図はタイマ回路が非作動状態に
ある場合の位相制御回路の等価的な回路図、第3
図は従来の放電灯点灯装置の回路図をそれぞれ示
している。
Claims (1)
- 【実用新案登録請求の範囲】 放電灯と直列に接続された双方向三端子サイリ
スタと、電源投入直後の一定時間作動状態にして
両端を高インピーダンスに保持するタイマ回路
と、前記サイリスタのゲートに直列に接続される
トリガ素子と、このトリガ素子を前記タイマ回路
の作動時に早い位相でオンするための起動用抵
抗、および前記タイマ回路の非作動時に所定の位
相でオンするための可変抵抗を含む位相制御回路
とからなる装置において、 前記起動用抵抗に直列に容量の比較的大きな第
1のコンデンサと小容量の第2のコンデンサを直
列に接続するとともに、前記起動用抵抗および前
記第1のコンデンサの直列回路に並列に前記可変
抵抗を接続して構成し、更に前記第1,第2のコ
ンデンサの直列回路に並列に前記タイマ回路を接
続したことを特徴とする放電灯点灯装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5372985U JPH0331040Y2 (ja) | 1985-04-09 | 1985-04-09 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5372985U JPH0331040Y2 (ja) | 1985-04-09 | 1985-04-09 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61168599U JPS61168599U (ja) | 1986-10-18 |
| JPH0331040Y2 true JPH0331040Y2 (ja) | 1991-07-01 |
Family
ID=30574865
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5372985U Expired JPH0331040Y2 (ja) | 1985-04-09 | 1985-04-09 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0331040Y2 (ja) |
-
1985
- 1985-04-09 JP JP5372985U patent/JPH0331040Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61168599U (ja) | 1986-10-18 |
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