JPH0334332U - - Google Patents
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- Publication number
- JPH0334332U JPH0334332U JP9377689U JP9377689U JPH0334332U JP H0334332 U JPH0334332 U JP H0334332U JP 9377689 U JP9377689 U JP 9377689U JP 9377689 U JP9377689 U JP 9377689U JP H0334332 U JPH0334332 U JP H0334332U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- digital
- analog
- delayed
- bit
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims description 3
- 230000003111 delayed effect Effects 0.000 claims 3
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Analogue/Digital Conversion (AREA)
Description
第１図は本考案の一実施例の構成図、第２図及
び第３図は第１図の変換器の動作説明図である。 １……Ｄ／Ａ変換回路、２……デイレイライン
、３……ＬＰＦ。
び第３図は第１図の変換器の動作説明図である。 １……Ｄ／Ａ変換回路、２……デイレイライン
、３……ＬＰＦ。
Claims (1)
- 【実用新案登録請求の範囲】 （ｍ＋ｎ）ビツトのデジタル入力信号（ｍ，ｎ
は整数）の上位ｍビツト信号をデジタル・アナロ
グ変換するデジタル・アナログ変換回路と、 前記デジタル入力信号の下位ｎビツト信号で定
められる時間だけ前記アナログ・デジタル変換回
路で変換した信号の出力タイミングを遅延させる
デイレイ・ラインと、 このデイレイ・ラインで遅延させた信号の高周
波成分を除去してアナログ出力信号を生成するロ
ーパスフイルタ、 を具備したことを特徴とするデジタル・アナロ
グ変換器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9377689U JPH0334332U (ja) | 1989-08-09 | 1989-08-09 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9377689U JPH0334332U (ja) | 1989-08-09 | 1989-08-09 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0334332U true JPH0334332U (ja) | 1991-04-04 |
Family
ID=31643143
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9377689U Pending JPH0334332U (ja) | 1989-08-09 | 1989-08-09 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0334332U (ja) |
-
1989
- 1989-08-09 JP JP9377689U patent/JPH0334332U/ja active Pending
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