JPH0335586U - - Google Patents
Info
- Publication number
- JPH0335586U JPH0335586U JP9687389U JP9687389U JPH0335586U JP H0335586 U JPH0335586 U JP H0335586U JP 9687389 U JP9687389 U JP 9687389U JP 9687389 U JP9687389 U JP 9687389U JP H0335586 U JPH0335586 U JP H0335586U
- Authority
- JP
- Japan
- Prior art keywords
- vram
- cpu
- display
- cpu access
- chip select
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000003213 activating effect Effects 0.000 claims 1
- 230000004913 activation Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 1
- 238000001514 detection method Methods 0.000 description 1
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 1
- 238000003786 synthesis reaction Methods 0.000 description 1
Landscapes
- Digital Computer Display Output (AREA)
Description
第1図は、この考案の表示装置について、その
要部構成の詳細な一実施例を示す機能ブロツク図
、第2図は、この考案の表示装置について、その
ノーマルモードの動作を説明するためのタイミン
グチヤート、第3図は、この考案の表示装置につ
いて、そのノーウエイトモードの動作を説明する
ためのタイミングチヤート。 図面において、1……表示コントローラで、1
1……そのVRAMチツプセレクト検出部、12
……VRAM制御信号生成部、13……モード切
換え制御部、14……VRAMアドレスカウンタ
、15……CPU/表示アドレス切換え部、16
……CPU/表示データ切換え部、17……表示
データバツフア、18……バツフア入出力制御部
、19……表示情報合成部、2……CPU、3…
…VRAM、4……CRTデイスプレイ等の表示
装置。
要部構成の詳細な一実施例を示す機能ブロツク図
、第2図は、この考案の表示装置について、その
ノーマルモードの動作を説明するためのタイミン
グチヤート、第3図は、この考案の表示装置につ
いて、そのノーウエイトモードの動作を説明する
ためのタイミングチヤート。 図面において、1……表示コントローラで、1
1……そのVRAMチツプセレクト検出部、12
……VRAM制御信号生成部、13……モード切
換え制御部、14……VRAMアドレスカウンタ
、15……CPU/表示アドレス切換え部、16
……CPU/表示データ切換え部、17……表示
データバツフア、18……バツフア入出力制御部
、19……表示情報合成部、2……CPU、3…
…VRAM、4……CRTデイスプレイ等の表示
装置。
Claims (1)
- 【実用新案登録請求の範囲】 CPUと、VRAMと、表示コントローラと、
表示手段とを備えた表示装置において、 CPUからのVRAMのチツプセレクト信号が
入力されたとき、表示用VRAMアドレスカウン
ターを一時停止させ、CPUのアクセス終了後カ
ウントを再開し、かつ、CPUアクセス用期間に
CPUのアクセスがないときにカウントするアド
レスカウンタと、 CPUアクセス用期間でCPUのアクセスがな
いとき、前記VRAMのチツプセレクト信号をア
クテイブにするチツプセレクト信号アクテイブ手
段と、 VRAMデータをCPU側と表示側と切換える
VRAMデータ切換え手段と、 該VRAMデータ切換え手段から出力される表
示用のデータを格納するバツフアメモリと、 通常の時分割方式をノーウエイトモードに切換
えるモード切換え手段、 とを前記表示コントローラへ設けたことを特徴
とする表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9687389U JPH0335586U (ja) | 1989-08-19 | 1989-08-19 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9687389U JPH0335586U (ja) | 1989-08-19 | 1989-08-19 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0335586U true JPH0335586U (ja) | 1991-04-08 |
Family
ID=31646049
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9687389U Pending JPH0335586U (ja) | 1989-08-19 | 1989-08-19 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0335586U (ja) |
-
1989
- 1989-08-19 JP JP9687389U patent/JPH0335586U/ja active Pending