JPH0344672U - - Google Patents
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- Publication number
- JPH0344672U JPH0344672U JP10682689U JP10682689U JPH0344672U JP H0344672 U JPH0344672 U JP H0344672U JP 10682689 U JP10682689 U JP 10682689U JP 10682689 U JP10682689 U JP 10682689U JP H0344672 U JPH0344672 U JP H0344672U
- Authority
- JP
- Japan
- Prior art keywords
- control circuit
- storage memory
- logic analyzer
- trigger condition
- writes
- Prior art date
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- Pending
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- 238000013500 data storage Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 239000000523 sample Substances 0.000 description 1
Landscapes
- Tests Of Electronic Circuits (AREA)
Description
第１図は本考案のロジツクアナライザのブロツ
ク図である。第２図は第１図におけるトリガ条件
比較器とストレージメモリコントロール回路のフ
ローチヤートを示す。 １……ロジツク・アナライザ、２……被測定器
、３……標本化器、４……量子化器、５……デー
タストレージメモリ、６……データ表示部、７…
…コントロール回路、８……入力パネル、９……
トリガ条件比較器、１０……ストレージメモリコ
ントロール回路、１１……プローブ。
ク図である。第２図は第１図におけるトリガ条件
比較器とストレージメモリコントロール回路のフ
ローチヤートを示す。 １……ロジツク・アナライザ、２……被測定器
、３……標本化器、４……量子化器、５……デー
タストレージメモリ、６……データ表示部、７…
…コントロール回路、８……入力パネル、９……
トリガ条件比較器、１０……ストレージメモリコ
ントロール回路、１１……プローブ。
Claims (1)
- １回の測定で２箇所以上のトリガ条件を識別で
きるトリガ条件比較器と、識別されたデータのメ
モリへの書き込み・読み出しを行なうストレージ
メモリコントロール回路とを有することを特徴と
するロジツクアナライザ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10682689U JPH0344672U (ja) | 1989-09-11 | 1989-09-11 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10682689U JPH0344672U (ja) | 1989-09-11 | 1989-09-11 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0344672U true JPH0344672U (ja) | 1991-04-25 |
Family
ID=31655546
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10682689U Pending JPH0344672U (ja) | 1989-09-11 | 1989-09-11 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0344672U (ja) |
-
1989
- 1989-09-11 JP JP10682689U patent/JPH0344672U/ja active Pending
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