JPH0346847A - 競合制御回路 - Google Patents
競合制御回路Info
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- JPH0346847A JPH0346847A JP18311389A JP18311389A JPH0346847A JP H0346847 A JPH0346847 A JP H0346847A JP 18311389 A JP18311389 A JP 18311389A JP 18311389 A JP18311389 A JP 18311389A JP H0346847 A JPH0346847 A JP H0346847A
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- Japan
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- data
- transmission
- contention control
- data transmission
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Links
- 230000005540 biological transmission Effects 0.000 claims abstract description 55
- 238000010586 diagram Methods 0.000 description 4
- 238000000034 method Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
Landscapes
- Small-Scale Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明はデータの送受信制御回路、さらに詳しく云えば
複数のデータ送信部が衝突しないようにデータ送信制御
を行なう競合制御回路に関する。
複数のデータ送信部が衝突しないようにデータ送信制御
を行なう競合制御回路に関する。
（従来の技術）
第３図は従来の競合制御回路の一例を示すブロック図で
ある。
ある。
図において、２１は＃１データ送信部、２２は＃ｎデー
タ送信部、２３はデータ受信部、２４は競合制御部であ
る。
タ送信部、２３はデータ受信部、２４は競合制御部であ
る。
＃１データ盗信部２１．＄ｎデータ送信部２２およびデ
ータ受信部３１は共通の１つのデータバス２５によって
結合されている。
ータ受信部３１は共通の１つのデータバス２５によって
結合されている。
まず、第４図（ａ）のフローチャートによってデータ送
信部の動作について説明する。
信部の動作について説明する。
＃１データ送信部２１よりデータ受信部３１にデータを
送出する場合、＃１データ送信部２１Ｆ！、競合制御部
２４に対し送信要求を行なう（ステップ３１）。そして
勉合制御部２４から送信許可を受けると（ステップ３３
．３４）、データ受信部３１に対してデータを送出する
（ステップ３４）。
送出する場合、＃１データ送信部２１Ｆ！、競合制御部
２４に対し送信要求を行なう（ステップ３１）。そして
勉合制御部２４から送信許可を受けると（ステップ３３
．３４）、データ受信部３１に対してデータを送出する
（ステップ３４）。
データ送出終了後、＃１データ送出部２１は競合制御部
２４に対し送信終了信号上送出する（ステップ３５〕。
２４に対し送信終了信号上送出する（ステップ３５〕。
これにより１つのデータ転送サイクルが終了する。
次に第４図（ｂ）ｋ用いて競合制御部２４の内部の動作
について説明する。個々のデータ送信部（＃１〜＃ｎま
で）から受けている送信要求信号を順に走査しくステッ
プ４１．４２）、送信要求のあるデータ送信部全発見す
ると（ステップ４３）、そのデータ送信部に送信許可信
号全送出する（ステップ４４）。その後、データ送信部
からの送信終了信号金堂けて（ステップ４５）次のデー
タ送信部の送（′Ｉ！要求信号の走査に移る（ステップ
４６，４７．４８，４１．４２）。
について説明する。個々のデータ送信部（＃１〜＃ｎま
で）から受けている送信要求信号を順に走査しくステッ
プ４１．４２）、送信要求のあるデータ送信部全発見す
ると（ステップ４３）、そのデータ送信部に送信許可信
号全送出する（ステップ４４）。その後、データ送信部
からの送信終了信号金堂けて（ステップ４５）次のデー
タ送信部の送（′Ｉ！要求信号の走査に移る（ステップ
４６，４７．４８，４１．４２）。
全データ送信部の送信要求信号の走査全終了すると（ス
テップ４７）、再び、＃１のデータ送信部の送信要求信
号から走査を繰り返す（ステップ４１．４２）。
テップ４７）、再び、＃１のデータ送信部の送信要求信
号から走査を繰り返す（ステップ４１．４２）。
（発明が解決しようとする腺Ｕ）
さて、従来の競合制御回路は上記説明から明らかなよう
にデータ送信部と競合制御部の間で送信要求、送信許可
、送信終了の信号の手順が必要であり、また５デ一タ送
信部および競合制御部でのハード論理の複雑化、ハード
量の増加を招くという欠点があった。
にデータ送信部と競合制御部の間で送信要求、送信許可
、送信終了の信号の手順が必要であり、また５デ一タ送
信部および競合制御部でのハード論理の複雑化、ハード
量の増加を招くという欠点があった。
本発明の目的は上記諸欠点を解決するもので。
競合制御部とデータ送信部の信号のやりとりを単純化し
、各回路でのハード論理を簡単にするとともにハード量
を低減化した競合制御回路全提供することにある。
、各回路でのハード論理を簡単にするとともにハード量
を低減化した競合制御回路全提供することにある。
（課題を解決するための手段）
前記目的を達成する念めに本発明による競合制御回路は
複数のデータ送信部と、１つあるいは複数のデータ受信
部と、前記複数のデータ送信部に対して、順番にデータ
送出権金与える競合制御部を有する競合制御回路におい
て、前記各データ送出部はデータを送出するに要するデ
ータ送出時間を表示するデータ送出時間表示手段を有し
、前記競合制御部は前記データ送出部に対し順番に前記
各データ送出部が表示するデータ送出時間を読取るデー
タ送出時間読取手段と、前記表示した時間だけ待って次
のデータ送出部のデータ送出時間を走査する手段と含有
している。
複数のデータ送信部と、１つあるいは複数のデータ受信
部と、前記複数のデータ送信部に対して、順番にデータ
送出権金与える競合制御部を有する競合制御回路におい
て、前記各データ送出部はデータを送出するに要するデ
ータ送出時間を表示するデータ送出時間表示手段を有し
、前記競合制御部は前記データ送出部に対し順番に前記
各データ送出部が表示するデータ送出時間を読取るデー
タ送出時間読取手段と、前記表示した時間だけ待って次
のデータ送出部のデータ送出時間を走査する手段と含有
している。
（実 施例）
以下１図面を参照して本発明金さらに詳しく説明する。
第１図は本発明による競合制御回路の実施例を示すブロ
ック図である。
ック図である。
図において、ｌは＃ｌデータ送信部、２は＃ｎデータ送
信部、３はデータ受信部、４は競合制御部である。
信部、３はデータ受信部、４は競合制御部である。
＃１１デ一タ送信１．＃ｎデータ送信部２およびデータ
受信部３はデータバス１１で結合されている。
受信部３はデータバス１１で結合されている。
各データ送信部１．２は競合制御部４に対し送信時間を
表示するための送信時間表示回路５゜６ｔ−それぞれ備
えている。
表示するための送信時間表示回路５゜６ｔ−それぞれ備
えている。
第２図（ａ）Ｋデータ送信部の動作を説明するためのフ
ローチャート？、第２図（ｂ）に競合制御部の動作を説
明する之めのフローチャート全それぞれ示しである。
ローチャート？、第２図（ｂ）に競合制御部の動作を説
明する之めのフローチャート全それぞれ示しである。
以下、第２図に沿って動作全説明する。
＃１１デ一タ送信１がデータ送信部３にデータを送出す
る場合、＃１１デ一タ送信１は競合制御部４から送られ
てくる送信時間読取信号を受けると（ステップ１１．１
２）、送信時間表示回路５に表示した時間だけデータ送
出全行ない（ステップ１３）、データ転送を終了する。
る場合、＃１１デ一タ送信１は競合制御部４から送られ
てくる送信時間読取信号を受けると（ステップ１１．１
２）、送信時間表示回路５に表示した時間だけデータ送
出全行ない（ステップ１３）、データ転送を終了する。
一方、競合制御部４は＃１１デ一タ送信１の送信時間表
示回路５で表示された時間を読取り。
示回路５で表示された時間を読取り。
その表示され九時間だけ一時停止の状態となる（ステッ
プ１４，１５．１６）。その後１次のデータ送信部の送
信時間表示回路の読取動作に移る（ステップ１７．１８
，１４．１５）。
プ１４，１５．１６）。その後１次のデータ送信部の送
信時間表示回路の読取動作に移る（ステップ１７．１８
，１４．１５）。
なお、データ送信部において、送信するデータがない場
合は送信時間表示回路には「０」が表示される。
合は送信時間表示回路には「０」が表示される。
＃ｎデータ送信部に対しても動作は全く同じであＬ ＃
ｎデータ送信部に対する動作終了時点で再び＃１データ
送信部に７５！り、上述の動作を繰り返す。
ｎデータ送信部に対する動作終了時点で再び＃１データ
送信部に７５！り、上述の動作を繰り返す。
（発明の効果）
以上、説明したように本発明による競合制御回路は各デ
ータ送信部に送信時間表示回路を設け、競合制御部が各
データ送信部に対して単に送信時間を読取る動作をする
構成であるので。
ータ送信部に送信時間表示回路を設け、競合制御部が各
データ送信部に対して単に送信時間を読取る動作をする
構成であるので。
データ送信部と競合制御部のインタフェースが単純とな
る。また、データ送信部および競合制御部でのハード論
理も簡易となり、ハード量を削減できるという効果があ
る。
る。また、データ送信部および競合制御部でのハード論
理も簡易となり、ハード量を削減できるという効果があ
る。
第１図は本発明による競合制御回路の実施例を示すブロ
ック図、第２図は第１図の回路の動作を説明するための
フローチャート、第３図は従来の競合制御回路の一例を
示すブロック図、第４図は第３図の回路の動作を説明す
るためのフローチャートである。 １．２１・・・＃１データ送信部 ２２・・・＃ｎデータ送信部 ２３・・・データ受信部 ２４・・・競合制御部 ６・・・送信時間表示回路 ２５・・・データバス
ック図、第２図は第１図の回路の動作を説明するための
フローチャート、第３図は従来の競合制御回路の一例を
示すブロック図、第４図は第３図の回路の動作を説明す
るためのフローチャートである。 １．２１・・・＃１データ送信部 ２２・・・＃ｎデータ送信部 ２３・・・データ受信部 ２４・・・競合制御部 ６・・・送信時間表示回路 ２５・・・データバス
Claims (1)
- 複数のデータ送信部と、１つあるいは複数のデータ受信
部と、前記複数のデータ送信部に対して、順番にデータ
送出権を与える競合制御部を有する競合制御回路におい
て、前記各データ送出部はデータを送出するに要するデ
ータ送出時間を表示するデータ送出時間表示手段を有し
、前記競合制御部は前記データ送出部に対し順番に前記
各データ送出部が表示するデータ送出時間を読取るデー
タ送出時間読取手段と、前記表示した時間だけ待つて次
のデータ送出部のデータ送出時間を走査する手段とを有
することを特徴とする競合制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18311389A JPH0346847A (ja) | 1989-07-14 | 1989-07-14 | 競合制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18311389A JPH0346847A (ja) | 1989-07-14 | 1989-07-14 | 競合制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0346847A true JPH0346847A (ja) | 1991-02-28 |
Family
ID=16130007
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18311389A Pending JPH0346847A (ja) | 1989-07-14 | 1989-07-14 | 競合制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0346847A (ja) |
-
1989
- 1989-07-14 JP JP18311389A patent/JPH0346847A/ja active Pending
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