JPH0348284A - マトリクス型液晶表示装置のための駆動回路 - Google Patents
マトリクス型液晶表示装置のための駆動回路Info
- Publication number
- JPH0348284A JPH0348284A JP1183951A JP18395189A JPH0348284A JP H0348284 A JPH0348284 A JP H0348284A JP 1183951 A JP1183951 A JP 1183951A JP 18395189 A JP18395189 A JP 18395189A JP H0348284 A JPH0348284 A JP H0348284A
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- JP
- Japan
- Prior art keywords
- output
- signal
- display device
- liquid crystal
- crystal display
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明はマトリクス型液品表示装置のための駆動回路に
関する。
関する。
(従来の技術)
マトリクス型液晶表示装置は、近年における設計技術及
び製造技術の急速な進歩により、CRTに匹敵する表示
品質を獲得しつつある。マトリクス型液晶表示装置は、
薄型軽量であること、消費電力が小さいこと等の優れた
特徴を有しているため、テレビ受像機の表示部や、パー
ソナルコンピュータ等の情報機器用の表示装置等の広汎
な用途が期待されている。
び製造技術の急速な進歩により、CRTに匹敵する表示
品質を獲得しつつある。マトリクス型液晶表示装置は、
薄型軽量であること、消費電力が小さいこと等の優れた
特徴を有しているため、テレビ受像機の表示部や、パー
ソナルコンピュータ等の情報機器用の表示装置等の広汎
な用途が期待されている。
第3図に従来のマトリクス型液晶表示装置の一例を模式
的に示す。第3図のマトリクス型岐晶表示装置は、絵素
を駆動するためのスイッチング素子としてT F T
(Thin Film Transistor)を用い
たものである。スイッチング素子としては他に、MOS
}ランジスタ等を用いることができる。表示ユニットと
してのTPT液晶パネルlooはn行m列のマトリクス
状に配列された絵素103を備えている。第3図に於い
て水平方向に一列に並ぶ複数の絵素103によって1本
の水平走査線が構成される。各絵素103の近傍にはT
PTIO4がそれぞれ設けられ、TFT104のドレイ
ン電極は絵素103の電極に接続されている。全ての絵
素103の電極には共通の対向電極105が配置されて
いる。TFT液晶パネル100にはn本の走査電極10
1が平行に配設されている。j番目の走査電極101に
はj番目の水平走査線の絵素103に対応するTFT1
04のゲート電極が接続されている。走査電極101に
直交するようにm本の信号電極102が平行に配設され
ている。i番目の信号電極102にはi列目のTFT1
04のソース電極が接続されている。
的に示す。第3図のマトリクス型岐晶表示装置は、絵素
を駆動するためのスイッチング素子としてT F T
(Thin Film Transistor)を用い
たものである。スイッチング素子としては他に、MOS
}ランジスタ等を用いることができる。表示ユニットと
してのTPT液晶パネルlooはn行m列のマトリクス
状に配列された絵素103を備えている。第3図に於い
て水平方向に一列に並ぶ複数の絵素103によって1本
の水平走査線が構成される。各絵素103の近傍にはT
PTIO4がそれぞれ設けられ、TFT104のドレイ
ン電極は絵素103の電極に接続されている。全ての絵
素103の電極には共通の対向電極105が配置されて
いる。TFT液晶パネル100にはn本の走査電極10
1が平行に配設されている。j番目の走査電極101に
はj番目の水平走査線の絵素103に対応するTFT1
04のゲート電極が接続されている。走査電極101に
直交するようにm本の信号電極102が平行に配設され
ている。i番目の信号電極102にはi列目のTFT1
04のソース電極が接続されている。
TFT液晶バネル100はゲートドライバ(垂直走査手
段)200及びソースドライバ(映像信号出力手段’)
300を含む駆動回路によって駆動される。ゲートドラ
イバ200及びソースドライバ300はTFTパネルl
OOの走査電極101及び信号電極102にそれぞれ接
続されている。
段)200及びソースドライバ(映像信号出力手段’)
300を含む駆動回路によって駆動される。ゲートドラ
イバ200及びソースドライバ300はTFTパネルl
OOの走査電極101及び信号電極102にそれぞれ接
続されている。
映像信号はソースドライバ300に入力される。
ゲートドライバ200に入力される走査パルス及びソー
スドライバ300に入力されるサンプリンククロソク等
の制御信号は図外のコントロール回路から与えられる。
スドライバ300に入力されるサンプリンククロソク等
の制御信号は図外のコントロール回路から与えられる。
第3図のマトリクス型液晶表示装置における表示動作を
第4図を参照して説明する。ゲートドライバ200は、
第4図に示すように、TFTバネル100の走査電極1
01に順次、ゲートオン信号を印加する。即ち、ゲート
ドライバ200は水平走査線を所定の順序で走査する。
第4図を参照して説明する。ゲートドライバ200は、
第4図に示すように、TFTバネル100の走査電極1
01に順次、ゲートオン信号を印加する。即ち、ゲート
ドライバ200は水平走査線を所定の順序で走査する。
1本の水平走査線の走査には時間7Mが割り当てられて
いる。
いる。
j番目の水平走査線が走査されると、j番目の走査電極
101に接続されたTFT104がオンする。ソースド
ライバ300は、入力される映像信号を所定のサンプリ
ング周波数でサンプリングし、ゲートドライバ200に
よるゲートオン信号の出力に同期して信号電極102に
映像信号を出力する。従って、オン状態のTFTl04
を介して絵素103に映像信号が書き込まれる。絵素1
03に書き込まれた信号は、次の書き込み時迄の時間T
uの間にわたって保持される。
101に接続されたTFT104がオンする。ソースド
ライバ300は、入力される映像信号を所定のサンプリ
ング周波数でサンプリングし、ゲートドライバ200に
よるゲートオン信号の出力に同期して信号電極102に
映像信号を出力する。従って、オン状態のTFTl04
を介して絵素103に映像信号が書き込まれる。絵素1
03に書き込まれた信号は、次の書き込み時迄の時間T
uの間にわたって保持される。
上述の従来の駆動回路による書き込み動作をより詳細に
説明する。第5図にソースドライバ300の一例の出力
段の回路図を示す。第5図の回路は1本の信号電極10
2に対応している。
説明する。第5図にソースドライバ300の一例の出力
段の回路図を示す。第5図の回路は1本の信号電極10
2に対応している。
映像信号はサンプリングパルスが入力されることによっ
てサンプリングコンデンサC sr+pに蓄積される。
てサンプリングコンデンサC sr+pに蓄積される。
映像信号の絵素103に対する書き込みに際しては、第
6図に示すように、先ず、前回に書き込まれた信号を信
号電極102から消去するためにディスチャージ(D
I S)信号がハイレベルにされる。従ってトランジス
タ303を介して信号電極103がディスチャージされ
、その電位が接地レベルに引き下げられる。次にトラン
スファ(TRF)信号がハイレベルにされ、サンプリン
グコンデンサCSMρに蓄積されていた信号が、ホール
ドコンデンサCHに転送されると共に、差動増幅器30
1及び出力トランジスタ302を含む出力回路を介して
、出力線306に接続された信号電極102に出力され
る。トランジスタ3o5はバイアス電流を流す機能を有
している。TRF信号がハイレベルにされると同時に、
前述のゲートトライバ200から出力されるゲートオン
信号によって何れかの走査電極101に対応するTFT
104がオン状態にされ、信号電極102上の映像信号
が、オンしたTFT104に接続されている絵素103
に書き込まれる。
6図に示すように、先ず、前回に書き込まれた信号を信
号電極102から消去するためにディスチャージ(D
I S)信号がハイレベルにされる。従ってトランジス
タ303を介して信号電極103がディスチャージされ
、その電位が接地レベルに引き下げられる。次にトラン
スファ(TRF)信号がハイレベルにされ、サンプリン
グコンデンサCSMρに蓄積されていた信号が、ホール
ドコンデンサCHに転送されると共に、差動増幅器30
1及び出力トランジスタ302を含む出力回路を介して
、出力線306に接続された信号電極102に出力され
る。トランジスタ3o5はバイアス電流を流す機能を有
している。TRF信号がハイレベルにされると同時に、
前述のゲートトライバ200から出力されるゲートオン
信号によって何れかの走査電極101に対応するTFT
104がオン状態にされ、信号電極102上の映像信号
が、オンしたTFT104に接続されている絵素103
に書き込まれる。
(発明が解決しようとする課題)
上述した従来の駆動回路では、第5図に示す回路図から
わかるように、そのソースドライバ3oOに、入力信号
VINの電圧レベルが信号電極1o2の電圧より低い場
合に、信号電極102の電圧を引き下げる手段が備わっ
ていなかったため、書き込みに先立ってDIS信号によ
って信号電極lO2をディスチャージする必要があった
。第6図からわかるように、DIS信号の存在は、絵素
103への書き込み時間を減少せしめ、従って絵素10
3の充電度を向上させる上での障害、ひいては液晶表示
装置のコントラストを改善する上での障害となっていた
。
わかるように、そのソースドライバ3oOに、入力信号
VINの電圧レベルが信号電極1o2の電圧より低い場
合に、信号電極102の電圧を引き下げる手段が備わっ
ていなかったため、書き込みに先立ってDIS信号によ
って信号電極lO2をディスチャージする必要があった
。第6図からわかるように、DIS信号の存在は、絵素
103への書き込み時間を減少せしめ、従って絵素10
3の充電度を向上させる上での障害、ひいては液晶表示
装置のコントラストを改善する上での障害となっていた
。
また、DIS信号によって全ての信号電極1o2が同時
にディスチャージされるため、そのときに大きな放電電
流がソースドライバ300に流れる。更に、DIS信号
によるディスチャージは各水平走査線の走査に於いて行
われるので、ソースドライバ300の哨費電力が大きく
なる。
にディスチャージされるため、そのときに大きな放電電
流がソースドライバ300に流れる。更に、DIS信号
によるディスチャージは各水平走査線の走査に於いて行
われるので、ソースドライバ300の哨費電力が大きく
なる。
本発明はこのような現状に鑑みてなされたものであり、
その目的とするところは、上記DIS信号が不要であり
、表示装置のコントラストを改善し、消費電力を減少さ
せることができるマトリクス型液晶表示装置のための駆
動回路を提供することにある。
その目的とするところは、上記DIS信号が不要であり
、表示装置のコントラストを改善し、消費電力を減少さ
せることができるマトリクス型液晶表示装置のための駆
動回路を提供することにある。
(5題を解決するための手段)
本発明のマ} IJクス型液晶表示装置のための駆動回
路は、複数の絵素がマトリクス状に配列された表示ユニ
ットを有するマトリクス型液晶表示装置のための、該表
示ユニyトを水平走査線毎に走査する垂直走査手段と、
該垂直走査手段による水平走査線の走査毎に映像信号を
該表示ユニットに対して出力する映像信号出力手段とを
有する駆動回路であって、該映像信号出力手段が、その
出力線の充電及び放電を行うことができる双方向性の出
力回路を備えており、そのことにより上記目的が違或さ
れる。
路は、複数の絵素がマトリクス状に配列された表示ユニ
ットを有するマトリクス型液晶表示装置のための、該表
示ユニyトを水平走査線毎に走査する垂直走査手段と、
該垂直走査手段による水平走査線の走査毎に映像信号を
該表示ユニットに対して出力する映像信号出力手段とを
有する駆動回路であって、該映像信号出力手段が、その
出力線の充電及び放電を行うことができる双方向性の出
力回路を備えており、そのことにより上記目的が違或さ
れる。
(実施例)
本発明を実施例について以下に説明する。
本実施例の駆動回路は第3図に示した従来の駆動回路と
同様に、ゲートドライバ及びソースドライバを備えてい
る。第1図に該ソースドライバの出力段の回路図を示す
。映像信号が入力される入力線6は、2個のゲート7及
び8を介して差動増幅器lの非反転入力端子に接続され
ている。入力!II6には、第5図に示した回路と同様
に、サンプリングコンデンサC sI1p及びホールド
コンデンサCI4が接続されている。差動増幅器1の出
力線l3はNチャンネル出力トランジスタ2のゲート及
びPチャンネル出力トランジスタ12のゲートに接続さ
れている。出力トランジスタ2及び12のソースから出
力線9を介して出力映像信号が取り出される。出力線9
は差動増幅器Iの反転入力端子に接続されている。出力
トランジスタ2及び12のソースとアースとの間には、
バイアス設定用トランジスタ11が配設されている。
同様に、ゲートドライバ及びソースドライバを備えてい
る。第1図に該ソースドライバの出力段の回路図を示す
。映像信号が入力される入力線6は、2個のゲート7及
び8を介して差動増幅器lの非反転入力端子に接続され
ている。入力!II6には、第5図に示した回路と同様
に、サンプリングコンデンサC sI1p及びホールド
コンデンサCI4が接続されている。差動増幅器1の出
力線l3はNチャンネル出力トランジスタ2のゲート及
びPチャンネル出力トランジスタ12のゲートに接続さ
れている。出力トランジスタ2及び12のソースから出
力線9を介して出力映像信号が取り出される。出力線9
は差動増幅器Iの反転入力端子に接続されている。出力
トランジスタ2及び12のソースとアースとの間には、
バイアス設定用トランジスタ11が配設されている。
第1図の回路の動作を説明する。映像信号はサンプリン
グパルスがゲート7に入力されることによってサンプリ
ングコンデンサC sr+pに蓄積される。次にトラン
スファ(TRF)信号がハイレベルにされ、サンプリン
グコンデンサcsr+ρに蓄積されていた信号が、ホー
ルドコンデンサCHに転送されると共に、差勅増幅器l
に入力される。差勤増幅器1は非反転増幅器として動作
するので、差勤増幅器1の出力電圧VQは実質的に入力
映像信号のレベルに連動して変化する。
グパルスがゲート7に入力されることによってサンプリ
ングコンデンサC sr+pに蓄積される。次にトラン
スファ(TRF)信号がハイレベルにされ、サンプリン
グコンデンサcsr+ρに蓄積されていた信号が、ホー
ルドコンデンサCHに転送されると共に、差勅増幅器l
に入力される。差勤増幅器1は非反転増幅器として動作
するので、差勤増幅器1の出力電圧VQは実質的に入力
映像信号のレベルに連動して変化する。
電圧Vcが出力線9の電圧v ouvよりも大きい場合
には、電圧VcによってNチャンネル出力トランジスタ
2のゲートが制御され、出力トランジスタ2がオンし、
充ml流io+が流れる。充電電流io1は、出力電圧
V ourが差動増幅器1の入力電圧VINに等しくな
るまで流れる。
には、電圧VcによってNチャンネル出力トランジスタ
2のゲートが制御され、出力トランジスタ2がオンし、
充ml流io+が流れる。充電電流io1は、出力電圧
V ourが差動増幅器1の入力電圧VINに等しくな
るまで流れる。
他方、電圧VGが出力電圧V OLI7よりも小さい場
合には、電圧vGによってPチャンネル出力トランジス
タ12のゲートが制御され、出力トランジスタl2がオ
ンし、放電電流io2が流れる。放電電流102は、電
圧V OIJTが電圧VINに等しくなるまで流れる。
合には、電圧vGによってPチャンネル出力トランジス
タ12のゲートが制御され、出力トランジスタl2がオ
ンし、放電電流io2が流れる。放電電流102は、電
圧V OIJTが電圧VINに等しくなるまで流れる。
上述したことから分かるように、出力トランジスタ2及
びl2は、入力信号レベルに応じて、出力線9及びそれ
に接続される信号電極102の充電及び放電のいずれを
も行うことができる双方向性の機能を有している。
びl2は、入力信号レベルに応じて、出力線9及びそれ
に接続される信号電極102の充電及び放電のいずれを
も行うことができる双方向性の機能を有している。
このように、本実施例の駆動回路では、従来必要とされ
ていたDIS信号による信号電極のディスチャージが不
要である。第2図に示すように、本実施例の駆動回路を
用いれば、一水平走査線の走査に割り当てられた時間T
}Iの全てを絵素に対する書き込みに利用することがで
きる。従って、従来に比較して絵素の充電度が高められ
、表示装置のコントラストが改善される。また、上述し
たディスチャージに伴う電流がなくなる上、必要とされ
る電流は、入力電圧VINと出力電圧v ourとの差
を埋めるためのものだけであるから、駆動回路を含む表
示装置の消費電力が大きく減少する。
ていたDIS信号による信号電極のディスチャージが不
要である。第2図に示すように、本実施例の駆動回路を
用いれば、一水平走査線の走査に割り当てられた時間T
}Iの全てを絵素に対する書き込みに利用することがで
きる。従って、従来に比較して絵素の充電度が高められ
、表示装置のコントラストが改善される。また、上述し
たディスチャージに伴う電流がなくなる上、必要とされ
る電流は、入力電圧VINと出力電圧v ourとの差
を埋めるためのものだけであるから、駆動回路を含む表
示装置の消費電力が大きく減少する。
(発明の効果)
本発明によれば、表示装置のコントラストを改善し、消
費電力を減少させることができる、マトリクス型液晶表
示装置のための駆動回路が提供される。
費電力を減少させることができる、マトリクス型液晶表
示装置のための駆動回路が提供される。
マトリクス型液晶表示装置の分野では、今後、表示画面
の大型化や高精細化が追求されることが考えられる。こ
れに伴って、絵素に対する書き込み時間を一層短くせざ
るを得ないであろう。更に、画面の大型化によって表示
パネル内のソース容量やゲート容量が増大し、信号の遅
延時間が大きくなるであろうことを考慮すると、絵素に
対する書き込みの条件は益々厳しくなると思われる。本
発明はこのような状況に対してきわめて有効である。
の大型化や高精細化が追求されることが考えられる。こ
れに伴って、絵素に対する書き込み時間を一層短くせざ
るを得ないであろう。更に、画面の大型化によって表示
パネル内のソース容量やゲート容量が増大し、信号の遅
延時間が大きくなるであろうことを考慮すると、絵素に
対する書き込みの条件は益々厳しくなると思われる。本
発明はこのような状況に対してきわめて有効である。
画面の高精細化に伴い、信号取り出し端子が増大するの
で、高密度実装の技術が必要になると考えられる。高密
度実装の技術としては、COGが有望視されているが、
本発明によって達成される哨費電力の低減は、COGに
よる高密度実装の実現に於いても非常に有効である。
で、高密度実装の技術が必要になると考えられる。高密
度実装の技術としては、COGが有望視されているが、
本発明によって達成される哨費電力の低減は、COGに
よる高密度実装の実現に於いても非常に有効である。
4. のエ な!U
第1図は本発明の一実施例に於けるソースドライバの出
力段の回路図、第2図はその実施例の動作を説明するた
めのタイミングチャート、第3図は従来のマトリクス型
液晶表示装置の一例を模式的に示す図、第4図はそのマ
トリクス型液晶表示装置に於けるゲートオン信号のタイ
ミングチャート、第5図は従来のマトリクス型液晶表示
装置のための駆動回路に於けるソースドライバの一例の
出力段の回路図、第6図は第5図のソースドライバを有
する駆動回路の動作を説明するためのタイミングチャー
トである。
力段の回路図、第2図はその実施例の動作を説明するた
めのタイミングチャート、第3図は従来のマトリクス型
液晶表示装置の一例を模式的に示す図、第4図はそのマ
トリクス型液晶表示装置に於けるゲートオン信号のタイ
ミングチャート、第5図は従来のマトリクス型液晶表示
装置のための駆動回路に於けるソースドライバの一例の
出力段の回路図、第6図は第5図のソースドライバを有
する駆動回路の動作を説明するためのタイミングチャー
トである。
l・・・差動増幅器、2・・・Nチャンネル出力トラン
ジスタ、6・・・入力線、9・・・出力線、1l・・・
バイアス設定用トランジスタ、l2・・・Pチャンネル
出力トランジスタ、lOO・・・TFT液晶パネル、l
ol・・・走査電極、102・・・信号電極、103・
・・絵素、104・・・TFT,200・・・ゲートド
ライバ、3oO・・・ソースドライバ。
ジスタ、6・・・入力線、9・・・出力線、1l・・・
バイアス設定用トランジスタ、l2・・・Pチャンネル
出力トランジスタ、lOO・・・TFT液晶パネル、l
ol・・・走査電極、102・・・信号電極、103・
・・絵素、104・・・TFT,200・・・ゲートド
ライバ、3oO・・・ソースドライバ。
以 上
第1 1E
禁2図
第3図
第4図
第5図
VCρ
第6図
ト〕世堅十
Claims (1)
- 【特許請求の範囲】 1、複数の絵素がマトリクス状に配列された表示ユニッ
トを有するマトリクス型液晶表示装置のための、該表示
ユニットを水平走査線毎に走査する垂直走査手段と、該
垂直走査手段による水平走査線の走査毎に映像信号を該
表示ユニットに対して出力する映像信号出力手段とを有
する駆動回路であって、 該映像信号出力手段が、その出力線の充電及び放電を行
うことができる双方向性の出力回路を備えている マトリクス型液晶表示装置のための駆動回路。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1183951A JPH0348284A (ja) | 1989-07-17 | 1989-07-17 | マトリクス型液晶表示装置のための駆動回路 |
| US07/470,623 US5111195A (en) | 1989-01-31 | 1990-01-26 | Driving circuit for a matrix type display device |
| EP90300929A EP0381429B1 (en) | 1989-01-31 | 1990-01-30 | A driving circuit for a matrix type display device |
| DE69012846T DE69012846T2 (de) | 1989-01-31 | 1990-01-30 | Treiberschaltung für matrixartige Displayeinrichtungen. |
| KR1019900001084A KR930001650B1 (ko) | 1989-01-31 | 1990-01-31 | 매트릭스타입 디스플레이장치의 구동회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1183951A JPH0348284A (ja) | 1989-07-17 | 1989-07-17 | マトリクス型液晶表示装置のための駆動回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0348284A true JPH0348284A (ja) | 1991-03-01 |
Family
ID=16144673
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1183951A Pending JPH0348284A (ja) | 1989-01-31 | 1989-07-17 | マトリクス型液晶表示装置のための駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0348284A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5521611A (en) * | 1992-10-30 | 1996-05-28 | Sharp Kabushiki Kaisha | Driving circuit for a display apparatus |
| US5708454A (en) * | 1993-05-31 | 1998-01-13 | Sharp Kabushiki Kaisha | Matrix type display apparatus and a method for driving the same |
| JP2007334276A (ja) * | 2006-06-16 | 2007-12-27 | Chunghwa Picture Tubes Ltd | グレイスケール電圧源のための出力バッファー |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63311816A (ja) * | 1987-06-15 | 1988-12-20 | Hitachi Ltd | 容量性負荷駆動回路 |
-
1989
- 1989-07-17 JP JP1183951A patent/JPH0348284A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63311816A (ja) * | 1987-06-15 | 1988-12-20 | Hitachi Ltd | 容量性負荷駆動回路 |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| US5708454A (en) * | 1993-05-31 | 1998-01-13 | Sharp Kabushiki Kaisha | Matrix type display apparatus and a method for driving the same |
| JP2007334276A (ja) * | 2006-06-16 | 2007-12-27 | Chunghwa Picture Tubes Ltd | グレイスケール電圧源のための出力バッファー |
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