JPH0352698B2 - - Google Patents
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- JPH0352698B2 JPH0352698B2 JP59183786A JP18378684A JPH0352698B2 JP H0352698 B2 JPH0352698 B2 JP H0352698B2 JP 59183786 A JP59183786 A JP 59183786A JP 18378684 A JP18378684 A JP 18378684A JP H0352698 B2 JPH0352698 B2 JP H0352698B2
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Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は振幅変調(AM)ステレオ放送方式識
別装置に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to an amplitude modulation (AM) stereo broadcast system identification device.
本発明のAMステレオ放送方式識別装置は、ス
テレオ放送方式がそれぞれ異なる放送局から送出
される放送電波を受信してその放送方式を識別
し、その放送方式に応じた復調回路を選択してス
テレオ放送の受信を行うものであり、例えば自動
車搭載のカーラジオ等に適用できる。 The AM stereo broadcast system identification device of the present invention receives broadcast radio waves sent out from broadcast stations with different stereo broadcast systems, identifies the broadcast system, selects a demodulation circuit according to the broadcast system, and broadcasts stereo broadcasts. It can be applied to, for example, a car radio installed in a car.
米国あるいはカナダ等ではステレオ放送方式と
してAMステレオ放送方式が採用されている。こ
のAMステレオ放送方式としては種々の方式が知
られており、例えばマグナボツクスのAM−PM
方式、ハリスのCPM方式、カーン/ヘーゼルチ
ンのISB方式、モトローラのC−QUAM方式、
ベラーのAM−FM方式などがある。米国ではこ
れら各方式のうちの前4者の方式が現在認可さ
れ、放送局が現行に運営されてステレオ放送が行
われているが、これら各方式によるステレオ放送
は地域的に重複して行われているのが現状であ
る。
In the United States, Canada, etc., the AM stereo broadcasting system is adopted as a stereo broadcasting system. Various systems are known as this AM stereo broadcasting system, such as Magnabox's AM-PM.
system, Harris' CPM system, Kern/Hazelchin's ISB system, Motorola's C-QUAM system,
Examples include Beller's AM-FM system. In the United States, the first four of these systems are currently approved, and broadcast stations are currently operating and broadcasting in stereo, but stereo broadcasting using each of these systems overlaps in some regions. The current situation is that
一方、上記各ステレオ放送方式に対応して受信
機の構成も異なるものとなるが、或る方式の受信
機では他の方式のステレオ放送を受信することが
できない。このため、或る地域においては、種々
のステレオ放送番組が放送されているにもかかわ
らず、それらの番組のステレオ放送方式が異なつ
ているため、それらの番組のうち、所持している
受信機の方式の番組しか楽しむことができないの
が現状である。 On the other hand, although the configuration of the receiver differs depending on each of the above-mentioned stereo broadcasting systems, a receiver of a certain system cannot receive stereo broadcasting of another system. For this reason, even though a variety of stereo broadcast programs are being broadcast in a certain area, the stereo broadcast system for those programs is different, so you may not be able to watch the programs on your receiver. Currently, it is only possible to enjoy programs that are based on the system.
1つの受信機で各ステレオ放送方式によるステ
レオ放送番組を全て受信できるようにするために
は、受信機に各方式の復調回路を組み込み、放送
番組のステレオ放送方式を識別してその方式に応
じた復調回路を適宜選択するようにすればよい。
In order to be able to receive all stereo broadcast programs of each stereo broadcast system with a single receiver, the receiver must be equipped with a demodulation circuit for each system, and the receiver must be able to identify the stereo broadcast system of the broadcast program and convert it according to that system. The demodulation circuit may be selected appropriately.
各方式を自動的に識別する方法としてはパイロ
ツト信号を用いる方法が提案される。すなわち、
各方式の放送電波中には、ステレオ放送であるこ
とをステレオ・インジケータで表示するためのパ
イロツト信号が含まれており、このパイロツト信
号の周波数は各方式によりそれぞれ異なるものが
採用されている。すなわち、AM−PM方式は5
Hz、ISB方式は15Hz、C−QUAM方式は25Hz、
CPM方式は55Hzである。よつてパイロツト信号
周波数を識別することにより各方式の識別が可能
である。 A method using a pilot signal has been proposed as a method for automatically identifying each method. That is,
The broadcast radio waves of each system include a pilot signal for indicating that it is a stereo broadcast with a stereo indicator, and the frequency of this pilot signal differs depending on the system. In other words, the AM-PM method has 5
Hz, ISB method is 15Hz, C-QUAM method is 25Hz,
The CPM method is 55Hz. Therefore, each system can be identified by identifying the pilot signal frequency.
このため復調信号からパイロツト信号を取り出
すことが必要となる。パイロツト信号の分離のた
めには、4方式のパイロツト信号周波数帯域(5
Hz〜55Hz)を通過する帯域通過フイルタが利用可
能である。この場合、フイルタ通過後のパイロツ
ト信号中には音声の変調周波数成分、外来雑音成
分、電界変動による雑音成分などが含まれてい
る。これらの成分はパイロツト信号周波数の識
別、したがつて4方式の識別を誤らせる原因とな
る。 Therefore, it is necessary to extract the pilot signal from the demodulated signal. In order to separate the pilot signal, four types of pilot signal frequency bands (5
Hz to 55Hz) are available. In this case, the pilot signal after passing through the filter contains audio modulation frequency components, external noise components, noise components due to electric field fluctuations, and the like. These components cause erroneous identification of the pilot signal frequency and therefore the identification of the four methods.
4方式のパイロツト信号周波数にそれぞれ同調
するフイルタを用いることも考えられるが、この
ようなフイルタを構成することは技術的にもなか
なか難しく、また実現したとしても高価なものと
なる。さらに、このようなフイルタでは目的とす
る方式のパイロツト信号の周波数成分以外に他の
3方式のパイロツト信号周波数帯の雑音成分も取
り出されることとなり、これらの雑音成分が上記
同様やはり誤動作を起こす原因となる。 Although it is conceivable to use filters tuned to each of the four pilot signal frequencies, it is technically difficult to construct such a filter, and even if it were realized, it would be expensive. Furthermore, in addition to the frequency components of the pilot signal of the target system, such a filter also extracts noise components in the pilot signal frequency bands of the other three systems, and these noise components can also cause malfunctions as described above. Become.
上述の問題点を解決するために、本発明におい
ては、それぞれ異なる振幅変調ステレオ放送方式
用の複数の復調回路であつて各方式のステレオ表
示用パイロツト信号周波数がそれぞれ異なつてい
るもの、該復調回路の復調出力からパイロツト信
号を分離する回路、該分離する回路で分離された
パイロツト信号の周波数を識別する周波数識別回
路、および、該周波数識別回路により識別された
パイロツト信号周波数に基づき該複数の復調回路
のうちから該パイロツト信号周波数に対応した復
調回路を選択する回路を備えた振幅変調ステレオ
放送方式識別装置において、前記分離する回路か
らのパイロツト信号を波形整形するためのヒステ
リシス・コンパレータと、該ヒステリシス・コン
パレータへの入力を微分してその過大雑音入力を
検出し判定する微分判定回路と、該微分判定回路
の検出出力に応じて前記周波数識別回路の識別結
果を所定期間保持する記憶保持回路とを具備する
ことを特徴とする振幅変調ステレオ放送方式識別
装置が提供される。
In order to solve the above-mentioned problems, the present invention provides a plurality of demodulation circuits for different amplitude modulation stereo broadcast systems, each of which has a different pilot signal frequency for stereo display; a circuit for separating a pilot signal from the demodulated output of the demodulating circuit; a frequency identifying circuit for identifying the frequency of the pilot signal separated by the separating circuit; and a plurality of demodulating circuits based on the pilot signal frequency identified by the frequency identifying circuit. The amplitude modulation stereo broadcast system identification device includes a circuit for selecting a demodulation circuit corresponding to the pilot signal frequency from among the demodulation circuits, which further comprises: a hysteresis comparator for shaping the waveform of the pilot signal from the separating circuit; It includes a differential judgment circuit that differentiates the input to the comparator and detects and judges excessive noise input, and a memory holding circuit that holds the identification result of the frequency identification circuit for a predetermined period according to the detection output of the differential judgment circuit. An amplitude modulation stereo broadcast system identification device is provided.
本発明によれば、受信電波から分離されたパイ
ロツト信号はヒステリシス・コンパレータによつ
て或るヒステリシス幅をもつて比較されて波形整
形される。これにより、このヒステリシス幅内に
ある雑音成分は除去され、周波数識別回路の識別
動作が雑音成分によつて誤動作することを防止で
きる。
According to the present invention, a pilot signal separated from a received radio wave is compared with a certain hysteresis width by a hysteresis comparator and its waveform is shaped. Thereby, noise components within this hysteresis width are removed, and it is possible to prevent the frequency identification circuit from malfunctioning in its identification operation due to the noise components.
また、ヒステリシス・コンパレータによつても
除去しきれない過大電圧レベルの雑音成分が入力
された場合にも該雑音成分は検出回路によつて検
出され、周波数識別状態は保持回路によつて雑音
成分入力前の状態に保持されるので、過大レベル
の雑音による識別誤動作を防止できる。 Furthermore, even if a noise component with an excessive voltage level that cannot be removed even by the hysteresis comparator is input, the noise component is detected by the detection circuit, and the frequency identification state is determined by the holding circuit. Since the previous state is maintained, it is possible to prevent identification errors due to excessive level of noise.
本発明の一実施例としてのAMステレオ放送方
式識別装置が第1図に示される。第1図におい
て、受信電波は高周波受信部(図示しない)で受
信検波されて中間周波数(IF)信号に変換され
る。該IF信号は、方式がそれぞれ異なる4つの
復調回路11〜14の入力端子にそれぞれ導かれ
る。
An AM stereo broadcast system identification device as an embodiment of the present invention is shown in FIG. In FIG. 1, received radio waves are received and detected by a high frequency receiver (not shown) and converted into an intermediate frequency (IF) signal. The IF signal is guided to the input terminals of four demodulation circuits 11 to 14, each using a different method.
復調回路11,12,13,14はそれぞれ
AM−PM方式、ISB方式、C−QUAM方式、
CPM方式の復調回路であり、各復調回路11,
12,13,14のパイロツト信号周波数はそれ
ぞれ5Hz、15Hz、25Hz、55Hzである。これらの復
調回路11〜14は、入力されたIF信号からL
チヤネル信号およびRチヤネル信号を分離して方
式切替え回路5の入力端子に導く。 Demodulation circuits 11, 12, 13, and 14 are each
AM-PM method, ISB method, C-QUAM method,
It is a CPM method demodulation circuit, and each demodulation circuit 11,
Pilot signal frequencies 12, 13, and 14 are 5Hz, 15Hz, 25Hz, and 55Hz, respectively. These demodulation circuits 11 to 14 extract L from the input IF signal.
The channel signal and the R channel signal are separated and guided to the input terminal of the system switching circuit 5.
CPM方式の復調回路14で得られたSUB信号
(副チヤネル信号)はパイロツト・フイルタ2に
導かれる。パイロツト・フイルタ2は4方式のパ
イロツト信号を含む周波数帯域、すなわち5Hz〜
55Hzの帯域を通過させる帯域通過フイルタであ
り、LおよびRチヤネル信号成分を除去してパイ
ロツト信号成分を取り出す。 The SUB signal (subchannel signal) obtained by the CPM demodulation circuit 14 is guided to the pilot filter 2. The pilot filter 2 operates in a frequency band including four types of pilot signals, that is, from 5Hz to
This is a bandpass filter that passes the 55Hz band, and removes the L and R channel signal components to extract the pilot signal component.
パイロツト・フイルタ2の出力はヒステリシ
ス・コンパレータ3および微分判定回路5の入力
端子に導かれる。ヒステリシス・コンパレータ3
は被識別信号としてのパイロツト・フイルタ出力
信号をパルス波形に波形整形する回路であり、パ
イロツト信号に重畳された電圧レベルの低い雑音
成分の影響を除去しつつ波形整形を行う機能を有
している。ヒステリシス・コンパレータ3の出力
は周波数識別回路4の入力端子に導かれる。 The output of the pilot filter 2 is led to the input terminals of a hysteresis comparator 3 and a differential determination circuit 5. Hysteresis comparator 3
is a circuit that shapes the pilot filter output signal, which is the signal to be identified, into a pulse waveform, and has the function of shaping the waveform while removing the influence of low-voltage noise components superimposed on the pilot signal. . The output of the hysteresis comparator 3 is led to an input terminal of a frequency discrimination circuit 4.
周波数識別回路4は、パイロツト・フイルタ2
および波形整形回路3を介して入力されるパルス
状のパイロツト信号の周波数が4方式のパイロツ
ト信号5Hz、15Hz、25Hz、55Hzのいずれに該当す
るかを識別する回路である。識別結果は各方式対
応の4本の出力線のうちの1本をハイレベルとす
る識別信号の形式で方式切替え回路7に送られ
る。方式切替え回路7は例えばアナログスイツチ
で構成されており、識別信号に基づいて4方式の
復調回路11〜14のうちの1つを選択切替えす
る。 The frequency identification circuit 4 includes a pilot filter 2
This circuit identifies which of the four types of pilot signals 5Hz, 15Hz, 25Hz, and 55Hz the frequency of the pulsed pilot signal inputted through the waveform shaping circuit 3 corresponds to. The identification result is sent to the system switching circuit 7 in the form of an identification signal that sets one of the four output lines corresponding to each system to a high level. The system switching circuit 7 is composed of, for example, an analog switch, and selectively switches one of the four systems of demodulation circuits 11 to 14 based on an identification signal.
微分判定回路5は入力信号の微分値が或る一定
値を超えるか否かを判定することにより過大電圧
レベルの雑音を検出する回路であり、検出出力は
記憶保持回路6の入力端子に導かれる。 The differential determination circuit 5 is a circuit that detects excessive voltage level noise by determining whether the differential value of the input signal exceeds a certain constant value, and the detection output is led to the input terminal of the memory holding circuit 6. .
記憶保持回路6は入力端子に「0」レベル信号
が印加されることにより出力端子に「0」レベル
の出力信号S(q)を継続的に出力する回路であ
る。出力信号S(q)は周波数識別回路4のラツ
チ制御端子に導かれ、それにより周波数識別回路
4の識別出力を前回測定サイクルの値に保持す
る。周波数識別回路4から記憶保持回路6のリセ
ツト端子にリセツト信号S(r)が導かれており、
このリセツト信号S(r)により記憶保持回路6
の出力信号は「0」レベルから「1」レベルにリ
セツトされる。 The memory holding circuit 6 is a circuit that continuously outputs a "0" level output signal S(q) to its output terminal when a "0" level signal is applied to its input terminal. The output signal S(q) is led to the latch control terminal of the frequency identification circuit 4, thereby holding the identification output of the frequency identification circuit 4 at the value of the previous measurement cycle. A reset signal S(r) is led from the frequency identification circuit 4 to the reset terminal of the memory holding circuit 6,
This reset signal S(r) causes the memory holding circuit 6 to
The output signal of is reset from the "0" level to the "1" level.
第1図装置におけるヒステリシス・コンパレー
タ3の構成の一例が第2図に示される。第2図に
おいて、パイロツト・フイルタ2からの信号は抵
抗器R31を介して電圧比較器Q31の非反転入力端
子に導かれるとともに、抵抗器R32を介してコン
デンサC31および電圧比較器Q31の反転入力端子に
導かれる。コンデンサC31は直流基準電圧レベル
を作り、電圧比較器Q31の反転入力端子に与える
ためのものである。電圧比較器Q31の非反転入力
端子と出力端子間には出力にヒステリシス特性を
与えるための帰還抵抗器R33が接続される。 An example of the configuration of the hysteresis comparator 3 in the device shown in FIG. 1 is shown in FIG. In FIG. 2, the signal from pilot filter 2 is conducted via resistor R 31 to the non-inverting input terminal of voltage comparator Q 31 and via resistor R 32 to capacitor C 31 and voltage comparator Q. 31 is led to the inverting input terminal. Capacitor C31 is for creating a DC reference voltage level and applying it to the inverting input terminal of voltage comparator Q31 . A feedback resistor R 33 is connected between the non-inverting input terminal and the output terminal of the voltage comparator Q 31 to provide hysteresis characteristics to the output.
このヒステリシス・コンパレータ3の動作が以
下に説明される。いまヒステリシス・コンパレー
タ3への入力信号がa点において直流電圧成分V
(a)および交流電圧成分v(a)を有しているものとす
ると、C点においては直流電圧成分V(a)のみが現
れて交流電圧成分v(a)はゼロとなり、該直流電圧
成分v(a)が電圧比較器Q31の反転入力端子に基準
電圧として入力される。 The operation of this hysteresis comparator 3 will be explained below. Now, the input signal to the hysteresis comparator 3 has a DC voltage component V at point a.
(a) and an AC voltage component v(a), at point C, only the DC voltage component V(a) appears and the AC voltage component v(a) becomes zero, and the DC voltage component v(a) is input as a reference voltage to the inverting input terminal of voltage comparator Q31 .
電圧比較器Q31の出力端子(すなわちd点)に
おける出力信号電圧レベルは高レベルV(dh)ま
たは低レベルV(dl)のいずれかになる。したが
つて比較器Q31の出力信号が高レベルV(dh)の
ときにはb点における直流電圧V(bh)は、
V(bh)=R31・V(dh)+R33・V(a)/R31+R33
となり、一方、出力信号が低レベルV(dl)のと
きにはb点における直流電圧V(bl)は、
V(bl)=R31・V(dl)+R33・V(a)/R31+R33
となる。 The output signal voltage level at the output terminal (ie, point d) of voltage comparator Q 31 is either high level V (dh) or low level V (dl). Therefore, when the output signal of comparator Q31 is at a high level V(dh), the DC voltage V(bh) at point b is V(bh)= R31・V(dh)+ R33・V(a)/ On the other hand, when the output signal is at a low level V (dl), the DC voltage V ( bl ) at point b is V (bl) = R 31 · V (dl) + R 33 · V (a) / It becomes R 31 + R 33 .
このようにb点における直流バイアス電圧は比
較器Q31の出力電圧レベルに応じて変化すること
となり、結局、比較器Q31はV(bh)とV(bl)と
の差V(H)のヒステリシス幅を持つヒステリシ
ス特性を有することになる。 In this way, the DC bias voltage at point b changes according to the output voltage level of comparator Q 31 , and in the end, comparator Q 31 detects the difference V (H) between V (bh) and V (bl). It has a hysteresis characteristic with a hysteresis width.
V(H)=R31/R31+R33(V(dh)−V(dl))
上記の動作を理解しやすくするために第2図中
のa,b,c,dの各点における信号波形が第5
図に示される。第5図1はa点における信号波形
S(a)であり、雑音が重畳されていない場合のパイ
ロツト信号を示している。第5図2はb点の信号
波形S(b)およびC点の信号波形S(c)を示し、第5
図3ではd点の信号波形S(d)を示す。 V(H)=R 31 /R 31 +R 33 (V(dh)-V(dl)) To make the above operation easier to understand, the signals at each point a, b, c, and d in Figure 2 are shown below. The waveform is the fifth
As shown in the figure. FIG. 51 shows a signal waveform S(a) at point a, and shows a pilot signal when no noise is superimposed. 5. FIG. 2 shows the signal waveform S(b) at point b and the signal waveform S(c) at point C.
FIG. 3 shows a signal waveform S(d) at point d.
第1図装置における微分判定回路5の構成の一
例が第3図に示される。第3図において、パイロ
ツト・フイルタ2からの信号は、抵抗器R51およ
びコンデンサC51からなる遅延回路51を介して
トランジスタQ51およびQ52のベースに導かれる
とともに、抵抗器R52を介してトランジスタQ51
およびQ52のエミツタに導かれる。トランジスタ
Q51,Q52はエミツタ同志が接続されて電源Vccと
接地との間に抵抗器R53,R54とともに直列に挿
入される。トランジスタQ51,Q52は過大入力信
号の検出機能とともに検出信号の増幅機能を兼備
しており、利得Gは
G=R53/R54
となる。 An example of the configuration of the differential determination circuit 5 in the apparatus shown in FIG. 1 is shown in FIG. In FIG. 3, the signal from the pilot filter 2 is conducted to the bases of transistors Q 51 and Q 52 via a delay circuit 51 consisting of a resistor R 51 and a capacitor C 51 , and via a resistor R 52 . Transistor Q 51
and guided by the emitsuta of Q 52 . transistor
Q 51 and Q 52 have their emitters connected together and are inserted in series with resistors R 53 and R 54 between the power supply V cc and ground. The transistors Q 51 and Q 52 have both the function of detecting an excessive input signal and the function of amplifying the detected signal, and the gain G is G=R 53 /R 54 .
トランジスタQ51のコレクタはトランジスタ
Q53のベースに接続される。トランジスタQ52お
よびQ53のコレクタはトランジスタQ54のベース
に接続される。トランジスタQ54は次段のデイジ
タル回路とのインタフエース用の回路であつて、
検出信号をパルス化している。 The collector of transistor Q 51 is a transistor
Connected to the base of Q 53 . The collectors of transistors Q 52 and Q 53 are connected to the base of transistor Q 54 . Transistor Q54 is a circuit for interfacing with the next stage digital circuit,
The detection signal is pulsed.
この微分判別回路5の動作が以下に説明され
る。遅延回路51の入力電圧をv1、出力電圧をv2
とし、遅延時間をT(d)とする。この遅延時間T(d)
は
T(d)=C51・R51
で表わされる。微分判別回路5への入力信号電圧
v1は抵抗器R51を介してトランジスタQ51および
Q52のエミツタに直ちに印加されるとともに、遅
延回路51で時間T(d)だけ遅延された後に、トラ
ンジスタQ51およびQ52のベースに印加される。
したがつて、トランジスタQ51およびQ52のベー
ス・エミツタ間には入力電圧v1と出力電圧v2との
差電圧が印加されることとなる。 The operation of this differential discrimination circuit 5 will be explained below. The input voltage of the delay circuit 51 is v 1 and the output voltage is v 2
and the delay time is T(d). This delay time T(d)
is expressed as T(d)=C 51・R 51 . Input signal voltage to differential discrimination circuit 5
v 1 is connected to transistor Q 51 and through resistor R 51
It is immediately applied to the emitter of Q 52 and, after being delayed by time T(d) in delay circuit 51, applied to the bases of transistors Q 51 and Q 52 .
Therefore, the difference voltage between the input voltage v 1 and the output voltage v 2 is applied between the base and emitter of transistors Q 51 and Q 52 .
この差電圧がトランジスタQ51またはQ52のベ
ース・エミツタ間電圧VBEを超えてそれらのベー
ス・エミツタ間を順方向にバイアスすると、トラ
ンジスタQ51またはQ52は導通され、それにより、
トランジスタQ54から出力信号が送出される。す
なわち、正の過大入力電圧が印加された場合には
トランジスタQ51,Q53およびQ54が導通されて
「0」レベルのパルス信号が出力され、負の過大
入力電圧が印加された場合にはトランジスタQ52
およびQ54が導通されて同じく「0」レベルのパ
ルス信号が出力される。 When this differential voltage exceeds the base-emitter voltage V BE of transistor Q 51 or Q 52 and forward biases their base-emitter, transistor Q 51 or Q 52 becomes conductive, thereby causing
An output signal is delivered from transistor Q54 . That is, when a positive excessive input voltage is applied, transistors Q 51 , Q 53 and Q 54 are turned on and a "0" level pulse signal is output, and when a negative excessive input voltage is applied, a "0" level pulse signal is output. Transistor Q 52
and Q54 are made conductive, and a pulse signal of the same "0" level is output.
入力電圧v1と出力電圧v2との差電圧がベース・
エミツタ間電圧VBEを超える条件は、入力信号電
圧の時間変化率がVBE/T(d)以上であることであ
る。遅延時間T(d)はパイロツト信号周波数自体に
よつて回路の検出動作が行われないようにして選
定される。したがつてカツトオフ周波数は55Hz以
上とされる必要がある。 The difference voltage between the input voltage v 1 and the output voltage v 2 is the base voltage.
The condition for exceeding the emitter voltage V BE is that the time rate of change of the input signal voltage is equal to or higher than V BE /T(d). The delay time T(d) is selected such that the pilot signal frequency itself does not cause the detection operation of the circuit. Therefore, the cutoff frequency needs to be 55Hz or higher.
第1図装置における周波数識別回路4の構成の
一例が第4図に示される。第4図において、ヒス
テリシス・コンパレータ3からのパルス波形信号
はアンドゲート41を介してカウント部42の入
力端子に導かれる。アンドゲート41の他方の入
力端子にはゲートパルス発生器43から単位時間
幅を有するパルス波形のゲート信号S(g)が導かれ
る。 An example of the configuration of the frequency identification circuit 4 in the apparatus shown in FIG. 1 is shown in FIG. In FIG. 4, the pulse waveform signal from the hysteresis comparator 3 is guided to the input terminal of a counting section 42 via an AND gate 41. A gate signal S(g) having a pulse waveform having a unit time width is introduced from a gate pulse generator 43 to the other input terminal of the AND gate 41.
ゲートパルス発生器43には基準発振器44が
接続されており、該発振器44からの基準周波数
信号に基づいてゲートパルス発生器43はゲート
信号S(g)のパルス幅、あるいはゲート信号S(g)、
ラツチ信号S(l)およびリセツト信号S(r)の発
生タイミング等を制御する。これらゲート信号S
(g)、ラツチ信号S(l)およびリセツト信号S(r)
の信号波形および発生タイミングが第6図に示さ
れる。第6図1にはゲート信号S(g)が、第6図2
にはラツチ信号S(l)が、第6図3にはリセツト信
号S(r)がそれぞれ示される。 A reference oscillator 44 is connected to the gate pulse generator 43, and based on the reference frequency signal from the oscillator 44, the gate pulse generator 43 determines the pulse width of the gate signal S(g) or the gate signal S(g). ,
The timing of generating the latch signal S(l) and reset signal S(r) is controlled. These gate signals S
(g), latch signal S(l) and reset signal S(r)
The signal waveform and generation timing of is shown in FIG. The gate signal S(g) is shown in FIG. 61, and the gate signal S(g) is shown in FIG.
The latch signal S(l) is shown in FIG. 6, and the reset signal S(r) is shown in FIG.
ゲートパルス発生器43からのリセツト信号S
(r)はカウント部42のリセツト端子に導かれ
る。またゲートパルス発生器43からのラツチ信
号S(l)はアンドゲート45を介してラツチ回路4
6のラツチタイミング制御端子に導かれる。アン
ドゲート45の他方の入力端子には記憶保持回路
6からの出力信号S(g)が導かれる。 Reset signal S from gate pulse generator 43
(r) is led to the reset terminal of the counting section 42. Further, the latch signal S(l) from the gate pulse generator 43 is passed through the AND gate 45 to the latch circuit 4.
6 latch timing control terminal. The output signal S(g) from the memory holding circuit 6 is introduced to the other input terminal of the AND gate 45.
カウント部42はゲート信号S(g)により定まる
単位時間内にアンドゲート41を介して入力され
たパルスの数を計数することにより入力信号の周
波数を測定し、その入力信号周波数が4方式のパ
イロツト信号周波数のいずれに該当するかを識別
する回路であり、4本の出力線47のうちの該当
する方式の出力線に「1」レベル信号を送出す
る。ラツチ回路46には識別部42からの識別信
号をラツチ信号S(l)のタイミングでラツチする。
ラツチ回路46の出力信号は方式切替え回路7の
切替え制御入力端子に導かれる。 The counting unit 42 measures the frequency of the input signal by counting the number of pulses input through the AND gate 41 within a unit time determined by the gate signal S(g), and determines whether the input signal frequency is the same as that of the four types of pilots. This is a circuit that identifies which of the signal frequencies corresponds to, and sends out a "1" level signal to the output line of the corresponding method among the four output lines 47. The latch circuit 46 latches the identification signal from the identification section 42 at the timing of the latch signal S(l).
The output signal of the latch circuit 46 is led to the switching control input terminal of the system switching circuit 7.
第1図装置の動作が第7図を参照しつつ以下に
説明される。 The operation of the apparatus of FIG. 1 will now be described with reference to FIG.
受信された放送電波は高周波受信部(図示しな
い)でIF信号に変換され、該IF信号は復調回路
11〜14にそれぞれ入力される。 The received broadcast radio wave is converted into an IF signal by a high frequency receiving section (not shown), and the IF signal is input to demodulation circuits 11 to 14, respectively.
復調回路14で得られたSUB信号はパイロツ
ト・フイルタ2に導かれ、パイロツト・フイルタ
2によつてパイロツト信号周波数帯の成分が取り
出される。このパイロツト・フイルタ2の出力信
号波形イが第5図1に示される。この出力信号波
形イは低周波数のパイロツト信号に高周波数の雑
音成分が重畳された場合の波形である。このパイ
ロツト・フイルタ2の出力信号はヒステリシス・
コンパレータ3に入力される。 The SUB signal obtained by the demodulation circuit 14 is guided to the pilot filter 2, and the pilot signal frequency band components are extracted by the pilot filter 2. The output signal waveform of this pilot filter 2 is shown in FIG. This output signal waveform A is a waveform when a high frequency noise component is superimposed on a low frequency pilot signal. The output signal of this pilot filter 2 has hysteresis.
It is input to comparator 3.
ヒステリシス・コンパレータ3では出力信号波
形イを基準電圧V(a)と比較してパルス波形に波形
整形を行うが、ヒステリシス・コンパレータ3が
ヒステリシス特性を持たない単なる波形整形回路
(すなわち第2図において帰還抵抗器R33を削除
した回路)であると、整形後の波形は第7図2に
示すような波形ロとなる。すなわち、パイロツト
信号成分以外の雑音成分によつてパルス波形が細
分されており、これにより次段の周波数識別回路
4が識別誤動作を起こす。 The hysteresis comparator 3 compares the output signal waveform A with the reference voltage V(a) and shapes the waveform into a pulse waveform. In the case of a circuit in which the resistor R33 is removed), the waveform after shaping becomes waveform B as shown in FIG. 72. That is, the pulse waveform is subdivided by noise components other than the pilot signal component, which causes the frequency identification circuit 4 in the next stage to malfunction.
これに対し、ヒステリシス・コンパレータ3で
出力信号波形イを波形整形した場合には、差電圧
V(H)を超えない範囲の雑音成分はヒステリシス・
コンパレータのヒステリシス幅によつて除去され
るので、雑音成分によつて出力パルス波形が細分
されることはなく、第7図3の波形ハで示される
ように、パイロツト信号のみがパルス波形化され
る。したがつて周波数識別回路4のおける識別誤
動作を防止でき、方式切替え回路7によりパイロ
ツト信号周波数に対応した正しい復調回路を選択
できる。 On the other hand, when the output signal waveform A is shaped by the hysteresis comparator 3, the noise component within the range that does not exceed the differential voltage V(H) is generated by hysteresis.
Since the output pulse waveform is removed by the hysteresis width of the comparator, the output pulse waveform is not subdivided by noise components, and only the pilot signal is converted into a pulse waveform, as shown by waveform c in Figure 7. . Therefore, it is possible to prevent a discrimination error in the frequency discrimination circuit 4, and the system switching circuit 7 can select the correct demodulation circuit corresponding to the pilot signal frequency.
一方、差電圧V(H)の範囲を超える雑音成分がパ
イロツト信号に重畳された場合にはヒステリシ
ス・コンパレータ3ではその雑音成分を取り除く
ことができず、周波数識別回路4の誤動作を惹起
しうる。このような過大電圧レベルの雑音成分は
微分判定回路5で微分値を判定することにより検
出され、それにより記憶保持回路6の出力信号S
(q)が「0」レベルに保持される。 On the other hand, if a noise component exceeding the range of the differential voltage V(H) is superimposed on the pilot signal, the hysteresis comparator 3 cannot remove the noise component, which may cause the frequency discrimination circuit 4 to malfunction. Such excessive voltage level noise components are detected by determining the differential value in the differential determining circuit 5, and the output signal S of the memory holding circuit 6 is thereby detected.
(q) is held at the "0" level.
この「0」レベルの出力信号S(q)によつて
周波数識別回路4内のアンドゲート45が閉じら
れ、ゲートパルス発生器43からのラツチ信号S
(l)がラツチ回路46のラツチタイミング制御端子
に印加されなくなる。よつて、ラツチ回路46の
内容は前回測定サイクルの識別内容に保持される
こととなり、過大レベルの雑音成分による識別誤
動作が防止できる。 This “0” level output signal S(q) closes the AND gate 45 in the frequency identification circuit 4, and the latch signal S from the gate pulse generator 43 closes.
(l) is no longer applied to the latch timing control terminal of latch circuit 46. Therefore, the contents of the latch circuit 46 are held at the identification contents of the previous measurement cycle, and erroneous identification operations due to excessive level noise components can be prevented.
なお、記憶保持回路6はゲートパルス発生器4
3からのリセツト信号S(r)により第6図に示
すタイミングでリセツトされ、アンドゲート45
は次の測定サイクルでは再び開いた状態となり、
よつて引き続き正常な周波数識別動作が行われ
る。 Note that the memory holding circuit 6 is connected to the gate pulse generator 4.
It is reset by the reset signal S(r) from 3 at the timing shown in FIG.
will be open again in the next measurement cycle, and
Therefore, normal frequency identification operation continues.
本発明の実施にあたつては種々の変形形態が可
能である。例えばヒステリシス・コンパレータ、
周波数識別回路、微分判定回路などは第2図〜第
4図に示された構成に限られるものではなく、目
的とする機能を果たすものであれば他の回路構成
によるものであつてもよい。 Various modifications are possible in implementing the invention. For example, a hysteresis comparator,
The frequency identification circuit, differential determination circuit, etc. are not limited to the configurations shown in FIGS. 2 to 4, but may have other circuit configurations as long as they achieve the intended functions.
本発明によれば、パイロツト信号周波数帯に雑
音成分があつても、これらの雑音成分による誤動
作を防止してAMステレオ放送の4方式を識別し
ステレオ放送を楽しむことができ、特にパイロツ
ト信号を微分する微分判定回路を設け、この微分
判定回路の検出出力に応じて周波数識別回路の識
別内容を保持するようにしたので、パイロツト信
号に過大な雑音成分が重畳された場合にも、過大
レベルの雑音成分による識別誤動作を防止でき
る。
According to the present invention, even if there are noise components in the pilot signal frequency band, it is possible to prevent malfunctions due to these noise components, identify the four AM stereo broadcasting systems, and enjoy stereo broadcasting.In particular, it is possible to differentiate the pilot signal. Since a differential judgment circuit is provided to hold the identification content of the frequency identification circuit according to the detection output of this differential judgment circuit, even if an excessive noise component is superimposed on the pilot signal, excessive level noise can be detected. Identification errors due to components can be prevented.
第1図は本発明の一実施例としてのAMステレ
オ放送方式識別装置のブロツク図、第2図は第1
図装置におけるヒステリシス・コンパレータの回
路図、第3図は第1図装置における微分判定回路
の回路図、第4図は第1図装置における周波数識
別回路のブロツク図、第5図は第2図のヒステリ
シス・コンパレータの各部の波形図、第6図は第
4図回路におけるゲートパルス発生器からの出力
信号の波形図、第7図はヒステリシス・コンパレ
ータの入出力信号の波形図である。
11〜14……復調回路、2……パイロツト・
フイルタ、3……ヒステリシス・コンパレータ、
4……周波数識別回路、5……微分判定回路、6
……記憶保持回路、7……方式切替え回路。
FIG. 1 is a block diagram of an AM stereo broadcast system identification device as an embodiment of the present invention, and FIG.
3 is a circuit diagram of the differential determination circuit in the device shown in FIG. 1, FIG. 4 is a block diagram of the frequency discrimination circuit in the device shown in FIG. FIG. 6 is a waveform diagram of each part of the hysteresis comparator, FIG. 6 is a waveform diagram of the output signal from the gate pulse generator in the circuit of FIG. 4, and FIG. 7 is a waveform diagram of input/output signals of the hysteresis comparator. 11-14...Demodulation circuit, 2...Pilot
Filter, 3...Hysteresis comparator,
4... Frequency identification circuit, 5... Differential determination circuit, 6
...memory holding circuit, 7...method switching circuit.
Claims (1)
の複数の復調回路であつて各方式のステレオ表示
用パイロツト信号周波数がそれぞれ異なつている
もの、該復調回路の復調出力からパイロツト信号
を分離する回路2、該分離する回路で分離された
パイロツト信号の周波数を識別する周波数識別回
路4、および、該周波数識別回路4により識別さ
れたパイロツト信号周波数に基づき該複数の復調
回路のうちから該パイロツト信号周波数に対応し
た復調回路を選択する回路7を備えた振幅変調ス
テレオ放送方式識別装置において、 前記分離する回路2からのパイロツト信号を波
形整形するためのヒステリシス・コンパレータ3
と、 該ヒステリシス・コンパレータ3への入力を微
分してその過大雑音入力を検出し判定する微分判
定回路5と、 該微分判定回路5の検出出力に応じて前記周波
数識別回路4の識別結果を所定期間保持する記憶
保持回路6とを具備することを特徴とする振幅変
調ステレオ放送方式識別装置。[Scope of Claims] 1. A plurality of demodulation circuits for different amplitude modulation stereo broadcasting systems, each of which has a different pilot signal frequency for stereo display, which separates the pilot signal from the demodulated output of the demodulation circuits. a frequency identification circuit 4 that identifies the frequency of the pilot signal separated by the separating circuit; and a frequency identification circuit 4 that selects the pilot signal from among the plurality of demodulation circuits based on the pilot signal frequency identified by the frequency identification circuit 4. In an amplitude modulation stereo broadcast system identification device comprising a circuit 7 for selecting a demodulation circuit corresponding to a signal frequency, a hysteresis comparator 3 for shaping the waveform of the pilot signal from the separating circuit 2 is provided.
and a differential determination circuit 5 that differentiates the input to the hysteresis comparator 3 to detect and determine excessive noise input; 1. An amplitude modulation stereo broadcast system identification device comprising a memory holding circuit 6 for holding data for a period of time.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18378684A JPS6162248A (en) | 1984-09-04 | 1984-09-04 | Device for discriminating amplitude modulating stereophonic broadcasting system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18378684A JPS6162248A (en) | 1984-09-04 | 1984-09-04 | Device for discriminating amplitude modulating stereophonic broadcasting system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6162248A JPS6162248A (en) | 1986-03-31 |
| JPH0352698B2 true JPH0352698B2 (en) | 1991-08-12 |
Family
ID=16141906
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18378684A Granted JPS6162248A (en) | 1984-09-04 | 1984-09-04 | Device for discriminating amplitude modulating stereophonic broadcasting system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6162248A (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8144878B2 (en) * | 2006-03-06 | 2012-03-27 | Mediatek Inc. | FM receiver and pilot detector thereof, and method for determining a type of a processed signal |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5780842A (en) * | 1980-11-07 | 1982-05-20 | Matsushita Electric Ind Co Ltd | Pilot signal detecting device |
| JPS57155852A (en) * | 1981-03-20 | 1982-09-27 | Sony Corp | Stereo reproducing device |
| US4426728A (en) * | 1981-08-31 | 1984-01-17 | Kahn Leonard R | Multiple system AM stereo receiver and pilot signal detector |
-
1984
- 1984-09-04 JP JP18378684A patent/JPS6162248A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6162248A (en) | 1986-03-31 |
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