JPH0359773U - - Google Patents
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- Publication number
- JPH0359773U JPH0359773U JP12106889U JP12106889U JPH0359773U JP H0359773 U JPH0359773 U JP H0359773U JP 12106889 U JP12106889 U JP 12106889U JP 12106889 U JP12106889 U JP 12106889U JP H0359773 U JPH0359773 U JP H0359773U
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- Japan
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- adder
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Links
- 238000001514 detection method Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Picture Signal Circuits (AREA)
- Input Circuits Of Receivers And Coupling Of Receivers And Audio Equipment (AREA)
Description
第１図は本考案のノイズ除去回路の一実施例を
示すブロツク図、第２図は同第１図の動作波形図
、第３図は同第２図の水平走査線（Ｈ）とノイズ
の関係図である。 １，２……１Ｈ遅延回路、３……加算器、４…
…1/2ゲインアンプ、５，６……コンパレータで
ある。
示すブロツク図、第２図は同第１図の動作波形図
、第３図は同第２図の水平走査線（Ｈ）とノイズ
の関係図である。 １，２……１Ｈ遅延回路、３……加算器、４…
…1/2ゲインアンプ、５，６……コンパレータで
ある。
Claims (1)
- 衛星放送受信用チユーナ内蔵クリアビジヨンに
おいて、映像検波出力信号を第１の１Ｈ遅延回路
と加算器入力と第１のコンパレータとに接続し、
同第１の１Ｈ遅延回路出力を第２の１Ｈ遅延回路
と前記第１のコンパレータの他方の入力と第２の
コンパレータと出力信号切換えスイツチの一方の
端子とに接続し、同第２の１Ｈ遅延回路出力を同
第２のコンパレータの他方の入力と前記加算器の
他方の入力とに接続し、同加算器出力を1/2ゲイ
ンアンプを通して前記スイツチの他方の端子に接
続し、前記第１のコンパレータ出力と前記第２の
コンパレータ出力とをそれぞれ２入力オアゲート
回路に接続し、同オアゲート回路出力を前記スイ
ツチの制御端子に接続し、前記第１の１Ｈ遅延回
路出力信号と前記1/2ゲインアンプを通した前記
加算器出力信号とを切換えて同スイツチの共通端
子より補間信号を出力してなるノイズ除去回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12106889U JPH0359773U (ja) | 1989-10-17 | 1989-10-17 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12106889U JPH0359773U (ja) | 1989-10-17 | 1989-10-17 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0359773U true JPH0359773U (ja) | 1991-06-12 |
Family
ID=31669111
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12106889U Pending JPH0359773U (ja) | 1989-10-17 | 1989-10-17 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0359773U (ja) |
-
1989
- 1989-10-17 JP JP12106889U patent/JPH0359773U/ja active Pending