JPH036347U - - Google Patents
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- Publication number
- JPH036347U JPH036347U JP10978189U JP10978189U JPH036347U JP H036347 U JPH036347 U JP H036347U JP 10978189 U JP10978189 U JP 10978189U JP 10978189 U JP10978189 U JP 10978189U JP H036347 U JPH036347 U JP H036347U
- Authority
- JP
- Japan
- Prior art keywords
- reception control
- control data
- receiving
- paging receiver
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000013500 data storage Methods 0.000 claims 2
- 238000010586 diagram Methods 0.000 description 8
- 238000001514 detection method Methods 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 1
- 230000001537 neural effect Effects 0.000 description 1
- 230000000737 periodic effect Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Landscapes
- Mobile Radio Communication Systems (AREA)
Description
第１図は本考案の一実施例に係るページング受
信機が用いられるページングシステムで用いられ
る送信信号フオーマツトを示す図、第２図は本考
案の一実施例に係るページング受信機の回路構成
を示す図、第３図は第２図中のデコーダ部の構成
を詳細に示す図、第４図は第２図中のＲＯＭカー
ドの構成を示す図、第５図は第２図中のメツセー
ジメモリの構成を示す図、第６図は上記実施例に
係るページング受信機の外観を示す図、第７図は
プリアンブルサーチ動作および同期コードサーチ
動作を説明する図、第８図は受信時の動作を説明
する図、第９図は第２図中のＣＰＵの動作の概要
を示すジエネラルフローチヤート、第１０図は上
記ジエネラルフローチヤート中のキー処理を詳細
に示すフローチヤート、第１１図は上記ジエネラ
ルフローチヤート中の着信処理を詳細に示すフロ
ーチヤートである。 １……ＣＰＵ、２……アンテナ、３……受信部
、４……デコーダ部、５……ＩＤ−ＲＯＭ、６…
…電源、７……ＲＯＭカード、７ａ……端子部、
８……メツセージメモリ、９……スイツチ回路、
１０……ＬＥＤドライバー、１１……ＬＥＤ、１
２……ブザードライバ、１３……ブザー、１４…
…表示部、１４ａ……第一副表示部、１４ｂ……
第二副表示部、１４ｃ……第一主表示部、１４ｄ
……第二主表示部、１５……本体部、１６……取
付部、２０……ビツト周期回路、２１……タイミ
ング制御回路、２２……プリアンブル検出回路、
２３……同期信号検出回路、２４……ＢＣＨ補正
回路、２５……ＳＣ不一致カウンタ、２６……バ
ツテリーセーブ信号デコーダ、２７……ＩＤ−Ｒ
ＯＭ制御デコーダ、２８……ＳＣリトライレジス
タ、２９……フレームレジスタ、３０……フレー
ムレジスタ、３１〜３３……アドレスレジスタ、
３４〜３６……アドレス比較回路、３８……アド
レスメツセージデコーダ、３９……アドレス処理
回路、４０……データ処理回路、ＳＷ１，ＳＷ２
，ＳＷ３，ＳＷ４，ＳＷ５……スイツチ。
信機が用いられるページングシステムで用いられ
る送信信号フオーマツトを示す図、第２図は本考
案の一実施例に係るページング受信機の回路構成
を示す図、第３図は第２図中のデコーダ部の構成
を詳細に示す図、第４図は第２図中のＲＯＭカー
ドの構成を示す図、第５図は第２図中のメツセー
ジメモリの構成を示す図、第６図は上記実施例に
係るページング受信機の外観を示す図、第７図は
プリアンブルサーチ動作および同期コードサーチ
動作を説明する図、第８図は受信時の動作を説明
する図、第９図は第２図中のＣＰＵの動作の概要
を示すジエネラルフローチヤート、第１０図は上
記ジエネラルフローチヤート中のキー処理を詳細
に示すフローチヤート、第１１図は上記ジエネラ
ルフローチヤート中の着信処理を詳細に示すフロ
ーチヤートである。 １……ＣＰＵ、２……アンテナ、３……受信部
、４……デコーダ部、５……ＩＤ−ＲＯＭ、６…
…電源、７……ＲＯＭカード、７ａ……端子部、
８……メツセージメモリ、９……スイツチ回路、
１０……ＬＥＤドライバー、１１……ＬＥＤ、１
２……ブザードライバ、１３……ブザー、１４…
…表示部、１４ａ……第一副表示部、１４ｂ……
第二副表示部、１４ｃ……第一主表示部、１４ｄ
……第二主表示部、１５……本体部、１６……取
付部、２０……ビツト周期回路、２１……タイミ
ング制御回路、２２……プリアンブル検出回路、
２３……同期信号検出回路、２４……ＢＣＨ補正
回路、２５……ＳＣ不一致カウンタ、２６……バ
ツテリーセーブ信号デコーダ、２７……ＩＤ−Ｒ
ＯＭ制御デコーダ、２８……ＳＣリトライレジス
タ、２９……フレームレジスタ、３０……フレー
ムレジスタ、３１〜３３……アドレスレジスタ、
３４〜３６……アドレス比較回路、３８……アド
レスメツセージデコーダ、３９……アドレス処理
回路、４０……データ処理回路、ＳＷ１，ＳＷ２
，ＳＷ３，ＳＷ４，ＳＷ５……スイツチ。
Claims (1)
- 【実用新案登録請求の範囲】 少なくとも情報提供のための多数のページング
受信機の一斉呼出しを受けての受信が可能なペー
ジング受信機において、 上記情報提供を受けるための受信制御データを
提供される情報の種類に対応して複数記憶する受
信制御データ記憶手段と、 上記受信制御データ記憶手段に記憶されている
複数の受信制御データから特定の情報に係る受信
制御データを選択する選択手段と、 上記選択手段により選択された受信制御データ
がセツトされる受信制御データ設定部を有し、当
該受信制御データ設定部にセツトされている受信
制御データに基づき、受信制御を行う受信制御手
段とを備えることを特徴とするページング受信機
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10978189U JPH036347U (ja) | 1988-09-20 | 1989-09-20 |
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12331788 | 1988-09-20 | ||
| JP10978189U JPH036347U (ja) | 1988-09-20 | 1989-09-20 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH036347U true JPH036347U (ja) | 1991-01-22 |
Family
ID=31718821
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10978189U Pending JPH036347U (ja) | 1988-09-20 | 1989-09-20 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH036347U (ja) |
-
1989
- 1989-09-20 JP JP10978189U patent/JPH036347U/ja active Pending
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