JPH039088Y2 - - Google Patents

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JPH039088Y2
JPH039088Y2 JP1981183479U JP18347981U JPH039088Y2 JP H039088 Y2 JPH039088 Y2 JP H039088Y2 JP 1981183479 U JP1981183479 U JP 1981183479U JP 18347981 U JP18347981 U JP 18347981U JP H039088 Y2 JPH039088 Y2 JP H039088Y2
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output
signal
circuit
electrical signal
switching circuit
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Description

【考案の詳細な説明】 本考案は、各種物理量の状態を連続的に検出の
うえ、物理量の変化が所定範囲内のとき物理量の
値を逐次保持する物理量検出装置に関するもので
ある。
[Detailed Description of the Invention] The present invention relates to a physical quantity detection device that continuously detects the states of various physical quantities and sequentially holds the values of the physical quantities when the change in the physical quantity is within a predetermined range.

従来の物理量測定装置または検出装置は、現時
点における物理量を指示するものであり、また
は、逐次変化する物理量を連続的に記録するもの
であつて、物理量があらかじめ定められた所定範
囲内にあるか否かは、指示状況または記録状況に
基づき人為的に判断するほかはなく、物理量検出
の対象とする装置、機器、部品等が異常を生ずる
場合、物理量の変化から異常の発生を事前かつ自
動的に検出することのできない欠点を生じてい
る。
Conventional physical quantity measuring devices or detection devices indicate the physical quantity at the current moment or continuously record the physical quantity that changes sequentially, and check whether the physical quantity is within a predetermined range. There is no other way than to manually judge based on the instruction status or recording status, and if an abnormality occurs in the equipment, equipment, parts, etc. targeted for physical quantity detection, the occurrence of the abnormality can be detected in advance and automatically from changes in the physical quantity. This results in defects that cannot be detected.

本考案は、従来のかゝる欠点を一挙に解消する
目的を有し、逐次変化する物理量を所定のタイミ
ングで順次電気信号に変換して出力する信号発生
手段SS,SEL,ADCと、入力された電気信号を
第1の出力と第2の出力に切替える切替回路SW
と、切替回路が第1の出力に切替えられていると
きに、信号発生手段から出力される電気信号を入
力して既に記憶されている内容を更新のうえ記憶
保持する保持回路MMと、切替回路が第2の出力
に切替えられているときに、信号発生手段から出
力される電気信号を入力し、この現在の入力電気
信号と保持回路に保持された電気信号とを比較
し、現在の入力電気信号と保持回路に保持された
電気信号との差が所定範囲内にあるときに範囲内
信号を出力する比較器CP1,CP2と、比較器が
範囲内信号を出力したとき常時第2の出力に切替
えられている切替回路を第1の出力に切替える切
替制御手段LAT2とから構成し、装置、機器、
部品等が異常を生ずる直前における物理量を検出
するものとした極めて効果的な、物理状態検出装
置を提供するものである。
The purpose of this invention is to eliminate such drawbacks of the conventional methods at once, and includes a signal generating means SS, SEL, ADC that sequentially converts physical quantities that change sequentially into electrical signals at a predetermined timing and outputs the electrical signals. Switching circuit SW that switches the electrical signal between the first output and the second output
a holding circuit MM that inputs an electrical signal output from the signal generating means to update and store the already stored contents when the switching circuit is switched to the first output; and a switching circuit. is switched to the second output, inputs the electrical signal output from the signal generating means, compares this current input electrical signal with the electrical signal held in the holding circuit, and calculates the current input electrical signal. Comparators CP1 and CP2 output an in-range signal when the difference between the signal and the electrical signal held in the holding circuit is within a predetermined range, and a second output is always output when the comparator outputs an in-range signal. It consists of a switching control means LAT2 that switches the switched switching circuit to the first output, and the device, equipment,
The present invention provides an extremely effective physical state detection device that detects a physical quantity immediately before a component or the like becomes abnormal.

以下、実施例を示すブロツク図により本考案の
詳細を説明する。
Hereinafter, details of the present invention will be explained with reference to block diagrams showing embodiments.

同図においては、マイクロホン、ストレインゲ
ージ等の物理量を電気信号へ変換するセンサSS
の出力を、各々通過周波数帯域の異なる複数の帯
域波器BPF1〜BPFoへ与え、各周波数帯域毎の
成分へ分割したうえ、パルス発生器PGからのタ
イミングパルスPtに応じて動作するセレクタ
SELにより、順次かつ反復して選択し、これの選
択出力をアナログ・デイジタル変換器(以下、
ADC)A/Dによりデイジタル信号へ変換して
から、切替回路SWを介し、比較器CP1〜CP3
比較入力Aへ与えている。
In the figure, sensors SS such as microphones and strain gauges that convert physical quantities into electrical signals are shown.
The output of is given to a plurality of band wavers BPF 1 to BPF o , each having a different passing frequency band, and divided into components for each frequency band, and a selector that operates according to the timing pulse Pt from the pulse generator PG.
SEL sequentially and iteratively selects and converts the selected output to an analog-to-digital converter (hereinafter referred to as
ADC) After converting into a digital signal by A/D, it is applied to comparison inputs A of comparators CP 1 to CP 3 via a switching circuit SW.

一方、保持回路としてのメモリMMの各アドレ
スには、帯域波器BPF1〜BPFoと対応して初期
値が格納されており、これがタイミングパルス
Ptと同期してパルス発生器PGから送出されるア
ドレス指定信号Saにより逐次に読み出され、タ
イミングパルスPtの前縁を微分回路DF1により微
分して取出したラツチパルスPl1に応じ、ラツチ
回路LAT1によつて保持され、これの保持内容
が、所定範囲の上限値を定めるためのバイアス回
路BAS1により、上限方向分のバイアス+aが付
加されると共に、所定範囲の下限値を定めるため
のバイアス回路BAS2により、下限方向分のバイ
アス−aが付加されたうえ、比較器CP1,CP2
基準入力Bへ与えられるものとなつている。
On the other hand, initial values are stored in each address of the memory MM as a holding circuit in correspondence with the bandpass filters BPF 1 to BPF o , and these are the timing pulses.
The latch circuit LAT is sequentially read out by the addressing signal Sa sent out from the pulse generator PG in synchronization with Pt, and is output by the latch circuit LAT according to the latch pulse Pl 1 which is extracted by differentiating the leading edge of the timing pulse Pt by the differentiating circuit DF 1 . 1 , and the content of this is added by the bias circuit BAS 1 for determining the upper limit value of a predetermined range, and a bias +a in the upper limit direction is added, and the bias circuit BAS 1 for determining the lower limit value of the predetermined range is added. A bias -a in the lower limit direction is added by the circuit BAS 2 , and is applied to the reference input B of the comparators CP 1 and CP 2 .

このため、現在の物理量を変換したADC・
A/Dの出力と、バイアス+aおよび−aが付加
された初期値とは、各比較器CP1,CP2により比
較され、比較器CP1においては、基準入力B>比
較入力Aの条件下において比較出力が例えば
“L”(低レベル)、BAのときに比較出力が例
えば“H”(高レベル)となり、比較器CP2にお
いては、基準入力B<比較入力Aの条件下におい
て比較出力が例えば“L”、BAのときに比較
出力が例えば“H”になるものとして設定されて
いるため、ADC・A/Dの出力が初期値に対し
所定範囲内であれば、各比較出力が“L”とな
り、NORゲートG1により反転されて“H”とな
つたうえ、インヒビツトゲートG2へ送出される。
For this reason, the ADC that converted the current physical quantity
The output of the A/D and the initial value to which biases +a and -a are added are compared by each comparator CP 1 and CP 2 , and in the comparator CP 1 , under the condition of reference input B>comparison input A In the case of BA, the comparison output becomes, for example, "L" (low level), and in the case of BA, the comparison output becomes, for example, "H" (high level).In the comparator CP 2 , under the condition of reference input B<comparison input A, the comparison output becomes "L" (low level). Since the comparison output is set to be, for example, "H" when is "L" and BA is "L", if the output of ADC/A/D is within a predetermined range with respect to the initial value, each comparison output will be The signal becomes "L", is inverted by NOR gate G1 , becomes "H", and is sent to inhibit gate G2 .

また、比較器CP3においては、比較入力Aへ
ADC・A/Dの出力が与えられ、各基準入力C
およびBには、物理量の絶対上限値と対応する信
号を発生する基準値回路E1および、物理量の絶
対下限値と対応する信号を発生する基準値回路
E2が与えられており、基準入力B<比較入力A
<基準入力Cの条件下において、比較出力が例え
ば“L”、BAまたはCAの条件において比
較出力が例えば“H”になるものと設定してある
ため、ADC・A/Dの出力が絶対値の上下限範
囲内であれば、比較出力が“L”であり、インヒ
ビツトゲートG2がオン状態となり、NORゲート
G1の出力がインヒビツトゲートG2を介し、ラツ
チ回路LAT2へ送出される。
Also, in comparator CP 3 , to comparison input A
The output of ADC/A/D is given, and each reference input C
and B includes a reference value circuit E 1 that generates a signal corresponding to the absolute upper limit value of the physical quantity, and a reference value circuit E 1 that generates a signal corresponding to the absolute lower limit value of the physical quantity.
E 2 is given, and reference input B < comparison input A
<Under the condition of reference input C, the comparison output is set to be, for example, “L”, and under the conditions of BA or CA, the comparison output is set to be, for example, “H”, so the output of ADC/A/D is an absolute value. If it is within the upper and lower limits of
The output of G1 is sent to the latch circuit LAT2 via the inhibit gate G2 .

ラツチ回路LAT2は、タイミングパルスPtの後
縁を微分回路DF2により微分して取出したラツチ
パルスPl2に応じ、インヒビツトゲートG2の出力
を保持し、この例では、保持内容が“H”のとき
に切替回路SWを駆動するため、現在の物理量に
応ずるADC・A/Dの出力がメモリMMへ与え
られ、アドレス指定信号Saにより指定されたア
ドレスへ内容を更新のうえ格納される。
The latch circuit LAT 2 holds the output of the inhibit gate G 2 according to the latch pulse Pl 2 obtained by differentiating the trailing edge of the timing pulse Pt by the differentiating circuit DF 2 , and in this example, the holding content is “H”. In order to drive the switching circuit SW at this time, the output of the ADC/A/D corresponding to the current physical quantity is given to the memory MM, and the contents are updated and stored at the address specified by the address designation signal Sa.

このため、セレクタSELの動作と同期して、各
周波数帯域毎に分割された現在の物理量に応ずる
ADC・A/Dの出力が、メモリMMの帯域波
器BPF1〜BPFoと対応するアドレスへ順次かつ反
復して格納され、格納された値が、つぎの基準値
としてラツチ回路LAT1へ与えられ、これが直前
の物理量を変換した値として、つぎの時点におけ
る現在の物理量を変換した値と比較されたうえ、
この比較結果が所定範囲内であれば、メモリMM
へ格納され、これらの動作を反復する。
For this reason, in synchronization with the operation of selector SEL, it corresponds to the current physical quantity divided for each frequency band.
The outputs of the ADC/A/D are sequentially and repeatedly stored in the addresses corresponding to the bandpass filters BPF 1 to BPF o of the memory MM, and the stored values are given to the latch circuit LAT 1 as the next reference value. This is the value obtained by converting the previous physical quantity, and is compared with the value obtained by converting the current physical quantity at the next point in time.
If the comparison result is within the specified range, the memory MM
and repeat these operations.

以上に対し、ADC・A/Dの出力が所定範囲
から逸脱すれば、比較器CP1またはCP2の比較出
力が“H”へ転じ、NORゲートG1の出力が
“L”となるため、インヒビツトゲートG2の出力
も“L”となり、あるいは、ADC・A/Dの出
力が絶対上下限範囲を逸脱すれば、比較器CP3
出力が“H”となつてインヒビツトゲートG2
オフ状態となり、この場合も同ゲートG2の出力
が“L”となることにより、切替回路SWが駆動
されず、現在の物理量を変換したADC・A/D
の出力がメモリMMへ格納されず、更に、各比較
器CP1〜CP3の比較出力がORゲートG3を介し警
報信号ALとして送出されると共に、警報信号AL
に応じてパルス発生器PGが動作を停止するため、
直前の物理量を変換した値がメモリMMにおいて
保持される。
Regarding the above, if the output of ADC/A/D deviates from the predetermined range, the comparison output of comparator CP 1 or CP 2 changes to "H" and the output of NOR gate G 1 becomes "L". If the output of the inhibit gate G2 also becomes "L" or the output of the ADC/A/D deviates from the absolute upper and lower limit range, the output of the comparator CP3 becomes "H" and the inhibit gate G2 turns off, and in this case as well, the output of the same gate G2 becomes "L", so the switching circuit SW is not driven, and the ADC/A/D that converted the current physical quantity
The output of each comparator CP 1 to CP 3 is not stored in the memory MM, and the comparison output of each comparator CP 1 to CP 3 is sent out as the alarm signal AL via the OR gate G 3 .
Since the pulse generator PG stops working depending on the
The value obtained by converting the immediately previous physical quantity is held in the memory MM.

したがつて、メモリMMの内容を電算機CPU
により読み出したうえ処理すれば、物理量が異常
値となる直前のデータが各周波数帯域毎に求めら
れ、所定範囲および絶対上下限値を適宜に定める
ことにより、装置、機器等が完全に障害を生ずる
事前において、対象部位の修理等を行なうことが
できる。
Therefore, the contents of memory MM are transferred to the computer CPU.
When read out and processed by , the data immediately before the physical quantity becomes an abnormal value can be obtained for each frequency band, and by appropriately setting a predetermined range and absolute upper and lower limits, it is possible to prevent equipment, equipment, etc. from completely failing. Repairs to the target area can be made in advance.

たゞし、センサSSとしては、マイクロホン、
ストレインゲージのほか、温度センサ、圧力セン
サ、流量センサ等、物理量を電気信号へ変換する
ものであれば、条件に応じて任意のものを用いれ
ばよく、複数のセンサを設けたうえ、セレクタ
SELにより順次かつ反復して選択するものとして
も同様であり、アナログ回路により構成し、
ADC・A/Dを省略してもよい。
However, the sensor SS is a microphone,
In addition to strain gauges, any device that converts a physical quantity into an electrical signal, such as a temperature sensor, pressure sensor, or flow rate sensor, can be used depending on the conditions.
The same applies to items that are selected sequentially and repeatedly using SEL, and are configured using analog circuits.
ADC/A/D may be omitted.

また、メモリMMの代りに、カウンタ、累算器
等を用い、セレクタSELの入力数と対応する数だ
けこれらのものを設けてもよく、各ゲートG1
G3を条件に応じて他のゲート回路へ置換しても
よい等、本考案は種々の変形が自在である。
Further, instead of the memory MM, counters, accumulators, etc. may be used, and a number of these items corresponding to the number of inputs of the selector SEL may be provided, and each gate G 1 to
The present invention can be modified in various ways, such as replacing G3 with another gate circuit depending on conditions.

以上の説明により明らかなとおり本考案によれ
ば、装置、機器等の物理的状態を連続的かつ自動
的に検出し、状態変化直前の値を保持するため、
装置、機器、部品等の寿命決定、保守、運用上省
力化が実現し、特に大型工作機械、歯科用グライ
ンダ等へ適用して多大な効果が得られる。
As is clear from the above explanation, according to the present invention, in order to continuously and automatically detect the physical state of devices, equipment, etc., and maintain the value immediately before the state change,
Labor savings can be realized in determining the lifespan, maintenance, and operation of equipment, equipment, parts, etc., and particularly when applied to large machine tools, dental grinders, etc., great effects can be obtained.

【図面の簡単な説明】[Brief explanation of drawings]

図は本考案の実施例を示すブロツク図である。 SS……センサ、BPF1〜BPFo……帯域波器、
SEL……セレクタ、A/D……ADC(アナログ・
デイジタル変換器)、SW……切替回路、MM…
…メモリ(保持回路)、CP1〜CP3……比較器、
BAS1,BAS2……バイアス回路、E1,E2……基
準値回路。
The figure is a block diagram showing an embodiment of the present invention. SS...Sensor, BPF 1 to BPF o ...Bandwidth wave device,
SEL...selector, A/D...ADC (analog/
digital converter), SW...switching circuit, MM...
...Memory (holding circuit), CP 1 to CP 3 ...Comparator,
BAS 1 , BAS 2 ...Bias circuit, E1 , E2 ...Reference value circuit.

Claims (1)

【実用新案登録請求の範囲】 逐次変化する物理量を所定のタイミングで順次
電気信号に変換して出力する信号発生手段と、 入力された電気信号を第1の出力と第2の出力
に切替える切替回路と、 該切替回路が第1の出力に切替えられていると
きに、前記信号発生手段から出力される電気信号
を入力して既に記憶されている内容を更新のうえ
記憶保持する保持回路と、 前記切替回路が第2の出力に切替えられている
ときに、前記信号発生手段から出力される電気信
号を入力し、この現在の入力電気信号と該保持回
路に保持された電気信号とを比較し、現在の入力
電気信号と保持回路に保持された電気信号との差
が所定範囲内にあるときに範囲内信号を出力する
比較器と、 該比較器が範囲内信号を出力したとき常時第2
の出力に切替えられている切替回路を第1の出力
に切替える切替制御手段と を設けたことを特徴とする物理状態検出装置。
[Claims for Utility Model Registration] Signal generating means that sequentially converts physical quantities that change sequentially into electrical signals at predetermined timings and outputs them, and a switching circuit that switches the input electrical signals to a first output and a second output. and a holding circuit that inputs the electric signal output from the signal generating means when the switching circuit is switched to the first output and updates and stores the already stored contents; inputting the electrical signal output from the signal generating means when the switching circuit is switched to the second output, and comparing this current input electrical signal with the electrical signal held in the holding circuit; a comparator that outputs an in-range signal when the difference between the current input electrical signal and the electrical signal held in the holding circuit is within a predetermined range;
1. A physical state detection device comprising: switching control means for switching a switching circuit that has been switched to the first output to the first output.
JP18347981U 1981-12-11 1981-12-11 Physical state detection device Granted JPS5890498U (en)

Priority Applications (1)

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JP18347981U JPS5890498U (en) 1981-12-11 1981-12-11 Physical state detection device

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JP18347981U JPS5890498U (en) 1981-12-11 1981-12-11 Physical state detection device

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Publication Number Publication Date
JPS5890498U JPS5890498U (en) 1983-06-18
JPH039088Y2 true JPH039088Y2 (en) 1991-03-07

Family

ID=29982777

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Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
GB1452740A (en) * 1972-10-12 1976-10-13 Mars Inc Digital memory coin selector method and apparatus
JPS5458458A (en) * 1977-10-19 1979-05-11 Hitachi Ltd Digital numerical display method

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JPS5890498U (en) 1983-06-18

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