JPH0397232U - - Google Patents

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JPH0397232U
JPH0397232U JP550990U JP550990U JPH0397232U JP H0397232 U JPH0397232 U JP H0397232U JP 550990 U JP550990 U JP 550990U JP 550990 U JP550990 U JP 550990U JP H0397232 U JPH0397232 U JP H0397232U
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JP
Japan
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push button
common terminal
circuit
button switches
flop
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【図面の簡単な説明】
第1図は従来の構成回路図、第2図は本考案の
構成例を示す回路図である。 1〜3……押しボタンスイツチ、10〜12…
…2回路押しボタンスイツチ、4〜6,13〜1
5……R−Sフリツプフロツプ、7,16……D
フリツプフロツプ、8,17……論理和回路、9
,18……遅延回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 それぞれ2回路のトランスフア接点を有する複
    数のモメンタリ形押しボタンスイツチと、 該複数の押しボタンスイツチのそれぞれの前記
    2回路のうちの一方の回路のメーク接点及びブレ
    ーク接点に接続されたチヤタリング防止用のR−
    Sフリツプフロツプと、 該R−Sフリツプフロツプの出力の論理和をと
    る論理和回路と、 該論理和回路の出力を遅延させる遅延回路と、 該R−Sフリツプフロツプの出力を入力し、前
    記遅延回路からのクロツクによつて該入力のいず
    れかをサンプリング出力するDフリツプフロツプ
    と を備え、前記複数の押しボタンスイツチの前記2
    回路の各共通端子はそれぞれ互いに共通接続され
    、前記複数の押しボタンスイツチのうちの1つの
    押しボタンスイツチの前記共通に接続された共通
    端子は接地され、該1つの押しボタンスイツチを
    除く他の押しボタンスイツチの前記共通に接続さ
    れた共通端子は前記1つの押しボタンスイツチま
    たは該他の押しボタンスイツチのうちの前段の押
    しボタンスイツチの前記2回路のうちの他方の回
    路のブレーク接点に接続されたスイツチ回路。
JP550990U 1990-01-24 1990-01-24 Pending JPH0397232U (ja)

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61156494A (ja) * 1984-12-28 1986-07-16 グレイ・エンジニアリング株式会社 重複投票防止型投票機用選出スイツチ装置

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61156494A (ja) * 1984-12-28 1986-07-16 グレイ・エンジニアリング株式会社 重複投票防止型投票機用選出スイツチ装置

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