JPH04100184A - １チップコンピュータ - Google Patents
１チップコンピュータInfo
- Publication number
- JPH04100184A JPH04100184A JP2217668A JP21766890A JPH04100184A JP H04100184 A JPH04100184 A JP H04100184A JP 2217668 A JP2217668 A JP 2217668A JP 21766890 A JP21766890 A JP 21766890A JP H04100184 A JPH04100184 A JP H04100184A
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- JP
- Japan
- Prior art keywords
- chip
- lsi
- lsi chip
- output device
- built
- Prior art date
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- Pending
Links
- 239000004973 liquid crystal related substance Substances 0.000 claims abstract description 8
- 230000010365 information processing Effects 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
Landscapes
- Calculators And Similar Devices (AREA)
- Microcomputers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は情報処理装置の小型化に利用する。本発明はシ
ステム全体を小型化した１チップコンピュータに関する
。
ステム全体を小型化した１チップコンピュータに関する
。
本発明は、中央処理部、記憶部、および入出力制御部を
含む論理回路が集積回路化された１チップコンピュータ
において、 表示手段および電源をＬＳＩチップに内蔵することによ
り、 システム全体を小型化するようにしたものである。
含む論理回路が集積回路化された１チップコンピュータ
において、 表示手段および電源をＬＳＩチップに内蔵することによ
り、 システム全体を小型化するようにしたものである。
従来、情報処理装置の小型化は中央処理部、記憶部、お
よび入出力制御部を構成する論理回路の１部あるいは全
部を集積回路化することにより行われできた。
よび入出力制御部を構成する論理回路の１部あるいは全
部を集積回路化することにより行われできた。
上述した従来の方法では、入出力装置や電源が全て外付
けであるためＬＳＩの集積度が高くなってもシステム全
体としての小型化に限界があった。
けであるためＬＳＩの集積度が高くなってもシステム全
体としての小型化に限界があった。
本発明はこのような問題を解決するもので、出力装置お
よび電源を集積回路化し小型化した１チップコンピュー
タを提供することを目的とする。
よび電源を集積回路化し小型化した１チップコンピュー
タを提供することを目的とする。
本発明は、入力装置、出力装置、および電源が外部に設
けられ、中央処理部、記憶部、および入出力制御部を構
成する論理回路がＬＳＩチップに内蔵された１チップコ
ンピュータにおいて、前記出力装置が前記ＬＳＩチップ
のチップケースに設けられ、前記電源が前記ＬＳＩチッ
プに内蔵されたことを特徴とする。
けられ、中央処理部、記憶部、および入出力制御部を構
成する論理回路がＬＳＩチップに内蔵された１チップコ
ンピュータにおいて、前記出力装置が前記ＬＳＩチップ
のチップケースに設けられ、前記電源が前記ＬＳＩチッ
プに内蔵されたことを特徴とする。
前記出力装置が液晶表示板であり、前記ＬＳＩチップに
光源を内蔵し、表示内容が外部スクリーンに投影され、
前記ＬＳＩチップの蓋が共鳴板により構成された圧電ブ
ザーを備えることができる。
光源を内蔵し、表示内容が外部スクリーンに投影され、
前記ＬＳＩチップの蓋が共鳴板により構成された圧電ブ
ザーを備えることができる。
外部に接続された出力装置をＬＳＩチップのチップケー
スに設け、電源をＬＳＩチップに内蔵することにより小
型化することができ、さらに出力装置を液晶表示板とし
、光源を内蔵することによって表示内容を外部スクリー
ンに投影することが可能となり、チップケースの蓋に共
鳴板によって構成された圧電ブザーを設はエラー発生時
に警報を発することもできる。
スに設け、電源をＬＳＩチップに内蔵することにより小
型化することができ、さらに出力装置を液晶表示板とし
、光源を内蔵することによって表示内容を外部スクリー
ンに投影することが可能となり、チップケースの蓋に共
鳴板によって構成された圧電ブザーを設はエラー発生時
に警報を発することもできる。
次に、本発明実施例を図面に基づいて説明する。
図は本発明実施例の構成を示す図である。
本発明実施例は、入力装置を構成するマウス３が外部に
接続され、中央処理部、記憶部、および入出力制御部を
構成する論理回路１１がＬＳＩチップ１に内蔵される。
接続され、中央処理部、記憶部、および入出力制御部を
構成する論理回路１１がＬＳＩチップ１に内蔵される。
さらに、本発明の特徴として、出力装置を構成する液晶
表示板１４がＬＳＩチップ１のチップケースに設けられ
、蓄電池１２および光源１３がＬＳＩチップ１に内蔵さ
れ、表示内容がスクリーン４に投影されるように構成さ
れる。また、ＬＳＩチップ１の蓋に共鳴板により構成さ
れた圧電ブザー１５が設けられる。
表示板１４がＬＳＩチップ１のチップケースに設けられ
、蓄電池１２および光源１３がＬＳＩチップ１に内蔵さ
れ、表示内容がスクリーン４に投影されるように構成さ
れる。また、ＬＳＩチップ１の蓋に共鳴板により構成さ
れた圧電ブザー１５が設けられる。
このように構成された本発明実施例は、マウス３から入
力された入力情報はＬＳＩソケット２を経由してＬＳＩ
チップ１内の論理回路１１に与えられる。論理回路１１
からの出力情報は液晶表示板１４上に表示され、光源１
３によってスクリーン４上に投影されると共に、エラー
などによる警告はＬＳＩチップｌの蓋に設けられた圧電
ブザー１５の鳴動によって通知される。
力された入力情報はＬＳＩソケット２を経由してＬＳＩ
チップ１内の論理回路１１に与えられる。論理回路１１
からの出力情報は液晶表示板１４上に表示され、光源１
３によってスクリーン４上に投影されると共に、エラー
などによる警告はＬＳＩチップｌの蓋に設けられた圧電
ブザー１５の鳴動によって通知される。
また、本体１内各部への電源は蓄電池１２から供給され
、蓄電池１２の充電はＬＳＩソケット２に設けられたＤ
Ｃ入力端子２１へＡＣアダプターを接続することにより
行われる。ＬＳＩソケット２は吸盤２２によって机上な
どに固定することができる。
、蓄電池１２の充電はＬＳＩソケット２に設けられたＤ
Ｃ入力端子２１へＡＣアダプターを接続することにより
行われる。ＬＳＩソケット２は吸盤２２によって机上な
どに固定することができる。
以上説明したように本発明によれば、表示装置、電源な
どの構成要素をＬＳＩチップ内に取り込むことによりシ
ステム全体を小型化することができる効果がある。
どの構成要素をＬＳＩチップ内に取り込むことによりシ
ステム全体を小型化することができる効果がある。
図は本発明実施例の構成を示す図。
１・・・ＬＳＩチップ、２・・・ＬＳＩソケット、３・
・・マウス、４・・・スクリーン、１１・・・論理回路
、１２・・・蓄？、Ｌ池、１３・・・光源、１４・・・
液晶表示板、１５・・・圧電ブザ、２１・・・ＤＣ入力
端子、２２・・・吸盤。
・・マウス、４・・・スクリーン、１１・・・論理回路
、１２・・・蓄？、Ｌ池、１３・・・光源、１４・・・
液晶表示板、１５・・・圧電ブザ、２１・・・ＤＣ入力
端子、２２・・・吸盤。
Claims (1)
- 【特許請求の範囲】 １、入力装置、出力装置、および電源が外部に設けられ
、 中央処理部、記憶部、および入出力制御部を構成する論
理回路がＬＳＩチップに内蔵された１チップコンピュー
タにおいて、 前記出力装置が前記ＬＳＩチップのチップケースに設け
られ、前記電源が前記ＬＳＩチップに内蔵された ことを特徴とする１チップコンピュータ。 ２、前記出力装置が液晶表示板であり、前記ＬＳＩチッ
プに光源を内蔵し、表示内容が外部スクリーンに投影さ
れる請求項１記載の１チップコンピュータ。 ３、前記ＬＳＩチップの蓋が共鳴板により構成された圧
電ブザーである請求項１記載の１チップコンピュータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2217668A JPH04100184A (ja) | 1990-08-17 | 1990-08-17 | １チップコンピュータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2217668A JPH04100184A (ja) | 1990-08-17 | 1990-08-17 | １チップコンピュータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04100184A true JPH04100184A (ja) | 1992-04-02 |
Family
ID=16707851
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2217668A Pending JPH04100184A (ja) | 1990-08-17 | 1990-08-17 | １チップコンピュータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04100184A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| USRE37880E1 (en) | 1995-03-01 | 2002-10-15 | Seiko Epson Corporation | Projector |
-
1990
- 1990-08-17 JP JP2217668A patent/JPH04100184A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| USRE37880E1 (en) | 1995-03-01 | 2002-10-15 | Seiko Epson Corporation | Projector |
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