JPH04109631A - 半導体装置 - Google Patents

半導体装置

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JPH04109631A
JPH04109631A JP2228830A JP22883090A JPH04109631A JP H04109631 A JPH04109631 A JP H04109631A JP 2228830 A JP2228830 A JP 2228830A JP 22883090 A JP22883090 A JP 22883090A JP H04109631 A JPH04109631 A JP H04109631A
Authority
JP
Japan
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inp
layer
heterojunction
interface
electron
Prior art date
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Pending
Application number
JP2228830A
Other languages
English (en)
Inventor
Shigeru Nakajima
中島 成
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sumitomo Electric Industries Ltd
Original Assignee
Sumitomo Electric Industries Ltd
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Filing date
Publication date
Application filed by Sumitomo Electric Industries Ltd filed Critical Sumitomo Electric Industries Ltd
Priority to JP2228830A priority Critical patent/JPH04109631A/ja
Priority to US07/748,946 priority patent/US5164800A/en
Priority to CA002050245A priority patent/CA2050245A1/en
Priority to EP19910114536 priority patent/EP0477580A3/en
Priority to KR1019910015132A priority patent/KR950007350B1/ko
Publication of JPH04109631A publication Critical patent/JPH04109631A/ja
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  • Recrystallisation Techniques (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、InPから成る異種(ヘテロ)接合を使用す
る電界効果トランジスタ(FET)等の半導体装置に関
するものである。
〔従来の技術〕
InPは飽和電子速度がGaAsやI nGaAsより
も速く、しかも、熱伝導率がGaAsよりも高い。従っ
て、このInPを用いて形成されたFETは、高周波回
路における高出力の回路素子として適している。一方、
InPを素材とするショットキ接合は、従来、良好な接
合状態で形成することが出来なかった。このため、S 
I O2膜やSiN膜等の絶縁膜を接合面に形成したM
IS型のへテロ接合FETが開発されている。また、A
、QGaAs/GaAsのへテロ接合界面に形成される
2次元電子ガスを利用したGaAs系の高電子移動度ト
ランジスタ(HEMT)が存在するか、InPから成る
ヘテロ接合を使用するHEMTも検討されている。
このInP系のHEMTとしては、例えば、第4図に示
される構造のものがある。この構造は、文献[新規なA
Q I nAs/InP 争HEMTJ(ELECTR
ONICS LETTER8,LOth May 19
90 Vol、26No、lO,p651 )に開示さ
れたものである。InP半導体基板1上には、バッファ
層であるAllnAs層2および活性層であるInP層
3が形成されている。さらに、InP層3上には、アン
ドープのAglnAs層4が形成され、A、QInAs
層4上にはn+型のAllInAs層5およびn+型の
InP層6か形成されている。そして、ケート電極7か
AJ7InAs層5上に形成され、ドレイン電極8およ
びソース電極9がInP層6上に形成されている。この
A、QInAs/1nPのへテロ接合を使用したHEM
Tも、高周波回路における高出力の回路素子として有望
である。
〔発明が解決しようとする課題〕
しかしながら、上記従来のInPを使用したMIs型F
ETにあっては、金属と半導体との接合面に絶縁膜が形
成されているため、半導体と絶縁膜との界面に高濃度の
界面準位が存在する。このため、この界面準位が原因に
なってドレイン電流にドリフト現象が発生し、また、低
周波数領域で伝達特性にヒステリシス現象が発生してし
まう。
一方、n−A11nAs/I nPのへテロ接合を使用
したHEMTにあっては、AJ71nAs1−の界面に
おけるAg元素とP元素との相性が悪く、結晶の整合性
は良くなかった。このため、InP系のHEMTにあっ
ては、GaAs系のHE M Tにおけるような高移動
度の電子を得ることか8来す、良好な高周波特性か達成
されなかった。
〔課題を解決するための手段〕
本発明はこのような課題を解消するためになされたもの
で、組成比Xか0.65以上0.85以下で構成される
(AgAs)   (InSb)1−x1−のへテロ接
合を備えて半導体装置を形成したものである。
〔作用〕
AgAsの格子定数は5.65A、1nsbの格子定数
は6,5Aである。従って、AJ7Asの組成比Xを0
.65以上0.85以下の範囲内で(AgAs)   
(InSb)   を構成することx        
l−x により、(AgAs)   (InSb)   は格子
x        1−X 定数が5.85AのInPに格子整合し、良好な接合状
態のへテロ接合が形成される。
また、この範囲内でのある組成比における(AN As
)   (I n5b)   のエネルギパンx   
    1−x ド図は第1図(a)に示される。伝導帯の底のエネルギ
準位Ecと価電子帯の頂上のエネルギ準位Evとの差に
相当するエネルギギャップEgは例えば1.33eVに
なり、伝導帯の底のエネルギ準位Ecにある電子を真空
準位EOに取り出す電子親和力χlは例えば約3.8e
Vと推定される。
また、InPのエネルギバンド図は同図(b)に示され
、エネルギギャップEgは1.35eV。
電子親和力χ2は約4.4eVになっている。従って、
これらCARAs)   (I n5b)   とx 
       トx InPとのへテロ接合部における伝導帯には、同IZ 
(C)に示されるように、両者の電子親和力の差(χ2
−χ1)に相当する、大きさΔECが例えば約0.6e
Vのエネルギスパイクが生じる。
〔実施例〕
次に本発明によるヘテロ接合をHEMTに適用した場合
の一実施例について説明する。
第2図はこの一実施例によるInP系のHEMTの構造
を示す断面図であり、以下の各製造工程を経ることによ
り完成される。
まず、MBE(分子線エピタキシ)法などの結晶成長技
術により、半絶縁性のInP半導体基板11上にバッフ
ァ層12.チャネル層13および電子供給層14を順次
形成する。バッファ層12の材質はアンドープのAI)
   In   Asであ0.48  0.52 す、その厚さは約1μmである。チャネル層13の材質
はアンドープのInPであり、その厚さは1000Aで
ある。また、電子供給層14の材質は、AJ1+ASの
組成比Xが0.65以上0.85以下に構成された(A
NAs)X (InSb)   であり、この(AI)As)x−x (InSb)   には濃度が1×1018個/−x Cm3のドナー不純物か添加されている。この組成比に
おいて、n  (AI As) x(InSb)   
からなる電子供給層14はアン−x ドープInPからなるチャネル層13と良好な格子整合
を形成している。また、電子供給層14の厚さは500
Aである。
次に、通常のフォトリソグラフィ技術を使用し、素子間
分離のためのマスクパターンを電子供給層14上に形成
する。そして、このパターンを利用したメサエッチング
により、各素子間を電気的に分離し、その後、形成した
マスクパターンを除去する。引き続いて露出した電子供
給層14上にAuGe/Niなどの金属を蒸着し、フォ
トリソグラフィ技術により蒸着した金属を選択的に除去
する。そして、合金化処理を施して金属と電子供給層]
4とのオーミック接触を取り、ソース電極15およびド
レイン電極16を形成する。
最後に、フォトリソグラフィ技術によりマスクパターン
を形成し、T i / P t / A u金属などを
選択的に形成する。そして、この金属と電子供給層14
とのショットキ接触を取り、ゲート電極17を形成する
。この結果、第2図に示される構造のHEMTが完成す
る。
本実施例によるHEMTのへテロ接合の界面、つまり、
n−AIInAsSbからなる電子供給層14とアンド
ープのInPからなるチャネル層13との界面近傍のチ
ャネル層13には点線で示される2次元電子ガスが生成
される。この2次元電子ガスは、ゲート電極17領域の
第3図に示されるエネルギハンド図において次のように
表される。同図の左側はケート電極17(ゲート金属)
中央は電子供給層14輸−(AIAs)X(InSb)
   )、右側はチャネル層13(ア■−X ントープInP)の領域に対応しており、伝導帯の底の
エネルギ準位ECが実線、フェルミ準位EFか点線で示
されている。
電子供給層14とチャネル層13との接合部には、前述
した第1図に示される大きさΔEcか約600meVの
エネルギスパイクか現れる。電子供給層14に添加され
たドナー不純物から放出された電子はこのスパイク部に
図示の斜線のように蓄積し、2次元電子ガスが生成され
る。この2次元電子ガス濃度はゲート電極17への印加
電圧によって調整される。
本実施例における(Aj?As)x (I n S b )   / I n Pのへテロ接
合界面は、x 上述のように結晶格子の整合性が良く、高品質に形成さ
れている。このため、ヘテロ接合界面における界面準位
の濃度は低下し、従来のようにドレイン電流のドリフト
現象や、伝達特性のヒステリシス現象は発生しない。ま
た、2次元電子ガスはこの高品質な界面近傍のチャネル
層13中に形成され、かつ、このチャネル層13は高電
界での電子輸送特性に優れたInPによって形成されて
いる。このため、2次元電子ガスの移動度は高くなる。
従って、本実施例によるヘテロ接合は、HEMTの他に
、特に、高電界が印加される高周波回路素子に利用する
と効果的である。
また、(AI As)   (J n5b)   およ
びx        1−x InPの各電子親和力の差は前述のように約0.6eV
であり、一方、従来のAplnAs/rnPのへテロ接
合における各半導体の電子親和力の差は約0.2eVで
ある。このため、第3図に示されるエネルギスパイクの
大きさΔEeは従来より大きくなり、2次元電子ガスの
蓄積量が増大してガス濃度を高くとれる。従って、HE
MTのチャネル層13に通電される電流量は増大し、電
流駆動能力に優れた高出力の高周波回路用素子が提供さ
れる。
なお、上記実施例は本発明によるヘテロ接合をHEMT
に適用した場合について説明したが、これに限定される
ものではなく、例えば、ヘテロ接合バイポーラトランジ
スタ(HB T)に適用しても良く、上記実施例と同様
な効果を奏する。この場合のHBTは、エミッタに(A
i)As)x(JnSb)      (0,65≦X
≦0. 85)1、−x ベースにp−InP、  コレクタにn−1nPを使用
して形成する。
〔発明の効果〕
以上説明したように本発明によれば、組成比Xか0,6
5以上0,85以下で構成される(AJ7As)   
(InSb)   1−のへテロ接x        
      1−x 合は、界面の結晶格子の整合性が良好な状態で形成され
る。このため、ヘテロ接合界面の界面準位濃度は低減し
、高濃度の界面準位に一起因する従来の種々の課題は解
決される。しかも、InPの有する速い飽和電子速度、
および高い熱伝導率といった特性か半導体装置に生かさ
れ、高周波特性の優れた高出力の素子を提供することが
可能になる。
【図面の簡単な説明】
第1図は本発明によるヘテロ接合のエネルギバンド構造
を示す図、第2図は本発明の一実施例によるHEMTの
構造を示す断面図、第3図は第2図に示されたH E 
MTのゲート領域におけるエネルギバンド構造を示す図
、第4図は従来のHE MTの構造を示す断面図である
。 11・・・半絶縁性基板(InP)、12・・・バッフ
ァ層(アンドープARIn   As)、0.48  
0.52 13・・・チャネル層(アンドープInP)、14・・
・電子供給層(n −(Ajll As) x(InS
b)   )、15−ソース電極、16−=−x ドレイン電極、17・・・ゲート電極。 代理人弁理士   長谷用  芳  樹間      
   塩   1)  辰   也従来のHEMTの構
造 竿4図

Claims (1)

    【特許請求の範囲】
  1. 組成比xが0.65以上0.85以下で構成される(A
    lAs)_x(InSb)_1_−_xとInPとの異
    種接合を備えて形成されることを特徴とする半導体装置
JP2228830A 1990-08-30 1990-08-30 半導体装置 Pending JPH04109631A (ja)

Priority Applications (5)

Application Number Priority Date Filing Date Title
JP2228830A JPH04109631A (ja) 1990-08-30 1990-08-30 半導体装置
US07/748,946 US5164800A (en) 1990-08-30 1991-08-23 Semiconductor device
CA002050245A CA2050245A1 (en) 1990-08-30 1991-08-29 Semiconductor device
EP19910114536 EP0477580A3 (en) 1990-08-30 1991-08-29 Heterostructure semiconductor devices
KR1019910015132A KR950007350B1 (ko) 1990-08-30 1991-08-30 반도체장치

Applications Claiming Priority (1)

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JP2228830A JPH04109631A (ja) 1990-08-30 1990-08-30 半導体装置

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JPH04109631A true JPH04109631A (ja) 1992-04-10

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JP2228830A Pending JPH04109631A (ja) 1990-08-30 1990-08-30 半導体装置

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