JPH0424710A - 定電圧回路 - Google Patents
定電圧回路Info
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- JPH0424710A JPH0424710A JP12403390A JP12403390A JPH0424710A JP H0424710 A JPH0424710 A JP H0424710A JP 12403390 A JP12403390 A JP 12403390A JP 12403390 A JP12403390 A JP 12403390A JP H0424710 A JPH0424710 A JP H0424710A
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- JP
- Japan
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- voltage
- transistor
- output voltage
- resistor
- power supply
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- Pending
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- Control Of Voltage And Current In General (AREA)
- Control Of Electrical Variables (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の目的〕
（産業上の利用分野）
本発明は低電源電圧がら高電源電圧まで適用することが
できる定電圧回路に関する。
できる定電圧回路に関する。
（従来の技術）
例えば、電源によって得られた電圧がら予め設定されて
いる電圧を生成する定電圧回路として、従来、第４図に
示す回路が知られている。
いる電圧を生成する定電圧回路として、従来、第４図に
示す回路が知られている。
この図に示す定電圧回路は電源１０１から出力される電
圧（電源電圧はＥｉ）から一定の電圧を生成する抵抗１
０２およびツェナーダイオード１０３と、これら抵抗１
０２およびツェナーダイオード１０３によって得られた
一定電圧に基づいて前記電源電圧から予め設定されてい
る電圧値Ｅ。
圧（電源電圧はＥｉ）から一定の電圧を生成する抵抗１
０２およびツェナーダイオード１０３と、これら抵抗１
０２およびツェナーダイオード１０３によって得られた
一定電圧に基づいて前記電源電圧から予め設定されてい
る電圧値Ｅ。
の出力電圧を生成してこれを負荷１０５に供給するトラ
ンジスタ１０４とを備えており、前記電源１０１から出
力される電源電圧から出力電圧を生成してこれを負荷１
０５に供給する。
ンジスタ１０４とを備えており、前記電源１０１から出
力される電源電圧から出力電圧を生成してこれを負荷１
０５に供給する。
（発明が解決しようとする課題）
しかしながら上述した従来の定電圧回路においては、電
源１０１によって得られる電源電圧の電圧値Ｅｉに応じ
て抵抗１０２およびツェナーダイオード１０３に流れる
電流値（ツェナー電流）が変化するため、電源１０１と
してＤＣ２４Ｖ〜ＡＣ１００Ｖのものを使用すると、Ａ
ＣｌｏｏＶのとき、直流電圧値で１４１Ｖ （−１００
Ｖ・２）になってしまうため、ＤＣ２４Ｖ−ＤＣ１４１
Ｖで使用するときと同じことになる。
源１０１によって得られる電源電圧の電圧値Ｅｉに応じ
て抵抗１０２およびツェナーダイオード１０３に流れる
電流値（ツェナー電流）が変化するため、電源１０１と
してＤＣ２４Ｖ〜ＡＣ１００Ｖのものを使用すると、Ａ
ＣｌｏｏＶのとき、直流電圧値で１４１Ｖ （−１００
Ｖ・２）になってしまうため、ＤＣ２４Ｖ−ＤＣ１４１
Ｖで使用するときと同じことになる。
そして、このような定電圧回路においては、針路電力か
ら制限される電流値以下でツェナーダイオード１０３を
使用しなければならないため、ＤＣ１４１Ｖで定格を設
定しなければならない。
ら制限される電流値以下でツェナーダイオード１０３を
使用しなければならないため、ＤＣ１４１Ｖで定格を設
定しなければならない。
しかし、仮にツェナーダイオード１０３のツェナー電圧
を１５Ｖ１ツエナー電力を２５０ｍＷとすると、最大入
力電圧値としてＤＣ１４１Ｖのとき、ツェナー電流とし
て１６．７ｍＡ （＝２５０ｍＷ／１５Ｖ）の電流が流
れ、抵抗１０２の抵抗値が７．５にΩ（−（１４１Ｖ−
１５Ｖ）／１６７ｍＡ）になる。
を１５Ｖ１ツエナー電力を２５０ｍＷとすると、最大入
力電圧値としてＤＣ１４１Ｖのとき、ツェナー電流とし
て１６．７ｍＡ （＝２５０ｍＷ／１５Ｖ）の電流が流
れ、抵抗１０２の抵抗値が７．５にΩ（−（１４１Ｖ−
１５Ｖ）／１６７ｍＡ）になる。
そして、このようにツェナーダイオード１０３の定格お
よび抵抗１０２の値を設定すると、ＤＣ２４Ｖのとき、
ツェナー電流が１．２ｍＡと極端に小さくなり過ぎてて
十分なツェナー電圧が得られなくなるばかりか、出力電
圧の電圧変動が大きくなってしまうという問題があった
。
よび抵抗１０２の値を設定すると、ＤＣ２４Ｖのとき、
ツェナー電流が１．２ｍＡと極端に小さくなり過ぎてて
十分なツェナー電圧が得られなくなるばかりか、出力電
圧の電圧変動が大きくなってしまうという問題があった
。
また、電源電圧としてＤＣ１４１Ｖが入力されると、抵
抗１０２の消費電力も１．９２Ｗ（−（０，０１６Ａ）
２ ・７．５にΩ）と非常に大きくなってしまうという
問題があった。
抗１０２の消費電力も１．９２Ｗ（−（０，０１６Ａ）
２ ・７．５にΩ）と非常に大きくなってしまうという
問題があった。
本発明は上記の事情に鑑み、部品点数を少なくすること
ができるとともに、消費電力を低く押さえながら電源電
圧の変動に左右されることなく安定した出力電圧を得る
ことができる定電圧回路を提供することを目的としてい
る。
ができるとともに、消費電力を低く押さえながら電源電
圧の変動に左右されることなく安定した出力電圧を得る
ことができる定電圧回路を提供することを目的としてい
る。
（課題を解決するための手段）
上記の目的を達成するために本発明による定電圧回路は
、制御端子に人力される信号に基づいて入力端子から出
力電圧を生成するトランジスタと、このトランジスタの
出力電圧値を検知する検知部と、この検知部の検知結果
に基づいて信号を生成して前記トランジスタの制御端子
に供給する出力電圧制御部とを備えたことを特徴として
いる。
、制御端子に人力される信号に基づいて入力端子から出
力電圧を生成するトランジスタと、このトランジスタの
出力電圧値を検知する検知部と、この検知部の検知結果
に基づいて信号を生成して前記トランジスタの制御端子
に供給する出力電圧制御部とを備えたことを特徴として
いる。
（作用）
上記の構成において、入力電圧から出力電圧を生成する
トランジスタの出力電圧が変化すれば、検知部によって
これが検知されるとともに、出力電圧制御部によって前
記検知結果に応じた信号が生成されて前記トランジスタ
の制御端子に供給され、このトランジスタの出力電圧が
一定値に保持される。
トランジスタの出力電圧が変化すれば、検知部によって
これが検知されるとともに、出力電圧制御部によって前
記検知結果に応じた信号が生成されて前記トランジスタ
の制御端子に供給され、このトランジスタの出力電圧が
一定値に保持される。
（実施例）
第１図は本発明による定電圧回路の一実施例を示すブロ
ック図である。
ック図である。
この図に示す定電圧回路はドレインが電圧入力端２に接
続されソースが電圧出力端子４に接続されるＦＥＴ３と
、一端が前記ＦＥＴ３のソースに接続される抵抗６と、
カソードが前記抵抗６の他端接続され、アノードが接地
ライン１ｏに接続されるツェナーダイオード７と、前記
電圧入力端子２と前記ＦＥＴ３のゲートとの間に介挿さ
れる抵抗８と、ベースが前記抵抗６の前記一端に接続さ
れ、コレクタが前記ＦＥＴ３のゲートに接続され、エミ
ッタが前記抵抗６の前記他端に接続されるトランジスタ
９とを備えている。
続されソースが電圧出力端子４に接続されるＦＥＴ３と
、一端が前記ＦＥＴ３のソースに接続される抵抗６と、
カソードが前記抵抗６の他端接続され、アノードが接地
ライン１ｏに接続されるツェナーダイオード７と、前記
電圧入力端子２と前記ＦＥＴ３のゲートとの間に介挿さ
れる抵抗８と、ベースが前記抵抗６の前記一端に接続さ
れ、コレクタが前記ＦＥＴ３のゲートに接続され、エミ
ッタが前記抵抗６の前記他端に接続されるトランジスタ
９とを備えている。
次に、第１図を参照しながらこの実施例の動作を説明す
る。
る。
まず、電源１から出力される電源電圧が入力端子２と接
地ライン１０との間に印加されれば、これが抵抗８を介
してＦＥＴ３のゲートに印加されて、このＦＥＴ３か導
通し、前記入力端子２に印加された電源電圧によってソ
ース電圧を上昇させる。
地ライン１０との間に印加されれば、これが抵抗８を介
してＦＥＴ３のゲートに印加されて、このＦＥＴ３か導
通し、前記入力端子２に印加された電源電圧によってソ
ース電圧を上昇させる。
そして、このソース電圧上昇に応して抵抗６、ツェナー
ダイオード７に電流が流れてツェナーダイオード７の電
圧がツェナー電圧まで上昇して抵抗６の両端間電圧がト
ランジスタ９のオン電圧（例えば、シリコン系で０．６
Ｖ、ゲルマニウム系で０．４Ｖ）以上となったとき、ト
ランジスタ９がオンして前記ＦＥＴ３のゲート電圧をツ
ェナーダイオード７のカソード電位側に引き下げる。
ダイオード７に電流が流れてツェナーダイオード７の電
圧がツェナー電圧まで上昇して抵抗６の両端間電圧がト
ランジスタ９のオン電圧（例えば、シリコン系で０．６
Ｖ、ゲルマニウム系で０．４Ｖ）以上となったとき、ト
ランジスタ９がオンして前記ＦＥＴ３のゲート電圧をツ
ェナーダイオード７のカソード電位側に引き下げる。
これによって、ＦＥＴ３のソース電圧が引き下げられて
予め設定されている電圧値になったとき、安定状態とな
って前記ソース電圧が出力電圧として出力端子４から出
力されて負荷５に供給される。
予め設定されている電圧値になったとき、安定状態とな
って前記ソース電圧が出力電圧として出力端子４から出
力されて負荷５に供給される。
このとき、抵抗６には出力電圧値からツェナー電圧を引
いた値をその抵抗値（抵抗６の抵抗値）で割り算した値
の電流（小さな値の電流）しか流れないため、その消費
電力を極めて小さくすることができる。
いた値をその抵抗値（抵抗６の抵抗値）で割り算した値
の電流（小さな値の電流）しか流れないため、その消費
電力を極めて小さくすることができる。
また、抵抗８は電源入力端子２に印加される電源電圧を
ＦＥＴ３のゲートに導くだけで良いため、数百にΩ程度
のものが使用することができ、これによってこの抵抗８
に電流がほとんど流れないようにすることができその消
費電力を極めて小さくすることができる。
ＦＥＴ３のゲートに導くだけで良いため、数百にΩ程度
のものが使用することができ、これによってこの抵抗８
に電流がほとんど流れないようにすることができその消
費電力を極めて小さくすることができる。
この状態で、電圧入力端子２に印加される電源電圧の値
が上昇すれば、これに応じてＦＥＴ３のドレイン電圧が
上昇してソース電圧が上昇するが、ソース電圧の上昇に
伴ってツェナーダイオード７に流れる電流（ツェナー電
流）が上昇に応じて、抵抗６の両端間電圧が上昇し、こ
れによってトランジスタ９の導通量が大きくなってＦＥ
Ｔ３のゲート電圧が引き下げられるので、ＦＥＴ３のソ
ース電圧が予め設定されている値に戻され出力端子から
出力される出力電圧の値か一定の値に保たれる。
が上昇すれば、これに応じてＦＥＴ３のドレイン電圧が
上昇してソース電圧が上昇するが、ソース電圧の上昇に
伴ってツェナーダイオード７に流れる電流（ツェナー電
流）が上昇に応じて、抵抗６の両端間電圧が上昇し、こ
れによってトランジスタ９の導通量が大きくなってＦＥ
Ｔ３のゲート電圧が引き下げられるので、ＦＥＴ３のソ
ース電圧が予め設定されている値に戻され出力端子から
出力される出力電圧の値か一定の値に保たれる。
この場合も、上述した動作と同様に抵抗６には出力電圧
値からツェナー電圧を引いた値をその抵抗値（抵抗６の
抵抗値）で割り算した値の電流（小さな値の電流）しか
流れないので、抵抗６によって消費される電力値を小さ
くすることができる。
値からツェナー電圧を引いた値をその抵抗値（抵抗６の
抵抗値）で割り算した値の電流（小さな値の電流）しか
流れないので、抵抗６によって消費される電力値を小さ
くすることができる。
またこのとき、上述した動作と同様に抵抗８は数百にΩ
程度のものが使用されているので、はとんど電流が流れ
ず、その消費電力を小さくすることができる。
程度のものが使用されているので、はとんど電流が流れ
ず、その消費電力を小さくすることができる。
このようにこの実施例においては、ＦＥＴ３のソース電
圧と接地ライン１０の間に抵抗６とツェナーダイオード
７とを直列に介挿してソース電圧の変化を検知するとと
もに、この検知結果に基づいてトランジスタ９の導通量
を変えて前記ＦＥＴ３のゲート電圧を制御してＦＥＴ３
のソース電圧を制御するようにしたので、部品点数を少
なくすることができるとともに、消費電力を低く押さえ
ながら電源電圧の変動に左右されることなく安定した出
力電圧を得ることができる。
圧と接地ライン１０の間に抵抗６とツェナーダイオード
７とを直列に介挿してソース電圧の変化を検知するとと
もに、この検知結果に基づいてトランジスタ９の導通量
を変えて前記ＦＥＴ３のゲート電圧を制御してＦＥＴ３
のソース電圧を制御するようにしたので、部品点数を少
なくすることができるとともに、消費電力を低く押さえ
ながら電源電圧の変動に左右されることなく安定した出
力電圧を得ることができる。
また、上述した実施例においては、ＦＥＴ３のソースか
ら出力電圧を取り出すようにしているが、第２図に示す
如くツェナーダイオード７のカソードから出力電圧を取
り出すようにしても良い。
ら出力電圧を取り出すようにしているが、第２図に示す
如くツェナーダイオード７のカソードから出力電圧を取
り出すようにしても良い。
このように構成しても、上述した実施例と同様に少ない
部品点数で消費電力を低く押さえながら電源電圧の変動
に左右されることなく安定した出力電圧を得ることがで
きる。
部品点数で消費電力を低く押さえながら電源電圧の変動
に左右されることなく安定した出力電圧を得ることがで
きる。
また、上述した各実施例においては、ＦＥＴ３のソース
に抵抗６の一端を接続するとともに、前記抵抗６の他端
にツェナーダイオード７のカッドを接続し、さらにこの
ツェナーダイオード７のアノードを接地ライン１０に接
続するようにしているが、第３図に示す如＜：ＦＥＴ３
のソースにツェナーダイオード１１のカソードを接続す
るとともに、このツェナーダイオード１１のアノードと
接地ライン１０との間に抵抗１２を介挿し、さらに前記
ツェナーダイオード１１のアノードをトランジスタ９の
ベースに接続し、このトランジスタ９のエミッタを前記
接地ライン１０に接続するようにしても良い。
に抵抗６の一端を接続するとともに、前記抵抗６の他端
にツェナーダイオード７のカッドを接続し、さらにこの
ツェナーダイオード７のアノードを接地ライン１０に接
続するようにしているが、第３図に示す如＜：ＦＥＴ３
のソースにツェナーダイオード１１のカソードを接続す
るとともに、このツェナーダイオード１１のアノードと
接地ライン１０との間に抵抗１２を介挿し、さらに前記
ツェナーダイオード１１のアノードをトランジスタ９の
ベースに接続し、このトランジスタ９のエミッタを前記
接地ライン１０に接続するようにしても良い。
このように構成しても、ＦＥＴ３のソース電圧に応じて
抵抗１２に流れる電流が変化し、この変化に基づいてト
ランジスタ９が前記ＦＥＴ３のゲート電圧を制御してこ
のＦＥＴ３のソース電圧を一定値に保つので、上述した
実施例と同様に少ない部品点数で消費電力を低く押さえ
ながら電源電圧の変動に左右されることなく安定した出
力電圧を得ることができる。
抵抗１２に流れる電流が変化し、この変化に基づいてト
ランジスタ９が前記ＦＥＴ３のゲート電圧を制御してこ
のＦＥＴ３のソース電圧を一定値に保つので、上述した
実施例と同様に少ない部品点数で消費電力を低く押さえ
ながら電源電圧の変動に左右されることなく安定した出
力電圧を得ることができる。
以上説明したように本発明によれば、部品点数を少なく
することができるとともに、消費電力を低く押さえなが
ら電源電圧の変動に左右されることなく安定した出力電
圧を得ることができる。
することができるとともに、消費電力を低く押さえなが
ら電源電圧の変動に左右されることなく安定した出力電
圧を得ることができる。
第１図は本発明による定電圧回路の一実施例を示すブロ
ック図、第２図は本発明による定電圧回路の他の実施例
を示すブロック図、第３図は本発明による定電圧回路の
他の実施例を示すブロック図、第４図は従来から知られ
ている定電圧回路の−例を示すブロック図である。 １・・・電源 ３・・・トランジスタ（ＦＥＴ） ５・・・負荷 ６・・・検知部（抵抗）
ック図、第２図は本発明による定電圧回路の他の実施例
を示すブロック図、第３図は本発明による定電圧回路の
他の実施例を示すブロック図、第４図は従来から知られ
ている定電圧回路の−例を示すブロック図である。 １・・・電源 ３・・・トランジスタ（ＦＥＴ） ５・・・負荷 ６・・・検知部（抵抗）
Claims (1)
- （１）制御端子に入力される信号に基づいて入力電圧か
ら出力電圧を生成するトランジスタと、このトランジス
タの出力電圧値を検知する検知部と、 この検知部の検知結果に基づいて信号を生成して前記ト
ランジスタの制御端子に供給する出力電圧制御部と、 を備えたことを特徴とする定電圧回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12403390A JPH0424710A (ja) | 1990-05-16 | 1990-05-16 | 定電圧回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12403390A JPH0424710A (ja) | 1990-05-16 | 1990-05-16 | 定電圧回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0424710A true JPH0424710A (ja) | 1992-01-28 |
Family
ID=14875364
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12403390A Pending JPH0424710A (ja) | 1990-05-16 | 1990-05-16 | 定電圧回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0424710A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2011107800A (ja) * | 2009-11-13 | 2011-06-02 | Mitsumi Electric Co Ltd | 参照電圧発生回路および受信回路 |
-
1990
- 1990-05-16 JP JP12403390A patent/JPH0424710A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2011107800A (ja) * | 2009-11-13 | 2011-06-02 | Mitsumi Electric Co Ltd | 参照電圧発生回路および受信回路 |
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