JPH04257464A - Ｌｅｄアレイ駆動装置 - Google Patents
Ｌｅｄアレイ駆動装置Info
- Publication number
- JPH04257464A JPH04257464A JP3039432A JP3943291A JPH04257464A JP H04257464 A JPH04257464 A JP H04257464A JP 3039432 A JP3039432 A JP 3039432A JP 3943291 A JP3943291 A JP 3943291A JP H04257464 A JPH04257464 A JP H04257464A
- Authority
- JP
- Japan
- Prior art keywords
- data
- brightness
- corrected
- led
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- Prior art date
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- Pending
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- Dot-Matrix Printers And Others (AREA)
- Printers Or Recording Devices Using Electromagnetic And Radiation Means (AREA)
- Exposure Or Original Feeding In Electrophotography (AREA)
- Led Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明はスキャナ、プリンタ、複
写機などに用いられるＬＥＤアレイを駆動する駆動装置
に関し、特に各ＬＥＤ素子の輝度補正を行なう輝度補正
手段を備えた駆動装置に関するものである。
写機などに用いられるＬＥＤアレイを駆動する駆動装置
に関し、特に各ＬＥＤ素子の輝度補正を行なう輝度補正
手段を備えた駆動装置に関するものである。
【０００２】
【従来の技術】ＬＥＤアレイ駆動装置で各ＬＥＤ素子の
輝度を補正するために、各ＬＥＤ素子の輝度補正データ
をもつＲＯＭが設けられている。従来のＬＥＤアレイ駆
動装置を図４に示す。１２はＬＥＤ素子の輝度データを
もつ輝度データＲＯＭであり、各ＬＥＤ素子の輝度デー
タがｍビットで表現されて保持されている。ＬＥＤ素子
を点灯させるためのデータは外部からｎビットで階調デ
ータとして与えられる。１４は階調データが入力される
シフトレジスタ及びラッチ、１６は輝度データが入力さ
れるシフトレジスタ及びラッチである。シフトレジスタ
及びラッチ１４のシフトレジスタにはｎビットの階調デ
ータがクロック（ＤＣＬＫ）で入力されてシフトされ、
シフトレジスタ及びラッチ１６のシフトレジスタにはｍ
ビットの輝度データがクロック（ＤＣＬＫ）で入力され
てシフトされ、それらのデータは１ライン分が入力され
た時点でセット信号（ＳＥＴ）によってラッチに保持さ
れる。１８はラッチされた（ｍ＋ｎ）ビットのデータに
従ってＬＥＤ素子を駆動するドライバートランジスタで
ある。
輝度を補正するために、各ＬＥＤ素子の輝度補正データ
をもつＲＯＭが設けられている。従来のＬＥＤアレイ駆
動装置を図４に示す。１２はＬＥＤ素子の輝度データを
もつ輝度データＲＯＭであり、各ＬＥＤ素子の輝度デー
タがｍビットで表現されて保持されている。ＬＥＤ素子
を点灯させるためのデータは外部からｎビットで階調デ
ータとして与えられる。１４は階調データが入力される
シフトレジスタ及びラッチ、１６は輝度データが入力さ
れるシフトレジスタ及びラッチである。シフトレジスタ
及びラッチ１４のシフトレジスタにはｎビットの階調デ
ータがクロック（ＤＣＬＫ）で入力されてシフトされ、
シフトレジスタ及びラッチ１６のシフトレジスタにはｍ
ビットの輝度データがクロック（ＤＣＬＫ）で入力され
てシフトされ、それらのデータは１ライン分が入力され
た時点でセット信号（ＳＥＴ）によってラッチに保持さ
れる。１８はラッチされた（ｍ＋ｎ）ビットのデータに
従ってＬＥＤ素子を駆動するドライバートランジスタで
ある。
【０００３】
【発明が解決しようとする課題】図４のようにシフトレ
ジスタとラッチに（ｍ＋ｎ）ビット分のデータを入力す
ると、各ＬＥＤ素子に対して（ｍ＋ｎ）ビット分のシフ
トレジスタとラッチが必要になり、駆動回路の規模が大
きくなり、大型化し、コスト高を招く。本発明はＬＥＤ
アレイの駆動回路のシフトレジスタに入力されるデータ
のビット数を少なくすることにより、ＬＥＤアレイ駆動
回路の回路規模を小さくすることを目的とするものであ
る。
ジスタとラッチに（ｍ＋ｎ）ビット分のデータを入力す
ると、各ＬＥＤ素子に対して（ｍ＋ｎ）ビット分のシフ
トレジスタとラッチが必要になり、駆動回路の規模が大
きくなり、大型化し、コスト高を招く。本発明はＬＥＤ
アレイの駆動回路のシフトレジスタに入力されるデータ
のビット数を少なくすることにより、ＬＥＤアレイ駆動
回路の回路規模を小さくすることを目的とするものであ
る。
【０００４】
【課題を解決するための手段】回路規模を小さくした本
発明のＬＥＤアレイ駆動装置は、ＬＥＤアレイユニット
の各ＬＥＤ素子の輝度補正値を記憶している記憶装置と
、この記憶装置からの輝度補正値と入力データとを入力
し、輝度補正されたデータを出力する輝度補正テーブル
と、この輝度補正されたシリアルデータをパラレルデー
タにするシフトレジスタと、１ライン分のシリアルデー
タが入力された時点で前記シフトレジスタのデータを保
持するラッチと、このラッチに保持されたデータに従っ
てＬＥＤ素子を点灯させるパルス信号を選択するマルチ
プレクサとを備えている。
発明のＬＥＤアレイ駆動装置は、ＬＥＤアレイユニット
の各ＬＥＤ素子の輝度補正値を記憶している記憶装置と
、この記憶装置からの輝度補正値と入力データとを入力
し、輝度補正されたデータを出力する輝度補正テーブル
と、この輝度補正されたシリアルデータをパラレルデー
タにするシフトレジスタと、１ライン分のシリアルデー
タが入力された時点で前記シフトレジスタのデータを保
持するラッチと、このラッチに保持されたデータに従っ
てＬＥＤ素子を点灯させるパルス信号を選択するマルチ
プレクサとを備えている。
【０００５】本発明はまた、ＬＥＤアレイユニットの各
ＬＥＤ素子の輝度補正値を記憶している記憶装置と、こ
の記憶装置からの輝度補正値と入力データとを入力し、
輝度補正されたデータを出力する輝度補正テーブルと、
この輝度補正されたシリアルデータをパラレルデータに
するシフトレジスタと、輝度補正されたデータに従って
ＬＥＤドライブトランジスタのサイズを選択する選択回
路とを備えている。
ＬＥＤ素子の輝度補正値を記憶している記憶装置と、こ
の記憶装置からの輝度補正値と入力データとを入力し、
輝度補正されたデータを出力する輝度補正テーブルと、
この輝度補正されたシリアルデータをパラレルデータに
するシフトレジスタと、輝度補正されたデータに従って
ＬＥＤドライブトランジスタのサイズを選択する選択回
路とを備えている。
【０００６】
【実施例】図１は一実施例を表わし、ＬＥＤアレイユニ
ットのうちの１個のＬＥＤ素子についての駆動回路を表
わしている。２２は各ＬＥＤ素子の輝度を補正するため
の輝度データを保持している輝度データＲＯＭである。 輝度の明るいＬＥＤ素子を輝度１００％とし、各ＬＥＤ
素子の輝度に応じて４つのレベル、例えば１００％、９
０％、８０％、７０％というようにレベルが設定され、
各ＬＥＤ素子ごとの輝度を示すデータが輝度データＲＯ
Ｍ２２に記憶されている。２４は輝度補正テーブルであ
り、輝度データＲＯＭ２２からの輝度データと外部から
データとして送られた階調データとを入力して輝度補正
されたデータを出力する。
ットのうちの１個のＬＥＤ素子についての駆動回路を表
わしている。２２は各ＬＥＤ素子の輝度を補正するため
の輝度データを保持している輝度データＲＯＭである。 輝度の明るいＬＥＤ素子を輝度１００％とし、各ＬＥＤ
素子の輝度に応じて４つのレベル、例えば１００％、９
０％、８０％、７０％というようにレベルが設定され、
各ＬＥＤ素子ごとの輝度を示すデータが輝度データＲＯ
Ｍ２２に記憶されている。２４は輝度補正テーブルであ
り、輝度データＲＯＭ２２からの輝度データと外部から
データとして送られた階調データとを入力して輝度補正
されたデータを出力する。
【０００７】鎖線で囲まれた回路２６は１個のＬＥＤ素
子についてのドライバー回路である。ドライバー回路２
６には、輝度補正テーブル２４から出力される輝度補正
されたＬＥＤ素子１個当たり４ビットのデータがクロッ
ク信号ＤＣＬＫのタイミングで送られるシフトレジスタ
２８と、１ライン分のデータがシフトレジスタ２８に送
られた後、シフトレジスタ２８のデータを保持するラッ
チ３０と、データの各ビットに対応したパルス幅のイネ
ーブル信号ＥＮ１〜ＥＮ４をラッチ３０のデータに対応
して選択するマルチプレクサ３２と、マルチプレクサ３
２で決定されたパルス信号のパルス時間だけドライバー
トランジスタ３６をオンにして通電させるゲート回路３
４が設けられている。
子についてのドライバー回路である。ドライバー回路２
６には、輝度補正テーブル２４から出力される輝度補正
されたＬＥＤ素子１個当たり４ビットのデータがクロッ
ク信号ＤＣＬＫのタイミングで送られるシフトレジスタ
２８と、１ライン分のデータがシフトレジスタ２８に送
られた後、シフトレジスタ２８のデータを保持するラッ
チ３０と、データの各ビットに対応したパルス幅のイネ
ーブル信号ＥＮ１〜ＥＮ４をラッチ３０のデータに対応
して選択するマルチプレクサ３２と、マルチプレクサ３
２で決定されたパルス信号のパルス時間だけドライバー
トランジスタ３６をオンにして通電させるゲート回路３
４が設けられている。
【０００８】ドライバートランジスタ３６には一定電流
が流れるようにカレントミラー回路３８が設けられてい
る。４０はＬＥＤ素子が接続されるコンタクトである。 このドライバー回路２６がＬＥＤ素子の数だけ配置され
、それらのドライバー回路２６に共通に輝度データＲＯ
Ｍ２２、輝度補正テーブル２４、カレントミラー回路３
８、イネーブル信号端子ＥＮ１〜ＥＮ４、セット信号端
子ＳＥＴ、及びクロック信号端子ＤＣＬＫが設けられて
いる。イネーブル信号ＥＮ１〜ＥＮ４としては、図２に
示されるように４ビットのデータに対応したパルス幅の
パルス信号が用いられる。
が流れるようにカレントミラー回路３８が設けられてい
る。４０はＬＥＤ素子が接続されるコンタクトである。 このドライバー回路２６がＬＥＤ素子の数だけ配置され
、それらのドライバー回路２６に共通に輝度データＲＯ
Ｍ２２、輝度補正テーブル２４、カレントミラー回路３
８、イネーブル信号端子ＥＮ１〜ＥＮ４、セット信号端
子ＳＥＴ、及びクロック信号端子ＤＣＬＫが設けられて
いる。イネーブル信号ＥＮ１〜ＥＮ４としては、図２に
示されるように４ビットのデータに対応したパルス幅の
パルス信号が用いられる。
【０００９】図１の実施例は各ＬＥＤ素子の階調を４ビ
ットで表現するので、１６階調まで表わすことができる
。輝度補正テーブル２４に入力する階調データは１２階
調とし、輝度データを４階調として、ＬＥＤ素子ごとの
輝度補正された１６階調を表わす。輝度補正テーブル２
４の例は次の表に示されるようなものである。
ットで表現するので、１６階調まで表わすことができる
。輝度補正テーブル２４に入力する階調データは１２階
調とし、輝度データを４階調として、ＬＥＤ素子ごとの
輝度補正された１６階調を表わす。輝度補正テーブル２
４の例は次の表に示されるようなものである。
【００１０】
【００１１】次に、図１の実施例の動作について説明す
る。データ入力端子から１２階調のデータが輝度補正テ
ーブル２４に入力され、輝度データＲＯＭ２２からその
データに対応した位置のＬＥＤ素子のレベルを示す輝度
データが輝度補正テーブル２４に入力される。この２つ
のデータをもとにして輝度補正テーブル２４から輝度補
正されたデータが出力される。例えば、輝度レベルが８
０％の位置のＬＥＤ素子に階調５（０１０１）の輝度デ
ータが輝度補正テーブル２４に入力されたとすると、前
記表からＬＥＤドライバー回路２６には輝度補正された
データとして階調６（０１１０）が入力される。この輝
度補正されたデータはクロック信号ＤＣＬＫでシフトレ
ジスタ２８に送られ、１ライン分入力された時点でセッ
ト信号ＳＥＴでシフトレジスタ２８のデータがラッチ３
０に保持される。ラッチ３０に保持されたデータにより
図２に示されるイネーブル信号ＥＮ１〜ＥＮ４がマルチ
プレクサ３２で選択され、ＬＥＤ素子のオン時間が決め
られる。このようにして輝度補正された１６階調のデー
タでＬＥＤ素子が点灯する。
る。データ入力端子から１２階調のデータが輝度補正テ
ーブル２４に入力され、輝度データＲＯＭ２２からその
データに対応した位置のＬＥＤ素子のレベルを示す輝度
データが輝度補正テーブル２４に入力される。この２つ
のデータをもとにして輝度補正テーブル２４から輝度補
正されたデータが出力される。例えば、輝度レベルが８
０％の位置のＬＥＤ素子に階調５（０１０１）の輝度デ
ータが輝度補正テーブル２４に入力されたとすると、前
記表からＬＥＤドライバー回路２６には輝度補正された
データとして階調６（０１１０）が入力される。この輝
度補正されたデータはクロック信号ＤＣＬＫでシフトレ
ジスタ２８に送られ、１ライン分入力された時点でセッ
ト信号ＳＥＴでシフトレジスタ２８のデータがラッチ３
０に保持される。ラッチ３０に保持されたデータにより
図２に示されるイネーブル信号ＥＮ１〜ＥＮ４がマルチ
プレクサ３２で選択され、ＬＥＤ素子のオン時間が決め
られる。このようにして輝度補正された１６階調のデー
タでＬＥＤ素子が点灯する。
【００１２】図３は第２の実施例を表わす。一例として
、図１に示されているような輝度データＲＯＭ２２と階
調データとから輝度補正テーブル２４で輝度補正された
データＤが１ＬＥＤ素子について３ビットのデータとし
て送られてくるものとする。
、図１に示されているような輝度データＲＯＭ２２と階
調データとから輝度補正テーブル２４で輝度補正された
データＤが１ＬＥＤ素子について３ビットのデータとし
て送られてくるものとする。
【００１３】このドライバー回路はデータレジスタ部と
ドライバー部とからなり、データレジスタ部にはクロッ
ク信号ＣＫによりデータを送るシフトレジスタ４２が設
けられている。ドライバー部にはＬＥＤ素子４４に流す
電流を制御するドライバートランジスタＤＴ１〜ＤＴ３
が並列に設けられている。これらのドライバートランジ
スタＤＴ１〜ＤＴ３はトランジスタサイズが異なるもの
であり、全てをオンにしたときの電流値を１００とする
と、ドライバートランジスタＤＴ１が７０％、ドライバ
ートランジスタＤＴ２が２０％、ドライバートランジス
タＤＴ３が１０％の電流を流すサイズに設定されている
ものとする。
ドライバー部とからなり、データレジスタ部にはクロッ
ク信号ＣＫによりデータを送るシフトレジスタ４２が設
けられている。ドライバー部にはＬＥＤ素子４４に流す
電流を制御するドライバートランジスタＤＴ１〜ＤＴ３
が並列に設けられている。これらのドライバートランジ
スタＤＴ１〜ＤＴ３はトランジスタサイズが異なるもの
であり、全てをオンにしたときの電流値を１００とする
と、ドライバートランジスタＤＴ１が７０％、ドライバ
ートランジスタＤＴ２が２０％、ドライバートランジス
タＤＴ３が１０％の電流を流すサイズに設定されている
ものとする。
【００１４】シフトレジスタ４２のデータによりドライ
バートランジスタＤＴ１〜ＤＴ３を選択してオンとする
ために、シフトレジスタ４２のデータとイネーブル信号
ＥＮを入力とするＮＡＮＤゲート４６と、それらのＮＡ
ＮＤゲート４６の出力により開閉するゲート回路４８が
設けられている。
バートランジスタＤＴ１〜ＤＴ３を選択してオンとする
ために、シフトレジスタ４２のデータとイネーブル信号
ＥＮを入力とするＮＡＮＤゲート４６と、それらのＮＡ
ＮＤゲート４６の出力により開閉するゲート回路４８が
設けられている。
【００１５】次に、図３の実施例の動作について説明す
る。イネーブル信号ＥＮがハイレベルのとき、データレ
ジスタ部のデータのオンビットにより、対応するドライ
バートランジスタＤＴ１〜ＤＴ３がオンとなり、ＬＥＤ
素子４４が点灯する。例えば、ドライバートランジスタ
ＤＴ１のみがオンになる状態が７０％の輝度、ドライバ
ートランジスタＤ１とＤ３がオンになる状態が８０％の
輝度、ドライバートランジスタＤ１とＤ２がオンになる
状態が９０％の輝度、ドライバートランジスタＤＴ１〜
ＤＴ３全てがオンになる状態が１００％の輝度となる。 このように、データレジスタ部のデータによって各ビッ
トのＬＥＤ素子の輝度が設定される。
る。イネーブル信号ＥＮがハイレベルのとき、データレ
ジスタ部のデータのオンビットにより、対応するドライ
バートランジスタＤＴ１〜ＤＴ３がオンとなり、ＬＥＤ
素子４４が点灯する。例えば、ドライバートランジスタ
ＤＴ１のみがオンになる状態が７０％の輝度、ドライバ
ートランジスタＤ１とＤ３がオンになる状態が８０％の
輝度、ドライバートランジスタＤ１とＤ２がオンになる
状態が９０％の輝度、ドライバートランジスタＤＴ１〜
ＤＴ３全てがオンになる状態が１００％の輝度となる。 このように、データレジスタ部のデータによって各ビッ
トのＬＥＤ素子の輝度が設定される。
【００１６】図３の回路ではドライバートランジスタは
３個しか設けられていないが、１ＬＥＤ素子当たりのド
ライバートランジスタ数を多くすることにより、さらに
細かい輝度補正を行なうことができるようになる。図３
の実施例ではドライバートランジスタのトランジスタサ
イズを変化させ、電流値を変化させることによって輝度
補正を行なうものであり、パルス変調方式に比べるとパ
ルス発生回路が不要となることにより回路が簡単になる
。
３個しか設けられていないが、１ＬＥＤ素子当たりのド
ライバートランジスタ数を多くすることにより、さらに
細かい輝度補正を行なうことができるようになる。図３
の実施例ではドライバートランジスタのトランジスタサ
イズを変化させ、電流値を変化させることによって輝度
補正を行なうものであり、パルス変調方式に比べるとパ
ルス発生回路が不要となることにより回路が簡単になる
。
【００１７】
【発明の効果】本発明では各ＬＥＤ素子について予め調
べられている輝度データが輝度データＲＯＭに記憶され
ており、その輝度データと階調データとを輝度補正テー
ブルに入力して輝度の異なるＬＥＤ素子でも同じ階調デ
ータが入力されると同じ階調でＬＥＤ素子が発光するよ
うな補正階調データとしてＬＥＤドライバー回路に入力
するので、ＬＥＤドライバー回路には輝度補正されたデ
ータが入力される。これにより、従来では輝度補正用の
データを入力するためのシフトレジスタやラッチが必要
であったが、本発明によればＬＥＤアレイ駆動装置１個
について輝度補正テーブルを１個設けるだけですみ、Ｌ
ＥＤアレイ駆動装置が簡単になって、それを実現する半
導体集積回路装置のチップ面積が小さくなる。
べられている輝度データが輝度データＲＯＭに記憶され
ており、その輝度データと階調データとを輝度補正テー
ブルに入力して輝度の異なるＬＥＤ素子でも同じ階調デ
ータが入力されると同じ階調でＬＥＤ素子が発光するよ
うな補正階調データとしてＬＥＤドライバー回路に入力
するので、ＬＥＤドライバー回路には輝度補正されたデ
ータが入力される。これにより、従来では輝度補正用の
データを入力するためのシフトレジスタやラッチが必要
であったが、本発明によればＬＥＤアレイ駆動装置１個
について輝度補正テーブルを１個設けるだけですみ、Ｌ
ＥＤアレイ駆動装置が簡単になって、それを実現する半
導体集積回路装置のチップ面積が小さくなる。
【図１】一実施例を示す回路図である。
【図２】同実施例における４種類のイネーブル信号を示
す波形図である。
す波形図である。
【図３】他の実施例を示す回路図である。
【図４】従来のＬＥＤアレイ駆動装置を示すブロック図
である。
である。
２２ 輝度データＲＯＭ２４
輝度補正テーブル２６
ＬＥＤ素子１個当たりの駆動回路を示す回路図であ
る。 ２８，４２ シフトレジスタ ３０ ラッチ ３２ マルチプレクサ３４，４８
ゲート回路 ３６，ＤＴ１〜ＤＴ３ ドライバートランジスタ４４
ＬＥＤ素子
輝度補正テーブル２６
ＬＥＤ素子１個当たりの駆動回路を示す回路図であ
る。 ２８，４２ シフトレジスタ ３０ ラッチ ３２ マルチプレクサ３４，４８
ゲート回路 ３６，ＤＴ１〜ＤＴ３ ドライバートランジスタ４４
ＬＥＤ素子
Claims (2)
- 【請求項１】 ＬＥＤアレイユニットの各ＬＥＤ素子
の輝度補正値を記憶している記憶装置と、この記憶装置
からの輝度補正値と入力データとを入力し、輝度補正さ
れたデータを出力する輝度補正テーブルと、この輝度補
正されたシリアルデータをパラレルデータにするシフト
レジスタと、１ライン分のシリアルデータが入力された
時点で前記シフトレジスタのデータを保持するラッチと
、このラッチに保持されたデータに従ってＬＥＤ素子を
点灯させるパルス信号を選択するマルチプレクサとを備
えたＬＥＤアレイ駆動装置。 - 【請求項２】 ＬＥＤアレイユニットの各ＬＥＤ素子
の輝度補正値を記憶している記憶装置と、この記憶装置
からの輝度補正値と入力データとを入力し、輝度補正さ
れたデータを出力する輝度補正テーブルと、この輝度補
正されたシリアルデータをパラレルデータにするシフト
レジスタと、輝度補正されたデータに従ってＬＥＤドラ
イブトランジスタのサイズを選択する選択回路とを備え
たＬＥＤアレイ駆動装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3039432A JPH04257464A (ja) | 1991-02-08 | 1991-02-08 | Ｌｅｄアレイ駆動装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3039432A JPH04257464A (ja) | 1991-02-08 | 1991-02-08 | Ｌｅｄアレイ駆動装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04257464A true JPH04257464A (ja) | 1992-09-11 |
Family
ID=12552840
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3039432A Pending JPH04257464A (ja) | 1991-02-08 | 1991-02-08 | Ｌｅｄアレイ駆動装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04257464A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1067505A3 (en) * | 1999-07-08 | 2002-10-30 | Nichia Corporation | Image display apparatus with light emitting elements |
| JP2005342933A (ja) * | 2004-06-01 | 2005-12-15 | Oki Data Corp | 光書き込みヘッドおよび光書き込みヘッド制御回路ならびに画像形成装置 |
-
1991
- 1991-02-08 JP JP3039432A patent/JPH04257464A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1067505A3 (en) * | 1999-07-08 | 2002-10-30 | Nichia Corporation | Image display apparatus with light emitting elements |
| US6545652B1 (en) | 1999-07-08 | 2003-04-08 | Nichia Corporation | Image display apparatus and its method of operation |
| US6847342B2 (en) | 1999-07-08 | 2005-01-25 | Nichia Corporation | Image display apparatus |
| EP1594117A3 (en) * | 1999-07-08 | 2007-12-19 | Nichia Corporation | LED characteristic memory for LED display apparatus |
| EP1612764A3 (en) * | 1999-07-08 | 2007-12-19 | Nichia Corporation | Image display apparatus |
| JP2005342933A (ja) * | 2004-06-01 | 2005-12-15 | Oki Data Corp | 光書き込みヘッドおよび光書き込みヘッド制御回路ならびに画像形成装置 |
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