JPH04294629A - 発振器の位相制御回路デバイス - Google Patents
発振器の位相制御回路デバイスInfo
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- JPH04294629A JPH04294629A JP3347549A JP34754991A JPH04294629A JP H04294629 A JPH04294629 A JP H04294629A JP 3347549 A JP3347549 A JP 3347549A JP 34754991 A JP34754991 A JP 34754991A JP H04294629 A JPH04294629 A JP H04294629A
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- JP
- Japan
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- transistor
- circuit
- oscillator
- emitter
- circuit device
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- Pending
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03B—GENERATION OF OSCILLATIONS, DIRECTLY OR BY FREQUENCY-CHANGING, BY CIRCUITS EMPLOYING ACTIVE ELEMENTS WHICH OPERATE IN A NON-SWITCHING MANNER; GENERATION OF NOISE BY SUCH CIRCUITS
- H03B5/00—Generation of oscillations using amplifier with regenerative feedback from output to input
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
- H03K3/02—Generators characterised by the type of circuit or by the means used for producing pulses
- H03K3/26—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback
- H03K3/28—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback
- H03K3/281—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator
- H03K3/282—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator astable
- H03K3/2821—Emitters connected to one another by using a capacitor
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
- Oscillators With Electromechanical Resonators (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、各トランジスタのエミ
ッタがコンデンサを介して互に結合され，交互にオン・
オフするトランジスタ対を持つマルチバイブレータを含
む発振器の位相を制御するための回路デバイスに関する
。
ッタがコンデンサを介して互に結合され，交互にオン・
オフするトランジスタ対を持つマルチバイブレータを含
む発振器の位相を制御するための回路デバイスに関する
。
【０００２】
【従来の技術】電圧制御発振器（ＶＣＯ）は、いろいろ
な電子機器に、特にＲＦ（無線周波数）信号の変調およ
び復調に、広く使用されている。
な電子機器に、特にＲＦ（無線周波数）信号の変調およ
び復調に、広く使用されている。
【０００３】このような発振器は、ほとんど、コンデン
サの充電電流が制御パルスに応じて変化するＲＣマルチ
バイブレータを用いて、集積回路として実現されている
。
サの充電電流が制御パルスに応じて変化するＲＣマルチ
バイブレータを用いて、集積回路として実現されている
。
【０００４】この種のデバイスの代表例は、例えば、１
９７７年にＷｉｌｅｙ社から出版された”Ａｎａｌｙｓ
ｉｓ ａｎｄ Ｄｅｓｉｇｎ ｏｆ Ａｎａｌ
ｏｇ Ｉｎｔｅｇｒａｔｅｄ Ｃｉｒｃｕｉｔｓ”
の５９０−５９３頁に記載されている。
９７７年にＷｉｌｅｙ社から出版された”Ａｎａｌｙｓ
ｉｓ ａｎｄ Ｄｅｓｉｇｎ ｏｆ Ａｎａｌ
ｏｇ Ｉｎｔｅｇｒａｔｅｄ Ｃｉｒｃｕｉｔｓ”
の５９０−５９３頁に記載されている。
【０００５】この種のデバイスに必要とされることの１
つは、任意の時点で発振を停止させ、予め決められた既
知の位相状態において発振を再開させることができる機
能である。
つは、任意の時点で発振を停止させ、予め決められた既
知の位相状態において発振を再開させることができる機
能である。
【０００６】従来技術のどの方法によってもこの要求を
満足できることは、知られていない。
満足できることは、知られていない。
【０００７】
【発明が解決しようとする課題】本発明が解決しようと
する技術的課題は、発振器の発振を一時的に停止させ、
所定の位相状態において再開させることを可能にするよ
うな構成的および機能的特徴を持つような回路デバイス
を提供することである。
する技術的課題は、発振器の発振を一時的に停止させ、
所定の位相状態において再開させることを可能にするよ
うな構成的および機能的特徴を持つような回路デバイス
を提供することである。
【０００８】
【課題を解決するための手段】本発明のもとになった解
決のためのアイデアは、発振器のトランジスタ対のエミ
ッタを結合するコンデンサの電圧が所定の値になると、
発振器内の正帰還信号を阻止することができる回路部を
発振器に付設するというものである。
決のためのアイデアは、発振器のトランジスタ対のエミ
ッタを結合するコンデンサの電圧が所定の値になると、
発振器内の正帰還信号を阻止することができる回路部を
発振器に付設するというものである。
【０００９】上記の課題は、発振器の動作を停止させる
ための動作停止信号を受けるように設けられた制御端子
を備えた電子的スイッチ手段と、発振器に接続され、電
子的スイッチ手段の状態に応動して，電子的スイッチ手
段の制御端子に動作停止信号が加えられ，かつ結合コン
デンサの電圧が所定の値になったとき，発振器のトラン
ジスタ対のエミッタ間の帰還を遮断する回路手段を含む
ことを特徴とする回路デバイスにより達成される。
ための動作停止信号を受けるように設けられた制御端子
を備えた電子的スイッチ手段と、発振器に接続され、電
子的スイッチ手段の状態に応動して，電子的スイッチ手
段の制御端子に動作停止信号が加えられ，かつ結合コン
デンサの電圧が所定の値になったとき，発振器のトラン
ジスタ対のエミッタ間の帰還を遮断する回路手段を含む
ことを特徴とする回路デバイスにより達成される。
【００１０】本発明による回路デバイスの特徴と利点は
、下記の添付された図を参照して行なう本発明の１実施
例の詳細な説明からより明らかになるであろう。ただし
ここに記載した実施例は、あくまで本発明の説明のため
のものであり、本発明の範囲を限定するものではない。
、下記の添付された図を参照して行なう本発明の１実施
例の詳細な説明からより明らかになるであろう。ただし
ここに記載した実施例は、あくまで本発明の説明のため
のものであり、本発明の範囲を限定するものではない。
【００１１】
【実施例】図において、１で全体的に示すのは、本発明
の一実施の回路デバイスで、発振器２の位相を制御する
ためのものである。
の一実施の回路デバイスで、発振器２の位相を制御する
ためのものである。
【００１２】発振器２は、既存の構成のＶＣＯ（電圧制
御発振器）回路であり、エミッタＥ１ ，Ｅ２ がコン
デンサＣを介して互に結合されている一対のトランジス
タＱ１ ，Ｑ２ を含むマルチバイブレータ３から構成
されている。コンデンサＣは、２つのトランジスタ間の
正帰還経路を形成している。このような発振器２の一例
は、１９７７年にＷｉｌｅｙ社から出版された”Ａｎａ
ｌｙｓｉｓ ａｎｄ Ｄｅｓｉｇｎ ｏｆ Ａ
ｎａｌｏｇ Ｉｎｔｅｇｒａｔｅｄ Ｃｉｒｃｕｉ
ｔｓ”の５９１頁に記載されている。
御発振器）回路であり、エミッタＥ１ ，Ｅ２ がコン
デンサＣを介して互に結合されている一対のトランジス
タＱ１ ，Ｑ２ を含むマルチバイブレータ３から構成
されている。コンデンサＣは、２つのトランジスタ間の
正帰還経路を形成している。このような発振器２の一例
は、１９７７年にＷｉｌｅｙ社から出版された”Ａｎａ
ｌｙｓｉｓ ａｎｄ Ｄｅｓｉｇｎ ｏｆ Ａ
ｎａｌｏｇ Ｉｎｔｅｇｒａｔｅｄ Ｃｉｒｃｕｉ
ｔｓ”の５９１頁に記載されている。
【００１３】この発振器のトランジスタＱ１ ，Ｑ２
は、それぞれ、電源の正極Ｖｃｃと，相等しい２つの電
流源Ｉの各々との間にエミッタ・フォロワとして接続さ
れているトランジスタＱ３ ，Ｑ４ により駆動される
。
は、それぞれ、電源の正極Ｖｃｃと，相等しい２つの電
流源Ｉの各々との間にエミッタ・フォロワとして接続さ
れているトランジスタＱ３ ，Ｑ４ により駆動される
。
【００１４】本発明の回路デバイス１は、発振器に接続
される回路部品として実現される。回路デバイス１は、
コレクタＣ７ が電源の正極Ｖｃｃに接続され、エミッ
タＥ７ が発振器のトランジスタＱ２ のエミッタＥ２
に接続されたｎｐｎ型のバイポーラ・トランジスタＱ
７ を含む第１の枝回路４を持つ。
される回路部品として実現される。回路デバイス１は、
コレクタＣ７ が電源の正極Ｖｃｃに接続され、エミッ
タＥ７ が発振器のトランジスタＱ２ のエミッタＥ２
に接続されたｎｐｎ型のバイポーラ・トランジスタＱ
７ を含む第１の枝回路４を持つ。
【００１５】また第２の枝回路５は、それぞれダイオー
ド接続され，電源の正極Ｖｃｃと電流源Ｉ１ の間に直
列に接続された２つのバイポーラ・トランジスタＱ８
，Ｑ９ を含む。トランジスタＱ８ ，Ｑ９ は、電源
電圧Ｖｃｃの分圧を供給するためのものである。トラン
ジスタＱ８ のコレクタＣ８ はトランジスタＱ９ の
エミッタＥ９ に接続され、トランジスタＱ９ のコレ
クタＣ９ は電源の正極Ｖｃｃに接続されている。
ド接続され，電源の正極Ｖｃｃと電流源Ｉ１ の間に直
列に接続された２つのバイポーラ・トランジスタＱ８
，Ｑ９ を含む。トランジスタＱ８ ，Ｑ９ は、電源
電圧Ｖｃｃの分圧を供給するためのものである。トラン
ジスタＱ８ のコレクタＣ８ はトランジスタＱ９ の
エミッタＥ９ に接続され、トランジスタＱ９ のコレ
クタＣ９ は電源の正極Ｖｃｃに接続されている。
【００１６】トランジスタＱ８ のエミッタＥ８ は電
流源Ｉ１ に接続されている。また常時開の電子スイッ
チＳＷを介してトランジスタＱ７のベースＢ７ に接続
されている。スイッチＳＷは、コンデンサＣの電圧が所
定の値になったとき発振器の動作を停止させるための閉
駆動信号ＩＮを受けるための制御端子を持つ。
流源Ｉ１ に接続されている。また常時開の電子スイッ
チＳＷを介してトランジスタＱ７のベースＢ７ に接続
されている。スイッチＳＷは、コンデンサＣの電圧が所
定の値になったとき発振器の動作を停止させるための閉
駆動信号ＩＮを受けるための制御端子を持つ。
【００１７】次に、本発明による回路デバイスの動作を
、動作開始（または再開）状態から説明する。動作開始
（または再開）状態では、発振器２は、図３において時
点ｔ１ とｔ２ の間の破線部で示すように、コンデン
サＣが放電しつつある状態にある。
、動作開始（または再開）状態から説明する。動作開始
（または再開）状態では、発振器２は、図３において時
点ｔ１ とｔ２ の間の破線部で示すように、コンデン
サＣが放電しつつある状態にある。
【００１８】図３は、時間に対するコンデンサＣの電圧
値Ｖｃ （ｔ）のグラフを示す。時点ｔ１ ，ｔ２ ，
ｔ３ は、コンデンサＣの充電と放電が切り替わった時
点を示す。
値Ｖｃ （ｔ）のグラフを示す。時点ｔ１ ，ｔ２ ，
ｔ３ は、コンデンサＣの充電と放電が切り替わった時
点を示す。
【００１９】時点ｔ１ とｔ２ の範囲内のある時点で
スイッチＳＷの制御端子に入力される駆動信号ＩＮが’
閉’になったときは、発振器２は、トランジスタＱ１
がオフ，トランジスタＱ２ がオンの状態にある。その
結果、デバイス１のトランジスタＱ７は、そのベースＢ
７ の電圧がトランジスタＱ２ のベースＢ２ の電圧
よりも低いため、オフのままである。
スイッチＳＷの制御端子に入力される駆動信号ＩＮが’
閉’になったときは、発振器２は、トランジスタＱ１
がオフ，トランジスタＱ２ がオンの状態にある。その
結果、デバイス１のトランジスタＱ７は、そのベースＢ
７ の電圧がトランジスタＱ２ のベースＢ２ の電圧
よりも低いため、オフのままである。
【００２０】この状態において、発振器２はそのまま動
作を続ける。
作を続ける。
【００２１】それに対して、ｔ２ とｔ３ の範囲内の
ある時点で駆動信号ＩＮが’閉’になったときは、トラ
ンジスタＱ１ がオン，トランジスタＱ２ がオフであ
り、トランジスタＱ２ のエミッタＥ２ の電圧はＩ１
／Ｃの変化率で低下しつつある。
ある時点で駆動信号ＩＮが’閉’になったときは、トラ
ンジスタＱ１ がオン，トランジスタＱ２ がオフであ
り、トランジスタＱ２ のエミッタＥ２ の電圧はＩ１
／Ｃの変化率で低下しつつある。
【００２２】トランジスタＱ７ のエミッタの面積をト
ランジスタＱ２ の面積よりも大きくすることにより、
トランジスタＱ７ は、時点ｔ＊おいてエミッタＥ２
が最低電圧になる，すなわちトランジスタＱ２ がオン
になる前に、時点ｔ３ においてオンになる。
ランジスタＱ２ の面積よりも大きくすることにより、
トランジスタＱ７ は、時点ｔ＊おいてエミッタＥ２
が最低電圧になる，すなわちトランジスタＱ２ がオン
になる前に、時点ｔ３ においてオンになる。
【００２３】時点ｔ３ 以後は、トランジスタＱ１ と
Ｑ２ の間の正帰還ループが断ち切られているので、Ｑ
２ はオンにならない。
Ｑ２ の間の正帰還ループが断ち切られているので、Ｑ
２ はオンにならない。
【００２４】この状態は、図３に示すコンデンサＣの電
圧Ｖｃ （ｔ）と同じ時間軸でエミッタＥ２ の電圧Ｖ
ｅ （ｔ）の波形を表わす図４に示されている。
圧Ｖｃ （ｔ）と同じ時間軸でエミッタＥ２ の電圧Ｖ
ｅ （ｔ）の波形を表わす図４に示されている。
【００２５】トランジスタＱ７ が集積回路中に占める
面積をＡ’とし、トランジスタＱ１ とＱ２ の各々が
占める面積をＡとすると、トランジスタＱ７ がオンに
なる電圧とトランジスタＱ２ がオンになる電圧の差は
、次式により得られる。
面積をＡ’とし、トランジスタＱ１ とＱ２ の各々が
占める面積をＡとすると、トランジスタＱ７ がオンに
なる電圧とトランジスタＱ２ がオンになる電圧の差は
、次式により得られる。
【００２６】ΔＶ＝Ｖｔ ＋ｌｎ Ａ’／Ａここで、
Ｖｔ は温度変動に関係する電圧値である。
Ｖｔ は温度変動に関係する電圧値である。
【００２７】信号ＩＮが’開’に戻され、それによって
発振器２に対する動作阻止が解除された時点で、トラン
ジスタＱ２ が再びオンになり得るためにはエミッタＥ
２ の電圧がさらに上記ΔＶだけ下降しなければならず
、そのため不可避的に、発振器の位相に時間遅れが発生
することが考えられる。
発振器２に対する動作阻止が解除された時点で、トラン
ジスタＱ２ が再びオンになり得るためにはエミッタＥ
２ の電圧がさらに上記ΔＶだけ下降しなければならず
、そのため不可避的に、発振器の位相に時間遅れが発生
することが考えられる。
【００２８】この時間遅れ、すなわち
ｔ＊ −ｔ３ ＝Δｔ＝ΔＶ＊Ｃ／Ｉ
をできるだけ小さくするために、発振周期Ｔに対する遅
延の比率を計算すると都合が良い。
延の比率を計算すると都合が良い。
【００２９】いまの場合には、周期Ｔは次式から得られ
る。
る。
【００３０】１／Ｔ＝Ｉ／４＊Ｃ＊ＶｂｅここでＶｂｅ
はトランジスタＱ２ のベース−エミッタ電圧である。
はトランジスタＱ２ のベース−エミッタ電圧である。
【００３１】したがって、発振周期Ｔに対する遅れ時間
延れの比率は、次式で計算される。 Δｔ／Ｔ＝ΔＶ／４＊Ｖｂｅ ＝ （
Ｖｔ ＊ｌｎ Ａ’／Ａ）／４＊Ｖｂｅこの式から、
Ｖｂｅ ＝０．７Ｖ，Ｖｔ ＝２６ｍＶ，Ａ’／Ａ＝
１．５とするとΔｔ／Ｔは０．００４になる。この値は
０．０２５ラジアンの位相誤差に相当し、デバイスの温
度変動と無関係である。
延れの比率は、次式で計算される。 Δｔ／Ｔ＝ΔＶ／４＊Ｖｂｅ ＝ （
Ｖｔ ＊ｌｎ Ａ’／Ａ）／４＊Ｖｂｅこの式から、
Ｖｂｅ ＝０．７Ｖ，Ｖｔ ＝２６ｍＶ，Ａ’／Ａ＝
１．５とするとΔｔ／Ｔは０．００４になる。この値は
０．０２５ラジアンの位相誤差に相当し、デバイスの温
度変動と無関係である。
【００３２】すなわちＶｂｅ ＝Ｖｔ ＊ｌｎ Ｉ
／Ｉｓ であるため、上記の関係は、ただ１つの温度に
依存する項であるＶｔ の影響を受けなくなる。
／Ｉｓ であるため、上記の関係は、ただ１つの温度に
依存する項であるＶｔ の影響を受けなくなる。
【００３３】上式から、Ａ’／Ａの値を小さくすること
により位相誤差を低減させることができること、この比
率を１にすると，スイッチＳＷのスイッチングに対する
発振器の発振の再開の遅れ，すなわち位相誤差は無くな
ることがわかる。
により位相誤差を低減させることができること、この比
率を１にすると，スイッチＳＷのスイッチングに対する
発振器の発振の再開の遅れ，すなわち位相誤差は無くな
ることがわかる。
【００３４】しかしながら、発振器の発振の再開が制御
不能になるのを避けようとするなら、面積の比率Ａ’／
Ａを１の近くまで小さくすることは賢明ではない。
不能になるのを避けようとするなら、面積の比率Ａ’／
Ａを１の近くまで小さくすることは賢明ではない。
【００３５】図２に示す実施例では、スイッチＳＷはＭ
ＯＳ型の電界効果トランジスタＭ１により構成されてい
る。このトランジスタＭ１ は、ソースＳ１ がトラン
ジスタＱ７ のベースに，ドレインＤ１ がダイオード
−トランジスタＱ８ およびＱ９ から成る分圧発生回
路に接続されており、ゲートＧ１ が制御端子に接続さ
れている。
ＯＳ型の電界効果トランジスタＭ１により構成されてい
る。このトランジスタＭ１ は、ソースＳ１ がトラン
ジスタＱ７ のベースに，ドレインＤ１ がダイオード
−トランジスタＱ８ およびＱ９ から成る分圧発生回
路に接続されており、ゲートＧ１ が制御端子に接続さ
れている。
【００３６】回路の寸法を決めるときは、トランジスタ
Ｍ１ の内部電圧降下を考慮に入れる必要がある。
Ｍ１ の内部電圧降下を考慮に入れる必要がある。
【００３７】
【発明の効果】以上のように本発明の回路デバイスによ
れば、発振器の発振の位相を正確に制御することができ
る。
れば、発振器の発振の位相を正確に制御することができ
る。
【００３８】本発明のデバイスはまた、発振器に干渉す
る必要がないときは、発振器の動作にまったく影響を及
ぼさないという利点がある。
る必要がないときは、発振器の動作にまったく影響を及
ぼさないという利点がある。
【図１】本発明による回路デバイスの１実施例の構成と
動作原理の説明図である。
動作原理の説明図である。
【図２】本発明による回路デバイスの他の実施例の構成
とその動作原理の説明図である。
とその動作原理の説明図である。
【図３】発振器のトランジスタ対のエミッタを結合する
コンデンサの電圧の変化を示す説明図である。
コンデンサの電圧の変化を示す説明図である。
【図４】発振器のトランジスタ対の１方のエミッタの電
圧の変化を示す説明図である。
圧の変化を示す説明図である。
１ 回路デバイス
２ 発振器
３ マルチバイブレータ
Claims (9)
- 【請求項１】 エミッタ（Ｅ１ ，Ｅ２ ）がコンデ
ンサ（Ｃ）を含む帰還経路により結合された一対のトラ
ンジスタ（Ｑ１ ，Ｑ２ ）を持つマルチバイブレータ
（３）を含む発振器（２）の位相を制御するための回路
デバイスであって、発振器（２）の動作を停止させるた
めの動作停止信号（ＩＮ）を受けるように設けられた制
御端子を備えた電子的スイッチ手段（ＳＷ）と、発振器
（２）に接続され、電子的スイッチ手段（ＳＷ）の状態
に応動して，電子的スイッチ手段（ＳＷ）の制御端子に
動作停止信号（ＩＮ）が加えられ，かつ結合コンデンサ
（Ｃ）の電圧（Ｖｃ）が所定の値になったとき，トラン
ジスタ対（Ｑ１ ，Ｑ２ ）のエミッタ（Ｅ１ ，Ｅ２
）間の帰還を遮断する回路手段（Ｑ７ ，４，５）を
含むことを特徴とする回路デバイス。 - 【請求項２】 前記電子的スイッチ手段（ＳＷ）が常
時開いており、かつ前記回路手段が，該デバイスの電源
の極と前記トランジスタ対（Ｑ１ ，Ｑ２ ）の１方の
エミッタ（Ｅ１ またはＥ２ ）の間に接続され，その
制御端子（Ｂ７ ）が前記電子的スイッチ手段（ＳＷ）
に直列に接続されたトランジスタ（Ｑ７ ）を含むこと
を特徴とする請求項１に記載の回路デバイス。 - 【請求項３】 前記回路手段が，前記スイッチ手段（
ＳＷ）を介して前記トランジスタ（Ｑ７ ）の制御端子
（Ｂ７ ）に接続された電圧分割回路を含むことを特徴
とする請求項２に記載の回路デバイス。 - 【請求項４】 前記電圧分割回路が、電源の正極（Ｖ
ｃｃ）と接地された電流回路（Ｉ）の間に接続された，
直列接続されたダイオード（Ｑ７ ，Ｑ８ ）を含むこ
とを特徴とする請求項３に記載の回路デバイス。 - 【請求項５】 前記直列接続されたダイオードが，ダ
イオード接続されたトランジスタ対（Ｑ７ ，Ｑ８ ）
により構成されることを特徴とする請求項４に記載の回
路。 - 【請求項６】 前記トランジスタ（Ｑ７ ）がバイポ
ーラ・トランジスタであり，そのコレクタ（Ｃ７ ）が
電源の正極（Ｖｃｃ）に，エミッタ（Ｅ７ ）が前記ト
ランジスタ対（Ｑ１ ，Ｑ２ ）のエミッタ（Ｅ２ ）
に，ベース（Ｂ７ ）が前記スイッチ手段（ＳＷ）にそ
れぞれ接続されていることを特徴とする請求項２に記載
の回路。 - 【請求項７】 前記バイポーラ・トランジスタ（Ｑ７
）のエミッタの面積が、前記トランジスタ対（Ｑ１
，Ｑ２ ）のうち該トランジスタ（Ｑ７ ）が接続され
ているトランジスタ（Ｑ２ ）のエミッタの面積よりも
大きく設けられていることを特徴とする請求項６に記載
の回路デバイス。 - 【請求項８】 前記電子的スイッチ手段（ＳＷ）がＭ
ＯＳ型の電界効果トランジスタ（Ｍ１）であることを特
徴とする請求項１に記載の回路デバイス。 - 【請求項９】 前記電子的スイッチ手段（ＳＷ）がＭ
ＯＳ型の電界効果トランジスタ（Ｍ１ ）であり、その
ソース（Ｓ１ ）が前記トランジスタ（Ｑ７ ）の制御
端子（Ｂ７ ）に接続されていることを特徴とする請求
項２に記載の回路デバイス。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| IT02255090A IT1246741B (it) | 1990-12-28 | 1990-12-28 | Dispositivo circuitale per il rifasamento di un oscillatore. |
| IT22550A/90 | 1990-12-28 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04294629A true JPH04294629A (ja) | 1992-10-19 |
Family
ID=11197732
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3347549A Pending JPH04294629A (ja) | 1990-12-28 | 1991-12-27 | 発振器の位相制御回路デバイス |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US5231362A (ja) |
| EP (1) | EP0492338B1 (ja) |
| JP (1) | JPH04294629A (ja) |
| KR (1) | KR920013877A (ja) |
| DE (1) | DE69127430T2 (ja) |
| IT (1) | IT1246741B (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05227145A (ja) * | 1992-02-10 | 1993-09-03 | Oki Electric Ind Co Ltd | クロック発振回路及びクロック抽出回路 |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN101268612A (zh) * | 2005-09-23 | 2008-09-17 | 格罗纳乌有限公司 | 滤波器电路 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4496914A (en) * | 1981-11-13 | 1985-01-29 | Texas Instruments Incorporated | Piezo harn self-oscillating drive circuit |
-
1990
- 1990-12-28 IT IT02255090A patent/IT1246741B/it active IP Right Grant
-
1991
- 1991-12-16 EP EP91121516A patent/EP0492338B1/en not_active Expired - Lifetime
- 1991-12-16 DE DE69127430T patent/DE69127430T2/de not_active Expired - Fee Related
- 1991-12-23 US US07/813,155 patent/US5231362A/en not_active Expired - Lifetime
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