JPH04316851A - インクジェットマルチノズルヘッドの駆動回路 - Google Patents
インクジェットマルチノズルヘッドの駆動回路Info
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- JPH04316851A JPH04316851A JP8404891A JP8404891A JPH04316851A JP H04316851 A JPH04316851 A JP H04316851A JP 8404891 A JP8404891 A JP 8404891A JP 8404891 A JP8404891 A JP 8404891A JP H04316851 A JPH04316851 A JP H04316851A
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- Japan
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- pulse
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- logic circuits
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、複数のノズルからイン
クを吐出させる複数の圧電素子を駆動するインクジェッ
トマルチノズルヘッドの駆動回路に関する。
クを吐出させる複数の圧電素子を駆動するインクジェッ
トマルチノズルヘッドの駆動回路に関する。
【０００２】
【従来の技術】従来のインクジェットを用いて階調表現
を行う方法としては、単位面積当りのドット数を階調に
応じて変化させる面積階調方法と、オンデマンド型に有
利な方法でありドット数は一定としてノズルからインク
を吐出させるための圧電素子の駆動電圧または駆動時間
を階調に応じて制御することにより１つのドットを形成
するインクの量を変えてドットの大きさを階調に応じて
変化させるドット変化方法とが知られている。
を行う方法としては、単位面積当りのドット数を階調に
応じて変化させる面積階調方法と、オンデマンド型に有
利な方法でありドット数は一定としてノズルからインク
を吐出させるための圧電素子の駆動電圧または駆動時間
を階調に応じて制御することにより１つのドットを形成
するインクの量を変えてドットの大きさを階調に応じて
変化させるドット変化方法とが知られている。
【０００３】上記面積階調方法は、階調数を上げるため
には解像度を犠牲にしなければならないという欠点があ
るが、上記ドット変化方法はその点で優れている。
には解像度を犠牲にしなければならないという欠点があ
るが、上記ドット変化方法はその点で優れている。
【０００４】以下、図５を参照して上記ドット変化方法
を説明する。
を説明する。
【０００５】図５は、ドット変化方法を用いた圧電素子
の駆動回路を示す。高耐圧アンプ２０には高圧電源２１
が接続されており、パルス幅設定回路２２からパルス信
号が入力されると、高圧電源２１の電圧により高圧パル
スを発生して圧電素子２３に印加する。圧電素子２３に
印加される高圧パルスの幅はパルス幅設定回路２２によ
り制御される。
の駆動回路を示す。高耐圧アンプ２０には高圧電源２１
が接続されており、パルス幅設定回路２２からパルス信
号が入力されると、高圧電源２１の電圧により高圧パル
スを発生して圧電素子２３に印加する。圧電素子２３に
印加される高圧パルスの幅はパルス幅設定回路２２によ
り制御される。
【０００６】図６は、他の駆動回路の構成例であり、高
耐圧アンプ２４には印加電圧設定回路２５から高圧パル
スを発生するように電圧が与えられており、ヘッドＯＮ
−ＯＦＦ信号がオンとなったときに印加電圧設定回路２
５によって設定される電圧値の高圧パルスが圧電素子２
６に印加される。
耐圧アンプ２４には印加電圧設定回路２５から高圧パル
スを発生するように電圧が与えられており、ヘッドＯＮ
−ＯＦＦ信号がオンとなったときに印加電圧設定回路２
５によって設定される電圧値の高圧パルスが圧電素子２
６に印加される。
【０００７】
【発明が解決しようとする課題】しかしながら、上述し
た従来のドット変化方法を用いた圧電素子の駆動回路で
は、記録密度を高めるときにヘッドを複数のノズル、即
ちマルチノズルヘッドを形成することが有効であるが、
図５または図６に示したような駆動回路を各圧電素子ご
とに設ける必要があり回路全体が複雑で大型化してしま
いコストが高いという問題点がある。
た従来のドット変化方法を用いた圧電素子の駆動回路で
は、記録密度を高めるときにヘッドを複数のノズル、即
ちマルチノズルヘッドを形成することが有効であるが、
図５または図６に示したような駆動回路を各圧電素子ご
とに設ける必要があり回路全体が複雑で大型化してしま
いコストが高いという問題点がある。
【０００８】本発明は、上述した従来のインクジェット
マルチノズルヘッドの駆動回路における問題点に鑑み、
回路の構造が簡単で小型化可能でありコストが安いイン
クジェットマルチノズルヘッドの駆動回路を提供する。
マルチノズルヘッドの駆動回路における問題点に鑑み、
回路の構造が簡単で小型化可能でありコストが安いイン
クジェットマルチノズルヘッドの駆動回路を提供する。
【０００９】
【課題を解決するための手段】本発明は、所定のクロッ
ク信号にデータを同期させて生成したパルス信号を出力
するパルス出力手段と、パルス出力手段から出力された
パルス信号のパルス幅をパルス幅生成手段から出力され
た共通の制御信号に基づいて変調する複数の論理回路と
、複数の論理回路で変調されたパルス信号に基づいて複
数の圧電素子に電圧を印加する電圧増幅手段とを備えて
いるインクジェットマルチノズルヘッドの駆動回路によ
って達成される。
ク信号にデータを同期させて生成したパルス信号を出力
するパルス出力手段と、パルス出力手段から出力された
パルス信号のパルス幅をパルス幅生成手段から出力され
た共通の制御信号に基づいて変調する複数の論理回路と
、複数の論理回路で変調されたパルス信号に基づいて複
数の圧電素子に電圧を印加する電圧増幅手段とを備えて
いるインクジェットマルチノズルヘッドの駆動回路によ
って達成される。
【００１０】また、本発明は、所定のクロック信号にデ
ータを同期させて生成したパルス信号を出力するパルス
出力手段と、パルス出力手段から出力されたパルス信号
をパルス幅生成手段から出力された共通の制御信号に基
づいて出力する複数の論理回路と、複数の論理回路から
出力されたパルス信号に基づいて電圧値を変調して複数
の圧電素子のそれぞれに印加する電圧増幅手段とを備え
ているインクジェットマルチノズルヘッドの駆動回路に
よっても達成される。
ータを同期させて生成したパルス信号を出力するパルス
出力手段と、パルス出力手段から出力されたパルス信号
をパルス幅生成手段から出力された共通の制御信号に基
づいて出力する複数の論理回路と、複数の論理回路から
出力されたパルス信号に基づいて電圧値を変調して複数
の圧電素子のそれぞれに印加する電圧増幅手段とを備え
ているインクジェットマルチノズルヘッドの駆動回路に
よっても達成される。
【００１１】
【作用】上記第１の発明によれば、パルス出力手段は所
定のクロック信号にデータを同期させて生成したパルス
信号を出力し、複数の論理回路のそれぞれはパルス出力
手段から出力されたパルス信号のパルス幅をパルス幅生
成手段から出力された共通の制御信号に基づいて変調し
、電圧増幅手段は複数の論理回路で変調されたパルス信
号に基づいて複数の圧電素子に電圧を印加する。
定のクロック信号にデータを同期させて生成したパルス
信号を出力し、複数の論理回路のそれぞれはパルス出力
手段から出力されたパルス信号のパルス幅をパルス幅生
成手段から出力された共通の制御信号に基づいて変調し
、電圧増幅手段は複数の論理回路で変調されたパルス信
号に基づいて複数の圧電素子に電圧を印加する。
【００１２】上記第２の発明によれば、パルス出力手段
は所定のクロック信号にデータを同期させて生成したパ
ルス信号を出力し、複数の論理回路はパルス出力手段か
ら出力されたパルス信号をパルス幅生成手段から出力さ
れた共通の制御信号に基づいて出力し、電圧増幅手段は
複数の論理回路から出力されたパルス信号に基づいて電
圧値を変調して複数の圧電素子のそれぞれに印加する。
は所定のクロック信号にデータを同期させて生成したパ
ルス信号を出力し、複数の論理回路はパルス出力手段か
ら出力されたパルス信号をパルス幅生成手段から出力さ
れた共通の制御信号に基づいて出力し、電圧増幅手段は
複数の論理回路から出力されたパルス信号に基づいて電
圧値を変調して複数の圧電素子のそれぞれに印加する。
【００１３】
【実施例】以下、図面を参照して本発明のインクジェッ
トマルチノズルヘッドの駆動回路における実施例を詳述
する。
トマルチノズルヘッドの駆動回路における実施例を詳述
する。
【００１４】図１に本発明のインクジェットマルチノズ
ルヘッドの駆動回路における一実施例の構成を示す。
ルヘッドの駆動回路における一実施例の構成を示す。
【００１５】図１のインクジェットマルチノズルヘッド
の駆動回路は、複数の圧電素子ＰＺＴ１〜ＰＺＴｎによ
り形成されている圧電素子部ＰＺＴ 、複数の電圧増幅
手段である複数の高耐圧アンプ１１１ 〜１１ｎ によ
り形成されている高耐圧アンプ部１１、制御電圧発生回
路１２、論理回路である複数のゲート回路１３１ 〜１
３ｎ により形成されているゲート回路部１３、パルス
発生手段であるシフトレジスタ１４及びパルス幅生成手
段であるパルス幅生成回路１５により構成されている。
の駆動回路は、複数の圧電素子ＰＺＴ１〜ＰＺＴｎによ
り形成されている圧電素子部ＰＺＴ 、複数の電圧増幅
手段である複数の高耐圧アンプ１１１ 〜１１ｎ によ
り形成されている高耐圧アンプ部１１、制御電圧発生回
路１２、論理回路である複数のゲート回路１３１ 〜１
３ｎ により形成されているゲート回路部１３、パルス
発生手段であるシフトレジスタ１４及びパルス幅生成手
段であるパルス幅生成回路１５により構成されている。
【００１６】各圧電素子ＰＺＴ１〜ＰＺＴｎは電圧を印
加することにより駆動し、各ノズル（図示せず）からイ
ンクを吐出するように構成されている。
加することにより駆動し、各ノズル（図示せず）からイ
ンクを吐出するように構成されている。
【００１７】各高耐圧アンプ１１１ 〜１１ｎ は、一
定の値を有する高電圧ＶＨが制御電圧発生回路１２から
電源として与えられており、各ゲート回路１３１ 〜１
３ｎ からパルス信号が入力されると、それらのパルス
信号が入力されている間に各圧電素子ＰＺＴ１〜ＰＺＴ
ｎ１０高電圧を印加する。
定の値を有する高電圧ＶＨが制御電圧発生回路１２から
電源として与えられており、各ゲート回路１３１ 〜１
３ｎ からパルス信号が入力されると、それらのパルス
信号が入力されている間に各圧電素子ＰＺＴ１〜ＰＺＴ
ｎ１０高電圧を印加する。
【００１８】各ゲート回路１３１ 〜１３ｎ は論理積
回路であり、各ゲート回路１３１ 〜１３ｎ の一方の
入力端子はシフトレジスタ１４の出力端子１４１ 〜１
４ｎ にそれぞれ接続されており、他方の入力端子は全
てパルス幅生成回路１５の出力端子に接続されている。
回路であり、各ゲート回路１３１ 〜１３ｎ の一方の
入力端子はシフトレジスタ１４の出力端子１４１ 〜１
４ｎ にそれぞれ接続されており、他方の入力端子は全
てパルス幅生成回路１５の出力端子に接続されている。
【００１９】シフトレジスタ１４はクロック信号ＣＰを
入力し、入力されたクロック信号ＣＰの立上りに同期し
てデータ信号ＤＡＴを取り込み、取り込まれたデータ信
号ＤＡＴをシフトして出力端子１４１ 〜１４ｎ から
順番に出力する。
入力し、入力されたクロック信号ＣＰの立上りに同期し
てデータ信号ＤＡＴを取り込み、取り込まれたデータ信
号ＤＡＴをシフトして出力端子１４１ 〜１４ｎ から
順番に出力する。
【００２０】パルス幅生成回路１５は、クロック信号Ｃ
Ｐの立上りに同期してパルス信号ＰＷＭを出力し、出力
されたパルス信号ＰＷＭの幅に基づいて各圧電素子ＰＺ
Ｔ１〜ＰＺＴｎに印加する高圧パルスの幅を設定する。
Ｐの立上りに同期してパルス信号ＰＷＭを出力し、出力
されたパルス信号ＰＷＭの幅に基づいて各圧電素子ＰＺ
Ｔ１〜ＰＺＴｎに印加する高圧パルスの幅を設定する。
【００２１】次に、図２に示すタイミングチャートを用
いて動作を説明する。
いて動作を説明する。
【００２２】シフトレジスタ１４はデータ信号ＤＡＴが
入力されると、データ信号ＤＡＴを取り込み、クロック
信号ＣＰの立上りに同期して、クロック信号ＣＰの１周
期分の幅のパルス信号Ｑ１〜Ｑｎを出力端子１４１ 〜
１４ｎから順番に出力する。
入力されると、データ信号ＤＡＴを取り込み、クロック
信号ＣＰの立上りに同期して、クロック信号ＣＰの１周
期分の幅のパルス信号Ｑ１〜Ｑｎを出力端子１４１ 〜
１４ｎから順番に出力する。
【００２３】パルス幅生成回路１５は、クロック信号Ｃ
Ｐの立上りに同期して、クロック信号ＣＰの１周期より
短い幅のパルス信号ＰＷＭを出力し、パルス信号ＰＷＭ
のパルス幅Ｔｗ１〜Ｔｗｎを、各パルス信号ＰＷＭごと
に印刷画像の階調を決める階調データに基づいて設定す
る。
Ｐの立上りに同期して、クロック信号ＣＰの１周期より
短い幅のパルス信号ＰＷＭを出力し、パルス信号ＰＷＭ
のパルス幅Ｔｗ１〜Ｔｗｎを、各パルス信号ＰＷＭごと
に印刷画像の階調を決める階調データに基づいて設定す
る。
【００２４】各ゲート回路１３１ 〜１３ｎ は、シフ
トレジスタ１４からパルス信号が入力されたときにパル
ス信号ＰＷＭを出力し、対応する各高耐圧アンプ１１１
〜１１ｎ に出力する。
トレジスタ１４からパルス信号が入力されたときにパル
ス信号ＰＷＭを出力し、対応する各高耐圧アンプ１１１
〜１１ｎ に出力する。
【００２５】その結果、パルス信号ＰＷＭが与えられた
各高耐圧アンプ１１１〜１１ｎ は、継続時間がパルス
信号ＰＷＭのパルス幅に等しい一定電圧の高圧パルスＶ
１〜Ｖｎを対応する圧電素子ＰＺＴ１〜ＰＺＴｎにそれ
ぞれ印加する。
各高耐圧アンプ１１１〜１１ｎ は、継続時間がパルス
信号ＰＷＭのパルス幅に等しい一定電圧の高圧パルスＶ
１〜Ｖｎを対応する圧電素子ＰＺＴ１〜ＰＺＴｎにそれ
ぞれ印加する。
【００２６】圧電素子ＰＺＴ１〜ＰＺＴｎは印加された
高圧パルスにより駆動され、高圧パルスの継続時間に応
じた量のインクがノズルから吐出される。
高圧パルスにより駆動され、高圧パルスの継続時間に応
じた量のインクがノズルから吐出される。
【００２７】次に、本発明のインクジェットマルチノズ
ルヘッドの駆動回路における他の実施例について説明す
る。
ルヘッドの駆動回路における他の実施例について説明す
る。
【００２８】図３は、本実施例のインクジェットマルチ
ノズルヘッドの駆動回路を示す。なお、上述した実施例
と同一の構成要素には同じ符号を付した。
ノズルヘッドの駆動回路を示す。なお、上述した実施例
と同一の構成要素には同じ符号を付した。
【００２９】図３の駆動回路と図１の駆動回路の異なる
点は、パルス幅生成回路１６の出力であるパルス信号Ｐ
ＷＭ´のレベルを一定の値にするという点である。即ち
、制御電圧発生回路１７は、階調データに応じて電圧が
異なるパルス状の高電圧Ｖｐをクロック信号ＣＰの立上
りに同期して各高耐圧アンプ１１１ 〜１１ｎ に与え
、パルス幅生成回路１６は、圧電素子ＰＺＴ１〜ＰＺＴ
ｎを駆動するときにパルス信号ＰＷＭ´を一定の値のハ
イレベルに固定する。
点は、パルス幅生成回路１６の出力であるパルス信号Ｐ
ＷＭ´のレベルを一定の値にするという点である。即ち
、制御電圧発生回路１７は、階調データに応じて電圧が
異なるパルス状の高電圧Ｖｐをクロック信号ＣＰの立上
りに同期して各高耐圧アンプ１１１ 〜１１ｎ に与え
、パルス幅生成回路１６は、圧電素子ＰＺＴ１〜ＰＺＴ
ｎを駆動するときにパルス信号ＰＷＭ´を一定の値のハ
イレベルに固定する。
【００３０】次に、図４に示すタイミングチャートを参
照して図２の駆動回路の動作を説明する。
照して図２の駆動回路の動作を説明する。
【００３１】シフトレジスタ１４はデータ信号ＤＡＴが
入力されると、データ信号ＤＡＴを取り込み、クロック
信号ＣＰの立上りに同期して、クロック信号ＣＰの１周
期分の幅のパルス信号Ｑ１〜Ｑｎを出力端子１４１ 〜
１４ｎから順番に出力する。
入力されると、データ信号ＤＡＴを取り込み、クロック
信号ＣＰの立上りに同期して、クロック信号ＣＰの１周
期分の幅のパルス信号Ｑ１〜Ｑｎを出力端子１４１ 〜
１４ｎから順番に出力する。
【００３２】パルス幅生成回路１６はパルス信号ＰＷＭ
´をハイレベルに固定し、パルス信号ＰＷＭ´に基づい
てパルス信号Ｑ１〜Ｑｎがゲート回路１３から順番に出
力され、対応する各高耐圧アンプ１１に与えられる。
´をハイレベルに固定し、パルス信号ＰＷＭ´に基づい
てパルス信号Ｑ１〜Ｑｎがゲート回路１３から順番に出
力され、対応する各高耐圧アンプ１１に与えられる。
【００３３】制御電圧生成回路１７は、階調データに応
じて電圧が異なるパルス状の高電圧をクロック信号ＣＰ
の立上りに同期して各高耐圧アンプ１１１〜１１ｎ に
与え、各ゲート回路１３１ 〜１３ｎ からパルス信号
が入力された各高耐圧アンプ１１１ 〜１１ｎ が、制
御電圧生成回路１７からのパルス状の高電圧Ｖｐに基づ
いて高圧パルスＶｐ１〜Ｖｐｎを対応する各圧電素子Ｐ
ＺＴ１〜ＰＺＴｎにそれぞれ印加して高圧パルスＶｐ１
〜Ｖｐｎが印加された各圧電素子ＰＺＴ１〜ＰＺＴｎが
駆動され、ノズルが高圧パルスの電圧Ｖｐに応じた量の
インクを吐出する。
じて電圧が異なるパルス状の高電圧をクロック信号ＣＰ
の立上りに同期して各高耐圧アンプ１１１〜１１ｎ に
与え、各ゲート回路１３１ 〜１３ｎ からパルス信号
が入力された各高耐圧アンプ１１１ 〜１１ｎ が、制
御電圧生成回路１７からのパルス状の高電圧Ｖｐに基づ
いて高圧パルスＶｐ１〜Ｖｐｎを対応する各圧電素子Ｐ
ＺＴ１〜ＰＺＴｎにそれぞれ印加して高圧パルスＶｐ１
〜Ｖｐｎが印加された各圧電素子ＰＺＴ１〜ＰＺＴｎが
駆動され、ノズルが高圧パルスの電圧Ｖｐに応じた量の
インクを吐出する。
【００３４】
【発明の効果】第１の発明のインクジェットマルチノズ
ルヘッドの駆動回路は、所定のクロック信号にデータを
同期させて生成したパルス信号を出力するパルス出力手
段と、パルス出力手段から出力されたパルス信号のパル
ス幅をパルス幅生成手段から出力された共通の制御信号
に基づいて変調する複数の論理回路と、複数の論理回路
で変調されたパルス信号に基づいて複数の圧電素子に電
圧を印加する電圧増幅手段とを備えているので、圧電素
子に印加する電圧のパルス幅を制御してノズルから吐出
されるインクの量を変化させるときにパルス幅を制御す
る回路が全ての圧電素子に対して共通化されて、回路全
体が簡素で小型化されてコストが安くなる。
ルヘッドの駆動回路は、所定のクロック信号にデータを
同期させて生成したパルス信号を出力するパルス出力手
段と、パルス出力手段から出力されたパルス信号のパル
ス幅をパルス幅生成手段から出力された共通の制御信号
に基づいて変調する複数の論理回路と、複数の論理回路
で変調されたパルス信号に基づいて複数の圧電素子に電
圧を印加する電圧増幅手段とを備えているので、圧電素
子に印加する電圧のパルス幅を制御してノズルから吐出
されるインクの量を変化させるときにパルス幅を制御す
る回路が全ての圧電素子に対して共通化されて、回路全
体が簡素で小型化されてコストが安くなる。
【００３５】また、第２の発明のインクジェットマルチ
ノズルヘッドの駆動回路は、所定のクロック信号にデー
タを同期させて生成したパルス信号を出力するパルス出
力手段と、パルス出力手段から出力されたパルス信号を
パルス幅生成手段から出力された共通の制御信号に基づ
いて出力する複数の論理回路と、複数の論理回路から出
力されたパルス信号に基づいて電圧値を変調して複数の
圧電素子のそれぞれに印加する電圧増幅手段とを備えて
いるので、電圧パルスの電圧値を制御してノズルから吐
出されるインクの量を変化させるときに電圧パルスの電
圧値を設定する回路が共通化されて、回路全体が簡素で
小型化されてコストが安くなる。
ノズルヘッドの駆動回路は、所定のクロック信号にデー
タを同期させて生成したパルス信号を出力するパルス出
力手段と、パルス出力手段から出力されたパルス信号を
パルス幅生成手段から出力された共通の制御信号に基づ
いて出力する複数の論理回路と、複数の論理回路から出
力されたパルス信号に基づいて電圧値を変調して複数の
圧電素子のそれぞれに印加する電圧増幅手段とを備えて
いるので、電圧パルスの電圧値を制御してノズルから吐
出されるインクの量を変化させるときに電圧パルスの電
圧値を設定する回路が共通化されて、回路全体が簡素で
小型化されてコストが安くなる。
【図１】本発明によるインクジェットマルチノズルヘッ
ドの駆動回路の一実施例の構成を示す回路図である。
ドの駆動回路の一実施例の構成を示す回路図である。
【図２】図１の駆動回路の動作を説明するためのタイミ
ングチャートである。
ングチャートである。
【図３】本発明によるインクジェットマルチノズルヘッ
ドの駆動回路の他の実施例の構成を示す回路図である。
ドの駆動回路の他の実施例の構成を示す回路図である。
【図４】図３の駆動回路の動作を説明するためのタイミ
ングチャートである。
ングチャートである。
【図５】従来のノズルヘッドの駆動回路の一構成例を示
す回路図である。
す回路図である。
【図６】従来のノズルヘッドの駆動回路の他の構成例を
示す回路図である。
示す回路図である。
ＰＺＴ１〜ＰＺＴｎ 圧電素子
１１１ 〜１１ｎ 高耐圧アンプ
１２ 制御電圧発生回路
１３１ 〜１３ｎ ゲート回路
１４ シフトレジスタ
１５ パルス幅生成回路
Claims (2)
- 【請求項１】 所定のクロック信号にデータを同期さ
せて生成したパルス信号を出力するパルス出力手段と、
前記パルス出力手段から出力された前記パルス信号のパ
ルス幅をパルス幅生成手段から出力された共通の制御信
号に基づいて変調する複数の論理回路と、前記複数の論
理回路で変調された前記パルス信号に基づいて複数の圧
電素子に電圧を印加する電圧増幅手段とを備えているこ
とを特徴とするインクジェットマルチノズルヘッドの駆
動回路。 - 【請求項２】 所定のクロック信号にデータを同期さ
せて生成したパルス信号を出力するパルス出力手段と、
前記パルス出力手段から出力された前記パルス信号をパ
ルス幅生成手段から出力された共通の制御信号に基づい
て出力する複数の論理回路と、前記複数の論理回路から
出力された前記パルス信号に基づいて電圧値を変調して
前記複数の圧電素子のそれぞれに印加する電圧増幅手段
とを備えていることを特徴とするインクジェットマルチ
ノズルヘッドの駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8404891A JPH04316851A (ja) | 1991-04-16 | 1991-04-16 | インクジェットマルチノズルヘッドの駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8404891A JPH04316851A (ja) | 1991-04-16 | 1991-04-16 | インクジェットマルチノズルヘッドの駆動回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04316851A true JPH04316851A (ja) | 1992-11-09 |
Family
ID=13819620
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8404891A Pending JPH04316851A (ja) | 1991-04-16 | 1991-04-16 | インクジェットマルチノズルヘッドの駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04316851A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1057635A3 (en) * | 1999-05-24 | 2002-04-10 | Nec Corporation | Piezoelectric element driving circuit and driving method |
| US6412895B1 (en) | 1997-10-23 | 2002-07-02 | Nec Corporation | Electrostatic ink jet printer |
| US7320509B2 (en) | 2004-03-15 | 2008-01-22 | Ricoh Printing Systems, Ltd. | Inkjet apparatus |
| US7396096B2 (en) | 2004-07-28 | 2008-07-08 | Ricoh Printing Systems, Ltd. | Inkjet recording device |
| JP2010034669A (ja) * | 2008-07-25 | 2010-02-12 | Sharp Corp | 電圧増幅回路および駆動回路 |
-
1991
- 1991-04-16 JP JP8404891A patent/JPH04316851A/ja active Pending
Cited By (7)
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|---|---|---|---|---|
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