JPH04336437A - 半導体装置 - Google Patents
半導体装置Info
- Publication number
- JPH04336437A JPH04336437A JP3138166A JP13816691A JPH04336437A JP H04336437 A JPH04336437 A JP H04336437A JP 3138166 A JP3138166 A JP 3138166A JP 13816691 A JP13816691 A JP 13816691A JP H04336437 A JPH04336437 A JP H04336437A
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- Japan
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- die pad
- semiconductor element
- semiconductor device
- semiconductor
- thermal stress
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- Pending
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- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/30—Die-attach connectors
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D62/00—Semiconductor bodies, or regions thereof, of devices having potential barriers
- H10D62/10—Shapes, relative sizes or dispositions of the regions of the semiconductor bodies; Shapes of the semiconductor bodies
- H10D62/117—Shapes of semiconductor bodies
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/071—Connecting or disconnecting
- H10W72/073—Connecting or disconnecting of die-attach connectors
- H10W72/07321—Aligning
- H10W72/07327—Aligning involving guiding structures, e.g. spacers or supporting members
-
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- H10W72/073—Connecting or disconnecting of die-attach connectors
- H10W72/07351—Connecting or disconnecting of die-attach connectors characterised by changes in properties of the die-attach connectors during connecting
- H10W72/07353—Connecting or disconnecting of die-attach connectors characterised by changes in properties of the die-attach connectors during connecting changes in shapes
-
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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- H10W72/334—Cross-sectional shape, i.e. in side view
-
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
- H10W72/931—Shapes of bond pads
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/731—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors
- H10W90/736—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors between a chip and a stacked lead frame, conducting package substrate or heat sink
Landscapes
- Die Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【0001】
【産業上の利用分野】この発明は、半導体装置に係り、
特に半導体素子の支持構造に関するものである。
特に半導体素子の支持構造に関するものである。
【0002】
【従来の技術】図4および図5は従来の半導体装置のダ
イパッド部分の斜視図および平面図であり、図6は図5
のB−B線の断面図である。図において、1は半導体素
子、2はダイパッド、3はダイパッドに半導体素子を固
定する接合材である。従来、半導体素子は、Au−Si
共晶合金、Pb−Sn系はんだや樹脂接着剤などの接合
材を用い、接合時に温度を上げてダイパッドに固定して
いる。
イパッド部分の斜視図および平面図であり、図6は図5
のB−B線の断面図である。図において、1は半導体素
子、2はダイパッド、3はダイパッドに半導体素子を固
定する接合材である。従来、半導体素子は、Au−Si
共晶合金、Pb−Sn系はんだや樹脂接着剤などの接合
材を用い、接合時に温度を上げてダイパッドに固定して
いる。
【0003】従来行われているPb−Sn系はんだを接
合材として用いる場合、予熱されたリードフレームのダ
イパッド2上に、所定寸法にカットされたはんだを置き
、その後、ダイパッド2をはんだの融点以上まで加熱し
、はんだを溶融状態としてから半導体素子1を押えつけ
、その後、冷却することにより、はんだを凝固させ、半
導体素子1をダイパッド2上に固定していた。その後、
半導体素子1の電極取出口と内部リードの先端部とを熱
圧着方式、超音波方式等のワイヤボンディング方法で金
属細線により接続し、モールド工程、リードカット工程
、リードベンド工程、電気特性検査工程等を経て半導体
装置が完成する。
合材として用いる場合、予熱されたリードフレームのダ
イパッド2上に、所定寸法にカットされたはんだを置き
、その後、ダイパッド2をはんだの融点以上まで加熱し
、はんだを溶融状態としてから半導体素子1を押えつけ
、その後、冷却することにより、はんだを凝固させ、半
導体素子1をダイパッド2上に固定していた。その後、
半導体素子1の電極取出口と内部リードの先端部とを熱
圧着方式、超音波方式等のワイヤボンディング方法で金
属細線により接続し、モールド工程、リードカット工程
、リードベンド工程、電気特性検査工程等を経て半導体
装置が完成する。
【0004】
【発明が解決しようとする課題】従来の半導体装置は以
上のような構造であるので、加熱され、その後室温まで
冷却された半導体素子1には、半導体素子1とダイパッ
ド2の熱膨張の差による熱応力がかかり、半導体素子1
にダメージを与える可能性があるという問題点があった
。
上のような構造であるので、加熱され、その後室温まで
冷却された半導体素子1には、半導体素子1とダイパッ
ド2の熱膨張の差による熱応力がかかり、半導体素子1
にダメージを与える可能性があるという問題点があった
。
【0005】この発明は上記のような問題点を解決する
ためになされたもので、組立時の熱応力によるダメージ
を皆無にすることができる半導体装置を得ることを目的
とする。
ためになされたもので、組立時の熱応力によるダメージ
を皆無にすることができる半導体装置を得ることを目的
とする。
【0006】
【課題を解決するための手段】この発明に係る半導体装
置は、半導体素子と支持体との互いに対向する一方の主
面に凸部を設けるとともに、他方の主面に上記凸部に嵌
合する凹部を設けたものである。
置は、半導体素子と支持体との互いに対向する一方の主
面に凸部を設けるとともに、他方の主面に上記凸部に嵌
合する凹部を設けたものである。
【0007】
【作用】この発明における半導体装置は、半導体素子と
支持体とが凹凸部で互いに嵌合する構造としたため、半
導体素子と支持体を加熱することがなく、半導体素子に
熱応力がかかり、ダメージを与えることがなくなる。
支持体とが凹凸部で互いに嵌合する構造としたため、半
導体素子と支持体を加熱することがなく、半導体素子に
熱応力がかかり、ダメージを与えることがなくなる。
【0008】
実施例1.図1および図2はこの発明の一実施例による
ダイパッド2上に半導体素子1が固定された状態を示す
斜視図と平面図であり、図3は図2のA−A線の断面図
である。図において、1は半導体素子、1aは半導体素
子1の裏面に十文字に設けられた凹部、2はダイパッド
、2aは上記凹部1aに嵌合する様にダイパッド2の表
面に十文字に設けられた凸部である。なおこのダイパッ
ド2はCu合金が用いられ、0.15mm程度の厚さに
形成されている。ここで半導体素子1の裏面に設けられ
ている凹部1aとダイパッド2上に設けられている凸部
2aを嵌合させることにより、半導体素子1をダイパッ
ド2に熱応力をかけずに固定することができる。その後
、半導体素子1の電極取出口と内部リードの先端とを熱
圧着方式、超音波方式等のワイヤボンディング法で金属
細線により結線する。この際、温度を上昇させるが、温
度を上昇させることにより、ダイパッド2表面に設けら
れた凸部2aは熱膨張し、半導体素子1をさらにしっか
りとダイパッド2に固定することができる。次にモール
ド工程、リードカット工程、リードベンド工程、電気特
性検査工程等を経て、半導体装置が完成する。
ダイパッド2上に半導体素子1が固定された状態を示す
斜視図と平面図であり、図3は図2のA−A線の断面図
である。図において、1は半導体素子、1aは半導体素
子1の裏面に十文字に設けられた凹部、2はダイパッド
、2aは上記凹部1aに嵌合する様にダイパッド2の表
面に十文字に設けられた凸部である。なおこのダイパッ
ド2はCu合金が用いられ、0.15mm程度の厚さに
形成されている。ここで半導体素子1の裏面に設けられ
ている凹部1aとダイパッド2上に設けられている凸部
2aを嵌合させることにより、半導体素子1をダイパッ
ド2に熱応力をかけずに固定することができる。その後
、半導体素子1の電極取出口と内部リードの先端とを熱
圧着方式、超音波方式等のワイヤボンディング法で金属
細線により結線する。この際、温度を上昇させるが、温
度を上昇させることにより、ダイパッド2表面に設けら
れた凸部2aは熱膨張し、半導体素子1をさらにしっか
りとダイパッド2に固定することができる。次にモール
ド工程、リードカット工程、リードベンド工程、電気特
性検査工程等を経て、半導体装置が完成する。
【0009】実施例2.また上記実施例では、ダイパッ
ド2にCu合金を用いたが、Fe−Ni系合金、リン青
銅等で形成しても同様の効果を奏する。
ド2にCu合金を用いたが、Fe−Ni系合金、リン青
銅等で形成しても同様の効果を奏する。
【0010】実施例3.また上記実施例では、ダイパッ
ド2と半導体素子1間には何も挿入しない例を示したが
、ダイパッド2と半導体素子1にこれらを互いに接合し
ない導電性のあるシートや熱伝導の優れているシートを
挿入することにより、ダイパッド2と半導体素子1間の
電気的導通や熱的抵抗を改善することができる。
ド2と半導体素子1間には何も挿入しない例を示したが
、ダイパッド2と半導体素子1にこれらを互いに接合し
ない導電性のあるシートや熱伝導の優れているシートを
挿入することにより、ダイパッド2と半導体素子1間の
電気的導通や熱的抵抗を改善することができる。
【0011】実施例4.また上記実施例では、半導体素
子1裏面に十文字に凹部1aを設け、ダイパッド2表面
上にこの凹部1aに嵌合する凸部2aを十文字に設けて
いるが、半導体素子1裏面に複数の凹部1aを設け、そ
れに嵌合する様にダイパッド2表面上に複数の凸部2a
を設けても同様の効果を奏する。
子1裏面に十文字に凹部1aを設け、ダイパッド2表面
上にこの凹部1aに嵌合する凸部2aを十文字に設けて
いるが、半導体素子1裏面に複数の凹部1aを設け、そ
れに嵌合する様にダイパッド2表面上に複数の凸部2a
を設けても同様の効果を奏する。
【0012】
【発明の効果】以上のようにこの発明によれば、半導体
素子と支持体との互いに対向する一方の主面に凸部を設
けるとともに、他方の主面に上記凸部に嵌合する凹部を
設け、それらを嵌合させることで、半導体素子の固定を
行うようにしたので、半導体素子にかかる熱応力を低減
でき、半導体装置の信頼性の向上が図れる効果がある。
素子と支持体との互いに対向する一方の主面に凸部を設
けるとともに、他方の主面に上記凸部に嵌合する凹部を
設け、それらを嵌合させることで、半導体素子の固定を
行うようにしたので、半導体素子にかかる熱応力を低減
でき、半導体装置の信頼性の向上が図れる効果がある。
【図1】この発明の一実施例により半導体素子がダイパ
ッド上に固定された状態を示す斜視図である。
ッド上に固定された状態を示す斜視図である。
【図2】図1の平面図である。
【図3】図2のA−A線の断面図である。
【図4】従来の半導体装置の斜視図である。
【図5】図4の平面図である。
【図6】図4のB−B線の断面図である。
1 半導体素子
1a 凹部
2 ダイパッド
2a 凸部
3 接合材
Claims (1)
- 【請求項1】 半導体素子とこの半導体素子を載置す
る支持体とを備えたものにおいて、上記半導体素子と支
持体との互いに対向する一方の主面に凸部を設けるとと
もに、他方の主面に上記凸部に嵌合する凹部を設けたこ
とを特徴とする半導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3138166A JPH04336437A (ja) | 1991-05-13 | 1991-05-13 | 半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3138166A JPH04336437A (ja) | 1991-05-13 | 1991-05-13 | 半導体装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04336437A true JPH04336437A (ja) | 1992-11-24 |
Family
ID=15215574
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3138166A Pending JPH04336437A (ja) | 1991-05-13 | 1991-05-13 | 半導体装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04336437A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0669650A3 (de) * | 1994-02-22 | 1997-03-19 | Siemens Ag | Gehäuste Halbleiteranordnung und Verfahren zu deren Herstellung. |
-
1991
- 1991-05-13 JP JP3138166A patent/JPH04336437A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0669650A3 (de) * | 1994-02-22 | 1997-03-19 | Siemens Ag | Gehäuste Halbleiteranordnung und Verfahren zu deren Herstellung. |
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