JPH0434592A - ドットマトリクス表示装置 - Google Patents
ドットマトリクス表示装置Info
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- JPH0434592A JPH0434592A JP14221890A JP14221890A JPH0434592A JP H0434592 A JPH0434592 A JP H0434592A JP 14221890 A JP14221890 A JP 14221890A JP 14221890 A JP14221890 A JP 14221890A JP H0434592 A JPH0434592 A JP H0434592A
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- drive circuit
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- 239000011159 matrix material Substances 0.000 title claims abstract description 22
- 238000010586 diagram Methods 0.000 description 4
- 102100040844 Dual specificity protein kinase CLK2 Human genes 0.000 description 2
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- 102100040858 Dual specificity protein kinase CLK4 Human genes 0.000 description 2
- 101000749291 Homo sapiens Dual specificity protein kinase CLK2 Proteins 0.000 description 2
- 101000749304 Homo sapiens Dual specificity protein kinase CLK3 Proteins 0.000 description 2
- 101000749298 Homo sapiens Dual specificity protein kinase CLK4 Proteins 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 239000004973 liquid crystal related substance Substances 0.000 description 2
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- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明はドツトマトリクス表示装置に関し、特にたと
えば液晶デイスプレィのようなドツトマトリクス表示パ
ネルを用いた、ドツトマトリクス表示装置に関する。
えば液晶デイスプレィのようなドツトマトリクス表示パ
ネルを用いた、ドツトマトリクス表示装置に関する。
この種の画像表示装置の一例が、昭和５８年３月３１日
付で公開された特開昭５８−５４３９１号ＣＧ０９Ｇ
３／３６）に開示されかつ、第３図に示される。
付で公開された特開昭５８−５４３９１号ＣＧ０９Ｇ
３／３６）に開示されかつ、第３図に示される。
第３図に示す従来のドツトマトリクス表示装置１は液晶
マトリクス表示パネル（以下、単に「表示パネル」とい
う）２を含み、この表示パネル２に、行駆動回路３から
行駆動信号が与えられ、奇数列駆動回路４および偶数列
駆動回路５から列駆動信号が印加される。奇数列駆動回
路４および偶数列駆動回路５は、それぞれ、周知のよう
にシフトレジスタおよびサンプルホールド回路を含む。
マトリクス表示パネル（以下、単に「表示パネル」とい
う）２を含み、この表示パネル２に、行駆動回路３から
行駆動信号が与えられ、奇数列駆動回路４および偶数列
駆動回路５から列駆動信号が印加される。奇数列駆動回
路４および偶数列駆動回路５は、それぞれ、周知のよう
にシフトレジスタおよびサンプルホールド回路を含む。
そして、第４図に示すように１８０°の位相差を有する
クロックパルスＣＬＫａおよびＣＬＫｂとシフトレジス
タスタートパルスＳＳＰとに応答して奇数列サンプリン
グパルス５ＲＡＩ、５ＲＡ２．５ＲＡ３．・・・および
偶数列サンプルパルス５ＲＢｌ、５ＲＢ２，５ＲＢ３．
・・・が出力され、そのサンプルパルスに応答して画像
信号ＤＡＴＡがすンブルホールドされ、表示パネル２に
出力されるＣ発明が解決しようとする課題〕 第３図に示す従来技術においては、列方向のドツト数が
比較的少ない場合は、サンプルパルスを発生するために
奇数列駆動回路４および偶数列駆動回路５に供給される
クロックＣＬＫａおよびＣＬＫｂの周波数は低く、した
がってデータをサンプルホールドするに十分なサンプル
パルス幅が得られる。しかしながら、たとえばハイビジ
ョンなどに対応できるような高精細表示パネルにした場
合、ドツト数が増加し、したがってクロック周波数を高
くしなければならず、そのために、サンプルパルスの幅
が非常に小さくなり、結果的に画像信号のサンプルホー
ルドを正確に行えなくなってしまう。そのため、各列の
駆動時間が短くなり、表示された画像品質が悪くなる。
クロックパルスＣＬＫａおよびＣＬＫｂとシフトレジス
タスタートパルスＳＳＰとに応答して奇数列サンプリン
グパルス５ＲＡＩ、５ＲＡ２．５ＲＡ３．・・・および
偶数列サンプルパルス５ＲＢｌ、５ＲＢ２，５ＲＢ３．
・・・が出力され、そのサンプルパルスに応答して画像
信号ＤＡＴＡがすンブルホールドされ、表示パネル２に
出力されるＣ発明が解決しようとする課題〕 第３図に示す従来技術においては、列方向のドツト数が
比較的少ない場合は、サンプルパルスを発生するために
奇数列駆動回路４および偶数列駆動回路５に供給される
クロックＣＬＫａおよびＣＬＫｂの周波数は低く、した
がってデータをサンプルホールドするに十分なサンプル
パルス幅が得られる。しかしながら、たとえばハイビジ
ョンなどに対応できるような高精細表示パネルにした場
合、ドツト数が増加し、したがってクロック周波数を高
くしなければならず、そのために、サンプルパルスの幅
が非常に小さくなり、結果的に画像信号のサンプルホー
ルドを正確に行えなくなってしまう。そのため、各列の
駆動時間が短くなり、表示された画像品質が悪くなる。
それゆえに、この発明の主たる目的は、高精細表示パネ
ルにおいても十分な駆動時間を確保することができる、
ドツトマトリクス表示装置を提供することである。
ルにおいても十分な駆動時間を確保することができる、
ドツトマトリクス表示装置を提供することである。
〔課題を解決するための手段〕
この発明は、簡単にいえば、表示ドツトが行列配置され
たドツトマトリクス表示パネル、ドツトマトリクス表示
パネルの各行に信号を供給する行駆動回路、ドツトマト
リクス表示パネルの各奇数列に交互に信号を供給する複
数の奇数列駆動回路、およびドツトマトリクス表示パネ
ルの各偶数列に交互に信号を供給する複数の偶数列駆動
回路を備える、ドツトマトリクス表示装置である。
たドツトマトリクス表示パネル、ドツトマトリクス表示
パネルの各行に信号を供給する行駆動回路、ドツトマト
リクス表示パネルの各奇数列に交互に信号を供給する複
数の奇数列駆動回路、およびドツトマトリクス表示パネ
ルの各偶数列に交互に信号を供給する複数の偶数列駆動
回路を備える、ドツトマトリクス表示装置である。
行駆動回路はたとえばシフトレジスタを含み、そのシフ
トレジスタの出力が表示パネルの行駆動信号として与え
られる。奇数列駆動回路および偶数列駆動回路がそれぞ
れ２以上に分割され、各奇数列駆動回路および各偶数列
駆動回路はシフトレジスタおよびサンプルホールド回路
を含む。そして、各奇数列駆動回路および各偶数列駆動
回路で互いに異なる位相のクロックパルスに基づいてサ
ンプルパルスを発生する。各奇数列駆動回路は画像信号
を交互にサンプルホールドし、各奇数列に交互に駆動信
号を出力する。同じように、各偶数列駆動回路は画像信
号を交互にサンプルホールドし、各偶数列に交互に出力
する。
トレジスタの出力が表示パネルの行駆動信号として与え
られる。奇数列駆動回路および偶数列駆動回路がそれぞ
れ２以上に分割され、各奇数列駆動回路および各偶数列
駆動回路はシフトレジスタおよびサンプルホールド回路
を含む。そして、各奇数列駆動回路および各偶数列駆動
回路で互いに異なる位相のクロックパルスに基づいてサ
ンプルパルスを発生する。各奇数列駆動回路は画像信号
を交互にサンプルホールドし、各奇数列に交互に駆動信
号を出力する。同じように、各偶数列駆動回路は画像信
号を交互にサンプルホールドし、各偶数列に交互に出力
する。
この発明によれば、奇数列駆動回路および偶数列駆動回
路をそれぞれ複数に分割したので、列方向のドツト数が
非常に多い高精細表示パネルであっても、十分なサンプ
ルパルス幅を確保することができ、したがって動作速度
の遅い駆動回路であっても十分に対応でき、品質の画像
が表示され得る。
路をそれぞれ複数に分割したので、列方向のドツト数が
非常に多い高精細表示パネルであっても、十分なサンプ
ルパルス幅を確保することができ、したがって動作速度
の遅い駆動回路であっても十分に対応でき、品質の画像
が表示され得る。
この発明の上述の目的、その他の目的、特徴および利点
は、図面を参照して行う以下の実施例の詳細な説明から
一層明らかとなろう。
は、図面を参照して行う以下の実施例の詳細な説明から
一層明らかとなろう。
第１図を参照して、この実施例のドツトマトリクス表示
装置１０は表示パネル１２を含み、この表示パネル１２
は第３図に示す従来のものに比べて列方向のドツト数が
増加された高精細ドツトマトリクス表示パネルとして構
成される。そして、表示パネル１２には、シフトレジス
タを含む行駆動回路１４から行駆動信号が供給される。
装置１０は表示パネル１２を含み、この表示パネル１２
は第３図に示す従来のものに比べて列方向のドツト数が
増加された高精細ドツトマトリクス表示パネルとして構
成される。そして、表示パネル１２には、シフトレジス
タを含む行駆動回路１４から行駆動信号が供給される。
なお、行駆動回路１４には、垂直スタートパルス■ＳＰ
および水平スタートパルスＨ３Ｐが与えられる。
および水平スタートパルスＨ３Ｐが与えられる。
この実施例では、第１．第２および第３奇数列駆動回路
１６ａ、１６ｂおよび１６ｃが表示パネル１２の奇数列
を受は持ち、第１．第２および第３偶数列駆動回路１８
ａ、１８ｂおよび１８ｃが表示パネル１２の偶数列を受
は持つ。画像信号ＤＡＴＡ、 シフトレジスタスター
トパルスＳＳＰおよび水平スタートパルスＨ３Ｐが第１
．第２および第３奇数列駆動回路１６ａ、１６ｂおよび
１６Ｃならびに第１．第２および第３偶数列駆動回路１
８ａ、１８ｂおよび１８ｃに共通的に与えられる。そし
て、第２図に示すように互いに１２０’の位相差を有す
るクロックパルスＣＬＫＩ、ＣＬＫ２およびＣＬＫ３が
、それぞれ、第１奇数列駆動回路１６ａ、第２奇数列駆
動回路１６ｂおよび第３奇数列駆動回路１６ｃに与えら
れ、同様に互いに１２０ｍの位相差を有するクロックパ
ルスＣＬＫ４．ＣＬＫ５およびＣＬＫ６が、それぞれ、
第１偶数列駆動回路１８ａ、第２偶数列駆動回路１８ｂ
および第３偶数列駆動回路１８ｃに与えられる。
１６ａ、１６ｂおよび１６ｃが表示パネル１２の奇数列
を受は持ち、第１．第２および第３偶数列駆動回路１８
ａ、１８ｂおよび１８ｃが表示パネル１２の偶数列を受
は持つ。画像信号ＤＡＴＡ、 シフトレジスタスター
トパルスＳＳＰおよび水平スタートパルスＨ３Ｐが第１
．第２および第３奇数列駆動回路１６ａ、１６ｂおよび
１６Ｃならびに第１．第２および第３偶数列駆動回路１
８ａ、１８ｂおよび１８ｃに共通的に与えられる。そし
て、第２図に示すように互いに１２０’の位相差を有す
るクロックパルスＣＬＫＩ、ＣＬＫ２およびＣＬＫ３が
、それぞれ、第１奇数列駆動回路１６ａ、第２奇数列駆
動回路１６ｂおよび第３奇数列駆動回路１６ｃに与えら
れ、同様に互いに１２０ｍの位相差を有するクロックパ
ルスＣＬＫ４．ＣＬＫ５およびＣＬＫ６が、それぞれ、
第１偶数列駆動回路１８ａ、第２偶数列駆動回路１８ｂ
および第３偶数列駆動回路１８ｃに与えられる。
各列駆動回路１６ａ〜１６ｃおよび１８ａ〜１８ｃは、
それぞれ、図示しないが、シフトレジスタとサンプルホ
ールド回路とを含み、シフトレジスタはクロックパルス
ＣＬＫＩ〜ＣＬＫ６およびシフトレジスタスタートパル
スＳＳＰによって、第２図に示すような、各奇数列のサ
ンプルパルス５ＲＡＩ、５ＲＡ２，５ＲＡ３．・・・お
よび各偶数列のサンプルパルス５ＲＢ１．５ＲＢ２，５
ＲＢ３、・・・を出力する。サンプルホールド回路は、
映像信号ＤＡＴＡをそのサンプルパルスに応答してサン
プリングするとともに、１水平走査期間それをホールド
する。
それぞれ、図示しないが、シフトレジスタとサンプルホ
ールド回路とを含み、シフトレジスタはクロックパルス
ＣＬＫＩ〜ＣＬＫ６およびシフトレジスタスタートパル
スＳＳＰによって、第２図に示すような、各奇数列のサ
ンプルパルス５ＲＡＩ、５ＲＡ２，５ＲＡ３．・・・お
よび各偶数列のサンプルパルス５ＲＢ１．５ＲＢ２，５
ＲＢ３、・・・を出力する。サンプルホールド回路は、
映像信号ＤＡＴＡをそのサンプルパルスに応答してサン
プリングするとともに、１水平走査期間それをホールド
する。
第１．第２および第３奇数列駆動回路１６ａ。
１６ｂおよび１６ｃは、奇数列の駆動信号を表示パネル
１２の上部から交互に供給し、第１．第２および第３偶
数列駆動回路１８ａ、１８ｂおよび１８ｃは、表示パネ
ル１２の下部から偶数列の駆動信号を交互に供給する。
１２の上部から交互に供給し、第１．第２および第３偶
数列駆動回路１８ａ、１８ｂおよび１８ｃは、表示パネ
ル１２の下部から偶数列の駆動信号を交互に供給する。
たとえば、第１奇数列駆動回路１６ａは第１．第７．第
１３．第１９゜・・・番目の列駆動信号を供給し、第２
奇数列駆動回路１６ｂは第３．第９．第１５．第２１．
・・・番目の列駆動信号を供給し、そして第３奇数列駆
動回路１６ｃは第５．第１１．第１７．第２３．・・・
番目の列駆動信号を供給する。同じように、第１偶数列
駆動回路１８ａは第２．第８．第１４．第２０、・・・
番目の列駆動信号を供給し、第２偶数列駆動回路１８ｂ
は第４．第１０．第１６．第２２゜・・・番目の列駆動
信号を供給し、そして第３偶数列駆動回路１８ｃは第６
．第１２．第１８．第２４・・・番目の列駆動信号を供
給する。
１３．第１９゜・・・番目の列駆動信号を供給し、第２
奇数列駆動回路１６ｂは第３．第９．第１５．第２１．
・・・番目の列駆動信号を供給し、そして第３奇数列駆
動回路１６ｃは第５．第１１．第１７．第２３．・・・
番目の列駆動信号を供給する。同じように、第１偶数列
駆動回路１８ａは第２．第８．第１４．第２０、・・・
番目の列駆動信号を供給し、第２偶数列駆動回路１８ｂ
は第４．第１０．第１６．第２２゜・・・番目の列駆動
信号を供給し、そして第３偶数列駆動回路１８ｃは第６
．第１２．第１８．第２４・・・番目の列駆動信号を供
給する。
前述のように、第１．第２および第３奇数列駆動回路１
６ａ、１６ｂおよび１６ｃに与えられるクロックパルス
ＣＬＫＩ、ＣＬＫ２およびＣＬＫ３は１２０°ずつ位相
のずれたパルスであり、第１、第２および第３偶数列駆
動回路１８ａ、１８ｂおよび１８ｃに与えられるクロッ
クパルスＣＬＫ４ ＣＬＫ５およびＣＬＫ６は１２０
°ずつ位相のずれたパルスである。そして、クロックパ
ルスＣＬＫ１とＣＬＫ４とは、６０°位相がずれた関係
にある。したがって、水平方向のドツト数が非常に多く
なった場合でも、１ドツトに対応するサンプルパルス幅
を十分広くすることができ、したがって動作速度の遅い
駆動回路を用いても高精細表示パネルに十分な駆動信号
を与えることができる。
６ａ、１６ｂおよび１６ｃに与えられるクロックパルス
ＣＬＫＩ、ＣＬＫ２およびＣＬＫ３は１２０°ずつ位相
のずれたパルスであり、第１、第２および第３偶数列駆
動回路１８ａ、１８ｂおよび１８ｃに与えられるクロッ
クパルスＣＬＫ４ ＣＬＫ５およびＣＬＫ６は１２０
°ずつ位相のずれたパルスである。そして、クロックパ
ルスＣＬＫ１とＣＬＫ４とは、６０°位相がずれた関係
にある。したがって、水平方向のドツト数が非常に多く
なった場合でも、１ドツトに対応するサンプルパルス幅
を十分広くすることができ、したがって動作速度の遅い
駆動回路を用いても高精細表示パネルに十分な駆動信号
を与えることができる。
なお、上述の実施例では表示パネルとして液晶ドツトマ
トリクス表示パネルを用いたが、この発明は、他にプラ
ズマ表示パネルなど、任意のドツトマトリクス表示パネ
ルに適用できることはいうまでもない。
トリクス表示パネルを用いたが、この発明は、他にプラ
ズマ表示パネルなど、任意のドツトマトリクス表示パネ
ルに適用できることはいうまでもない。
また、奇数列駆動回路および偶数列駆動回路の数は実施
例の各３つに限らず、２以上任意でよい
例の各３つに限らず、２以上任意でよい
第１図はこの発明の一実施例を示す回路図である。
第２図は第１図実施例の動作を示すタイミング図である
。 第３図は従来技術を示すブロック図である。 第４図は第３図従来技術の動作を示すタイミング図であ
る。 図において、１０はドツトマトリクス表示装置１２は表
示パネル、１４は行駆動回路、１６ａ、１６ｂおよび１
６ｃは第１．第２および第３奇数列駆動回路、１８ａ、
１８ｂおよび１８ｃは第１、第２および第３偶数列駆動
回路を示す。 特許出願人 三洋電機株式会社 代理人 弁理士 山 １）義 人 第 図 第 図 ＲＡ４ ＲＢ４ 第 図 ＦＩＡ３ ＲＢ３
。 第３図は従来技術を示すブロック図である。 第４図は第３図従来技術の動作を示すタイミング図であ
る。 図において、１０はドツトマトリクス表示装置１２は表
示パネル、１４は行駆動回路、１６ａ、１６ｂおよび１
６ｃは第１．第２および第３奇数列駆動回路、１８ａ、
１８ｂおよび１８ｃは第１、第２および第３偶数列駆動
回路を示す。 特許出願人 三洋電機株式会社 代理人 弁理士 山 １）義 人 第 図 第 図 ＲＡ４ ＲＢ４ 第 図 ＦＩＡ３ ＲＢ３
Claims (1)
- 【特許請求の範囲】 表示ドットが行列配置されたドットマトリクス表示パネ
ル、 前記ドットマトリクス表示パネルの各行に信号を供給す
る行駆動回路、 前記ドットマトリクス表示パネルの各奇数列に交互に信
号を供給する複数の奇数列駆動回路、および 前記ドットマトリクス表示パネルの各偶数列に交互に信
号を供給する複数の偶数列駆動回路を備える、ドットマ
トリクス表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2142218A JP2640014B2 (ja) | 1990-05-31 | 1990-05-31 | ドットマトリクス表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2142218A JP2640014B2 (ja) | 1990-05-31 | 1990-05-31 | ドットマトリクス表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0434592A true JPH0434592A (ja) | 1992-02-05 |
| JP2640014B2 JP2640014B2 (ja) | 1997-08-13 |
Family
ID=15310158
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2142218A Expired - Lifetime JP2640014B2 (ja) | 1990-05-31 | 1990-05-31 | ドットマトリクス表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2640014B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0766464A3 (en) * | 1995-09-07 | 1999-03-17 | Sony Corporation | Video signal processing apparatus for a liquid crystal panel |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58207071A (ja) * | 1982-05-27 | 1983-12-02 | 株式会社東芝 | 液晶表示装置 |
| JPH02170784A (ja) * | 1988-12-23 | 1990-07-02 | Sharp Corp | 液晶パネルを駆動するためのラインメモリ回路 |
-
1990
- 1990-05-31 JP JP2142218A patent/JP2640014B2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58207071A (ja) * | 1982-05-27 | 1983-12-02 | 株式会社東芝 | 液晶表示装置 |
| JPH02170784A (ja) * | 1988-12-23 | 1990-07-02 | Sharp Corp | 液晶パネルを駆動するためのラインメモリ回路 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0766464A3 (en) * | 1995-09-07 | 1999-03-17 | Sony Corporation | Video signal processing apparatus for a liquid crystal panel |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2640014B2 (ja) | 1997-08-13 |
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