JPH04373280A - 自動輝度制限回路 - Google Patents
自動輝度制限回路Info
- Publication number
- JPH04373280A JPH04373280A JP17755391A JP17755391A JPH04373280A JP H04373280 A JPH04373280 A JP H04373280A JP 17755391 A JP17755391 A JP 17755391A JP 17755391 A JP17755391 A JP 17755391A JP H04373280 A JPH04373280 A JP H04373280A
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- JP
- Japan
- Prior art keywords
- voltage
- circuit
- abl
- anode current
- resistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、カラーテレビ受信機等
におけるブラウン管アノード電流を制限する自動輝度制
限（以下、ＡＢＬと称す）回路において、ＡＢＬ制御感
度を従来の回路に比し改善するとともに該制御感度の設
計段階における定数設定を容易にした自動輝度制限回路
に関する。
におけるブラウン管アノード電流を制限する自動輝度制
限（以下、ＡＢＬと称す）回路において、ＡＢＬ制御感
度を従来の回路に比し改善するとともに該制御感度の設
計段階における定数設定を容易にした自動輝度制限回路
に関する。
【０００２】
【従来の技術】図２は従来のＡＢＬ回路、および関連回
路の一実施例を示す要部回路図である。図において、１
は水平出力回路、２は高圧を発生するフライバックトラ
ンス、３は映像信号入力ライン、４は輝度回路およびコ
ントラスト回路を含む映像信号を処理する映像信号処理
回路、５はブラウン管６（以下、ＣＲＴと称す）を駆動
する映像出力回路、７は第１の直流安定化電源（Ｅ１）
、８は第２の直流安定化電源ライン（Ｅ２）、９は第３
の直流安定化電源（Ｅ３）、１０はＣＲＴアノード電流
検出端子、１１は輝度制御電圧ライン、１２はコントラ
スト制御電圧ライン、ＴＲ１１はＡＢＬ用トランジスタ
、ＴＲ１２は自動コントラスト制限（以下、ＡＣＬと称
す）用トランジスタ、Ｒ１１乃至Ｒ１９は抵抗、Ｃ１１
乃至Ｃ１２はコンデンサ、Ｘ１１は高圧整流用ダイオー
ド、Ｘ１２はＡＢＬ用ダイオード、ＶＲ１１は輝度ボリ
ューム、ＶＲ１２はコントラストボリュームである。Ｃ
ＲＴアノード電流のルートはＡＢＬが非動作時と動作時
とで異なり、前者の場合は図示のＩａとＩ１のルートで
あり、後者の場合はＩａとＩ２のルートになる。 アノード電流は映像信号に応じて瞬時的変化をしている
が、アノード電流検出端子１０には１フィールド期間に
おける該瞬時的変化の平均電流に相当する電圧が発生し
ている。この電圧をＶ１とする。該Ｖ１は抵抗Ｒ１１と
Ｒ１２とで分圧されＴＲ１１のベース電圧として印加さ
れる。ＴＲ１１のエミッタ電圧は抵抗Ｒ１３を介して輝
度ボリュームの電圧に重畳される。この電圧をＶ２（輝
度制御電圧）とする。該Ｖ２により映像信号処理回路に
おける輝度回路を制御して輝度制限をなすのがＡＢＬ回
路の作用である。いま、平均アノード電流がある一定値
以上に増加したとすると、図示の電流の向きから電圧Ｖ
１は下がる。従って、ＴＲ１１のベース電圧およびエミ
ッタ電圧も下がり、Ｖ２が下がる。 輝度回路はかかるＶ２の減少に基づき平均輝度を下げる
ように作用し、アノード電流の増加に対しある一定値以
下に制限する。ＡＢＬ回路とＡＣＬ回路とはともに一定
条件下でアノード電流を制限して画質劣化を防止する目
的を有するが、両者の作用は互いに無関係ではなく双方
が連携して作用（所謂ＡＢＬ作用とＡＣＬ作用との比）
することにより高画質を再現することが可能となるもの
である。該連携作用を十分なものとするため、それぞれ
の回路の動作設定に際しては他の回路の動作に極力影響
を与えないことが理想的である。
路の一実施例を示す要部回路図である。図において、１
は水平出力回路、２は高圧を発生するフライバックトラ
ンス、３は映像信号入力ライン、４は輝度回路およびコ
ントラスト回路を含む映像信号を処理する映像信号処理
回路、５はブラウン管６（以下、ＣＲＴと称す）を駆動
する映像出力回路、７は第１の直流安定化電源（Ｅ１）
、８は第２の直流安定化電源ライン（Ｅ２）、９は第３
の直流安定化電源（Ｅ３）、１０はＣＲＴアノード電流
検出端子、１１は輝度制御電圧ライン、１２はコントラ
スト制御電圧ライン、ＴＲ１１はＡＢＬ用トランジスタ
、ＴＲ１２は自動コントラスト制限（以下、ＡＣＬと称
す）用トランジスタ、Ｒ１１乃至Ｒ１９は抵抗、Ｃ１１
乃至Ｃ１２はコンデンサ、Ｘ１１は高圧整流用ダイオー
ド、Ｘ１２はＡＢＬ用ダイオード、ＶＲ１１は輝度ボリ
ューム、ＶＲ１２はコントラストボリュームである。Ｃ
ＲＴアノード電流のルートはＡＢＬが非動作時と動作時
とで異なり、前者の場合は図示のＩａとＩ１のルートで
あり、後者の場合はＩａとＩ２のルートになる。 アノード電流は映像信号に応じて瞬時的変化をしている
が、アノード電流検出端子１０には１フィールド期間に
おける該瞬時的変化の平均電流に相当する電圧が発生し
ている。この電圧をＶ１とする。該Ｖ１は抵抗Ｒ１１と
Ｒ１２とで分圧されＴＲ１１のベース電圧として印加さ
れる。ＴＲ１１のエミッタ電圧は抵抗Ｒ１３を介して輝
度ボリュームの電圧に重畳される。この電圧をＶ２（輝
度制御電圧）とする。該Ｖ２により映像信号処理回路に
おける輝度回路を制御して輝度制限をなすのがＡＢＬ回
路の作用である。いま、平均アノード電流がある一定値
以上に増加したとすると、図示の電流の向きから電圧Ｖ
１は下がる。従って、ＴＲ１１のベース電圧およびエミ
ッタ電圧も下がり、Ｖ２が下がる。 輝度回路はかかるＶ２の減少に基づき平均輝度を下げる
ように作用し、アノード電流の増加に対しある一定値以
下に制限する。ＡＢＬ回路とＡＣＬ回路とはともに一定
条件下でアノード電流を制限して画質劣化を防止する目
的を有するが、両者の作用は互いに無関係ではなく双方
が連携して作用（所謂ＡＢＬ作用とＡＣＬ作用との比）
することにより高画質を再現することが可能となるもの
である。該連携作用を十分なものとするため、それぞれ
の回路の動作設定に際しては他の回路の動作に極力影響
を与えないことが理想的である。
【０００３】
【発明が解決しようとする課題】図２における前記Ｖ１
の変化に対するＶ２の変化の比、所謂制御感度は抵抗Ｒ
１１とＲ１２とにより減縮される。この理由は該Ｖ１の
変化が抵抗Ｒ１１とＲ１２とにより分圧されるためであ
る。また、回路の構成上該Ｖ２はＴＲ１１ベース電圧に
ＴＲ１１のベースとエミッタ間の電圧（約０．７Ｖ）を
加えた以上の電圧であることが必要になるという条件が
あり、設計段階での定数設定が困難な場合が生じ得る。 そして、これらの結果としてＡＢＬ回路とＡＣＬ回路と
の前記連携作用にも影響を与えていた。図２に示すＡＢ
Ｌ回路は以上のような欠点を有する。本発明は、かかる
欠点を改善すべく、ＡＢＬ回路の制御感度を抵抗の比率
をもって十分且つ自由度の広い定数設定を可能とする自
動輝度制限回路を提供することを目的とする。
の変化に対するＶ２の変化の比、所謂制御感度は抵抗Ｒ
１１とＲ１２とにより減縮される。この理由は該Ｖ１の
変化が抵抗Ｒ１１とＲ１２とにより分圧されるためであ
る。また、回路の構成上該Ｖ２はＴＲ１１ベース電圧に
ＴＲ１１のベースとエミッタ間の電圧（約０．７Ｖ）を
加えた以上の電圧であることが必要になるという条件が
あり、設計段階での定数設定が困難な場合が生じ得る。 そして、これらの結果としてＡＢＬ回路とＡＣＬ回路と
の前記連携作用にも影響を与えていた。図２に示すＡＢ
Ｌ回路は以上のような欠点を有する。本発明は、かかる
欠点を改善すべく、ＡＢＬ回路の制御感度を抵抗の比率
をもって十分且つ自由度の広い定数設定を可能とする自
動輝度制限回路を提供することを目的とする。
【０００４】
【課題を解決するための手段】本発明は、自動輝度制限
回路と自動コントラスト制限回路との双方によりブラウ
ン管アノード電流を制限するようにしたこれら回路のう
ちの自動輝度制限回路において、プラス入力端子をアノ
ード電流検出端子に接続し、マイナス入力端子と出力端
子とを接続した演算増幅器と、一端を第１の電源に接続
した第１の抵抗と、一端を該第１の抵抗の他端に接続し
、他端を該演算増幅器の出力端子に接続した第２の抵抗
と、ベースに該第１の抵抗と該第２の抵抗との接続点の
電圧を供給し、エミッタより輝度制御電圧として取り出
すようにしたエミッタフォロワ回路とで構成した自動輝
度制限回路を提供するものである。
回路と自動コントラスト制限回路との双方によりブラウ
ン管アノード電流を制限するようにしたこれら回路のう
ちの自動輝度制限回路において、プラス入力端子をアノ
ード電流検出端子に接続し、マイナス入力端子と出力端
子とを接続した演算増幅器と、一端を第１の電源に接続
した第１の抵抗と、一端を該第１の抵抗の他端に接続し
、他端を該演算増幅器の出力端子に接続した第２の抵抗
と、ベースに該第１の抵抗と該第２の抵抗との接続点の
電圧を供給し、エミッタより輝度制御電圧として取り出
すようにしたエミッタフォロワ回路とで構成した自動輝
度制限回路を提供するものである。
【０００５】
【作用】アノード電流検出端子の検出電圧を入力電圧と
し、且つ出力端から入力端へ抵抗値零の帰還をかけた演
算増幅器と、該演算増幅器の後段にエミッタフォロワ回
路とを設ける。これにより、ＡＢＬ回路としての制御感
度を向上し、輝度中心を変動させることなく回路定数の
設定を容易にする。
し、且つ出力端から入力端へ抵抗値零の帰還をかけた演
算増幅器と、該演算増幅器の後段にエミッタフォロワ回
路とを設ける。これにより、ＡＢＬ回路としての制御感
度を向上し、輝度中心を変動させることなく回路定数の
設定を容易にする。
【０００６】
【実施例】以下、図面に基づいて本発明による自動輝度
制限回路を説明する。図１は本発明による自動輝度制限
回路および関連回路の一実施例の要部回路図である。図
において、図２と同等のものは同一符号を付し、１３は
演算増幅器、ＴＲ１はエミッタフォロワ回路としてのト
ランジスタ、Ｒ１は第１の抵抗、Ｒ２は第２の抵抗、Ｒ
３およびＲ４は抵抗、ＶＲ１は輝度ボリュームである。
制限回路を説明する。図１は本発明による自動輝度制限
回路および関連回路の一実施例の要部回路図である。図
において、図２と同等のものは同一符号を付し、１３は
演算増幅器、ＴＲ１はエミッタフォロワ回路としてのト
ランジスタ、Ｒ１は第１の抵抗、Ｒ２は第２の抵抗、Ｒ
３およびＲ４は抵抗、ＶＲ１は輝度ボリュームである。
【０００７】次に、本回路の制御感度について説明する
。アノード電流検出端子１０の電圧および輝度制御電圧
を図２と同様にそれぞれＶ１およびＶ２とし、ＴＲ１の
ベース電圧をＶ３とし、ＡＢＬ用ダイオードＸ１２のカ
ソードに印加する電圧と抵抗Ｒ１に印加する電圧とは共
通電源から供給し、その電圧をＥ１とする。また、演算
増幅器１３の出力端子とマイナス入力端子とは抵抗値零
で帰還するので増幅度は「１」になり、出力電圧はプラ
ス入力端子の電圧値と同一値Ｖ１になる。以上からＶ３
は次のように表すことができる。 Ｖ３＝（Ｅ１−Ｖ１）×〔Ｒ２／（Ｒ
１＋Ｒ２）〕＋Ｖ１ ＝Ｒ２・Ｅ１
／（Ｒ１＋Ｒ２）＋〔Ｒ１・Ｖ１／（Ｒ１＋Ｒ２）〕
（１）上式右辺の〔Ｒ１・Ｖ１／（Ｒ１＋Ｒ２）〕が
ＡＢＬ制御感度を意味し、Ｒ１とＲ２とにより自由に定
められる。また、ＡＢＬオフ（非動作）時におけるＶ３
の値はＸ１２がオフのため、（Ｖ１＝Ｅ１＋０．７ ）
となる。ここで「０．７ 」とはシリコンダイオードＸ
１２の順方向飽和電圧である。この関係を（１）式に代
入すれば、ＡＢＬオフ時におけるＶ３は次のようになる
。 Ｖ３＝Ｒ２・Ｅ１／（Ｒ１＋Ｒ２）＋
〔Ｒ１（Ｅ１＋０．７ ）／（Ｒ１＋Ｒ２）〕
＝Ｅ１＋０．７ Ｒ１／（Ｒ１＋Ｒ２）
（２）（２）式において、Ｅ１は〔０．７ Ｒ１／（
Ｒ１＋Ｒ２）〕に比し十分大きいので、Ｖ３≒Ｅ１
となり、Ｖ３は演算増幅器１３およびＲ１、Ｒ２の影響
を殆ど受けないことが判る。このことは、制御感度の設
定に際し、Ｒ１、Ｒ２の値を変えてもＶ３は変動するこ
となくほぼ一定値であるので輝度の中心はほとんど変わ
らないということである。つまり、Ｒ１およびＲ２は輝
度中心を変動させることなく制御感度のみ着目して定め
ることができる。図２の場合、Ｒ１１およびＲ１２を変
えると輝度中心もこれに追従して変動するので定数設定
がやりにくいという問題があった。
。アノード電流検出端子１０の電圧および輝度制御電圧
を図２と同様にそれぞれＶ１およびＶ２とし、ＴＲ１の
ベース電圧をＶ３とし、ＡＢＬ用ダイオードＸ１２のカ
ソードに印加する電圧と抵抗Ｒ１に印加する電圧とは共
通電源から供給し、その電圧をＥ１とする。また、演算
増幅器１３の出力端子とマイナス入力端子とは抵抗値零
で帰還するので増幅度は「１」になり、出力電圧はプラ
ス入力端子の電圧値と同一値Ｖ１になる。以上からＶ３
は次のように表すことができる。 Ｖ３＝（Ｅ１−Ｖ１）×〔Ｒ２／（Ｒ
１＋Ｒ２）〕＋Ｖ１ ＝Ｒ２・Ｅ１
／（Ｒ１＋Ｒ２）＋〔Ｒ１・Ｖ１／（Ｒ１＋Ｒ２）〕
（１）上式右辺の〔Ｒ１・Ｖ１／（Ｒ１＋Ｒ２）〕が
ＡＢＬ制御感度を意味し、Ｒ１とＲ２とにより自由に定
められる。また、ＡＢＬオフ（非動作）時におけるＶ３
の値はＸ１２がオフのため、（Ｖ１＝Ｅ１＋０．７ ）
となる。ここで「０．７ 」とはシリコンダイオードＸ
１２の順方向飽和電圧である。この関係を（１）式に代
入すれば、ＡＢＬオフ時におけるＶ３は次のようになる
。 Ｖ３＝Ｒ２・Ｅ１／（Ｒ１＋Ｒ２）＋
〔Ｒ１（Ｅ１＋０．７ ）／（Ｒ１＋Ｒ２）〕
＝Ｅ１＋０．７ Ｒ１／（Ｒ１＋Ｒ２）
（２）（２）式において、Ｅ１は〔０．７ Ｒ１／（
Ｒ１＋Ｒ２）〕に比し十分大きいので、Ｖ３≒Ｅ１
となり、Ｖ３は演算増幅器１３およびＲ１、Ｒ２の影響
を殆ど受けないことが判る。このことは、制御感度の設
定に際し、Ｒ１、Ｒ２の値を変えてもＶ３は変動するこ
となくほぼ一定値であるので輝度の中心はほとんど変わ
らないということである。つまり、Ｒ１およびＲ２は輝
度中心を変動させることなく制御感度のみ着目して定め
ることができる。図２の場合、Ｒ１１およびＲ１２を変
えると輝度中心もこれに追従して変動するので定数設定
がやりにくいという問題があった。
【０００８】
【発明の効果】以上説明したように本発明によれば、Ａ
ＢＬ回路の制御感度を従来のものより向上するとともに
設計段階での定数設定を輝度中心に影響を与えるること
なく自由に決め得るので、ＡＣＬ回路との連携動作を改
善し、画質向上に寄与するところが大きい。
ＢＬ回路の制御感度を従来のものより向上するとともに
設計段階での定数設定を輝度中心に影響を与えるること
なく自由に決め得るので、ＡＣＬ回路との連携動作を改
善し、画質向上に寄与するところが大きい。
【図１】本発明による自動輝度制限回路及び関連回路の
一実施例を示す要部回路図である。
一実施例を示す要部回路図である。
【図２】従来の自動輝度制限回路及び関連回路の一実施
例を示す要部回路図である。
例を示す要部回路図である。
１ 水平出力回路
２ フライバックトランス
３ 映像信号入力ライン
４ 映像信号処理回路
５ 映像出力回路
６ ブラウン管（ＣＲＴ）
７ 第１の直流安定化電源（Ｅ１）
８ 第２の直流安定化電源ライン（Ｅ２）９ 第３
のの直流安定化電源（Ｅ３）１０ ＣＲＴアノード電
流検出端子 １１ 輝度制御電圧ライン １２ コントラスト制御電圧ライン １３ 演算増幅器 ＴＲ１ ＡＢＬ用トランジスタ ＴＲ１１ ＡＢＬ用トランジスタ ＴＲ１２ 自動コントラスト制限用トランジスタＲ１
第１の抵抗 Ｒ２ 第２の抵抗 Ｘ１１ 高圧整流用ダイオード Ｘ１２ ＡＢＬ用ダイオード ＶＲ１ 輝度ボリューム ＶＲ１１ 輝度ボリューム ＶＲ１２ コントラストボリューム
のの直流安定化電源（Ｅ３）１０ ＣＲＴアノード電
流検出端子 １１ 輝度制御電圧ライン １２ コントラスト制御電圧ライン １３ 演算増幅器 ＴＲ１ ＡＢＬ用トランジスタ ＴＲ１１ ＡＢＬ用トランジスタ ＴＲ１２ 自動コントラスト制限用トランジスタＲ１
第１の抵抗 Ｒ２ 第２の抵抗 Ｘ１１ 高圧整流用ダイオード Ｘ１２ ＡＢＬ用ダイオード ＶＲ１ 輝度ボリューム ＶＲ１１ 輝度ボリューム ＶＲ１２ コントラストボリューム
Claims (1)
- 【請求項１】 自動輝度制限回路と自動コントラスト
制限回路との双方によりブラウン管アノード電流を制限
するようにしたこれら回路のうちの自動輝度制限回路に
おいて、プラス入力端子をアノード電流検出端子に接続
し、マイナス入力端子と出力端子とを接続した演算増幅
器と、一端を第１の電源に接続した第１の抵抗と、一端
を該第１の抵抗の他端に接続し、他端を該演算増幅器の
出力端子に接続した第２の抵抗と、ベースに該第１の抵
抗と該第２の抵抗との接続点の電圧を供給し、エミッタ
より輝度制御電圧として取り出すようにしたエミッタフ
ォロワ回路とで構成したことを特徴とする自動輝度制限
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17755391A JPH04373280A (ja) | 1991-06-21 | 1991-06-21 | 自動輝度制限回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17755391A JPH04373280A (ja) | 1991-06-21 | 1991-06-21 | 自動輝度制限回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04373280A true JPH04373280A (ja) | 1992-12-25 |
Family
ID=16032971
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17755391A Pending JPH04373280A (ja) | 1991-06-21 | 1991-06-21 | 自動輝度制限回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04373280A (ja) |
-
1991
- 1991-06-21 JP JP17755391A patent/JPH04373280A/ja active Pending
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