JPH0443027U - - Google Patents
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- Publication number
- JPH0443027U JPH0443027U JP8446890U JP8446890U JPH0443027U JP H0443027 U JPH0443027 U JP H0443027U JP 8446890 U JP8446890 U JP 8446890U JP 8446890 U JP8446890 U JP 8446890U JP H0443027 U JPH0443027 U JP H0443027U
- Authority
- JP
- Japan
- Prior art keywords
- adder
- pwm waveform
- command value
- pwm
- correction
- Prior art date
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- Pending
Links
- 238000005259 measurement Methods 0.000 claims 2
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Analogue/Digital Conversion (AREA)
Description
第１図は本考案の一実施例の構成を示すブロツ
ク図、第２図は第１図の実施例の動作を説明する
ためのタイミングチヤート、第３図は従来例の構
成を示すブロツク図、第４図は第３図の従来例の
動作を説明するための図である。 １……加算器、２……ＰＷＭ波形生成器、３…
…ローパスフイルタ、４……カウンタ、５……ラ
ツチ、６……差分器。
ク図、第２図は第１図の実施例の動作を説明する
ためのタイミングチヤート、第３図は従来例の構
成を示すブロツク図、第４図は第３図の従来例の
動作を説明するための図である。 １……加算器、２……ＰＷＭ波形生成器、３…
…ローパスフイルタ、４……カウンタ、５……ラ
ツチ、６……差分器。
Claims (1)
- 【実用新案登録請求の範囲】 ＰＷＭコントローラからの出力指令値に補正値
を加算して補正指令値を出力する加算器１と、 該加算器１からの補正指令値を受けてＰＷＭ波
形を発生させるＰＷＭ波形生成器２と、 該ＰＷＭ波形生成器２から出力されるＰＷＭ波
形を入力とするフイルタ回路３と、 前記ＰＷＭ波形生成器２から出力されるパルス
幅を測定するパルス幅測定回路４と、 前記加算器１から出力される補正指令値と前記
パルス幅測定回路４の測定値とを比較し、その差
分を前記加算器１に前記補正値として帰還させる
差分器６とを有することを特徴とするＰＷＭ方式
のＤ／Ａ変換器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8446890U JPH0443027U (ja) | 1990-08-09 | 1990-08-09 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8446890U JPH0443027U (ja) | 1990-08-09 | 1990-08-09 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0443027U true JPH0443027U (ja) | 1992-04-13 |
Family
ID=31632977
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8446890U Pending JPH0443027U (ja) | 1990-08-09 | 1990-08-09 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0443027U (ja) |
-
1990
- 1990-08-09 JP JP8446890U patent/JPH0443027U/ja active Pending