JPH0454724A - 論理回路 - Google Patents

論理回路

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JPH0454724A
JPH0454724A JP2165046A JP16504690A JPH0454724A JP H0454724 A JPH0454724 A JP H0454724A JP 2165046 A JP2165046 A JP 2165046A JP 16504690 A JP16504690 A JP 16504690A JP H0454724 A JPH0454724 A JP H0454724A
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JP
Japan
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transistor
voltage stabilizing
driving
gate
voltage
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JP2165046A
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Nobuyuki Hirakata
宣行 平方
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Sumitomo Electric Industries Ltd
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Sumitomo Electric Industries Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、高速で動作する低消費電力の化合物半導体論
理回路に関するものである。
〔従来の技術〕
情報化社会の発展にともない、より高速の情報処理装置
に対する需要か高まり、これを構成する半導体装置にも
より高速の動作が求められている。
この要求に対して、従来のシリコンを主成分とした半導
体装置に代わって高電子移動度という特徴を持つ種々の
化合物半導体を用いた半導体装置が開発され、高速の論
理回路などに応用されている。
次に、このような半導体装置の一従来例としてＧａＡｓ
　ＩＣを用いたＳ　ＣＦ　Ｌ　（Ｓｏｕｒｃｅ　Ｃｏｕ
ｐｌｅｄＦＥＴ　Ｌｏｇｉｃ　）回路によるインバータ
回路を、第２図に基づいて説明する。
同図において、符号４１はソースフォロワ回路部、符号
４２はスイッチング部、符号４３．４４はソースフォロ
ワトランジスタ、符号４５．４６はレベルシフト用ダイ
オード、符号４７．４８は定電流源トランジスタ、符号
４９．５０は負荷素子、符号５１．５２は駆動用トラン
ジスタ、符号５３は電流源、符号５４．５５は電源用端
子、符号５６．５７は入力端子、符号５８．５９は出力
端子をそれぞれ示している。
５ＣＦＬ回路では、一般にデイプリージョン型のトラン
ジスタが用いられている。そして次段の論理回路との整
合性から、出力信号の電位を駆動用トランジスタのドレ
イン端子よりも低くする必要があるため、ソースフォロ
ワ回路部４１が付加されている。この回路ではソースフ
ォロワトランジスタ４３．４４のゲート−ソース間電圧
およびレベルシフト用ダイオード４５．４６の電圧降下
により、信号レベルのシフトが行われている。
〔発明が解決しようとする課題〕
このように、化合物半導体を採用することによって論理
回路装置の大幅な高速・低消費電力化が達成されつつあ
る。しかし、この化合物半導体は不用なエネルギー準位
の存在によるトランジスタの周波数特性の劣化という問
題を有していた。
この問題の原因として、シリコンに対する酸化シリコン
（Ｓｉｎ）のような安定な界面を形成する絶縁体が見つ
かっていない点や、複数の元素の化合物であるためにそ
の組成が安定し難いといった点が挙げられる。
このような原因により不要なエネルギー準位が発生し、
電位の変化の度に充放電が繰り返されるために、トラン
ジスタの周波数特性が劣化するという問題点かあった。
この周波数特性劣化について、第３図の従来例の波形図
を用いて説明する。
まず、入力信号がハイレベルとローレベルを一定間隔で
繰り返すデユーティ比５０％の第１状態では、入力信号
を反転させた波形の遅延のない出力信号が発生する。次
に、ローレベルの入力信号が長く続きその後にハイレベ
ルの信号に変化させる第２状態では、入力信号がローレ
ベルからハイレベルに変化するタイミングより遅いタイ
ミングで、出力信号がハイレベルからローレベルに変化
する。これとは逆に、ハイレベルの入力信号が長く続き
その後にローレベルの信号に変化させる第３状態では、
入力信号がハイレベルからローレベルに変化するタイミ
ングより遅いタイミングで、出力信号かローレベルから
ハイレベルに変化する。
このように周波数特性劣化は、第２状態、第３状態での
出力信号の応答の遅延であるジッタとして実際に現われ
る。また入力信号の立ち上がりと立ち下がりでジッタの
間隔が異なるときは、クロスポイントの変動として現わ
れる。
本発明は、このような周波数特性劣化の問題を解消する
ものである。
〔課題を解決するための手段〕
上記課題を解決するために、本発明の論理回路は、駆動
用化合物半導体トランジスタに与えられる切替制御信号
と同相でその平均電位が所定の値だけ高い電圧安定用制
御信号で動作する電圧安定用トランジスタが駆動用化合
物半導体トランジスタと負荷素子との間に直列接続され
ているものである。
〔作用〕
本発明に係る論理回路であれば、入出力の信号の変化に
よって、駆動用化合物半導体トランジスタのドレイン電
位が大幅に変動することがない。
このように駆動用化合物半導体トランジスタのドレイン
電位が安定しているので、準位充放電は行われない。
〔実施例〕
以下、第１図を参照して本発明の一実施例であるＧａＡ
ｓＩＣを用いたＳＣＦ　Ｌ　（ＳｏｕｒｃｅＣｏｕｐｌ
ｅｄ　ＰＥＴ　Ｌｏｇｉｃ　）回路によるインバータ回
路について説明する。
同図は、本実施例のインバータ回路を示すブロック図で
あり、このインバータ回路は、ソースフォロワ回路部１
１とスイッチング部１２から構成されている。
ソースフォロワ回路部１１は、ソースフォロワトランジ
スタ１３、レベルシフト用ダイオード１４、定電流源ト
ランジスタ１５からなる第１ソースフオロワと、ソース
フォロワトランジスタ１６、レベルシフト用ダイオード
１７、定電流源トランジスタ１８からなる第２ソースフ
オロワとを備えている。そして、ソースフォロワトラン
ジスタ１３のゲートは入力端子１９と、ソースフオロフ
トランジスタ１６のゲートは入力端子２０とそれぞれ接
続されている。
スイッチング部１２には、駆動用トランジスタ２１．２
２が備えられている。駆動用トランジスタ２１．２２の
各ソースは共通に電流源２３と接続されており、電流源
２３の他の一端は電源用端子２４と接続されている。駆
動用トランジスタ２１．２２の各ドレインは電圧安定用
トランジスタ２５．２６と接続されており、この電圧安
定用トランジスタ２５．２６の各ドレインは出力端子２
７．２８と接続されている。さらに、この電圧安定用ト
ランジスタ２５．２６の各ドレインは負荷素子２９．３
０とも接続されており、この負荷素子２９．３０の他の
一端は共通に電源用端子３１と接続されている。また、
駆動用トランジスタ２１と電圧安定用トランジスタ２５
はレベルシフト用ダイオード１４と接続され、駆動用ト
ランジスタ２２と電圧安定用トランジスタ２６はレベル
シフト用ダイオード１７と接続されている。
このインバータ回路は従来回路と異なり、駆動用トラン
ジスタ２１．２２と負荷素子２９．３０との間に電圧安
定用トランジスタ２５．２６を設けている。そして、こ
の電圧安定用トランジスタ２５．２６によって、前述し
た従来回路で問題となった不要な準位の充放電を防ぐこ
とができる。
この不要な準位の充放電防止の機能を、電圧安定用トラ
ンジスタ２５を用いて詳細に説明すると以下のようにな
る。
電圧安定用トランジスタ２５のゲートとレベルシフト用
ダイオード１４との接続位置は、駆動用トランジスタ２
１のゲートとレベルシフト用ダイオード１４との接続位
置よりも、レベルシフトダイオード段数が少ない位置で
ある。つまり、電圧安定用トランジスタ２５のゲートに
は、駆動用トランジスタ２１のゲートと同相で、しかも
平均電位が所定の値だけ高い電圧が印加されるのである
。
このため電圧安定用トランジスタ２５が緩衝器の役割を
果たし、駆動用トランジスタ２１の電位の変動を抑える
ことができる。
この機能は電圧安定用トランジスタ２６についても同様
である。
したがって、本実施例のインバータ回路であれば、駆動
用トランジスタ２１．２２における不要な準位の充放電
を伴うことがない。
なお、本実施例では、ショットキーゲート電界効果トラ
ンジスタを用いて説明したが、バイポーラトランジスタ
を用いても同様の効果が得られる。
また、本実施例では、インバータ回路を用いて説明した
が、ＡＮＤ回路、ＯＲ回路、ラッチ等の、より複雑な半
導体論理回路にも適用可能である。
〔発明の効果〕
以上説明したように、本発明に係る論理回路によれば、
不要な準位の充放電を伴うことがない。
このために、ジッダによる波形の歪みやクロスポイント
の変動のない安定した出力が確保できる。
【図面の簡単な説明】
第１図は本発明の一実施例であるインバータ回路を示す
回路図、第２図は従来のインバータ回路を示す回路図、
第３図は第２図の従来例の動作を示す波形図である。 １１・・・ソースフォロワ回路部、１２・・・スイ・ン
チング部、１３・・・ソースフォロワトランジスタ、１
４・・・レベルシフト用ダイオード、１５・・・定電流
源トランジスタ、１６・・・ソースフォロワトランジス
タ、１７・・・レベルシフト用ダイオード、１８・・・
定電流源トランジスタ、１９．２０・・・入力端子、２
１．２２・・・駆動用トランジスタ、２３・・・電流源
、２４・・・電源用端子、２５．２６・・・電圧安定用
トランジスタ、２７．２８・・・出力端子、２９．３０
・・・電源用端子、３１・・・電源用端子。 代理人弁理士　　　長谷用　　芳　　樹間　　　　　　
　　　塩　　　１）　　辰　　　也大塵例 莞１図 第２図 幣３図

Claims (1)

  1. 【特許請求の範囲】 低電位側が共通の電流源に接続され高電位側にそれぞれ
    負荷素子が接続された一対の駆動用化合物半導体トラン
    ジスタで構成された電流切替型論理回路において、 前記駆動用化合物半導体トランジスタに与えられる切替
    制御信号と同相でその平均電位が所定の値だけ高い電圧
    安定用制御信号で動作する電圧安定用トランジスタが前
    記駆動用化合物半導体トランジスタと前記負荷素子との
    間に直列接続されていることを特徴とする論理回路。
JP2165046A 1990-06-22 1990-06-22 論理回路 Pending JPH0454724A (ja)

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EP91110273A EP0464524B1 (en) 1990-06-22 1991-06-21 Current-switching type logic circuit
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