JPH047029B2 - - Google Patents
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- Publication number
- JPH047029B2 JPH047029B2 JP57164649A JP16464982A JPH047029B2 JP H047029 B2 JPH047029 B2 JP H047029B2 JP 57164649 A JP57164649 A JP 57164649A JP 16464982 A JP16464982 A JP 16464982A JP H047029 B2 JPH047029 B2 JP H047029B2
- Authority
- JP
- Japan
- Prior art keywords
- capacitor
- density recording
- search operation
- recording disk
- clock
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 239000003990 capacitor Substances 0.000 claims description 12
- 238000010586 diagram Methods 0.000 description 3
- 238000000605 extraction Methods 0.000 description 3
- 230000010355 oscillation Effects 0.000 description 3
- 230000000694 effects Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/14—Digital recording or reproducing using self-clocking codes
- G11B20/1403—Digital recording or reproducing using self-clocking codes characterised by the use of two levels
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
【発明の詳細な説明】
産業上の利用分野
本発明はデイジタル信号を高密度に記録したデ
イスクを再生する高密度記録デイスク再生装置に
関するものであり、特にデイスクの通常再生時と
サーチ動作時とで、再生信号中のクロツク抽出用
のフエーズ・ロツクド・ループ回路（以下PLL
回路と称する）の応答時定数を切換え、いずれの
場合にもクロツクが正確に抽出できるようにした
ものでさる。
イスクを再生する高密度記録デイスク再生装置に
関するものであり、特にデイスクの通常再生時と
サーチ動作時とで、再生信号中のクロツク抽出用
のフエーズ・ロツクド・ループ回路（以下PLL
回路と称する）の応答時定数を切換え、いずれの
場合にもクロツクが正確に抽出できるようにした
ものでさる。
従来例の構成とその問題点
近年、円盤状デイスクにデイジタル信号を高密
度に記録したビデオデイスクやデイジタルオーデ
イオデイスクの再生装置が実用化されつつある。
度に記録したビデオデイスクやデイジタルオーデ
イオデイスクの再生装置が実用化されつつある。
特にデイジタルオーデイオデイスクには、オー
デイオ情報と共にクロツクも記録されており、こ
のクロツクを再生しながらオーデイオ情報を再生
処理するようにしている。通常このクロツクは、
デイスクの再生信号中から、第１図に示すような
PLL回路によつて抽出される。
デイオ情報と共にクロツクも記録されており、こ
のクロツクを再生しながらオーデイオ情報を再生
処理するようにしている。通常このクロツクは、
デイスクの再生信号中から、第１図に示すような
PLL回路によつて抽出される。
第１図において、Ｘはデイスク（図示せず）か
ら再生されたデイジタル符号化された信号の入力
される入力端子、１はこの入力信号と分周器４か
らの分周信号との位相を比較し、その位相差に応
じた出力を発生する位相比較器、２は位相比較器
１の出力を低域波する低域通過フイルター、３
は低域通過フイルター２の出力する直流電圧によ
つて発振周波数が制御される電圧制御発振器、４
は電圧制御発振器３の発振出力を分周する分周
器、Ｙは分周器４から出力されるクロツクの出力
端子、Ａ，Ｂは低域通過フイルター２の入出力端
子である。
ら再生されたデイジタル符号化された信号の入力
される入力端子、１はこの入力信号と分周器４か
らの分周信号との位相を比較し、その位相差に応
じた出力を発生する位相比較器、２は位相比較器
１の出力を低域波する低域通過フイルター、３
は低域通過フイルター２の出力する直流電圧によ
つて発振周波数が制御される電圧制御発振器、４
は電圧制御発振器３の発振出力を分周する分周
器、Ｙは分周器４から出力されるクロツクの出力
端子、Ａ，Ｂは低域通過フイルター２の入出力端
子である。
上記構成において、電圧制御発振器３の基準発
振周波数を適切に設定しておけば、入力端子Ｘに
印加される入力信号中のクロツクのみを出力端子
Ｙに出力することができる。
振周波数を適切に設定しておけば、入力端子Ｘに
印加される入力信号中のクロツクのみを出力端子
Ｙに出力することができる。
そして低域通過フイルター２は、第２図のよう
に、演算増幅器５と、その入出力端子AB間に接
続された抵抗Ｒと第１のコンデンサC1の直列回
路と、基準電源V0とで構成されており、上記抵
抗Ｒと第１のコンデンサC1で低域通過フイルタ
ー２の時定数が決定され、この時定数でPLL回
路の応答時定数が決定される。
に、演算増幅器５と、その入出力端子AB間に接
続された抵抗Ｒと第１のコンデンサC1の直列回
路と、基準電源V0とで構成されており、上記抵
抗Ｒと第１のコンデンサC1で低域通過フイルタ
ー２の時定数が決定され、この時定数でPLL回
路の応答時定数が決定される。
ところで、このようなPLL回路を用いてクロ
ツクを抽出する場合、次のような問題が発生す
る。すなわち、デイクスを通常再生する場合に
は、トラツクオン時間（デイスク再生手段がデイ
スクのトラツクを再生する時間）が十分に長いた
め、PLL回路の応答時定数は、安定性の点から
も、可能な限り大きい方がよい。ところが、サー
チ動作時は、デイスクが高速でアクセスされ、デ
イスク中の情報を粗く調べることになるが、この
場合の高速アクセスは、デイスクの回転数は通常
再生時と同一で、トラツクを飛び越しながらサー
チするため、トラツクオン時間が著しく短くな
る。そこで、通常再生時の安定性を確保するため
にPLL回路の応答時定数を十分に大きくしてお
くと、サーチ動作時に正確にクロツクを抽出する
ことが困難になる。
ツクを抽出する場合、次のような問題が発生す
る。すなわち、デイクスを通常再生する場合に
は、トラツクオン時間（デイスク再生手段がデイ
スクのトラツクを再生する時間）が十分に長いた
め、PLL回路の応答時定数は、安定性の点から
も、可能な限り大きい方がよい。ところが、サー
チ動作時は、デイスクが高速でアクセスされ、デ
イスク中の情報を粗く調べることになるが、この
場合の高速アクセスは、デイスクの回転数は通常
再生時と同一で、トラツクを飛び越しながらサー
チするため、トラツクオン時間が著しく短くな
る。そこで、通常再生時の安定性を確保するため
にPLL回路の応答時定数を十分に大きくしてお
くと、サーチ動作時に正確にクロツクを抽出する
ことが困難になる。
発明の目的
本発明はこのような従来の問題を解決し、デイ
スクの通常再生時にも、サーチ動作時にも、常に
正確にクロツクが抽出できるようにした高密度記
録デイスク再生装置を提供するものである。
スクの通常再生時にも、サーチ動作時にも、常に
正確にクロツクが抽出できるようにした高密度記
録デイスク再生装置を提供するものである。
発明の構成
本発明はPLL回路の応答時定数を、通常再生
時には長く、サーチ動作時には短くすることによ
り、いずれの場合にもクロツクが正確に抽出でき
るようにしたものである。
時には長く、サーチ動作時には短くすることによ
り、いずれの場合にもクロツクが正確に抽出でき
るようにしたものである。
実施例の説明
第３図は本発明の一実施例におけるPLL回路
中の低域通過フイルター（第１図の低域通過フイ
ルター２に相当するもの）の具体構成を示すもの
であり、第１図、第２図と実質的に同一機能を有
する部分には同一符号を付して説明を省略する。
そしてC2は第２のコンデンサ、SWはスイツチで
あり、これらは第１のコンデンサC1に並列に接
続されている。そしてスイツチSWは、具体的に
は、通常再生かサーチ動作かを識別する識別信号
によつて自動的に開閉される半導体スイツチ等で
構成されている。
中の低域通過フイルター（第１図の低域通過フイ
ルター２に相当するもの）の具体構成を示すもの
であり、第１図、第２図と実質的に同一機能を有
する部分には同一符号を付して説明を省略する。
そしてC2は第２のコンデンサ、SWはスイツチで
あり、これらは第１のコンデンサC1に並列に接
続されている。そしてスイツチSWは、具体的に
は、通常再生かサーチ動作かを識別する識別信号
によつて自動的に開閉される半導体スイツチ等で
構成されている。
上記構成において、通常再生時にはスイツチ
SWが閉じ、容量値が第１、第２のコンデンサ
C1，C2の合成容量（C1＋C2）になつて大きくな
る。このためPLL回路の応答時定数が長くなり、
十分な安定性を確保しつつクロツクを正確に抽出
することができる。一方、サーチ動作時には、ス
イツチSWが開き、容量値は第１のコンデンサC1
の容量のみとなり、PLL回路の応答時定数も短
くなる。このため、トラツクオン時間が短くて
も、PLL回路の応答が速くなるため、この場合
にもクロツクを正確に抽出することができる。
SWが閉じ、容量値が第１、第２のコンデンサ
C1，C2の合成容量（C1＋C2）になつて大きくな
る。このためPLL回路の応答時定数が長くなり、
十分な安定性を確保しつつクロツクを正確に抽出
することができる。一方、サーチ動作時には、ス
イツチSWが開き、容量値は第１のコンデンサC1
の容量のみとなり、PLL回路の応答時定数も短
くなる。このため、トラツクオン時間が短くて
も、PLL回路の応答が速くなるため、この場合
にもクロツクを正確に抽出することができる。
特にこの実施例のように、スイツチSWを、通
常再生かサーチ動作かを識別する識別信号により
自動的に開閉制御すれば、いちいち手動で応答時
定数を切換えるものに比べて、その操作性を著し
く高めることができる。
常再生かサーチ動作かを識別する識別信号により
自動的に開閉制御すれば、いちいち手動で応答時
定数を切換えるものに比べて、その操作性を著し
く高めることができる。
なお、本発明は、デイジタルオーデイオデイス
クに限らず、デイジタル信号がクロツクと共に高
密度に記録されたデイスクを再生するものであれ
ば、どのようなものにも適用することができる。
クに限らず、デイジタル信号がクロツクと共に高
密度に記録されたデイスクを再生するものであれ
ば、どのようなものにも適用することができる。
発明の効果
本発明はクロツク抽出用のPLL回路の応答時
定数を、通常再生時には長く、サーチ動作時には
短くするようにしたものであるから、いずれの場
合にも、クロツクを正確に抽出することができ
る。
定数を、通常再生時には長く、サーチ動作時には
短くするようにしたものであるから、いずれの場
合にも、クロツクを正確に抽出することができ
る。
第１図は従来のクロツク抽出用のPLL回路を
示すブロツク図、第２図はその低域通過フイルタ
ーの具体構成を示す回路図、第３図は本発明の一
実施例における低域通過フイルターを示す回路図
である。 １……位相比較器、２……低域通過フイルタ
ー、３……電圧制御発振器、４……分周器、５…
…演算増幅器、Ｒ……抵抗、C1……第１のコン
デンサ、C2……第２のコンデンサ、SW……スイ
ツチ。
示すブロツク図、第２図はその低域通過フイルタ
ーの具体構成を示す回路図、第３図は本発明の一
実施例における低域通過フイルターを示す回路図
である。 １……位相比較器、２……低域通過フイルタ
ー、３……電圧制御発振器、４……分周器、５…
…演算増幅器、Ｒ……抵抗、C1……第１のコン
デンサ、C2……第２のコンデンサ、SW……スイ
ツチ。
Claims (1)
- 【特許請求の範囲】 １ 高密度記録デイスクの再生信号中のクロツク
をフエーズ・ロツクド・ループ回路により抽出す
るように構成するとともに、上記フエーズ・ロツ
クド・ループ回路の応答時定数を、上記高密度記
録デイスクの通常再生時には大きく、サーチ動作
時には小さくするようにしたことを特徴とする高
密度記録デイスク再生装置。 ２ フエーズ・ロツクド・ループ回路の低域通過
フイルターを、演算増幅器と、その入出力端子間
に接続された抵抗と第１のコンデンサの直列回路
と、上記第１のコンデンサに並列に接続された第
２のコンデンサとスイツチの直列回路とで構成
し、通常再生時かサーチ動作時かを識別する識別
信号により、通常再生時には上記スイツチを自動
的に閉じ、サーチ動作時には上記スイツチを自動
的に開くようにしたことを特徴とする特許請求の
範囲第１項記載の高密度記録デイスク再生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57164649A JPS5954017A (ja) | 1982-09-20 | 1982-09-20 | 高密度記録デイスク再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57164649A JPS5954017A (ja) | 1982-09-20 | 1982-09-20 | 高密度記録デイスク再生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5954017A JPS5954017A (ja) | 1984-03-28 |
| JPH047029B2 true JPH047029B2 (ja) | 1992-02-07 |
Family
ID=15797186
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57164649A Granted JPS5954017A (ja) | 1982-09-20 | 1982-09-20 | 高密度記録デイスク再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5954017A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4987387A (en) * | 1989-09-08 | 1991-01-22 | Delco Electronics Corporation | Phase locked loop circuit with digital control |
| US5392171A (en) * | 1993-01-07 | 1995-02-21 | Seagate Technology, Inc. | Fully integrated programmable filters for disc drive subsystems |
| JP2003011239A (ja) * | 2001-07-02 | 2003-01-15 | Inoac Corp | 車両用リボンディッドチップ製品の製造方法及び車両用リボンディッドチップ製品 |
| JP4730153B2 (ja) * | 2006-03-15 | 2011-07-20 | 株式会社デンソー | フィルタ回路 |
-
1982
- 1982-09-20 JP JP57164649A patent/JPS5954017A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5954017A (ja) | 1984-03-28 |
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