JPH0481391B2 - - Google Patents
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- JPH0481391B2 JPH0481391B2 JP60192516A JP19251685A JPH0481391B2 JP H0481391 B2 JPH0481391 B2 JP H0481391B2 JP 60192516 A JP60192516 A JP 60192516A JP 19251685 A JP19251685 A JP 19251685A JP H0481391 B2 JPH0481391 B2 JP H0481391B2
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- memory
- signal
- noise
- address
- video
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- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
- Television Signal Processing For Recording (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、映像記録再生装置に関し、特にフ
イールドメモリを用いて、高速再生時にノイズバ
ーのない品質の良い再生画を得るものである。DETAILED DESCRIPTION OF THE INVENTION [Industrial Field of Application] The present invention relates to a video recording and reproducing device, and particularly to a video recording and reproducing device that uses a field memory to obtain high-quality reproduced images without noise bars during high-speed reproduction.
従来例として、フイールドメモリを用いたビデ
オテープレコーダ(以下VTRと称す)の高速再
生を、4倍の偶数倍速で行う場合について説明す
る。ここで、一般に高速再生は奇数倍速が選ばれ
るが、これはフイールド毎のノイズ位置が同じで
あるため、ノイノズバーがロツクする性質を利用
するものである。反面、偶数倍速ではフイールド
毎にノイズ位置と信号のある位置とが交互に入れ
替り、この性質をメモリを使用する手段で用いれ
ば、場合によつてはノイズバーを狭くできること
となる。
As a conventional example, a case will be described in which high-speed playback of a video tape recorder (hereinafter referred to as VTR) using a field memory is performed at an even multiple of 4 times the speed. Here, an odd-numbered speed is generally selected for high-speed playback, but this takes advantage of the property that the noise noise bar locks because the noise position is the same for each field. On the other hand, at even multiple speeds, the noise position and the signal position alternate for each field, and if this property is used in a means that uses memory, the noise bar can be made narrower in some cases.
第4図は上記従来のVTRの高速再生系を示し、
図において、1は記録済のビデオテープであり、
ビデオヘツド2a,2bを介して再生信号がプリ
アンプ3に導かれ、その後再生信号はビデオ信号
処理回路4に送られる。一方、5はプリアンプ3
の出力により再生信号のエンベロープを取り出す
エンベロープ検波器であり、その出力はこれをあ
る一定のレベルと比較するコンパレータ6に導か
れ、フイールドメモリ8へのビデオ信号処理回路
4からの出力信号の書き込みのタイミングやアド
レスを発生させるメモリコントロール回路7へ送
られる。また、ビデオ信号処理回路4から同期信
号がメモリコントロール回路7に送られる。 Figure 4 shows the high-speed playback system of the conventional VTR mentioned above.
In the figure, 1 is a recorded videotape,
The reproduced signal is led to a preamplifier 3 via the video heads 2a and 2b, and then sent to a video signal processing circuit 4. On the other hand, 5 is preamp 3
This is an envelope detector that extracts the envelope of the reproduced signal by the output of It is sent to the memory control circuit 7 which generates timing and addresses. Further, a synchronizing signal is sent from the video signal processing circuit 4 to the memory control circuit 7.
なお、上記フイールドメモリ8はデユアルポー
トメモリ(図示しない)であり、出力ポートとし
てランダム出力とシリアル出力を持ち、シリアル
ポートを使用すればメモリへの書き込みと読み出
しが非同期で行えるものである。ここでの動作
は、フイールドメモリ8へビデオ信号処理回路4
からの再生信号を書込みながらシリアルポートを
使用して、該フイールドメモリ8の内容を読み出
す非同期動作を行う。 The field memory 8 is a dual port memory (not shown) and has a random output and a serial output as output ports, and if the serial port is used, writing and reading from the memory can be performed asynchronously. The operation here is to transfer the video signal processing circuit 4 to the field memory 8.
An asynchronous operation is performed in which the contents of the field memory 8 are read out using the serial port while writing the reproduction signal from the field memory 8 .
一方、9はコントロールヘツドであり、この出
力にもとずいて、サーボ回路10はキヤプスタモ
ータ11、リールモータ12を制御して各モード
におけるテープの走行制御を行うようになつてい
る。 On the other hand, 9 is a control head, and based on this output, a servo circuit 10 controls a capstor motor 11 and a reel motor 12 to control the running of the tape in each mode.
次に動作について説明する。 Next, the operation will be explained.
今、ビデオテープ1が逆方向へ4倍速で高速再
生しているとする。第5図及び第6図はこのとき
の動作を説明するための図である。第5図におい
て、50はビデオトラツクであり、A,Bはアジ
マス記録を表しており、Aに対してはビデオヘツ
ド2aが、Bに対してはビデオヘツド2bがそれ
ぞれ同アジマスとする。 Suppose that videotape 1 is being played back at 4x speed in the reverse direction. FIGS. 5 and 6 are diagrams for explaining the operation at this time. In FIG. 5, 50 is a video track, and A and B represent azimuth recording, with the video head 2a for A and the video head 2b for B having the same azimuth.
今、ビデオヘツド2aが図中破線cをトレース
したとき、アジマス記録の関係上、再生信号のプ
リアンプ3の出力は第6図aの如くなる。同様に
ビデオヘツド2bが図中破線dの軌跡をトレース
すると、第6図bの出力が得られる。これらの第
6図a,bの2フイールドの内容が時間軸で互い
に補間されると第6図cに示すような1フイール
ドの画像となり、これがフイールドメモリ8内に
記憶され、モニター上に表示される。 Now, when the video head 2a traces the broken line c in the figure, the output of the preamplifier 3 of the reproduced signal becomes as shown in FIG. 6a due to azimuth recording. Similarly, when the video head 2b traces the trajectory indicated by the broken line d in the figure, the output shown in FIG. 6b is obtained. When the contents of these two fields a and b in Fig. 6 are interpolated with each other on the time axis, a single field image as shown in Fig. 6 c is obtained, which is stored in the field memory 8 and displayed on the monitor. Ru.
このようなノイズバーのほとんどない1フイー
ルドの内容となるのは、磁気ヘツド幅に対し、ビ
デオトラツクの幅が同等以上でガードバンドのな
い場合である。実際には、例えばVHS方式にお
ける標準モードと3倍モードを兼用したヘツド構
成である普及機では、3倍モードを主にしたヘツ
ド仕様となつている。 The content of one field with almost no noise bars is obtained when the width of the video track is equal to or larger than the width of the magnetic head and there is no guard band. In fact, for example, in a popular VHS system, the head configuration is such that the standard mode and the 3x mode are used together, and the head specification is mainly for the 3x mode.
このようのな仕様のもので標準モードの記録を
行うと、ビデオトラツク50上の1/2〜2/3がガー
ドバンドとなり、第7図の51に示すようなビデ
オトラツクとなる。このビデオトラツク51上
を、ビデオヘツド2a,2bが図中破線e,fの
軌跡をトレースすることによつて得られるプリア
ンプ3の出力は、第8図a,bに示す如くとな
り、これらを時間軸で互いに補間した1フイール
ドの画像は第8図cのようになる。この第8図で
示すgの部分は、映像信号が全く得られない領域
であり、モニタ画面上では比較的大きなノイズバ
ーとなつて表われる。 When standard mode recording is performed using a device with such specifications, 1/2 to 2/3 of the video track 50 becomes a guard band, resulting in a video track as shown at 51 in FIG. The outputs of the preamplifier 3 obtained by tracing the trajectories of broken lines e and f in the figure on this video track 51 by the video heads 2a and 2b are as shown in FIG. An image of one field interpolated with each other along the axes is shown in FIG. 8c. The portion g shown in FIG. 8 is an area where no video signal is obtained, and appears as a relatively large noise bar on the monitor screen.
以上述べたように、ガードバンドのあるビデオ
トラツクを高速再生した場合、フイールドメモリ
を応用してもノイズカバーが完全に取れないで残
るという欠点があつた。
As mentioned above, when a video track with a guard band is played back at high speed, there is a drawback that the noise cover cannot be completely removed even if field memory is applied.
この発明は、上記のような欠点を解消するもの
で、ガードバンドのあるビデオトラツクを高速再
生しても、ノイズバーのない品質の良く映像を得
ることのできる映像記録再生装置を提供するもの
である。 The present invention solves the above-mentioned drawbacks and provides a video recording and reproducing device that can obtain high-quality video without noise bars even when playing back a video track with a guard band at high speed. .
この発明では、マイクロコンピユータ等を用い
て、エンベロープ検波信号よりノイズバー位置を
予測し、該予測決定に基いてノイズバー位置に対
応するメモリ番地にはデータを書き込まないよう
にしたものである。
In this invention, the noise bar position is predicted from the envelope detection signal using a microcomputer or the like, and data is not written to the memory address corresponding to the noise bar position based on the predicted determination.
この発明においては、ノイズバー位置を予測
し、これによりノイズバーのメモリへの書き込み
を停止するから、後でメモリ内のアドレス操作に
よりノイズ部分を除いて、再度メモリ内容を並べ
かえる等の操作が不要になり、リアルタイムでメ
モリ内容を非同期で読み出すのに新たな操作を必
要とせず、用意に品質の良い再生画が得られる。
In this invention, the position of the noise bar is predicted and writing of the noise bar to the memory is thereby stopped, so there is no need to perform operations such as removing the noise part through address operations in the memory and rearranging the memory contents again. Therefore, no new operations are required to asynchronously read out the memory contents in real time, and high-quality playback images can be easily obtained.
以下、本発明の実施例を図について説明する。 Embodiments of the present invention will be described below with reference to the drawings.
第1図において、20はワンチツプマイクロコ
ンピユータ(以下単にマイコンと称す)であり、
これにより、コンパレータ6からの出力を受けた
り、メモリコントロール回路7へのアドレス更新
停止信号を出力したりする入力出回路21、デー
タを一時的に記憶するデータメモリ23、タイマ
機能とタイマメモリを有するタイマ24、演算を
行うマイマロプロセツサ25、及び動作の指令を
司どるプログラムメモリ22が構成されている。
そしてこのマイコン20及びコンパレータ6によ
りガードバンドノイズの位置を予測するノイズ部
分予測手段が、またマイコン20及びメモリコン
トロール回路7によりガードバンドノイズ部分に
対応するメモリアドレス位置のアドレス指定を停
止するアドレス制御手段が構成されている。その
他の構成は従来構成と同様であり、第4図と同一
符号は同等のものを表す。 In FIG. 1, 20 is a one-chip microcomputer (hereinafter simply referred to as microcomputer);
This includes an input/output circuit 21 that receives the output from the comparator 6 and outputs an address update stop signal to the memory control circuit 7, a data memory 23 that temporarily stores data, a timer function, and a timer memory. It includes a timer 24, a mymallo processor 25 that performs calculations, and a program memory 22 that administers operation commands.
The microcomputer 20 and the comparator 6 are used as a noise part prediction means to predict the position of the guard band noise, and the microcomputer 20 and the memory control circuit 7 are used as an address control means to stop the addressing of the memory address position corresponding to the guard band noise part. is configured. The rest of the structure is the same as the conventional structure, and the same reference numerals as in FIG. 4 represent equivalent parts.
次に動作について述べる。 Next, we will discuss the operation.
今、ビデオヘツド2a,2bによりビデオテー
プ1上における第7図のビデオトラツク51の
e,fの軌跡を4倍速で逆方向再生したとする。
この時に得られる再生エンベロープに基づくコン
パレータ6からの出力は、それぞれ第2図a,b
のようになる。ここで第2図a,bの論理レベル
は、端的にフイールドメモリ8に対する読み出し
モード(レベル“H”)、書き込みモード(レベル
“L”)を示している。 Assume that the video heads 2a and 2b reproduce the trajectories e and f of the video tracks 51 in FIG. 7 on the video tape 1 at 4 times the speed in the reverse direction.
The outputs from the comparator 6 based on the reproduction envelope obtained at this time are shown in Fig. 2 a and b, respectively.
become that way. Here, the logic levels in FIGS. 2a and 2b simply indicate the read mode (level "H") and write mode (level "L") for the field memory 8.
なお、ここでの書き込み、読み出しモードど
は、以前に説明したフイールドメモリ8に使用し
ているデユアルポートメモリのランダム入力、ラ
ンダム出力ポートに対してのものであり、読み出
しモードでは、メモリ内容を読み出し出力するも
のではなく、メモリに書き込まないという意味で
ある。即ち、本来の読み出しモードとしてのメモ
リ内容の出力はシリアルポートを使用して行な
い、ランダム入力とは非同期での動作をすること
を前提としている。 Note that the write and read modes here are for the random input and random output ports of the dual port memory used in the field memory 8 described previously, and the read mode is for reading out the memory contents. It does not mean that it is output, but rather that it is not written to memory. That is, it is assumed that the output of memory contents in the original read mode is performed using a serial port, and that the operation is asynchronous with random input.
ところで第2図a,bの信号の2フイールド間
の立上り、立下りを検出すると、同図cの波形が
得られ、この波形の“H”レベル部分はノイズバ
ー部分を表わしていることになる。従つて同図c
の“H”レベルの間、フイールドメモリ8へのア
ドレス更新を中止して該メモリ8へ信号処理回路
4からの内容を書き込まないようになれば、ノイ
ズバーを除去してフイールドメモリ8への書き込
みを行うことができることとなる。 By the way, when the rising and falling points between the two fields of the signals shown in FIG. 2a and b are detected, the waveform shown in FIG. 2c is obtained, and the "H" level portion of this waveform represents the noise bar portion. Therefore, Figure c
If the address update to the field memory 8 is stopped and the contents from the signal processing circuit 4 are no longer written to the memory 8 while the signal is at "H" level, the noise bar is removed and writing to the field memory 8 is stopped. It is something that can be done.
以上述べた動作を、第3図に示すマイコン20
のフローチヤートを参照しながら説明する。 The operations described above are performed by the microcomputer 20 shown in FIG.
This will be explained with reference to the flowchart.
第3図のフローチヤートにおいて、まずマイコ
ン20内のデータメモリ23のアドレスを初期化
してアドレス“1”を設定する(ステツプ100)。
次に信号処理回路4から得られる垂直同期信号の
立上り検出(ステツプ101)すると、マイコン2
0内のタイマ24を初期化したスタートさせる
(ステツプ103〜104)。もし垂直同期信号の立上り
が検出されない時は、検出するまで持つか、又は
処理動作の途中であれば次の処理へ移行する(ス
テツプ102)。 In the flowchart of FIG. 3, first, the address of the data memory 23 in the microcomputer 20 is initialized and set to address "1" (step 100).
Next, when the rising edge of the vertical synchronizing signal obtained from the signal processing circuit 4 is detected (step 101), the microcomputer 2
The timer 24 in 0 is initialized and started (steps 103-104). If the rising edge of the vertical synchronizing signal is not detected, the process is held until it is detected, or if the processing operation is in progress, the process moves to the next process (step 102).
次に第2図aに示すコンパレータ6の出力を読
み込み、現在までの論理レベルと反転したか否か
を判断する(ステツプ105)。もし反転していなけ
れば、反転するまで持つ。反転していたならば、
その時点のタイマ値をデータメモリ23の指定さ
れたアドレス位置に書き込む。そしてアドレスを
+1更新する(ステツプ106〜107)。即ち、ここ
では処理ステツプ(100)で指定されたアドレス
1番地にタイマ値が書き込まれた後、アドレスが
2番地となる。この書き込まれた内容は、第2図
aの波形で示すT1値である。 Next, the output of the comparator 6 shown in FIG. 2a is read, and it is determined whether or not the logic level has been inverted to the current level (step 105). If it is not reversed, hold it until it is reversed. If it had been reversed,
The timer value at that time is written to the designated address location of the data memory 23. Then, the address is updated by +1 (steps 106-107). That is, here, after the timer value is written to address 1 specified in processing step (100), the address becomes address 2. This written content is the T1 value shown by the waveform in FIG. 2a.
次に処理ステツプ(107)で+1したアドレス
値が“7”と等しくなつたか否かを判断する(ス
テツプ108)。これは第2図a,bの波形のT1値
〜T6値を測定後、それぞれの値に対する書き込
みメモリアドレスは“1”〜“6”であるため、
アドレス値“7”では測定を終了したことを表わ
す。従つてアドレス値“7”以下の値、つまり
“1”〜“6”であれば、上記に述べたステツプ
(101)〜(107)の繰り返して、T1値測定後、該
当メモリ位置に内容書き込んだのと全く同じ方法
でT2〜T6値も測定でき、これが該当メモリ位置
に書き込まれる。ここで、T1〜T6値の測定が終
了すると、一度データメモリ23のアドレスをリ
セツトして1番地にする(ステツプ109)。 Next, it is determined whether the address value incremented by 1 in the processing step (107) has become equal to "7" (step 108). This is because after measuring the T1 value to T6 value of the waveforms in Figure 2 a and b, the write memory address for each value is "1" to "6".
Address value "7" indicates that the measurement has ended. Therefore, if the address value is less than "7", that is, "1" to "6", repeat steps (101) to (107) described above to measure the T1 value and then write the contents to the corresponding memory location. In exactly the same way, T2-T6 values can also be measured and written to the appropriate memory location. When the measurement of the T1 to T6 values is completed, the address of the data memory 23 is reset to address 1 (step 109).
これからの処理は、今までの処理で得られた
T1〜T6値をもとにして、ノイズバー位置を割り
出すための処理である。つまり、再度ビデオ信号
処理回路4からの垂直同期信号の立上りを検出す
る(ステツプ110)と、メモリコントロール回路
7への出力を“L”レベルにセツトする(ステツ
プ111)。その後タイマ24をリセツト後、再スタ
ートさせる(処理ステツプ112〜113)。 The future processing will be based on the results obtained from the previous processing.
This is a process for determining the noise bar position based on the T1 to T6 values. That is, when the rising edge of the vertical synchronizing signal from the video signal processing circuit 4 is detected again (step 110), the output to the memory control circuit 7 is set to the "L" level (step 111). Thereafter, the timer 24 is reset and restarted (processing steps 112 to 113).
次にマイコンプロセツサ25は、スタートした
タイマ24の値とデータメモリ23内のアドレス
“1”〜“6”の内容、つまりT1〜T6値とを比
較する(ステツプ114〜119)。このようにすると、
まず最初にアドレス“1”の内容であるT1値が
同じになる(ステツプ114)。ここで、出力として
いた“L”レベルを反転させ“H”レベルを出力
する(ステツプ120)。そして次には、アドレス
“4”の内容、つまりT4値が同じになる(ステツ
プ117)。この時も同様に、出力レベルを反転して
“L”レベルとする(ステツプ120)。以上のよう
に、残りのT2,T3,T5,T6の各値に対しても
同様に行えば、第2図cに示す波形が得られる。
なお、T6値に対する処理(ステツプ121)終了後
は1フイールドにおける処理が終了したのと同じ
であるから、再度判断ステツプ110に戻り次回の
フイールドの処理に備える。 Next, the microcomputer processor 25 compares the value of the started timer 24 with the contents of addresses "1" to "6" in the data memory 23, that is, the values T1 to T6 (steps 114 to 119). In this way,
First, the T1 values, which are the contents of address "1", become the same (step 114). Here, the "L" level output is inverted and the "H" level is output (step 120). Then, the contents of address "4", that is, the T4 value, become the same (step 117). At this time as well, the output level is similarly inverted to the "L" level (step 120). As described above, if the same procedure is performed for each of the remaining values of T2, T3, T5, and T6, the waveform shown in FIG. 2c will be obtained.
Note that after the processing for the T6 value (step 121) is completed, it is the same as the processing for one field has been completed, so the process returns to the judgment step 110 again to prepare for the processing of the next field.
このような本実施例では、ノイズバー位置に対
応するメモリ番地にはデータを書き込まないよう
にしたので、特殊なヘツドや多くのヘツド構成を
用いることなくノイズレスの高速再生が可能とな
り、また再生されるビデオテープを実際に高速再
生して得られた再生信号よりノイズ位置情報を得
るようにしたので、どのようなフオーマツトでビ
デオトラツクが記録されていてもノイズレスの高
速再生が可能となる。さらに本実施例では、後で
メモリ内のアドレス操作によりノイズ部分を除い
て再度メモリ内容を並べかえる等の操作をする必
要がなく、リアルタイムでメモリ内容を非同期で
読み出すのに新たな操作を必要としない。 In this embodiment, data is not written to the memory address corresponding to the noise bar position, so it is possible to perform noiseless high-speed playback without using a special head or a large number of head configurations. Since noise position information is obtained from the reproduction signal obtained by actually reproducing the video tape at high speed, noiseless high-speed reproduction is possible no matter what format the video track is recorded in. Furthermore, in this embodiment, there is no need to perform operations such as removing noise portions and rearranging the memory contents again using address operations in the memory, and no new operations are required to read out the memory contents asynchronously in real time. do not.
ここで、本実施例ではノイズバーは比較的大き
くない例を述べているので、ノイズバーに相当す
る部分を除いて記録することによる無記録部分は
表示エリアからはずれるので問題はない。しか
し、ノイズバーがある程度大きい時は、無記録部
分が表示エリアの下方に表れることがある。この
ような場合、表示エリアの上方にダミー無記録帯
を挿入し、真の映像部分を表示エリアの中央部に
持つてくるようにフイールドメモリのアドレスを
変更するのが望ましい。 Here, in this embodiment, an example in which the noise bar is not relatively large is described, so there is no problem because the unrecorded part caused by recording except for the part corresponding to the noise bar is out of the display area. However, when the noise bar is large to a certain extent, unrecorded portions may appear below the display area. In such a case, it is desirable to insert a dummy non-recording zone above the display area and change the address of the field memory so that the true video portion is located in the center of the display area.
なお、上記実施例では高速再生として4倍速を
述べたが、本発明はこの4倍速に限られるもので
はなく、偶数倍速であればどのような高速再生に
も適用でき、上記実施例と同様の効果が得られ
る。 In the above embodiment, 4x speed was described as high-speed playback, but the present invention is not limited to this 4x speed, but can be applied to any even numbered speed, and the present invention can be applied to any even-numbered high-speed playback. Effects can be obtained.
また、上記実施例ではマイコンを使用したが、
各制御手段はハードウエアで構成してもよく、上
記実施例と同様の効果が得られる。 In addition, although a microcomputer was used in the above embodiment,
Each control means may be constituted by hardware, and the same effects as in the above embodiment can be obtained.
以上のように、本発明によれば、再生信号のエ
ンベロープ検波信号よりノイズバー位置を予測
し、このノイズバー位置に対応するメモリ番地に
はデータを書き込まないようにしたので、複雑な
構成を用いることなく、またどのような記録フオ
ーマツトのものにおいてもノイズレスの高速再生
が可能となる効果がある。
As described above, according to the present invention, the noise bar position is predicted from the envelope detection signal of the reproduced signal, and data is not written to the memory address corresponding to the noise bar position, so there is no need to use a complicated configuration. , and has the effect of enabling noiseless high-speed reproduction of any recording format.
第1図は本発明の一実施例による映像記録再生
装置のブロツク構成図、第2図は該装置の動作を
説明するための動作波形図、第3図は該装置の動
作を説明するためのフローチヤート図、第4図は
従来の映像記録再生装置のブロツク構成図、第5
図はガードバンドレス記録したビデオトラツクを
高速再生した場合のヘツド軌跡を示す図、第6図
はその再生信号のプリアンプ出力を示す図、第7
図はガードバンド記録したビデオトラツクを高速
再生した場合のヘツド軌跡を示す図、第8図はそ
の再生信号のプリアンプ出力を示す図である。
1……磁気テープ、2a,2b……磁気ヘツ
ド、5……エンベロープ検波器、6……コンパレ
ータ、7……メモリコントロール回路、8……フ
イールドメモリ、20……マイクロコンピユー
タ。なお図中同一符号は同一又は相当部分を示
す。
FIG. 1 is a block configuration diagram of a video recording and reproducing apparatus according to an embodiment of the present invention, FIG. 2 is an operational waveform diagram for explaining the operation of the apparatus, and FIG. 3 is a diagram for explaining the operation of the apparatus. Flowchart diagram, Figure 4 is a block diagram of a conventional video recording and reproducing device, Figure 5 is a block diagram of a conventional video recording and reproducing device.
The figure shows the head trajectory when a video track recorded without guard band is played back at high speed. Figure 6 shows the preamplifier output of the playback signal. Figure 7
The figure shows the head locus when a guard band recorded video track is played back at high speed, and FIG. 8 shows the preamplifier output of the playback signal. DESCRIPTION OF SYMBOLS 1... Magnetic tape, 2a, 2b... Magnetic head, 5... Envelope detector, 6... Comparator, 7... Memory control circuit, 8... Field memory, 20... Microcomputer. Note that the same reference numerals in the figures indicate the same or equivalent parts.
Claims (1)
信号レベルが予め設定されている所定レベル以上
の時該再生信号をフイールドメモリに記憶し、こ
の記憶された内容を再生信号の同期信号と非同期
で読み出す映像記録再生装置において、 磁気ヘツドが上記磁気テープ上の記録トラツク
を横切る時に生ずるガードバンドノイズの位置
を、上記再生信号のエンベロープ検波信号をもと
に予測するノイズ位置予測手段と、 上記再生信号のフイールドメモリへの書き込み
において上記ノイズ位置予測手段の予測結果に基
づいてガードバンドノイズ部分に対応するメモリ
アドレス位置のアドレス指定を停止するアドレス
制御手段とを備えたことを特徴とする映像記録再
生装置。[Claims] 1. During high-speed playback, when the playback signal level from the recorded magnetic tape exceeds a predetermined level, the playback signal is stored in a field memory, and the stored content is used as the playback signal. In a video recording and reproducing apparatus that reads data asynchronously with a synchronization signal, noise position prediction means predicts the position of guard band noise generated when a magnetic head crosses a recording track on the magnetic tape based on an envelope detection signal of the reproduced signal. and address control means for stopping the addressing of the memory address position corresponding to the guard band noise portion based on the prediction result of the noise position prediction means when writing the reproduced signal to the field memory. Video recording and playback device.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60192516A JPS6251884A (en) | 1985-08-30 | 1985-08-30 | Video recording and reproducing device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60192516A JPS6251884A (en) | 1985-08-30 | 1985-08-30 | Video recording and reproducing device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6251884A JPS6251884A (en) | 1987-03-06 |
| JPH0481391B2 true JPH0481391B2 (en) | 1992-12-22 |
Family
ID=16292583
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60192516A Granted JPS6251884A (en) | 1985-08-30 | 1985-08-30 | Video recording and reproducing device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6251884A (en) |
-
1985
- 1985-08-30 JP JP60192516A patent/JPS6251884A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6251884A (en) | 1987-03-06 |
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