JPH0485833U - - Google Patents

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JPH0485833U
JPH0485833U JP12791890U JP12791890U JPH0485833U JP H0485833 U JPH0485833 U JP H0485833U JP 12791890 U JP12791890 U JP 12791890U JP 12791890 U JP12791890 U JP 12791890U JP H0485833 U JPH0485833 U JP H0485833U
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parallel
series
analog signal
input analog
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【図面の簡単な説明】
第１図はこの考案の一実施例によるＡ／Ｄ変換
器の構成図であり、第２図は従来の直並列型Ａ／
Ｄ変換器の構成図、第３図は従来の完全並立型Ａ
／Ｄ変換器の構成図である。 図において、１はアナログ信号入力端子、２は
サンプルホールド回路、３は磁容易ビツト用完全
並列型Ａ／Ｄ変換器、４は上位ビツトのＤ／Ａ変
換器、５は上位ビツトの出力端子、６はオペアン
プ、７は下位ビツト用、完全並列型Ａ／Ｄ変換器
、８は下位ビツト出力端子、９は上位ビツト選択
回路、１０は下位ビツト選択回路である。なお、
図中、同一符号は同一、または相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力アナログ信号の上位ビツトを先にデジタル
    化し、次にその値をＤ／Ａ変換し、入力アナログ
    信号との差を演算し、その結果をデジタル化する
    ことで下位ビツトを求める直並列型Ａ／Ｄ変換器
    において、入力アナログ信号をサンプルホールド
    し、上位、下位のデジタル化までの部分を並列に
    複数持ち、順番に各々の直並列型Ａ／Ｄ変換器を
    並列に動作させ各々の直並列型Ａ／Ｄ変換器のデ
    ジタル出力を順番に出力する制御回路を設けたこ
    とを特徴とするＡ／Ｄ変換器。
JP12791890U 1990-11-28 1990-11-28 Pending JPH0485833U (ja)

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JP12791890U JPH0485833U (ja) 1990-11-28 1990-11-28

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JPH0485833U true JPH0485833U (ja) 1992-07-27

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