JPH0485855A - 半導体集積回路 - Google Patents

半導体集積回路

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JPH0485855A
JPH0485855A JP19979590A JP19979590A JPH0485855A JP H0485855 A JPH0485855 A JP H0485855A JP 19979590 A JP19979590 A JP 19979590A JP 19979590 A JP19979590 A JP 19979590A JP H0485855 A JPH0485855 A JP H0485855A
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JP
Japan
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wiring
wiring layer
layer
contact
cross
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Pending
Application number
JP19979590A
Other languages
English (en)
Inventor
Shinji Kawai
河井 伸治
Shigeru Kikuta
菊田 繁
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
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  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野1 この発明は、半導体集積回路の配線抵抗の低減方法に関
するものであるう [従来の技術] 従来、半導体集積回路で電源線や信号線のように配線長
差S長いものは、配線抵抗等の影響により信号の遅延な
−が問題になる。その対策として配線抵抗を低減させる
ための改良が試みられておりその改良の手段の一例とし
て配線を上下2層配線トシてコンタクトホールによって
両配線の電位を同一にすることで抵抗を低減させてきた
その−例を第3図および第4図に示す。
図において、(1)は第1の配線層、(2)は第2の配
線層、(3)は酸化膜、(4)は第1の量線層(1)と
第2の配線層(2)を接続させるためのコンタクトホー
ルである。第4図は、第3図に示すA−Aにおける断面
図である。
次に作用について説明する。
第1の配線層(1)と第2の配線層(2)によって上下
2層配線とし、第1の配線層(1)と第2の配線層(2
)をコンタクトホール(4)によって接続して、第1の
配線層(1)と第2の配線層(2)の電位を同一電位に
するっそうすると第1の配線層(1)と第2の配線層(
2)が同一電位になっているので、この場合の配線の断
面積は、第1の配線層(1)と第2の配線層(2)の断
面積を合わせたものKなり配線の断面積が増加したこと
に々る。ここで配線抵抗は断面積に反比例するので断面
積が大きくなれば、配線の抵抗は小さくなろうこのよう
Kして第1の配線層(1)と第2の配線層(2)の電位
をコンタクトホールで同一にすることで配線抵抗が低減
できる。
〔発明が解決しようとする課題〕
従来の半導体集積回路は以上のように構成されているの
で、第1の配線層と第2の配線層のコンタクト部分の断
面は第4図のようになり、コンタクトホールの大きさ、
数を変えても配線の断面積は変わらないという問題点が
あった。
この発明は、以上のような問題点を解消するためになさ
れたもので、配線の断面積を増やすことにより配線の抵
抗を低減させた半導体集積回路を得ることを目的とする
〔課題を解決するための手段〕
この発明に係る半導体集積回路は、第1の配線層及び第
2の配線層にそって、導電性材料で第1の配線層と第2
の配線層間のコンタクトを設けて第1の配線層シよび第
2の配線層の配線間にそって4電性材料の層を形成した
ものである、[作用] この発明によれば、第1の配線層と第2の配線層にそっ
て中間に4電性材料のコンタクトをもうけ、第1の配線
層と第2の配線層の間にそって導電性材料の層を形成す
るのでこの導電性材料の分だけ配線の断面積が増加する
。したがって、この配線の断面積増加により配線抵抗が
低減するっC実施例〕 以下、この発明の一実施例を図について説明する。第1
図は半導体集積回路の側面断面図、第2図は第1図に示
すB−Bにおける断面図である。
図において、(5)はアルミの第1の配線層で、基板(
図示せず)上に酸化膜(図示せず)を形成した後スパッ
タで形成する、(3)は第1の配線層(5)をスパッタ
形成後に形成した酸化膜、(6)はタングステンの埋め
込み型コンタク) 、 (7)はアルミの第2の配線層
である。酸化膜(3)上で埋め込みコンタクトを形成す
る領域をエツチングし、そのエツチングした領域にタン
グステンの埋め込み型コンタクト(6)をC”JD(ケ
ミカルベーパーデポジション)Kよって形成し、その上
に第2の配線層(7)をスパッタで形成する。
上記の工程を、第1の配線層(5)と第2の配線層(7
)にそった全領域で行い、第1の配線層(5)と第2の
配線層(7)の間にタングステンの埋め込み型コンタク
ト(6)の層を形成する。
次に作用について説明する。第2図において第1の配線
層(5)と第2の配線層(7)を、タングステンの埋め
込み型コンタクト(6) Kよって接続して、第1の配
線層(5)と第2の配線層(7)の電位を同一にしであ
る。このため、タングステンの埋め込み型フンタクト(
6)の分だけ配線の断面積が増加し配線抵抗が低減され
る。たとえば、第3図の従来例では、配線の断面積を2
倍にすると配線抵抗は1になるが、この実施例では配線
の断面積を2倍にすると配線抵抗はΣ以下になる。
〔発明の効果〕
以上のように、この発明によれば、第1の配線層と第2
の配線層にそって導電性材料で上下2層間のコンタクト
をもうけ、上下2層の配線間にそって導電性材料の層を
形成し配線の断面積を増加させるように構成したので、
配線の断面積を増加させることなしに、配線の抵抗を低
減させることができる効果がある。
【図面の簡単な説明】
第1図はこの発明の一実施例による半導体集積回路を示
した断面側面図、第2図は第1図に示すB−Bにおける
断面図、第3図は従来の半導体集積回路の断面(II面
図、第4図は第3図に示すA−Aにおける断面図である
。 図において、(3)は酸化膜、(5)は第1の配線層、
(6)はタングステンの埋め込み型コンタクト、(7)
は第2の配線層である。 なお、各図中、同一符号は同一、又は相当部分を示す。 代 珊 人  大  岩   増  雄第1図 sJ、7のアルミ配4象層 t クシグ又テンの3[/>i/−1シψコンタクト7
8zめアルJ乙予泉層 第2図 3醍化肢 第3図 1:第1の配縁層 2:第20配線層 3’a′L4tzx爽 4−:コンタクトホーンレ 第4図

Claims (1)

    【特許請求の範囲】
  1.  半導体基板上に形成された第1の配線層と上記第1の
    配線層上に形成した第2の配線層を有し、上記第1の配
    線層と上記第2の配線層間のコンタクトを上記第1の配
    線層及び上記第2の配線層とは異なる別の導電性材料に
    よつて行う半導体集積回路において、上記第1の配線層
    と上記第2の配線層にそつて、上記コンタクトをもうけ
    ることにより、上記導電性材料による層が、上記第1の
    配線層と上記第2の配線層にそつて形成されたことを特
    徴とする半導体集積回路。
JP19979590A 1990-07-26 1990-07-26 半導体集積回路 Pending JPH0485855A (ja)

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JP19979590A JPH0485855A (ja) 1990-07-26 1990-07-26 半導体集積回路

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JPH0485855A true JPH0485855A (ja) 1992-03-18

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