JPH05183569A - ポリシング制御方式 - Google Patents
ポリシング制御方式Info
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- JPH05183569A JPH05183569A JP34463191A JP34463191A JPH05183569A JP H05183569 A JPH05183569 A JP H05183569A JP 34463191 A JP34463191 A JP 34463191A JP 34463191 A JP34463191 A JP 34463191A JP H05183569 A JPH05183569 A JP H05183569A
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Abstract
(57)【要約】
【目的】 ＡＴＭ伝送網の各ノードにおけるＡＴＭセル
（固定長パケット）のポリシング制御方式に関し、メモ
リのアクセス時間の制約を考慮する必要のないポリシン
グ制御方式を実現することを目的とする。 【構成】 判定対象となる固定長パケットの到着時刻を
蓄積するメモリ１に蓄積された固定長パケットの現在の
到着時刻と所定の個数Ｘ前に到着した時刻との時間間隔
を所定の時間間隔Ｔと比較して該所定の時間間隔内に通
過する該固定長パケットの個数が規定された該所定の個
数を越えているか否かを判定し、該固定長パケットの個
数が該所定の個数Ｘを越えないように違反パケットを廃
棄制御するように構成する。
（固定長パケット）のポリシング制御方式に関し、メモ
リのアクセス時間の制約を考慮する必要のないポリシン
グ制御方式を実現することを目的とする。 【構成】 判定対象となる固定長パケットの到着時刻を
蓄積するメモリ１に蓄積された固定長パケットの現在の
到着時刻と所定の個数Ｘ前に到着した時刻との時間間隔
を所定の時間間隔Ｔと比較して該所定の時間間隔内に通
過する該固定長パケットの個数が規定された該所定の個
数を越えているか否かを判定し、該固定長パケットの個
数が該所定の個数Ｘを越えないように違反パケットを廃
棄制御するように構成する。
Description
【０００１】
【産業上の利用分野】本発明はポリシング制御方式に関
し、特にＡＴＭ伝送網の各ノードにおけるＡＴＭセル
（固定長パケット）のポリシング制御方式に関するもの
である。
し、特にＡＴＭ伝送網の各ノードにおけるＡＴＭセル
（固定長パケット）のポリシング制御方式に関するもの
である。
【０００２】広範囲なマルチメディアサービスを目指す
高速・広帯域統合網（Ｂ−ＩＳＤＮ）の実現技術として
最近、ＡＴＭ(Asynchronous Transfer Mode ：非同期転
送技術) 伝送網の研究が活発に行われている。
高速・広帯域統合網（Ｂ−ＩＳＤＮ）の実現技術として
最近、ＡＴＭ(Asynchronous Transfer Mode ：非同期転
送技術) 伝送網の研究が活発に行われている。
【０００３】このＡＴＭ伝送網には、図６(a) に示すよ
うに加入者側に電話等の音声端末、テレビ端末等のビジ
ュアル端末、ファックス、コンピュータ間の伝送端末等
がつながっており、同図(b) に示すようにヘッダ部（５
バイト）とペイロード部（４８バイト）とで構成された
セル（以下、固定長パケットと称する）形式で全ての情
報を統一して多くのノード、即ちＡＴＭ伝送網のクロス
コネクト装置間のパスを非同期伝送するもので、情報が
発生したときのみに固定長パケットを送出することで回
線の使用効率が上がり、また、低速から高速まで全ての
速度を一元的に扱うことができるので、ＳＴＭ(Synchro
nous Transfer Mode: 同期転送技術) 伝送網と比較して
タイムスロット割り当て処理の手間が無くなるため、分
散処理制御に適合しており、柔軟性に富んだ多重化伝送
が可能となる。
うに加入者側に電話等の音声端末、テレビ端末等のビジ
ュアル端末、ファックス、コンピュータ間の伝送端末等
がつながっており、同図(b) に示すようにヘッダ部（５
バイト）とペイロード部（４８バイト）とで構成された
セル（以下、固定長パケットと称する）形式で全ての情
報を統一して多くのノード、即ちＡＴＭ伝送網のクロス
コネクト装置間のパスを非同期伝送するもので、情報が
発生したときのみに固定長パケットを送出することで回
線の使用効率が上がり、また、低速から高速まで全ての
速度を一元的に扱うことができるので、ＳＴＭ(Synchro
nous Transfer Mode: 同期転送技術) 伝送網と比較して
タイムスロット割り当て処理の手間が無くなるため、分
散処理制御に適合しており、柔軟性に富んだ多重化伝送
が可能となる。
【０００４】このようなＡＴＭ伝送網を加入者系に用い
た場合、自由な固定長パケットの送出を加入者に許容す
ると情報発生の頻度の違いにより加入者間で不公平が生
じるため、各ノードにおいて存在する伝送網（ネットワ
ーク）の供給者と加入者との間で単位時間当たりに送出
できる固定長パケットの上限を予め契約し、加入者はそ
の契約に従って固定長パケットを送出し、伝送網の供給
者は、加入者が契約の範囲内の量で固定長パケットを送
出しているかどうかを、伝送網の入口でチェックして自
ネットワークを防御するための「ポリシング制御機能」
が必要とされている。
た場合、自由な固定長パケットの送出を加入者に許容す
ると情報発生の頻度の違いにより加入者間で不公平が生
じるため、各ノードにおいて存在する伝送網（ネットワ
ーク）の供給者と加入者との間で単位時間当たりに送出
できる固定長パケットの上限を予め契約し、加入者はそ
の契約に従って固定長パケットを送出し、伝送網の供給
者は、加入者が契約の範囲内の量で固定長パケットを送
出しているかどうかを、伝送網の入口でチェックして自
ネットワークを防御するための「ポリシング制御機能」
が必要とされている。
【０００５】
【従来の技術】上記のようなポリシング制御機能を実現
する有力な候補としていわゆるＤＢ（危険な橋）法が提
案されている。このＤＢ法はその名の通り、「危険な
橋」を同時に通過出来る人数を制限することと等価の制
御をパケットに対して施すものであり、図７(a) に示す
ように長さＴパケット時間の橋ＤＢの上に同時に存在可
能なパケットの個数をＸ個とし、同図(b) に示すように
カウンタＣが橋ＤＢの上のパケットの個数を常に計数
し、この計数値がＸを越えるとポリシング契約に違反し
ているものと判定する事を原理としている。
する有力な候補としていわゆるＤＢ（危険な橋）法が提
案されている。このＤＢ法はその名の通り、「危険な
橋」を同時に通過出来る人数を制限することと等価の制
御をパケットに対して施すものであり、図７(a) に示す
ように長さＴパケット時間の橋ＤＢの上に同時に存在可
能なパケットの個数をＸ個とし、同図(b) に示すように
カウンタＣが橋ＤＢの上のパケットの個数を常に計数
し、この計数値がＸを越えるとポリシング契約に違反し
ているものと判定する事を原理としている。
【０００６】このようなＤＢ法の具体的な従来技術が図
８に示されており、まず入力した全ての固定長パケット
はヘッダーにおけるＶＰＩ(Virtual Path Identificati
on)が取り出されてタイマカウンタ２２の制御下でブリ
ッジメモリ２１に順次書き込まれて行く。
８に示されており、まず入力した全ての固定長パケット
はヘッダーにおけるＶＰＩ(Virtual Path Identificati
on)が取り出されてタイマカウンタ２２の制御下でブリ
ッジメモリ２１に順次書き込まれて行く。
【０００７】一方、入力した固定長パケットはＶＰＩ毎
にポリシング制御を行うものとすると、ＶＰＩフィルタ
２３で所定のＶＰＩのみが取り出されてパケット数カウ
ンタ２８に与えられ一つづつカウントアップされて行
く。
にポリシング制御を行うものとすると、ＶＰＩフィルタ
２３で所定のＶＰＩのみが取り出されてパケット数カウ
ンタ２８に与えられ一つづつカウントアップされて行
く。
【０００８】但し、このカウンタ２８は、タイマカウン
タ２２の制御下で逐次移動して行くブリッジメモリ２１
のタップ位置を示す信号（メモリ２１の最初のメモリセ
ルからの時間を示す信号）が、上記のＤＢ法におけるポ
リシングパラメータとしての時間Ｔを発生するポリシン
グパラメータ発生部２５からの時間Ｔと比較部２６で比
較し一致したときであって且つその時間Ｔに対応したタ
ップ位置のＶＰＩが所定のＶＰＩであるとき、そのＶＰ
ＩがＶＰＩフィルタ２４で検出された時には比較部２６
及びＶＰＩフィルタ２４の両出力信号によりＡＮＤゲー
ト２７が開かれてカウンタ２８がその分だけ一つづつカ
ウントダウンされて行くようになっている。
タ２２の制御下で逐次移動して行くブリッジメモリ２１
のタップ位置を示す信号（メモリ２１の最初のメモリセ
ルからの時間を示す信号）が、上記のＤＢ法におけるポ
リシングパラメータとしての時間Ｔを発生するポリシン
グパラメータ発生部２５からの時間Ｔと比較部２６で比
較し一致したときであって且つその時間Ｔに対応したタ
ップ位置のＶＰＩが所定のＶＰＩであるとき、そのＶＰ
ＩがＶＰＩフィルタ２４で検出された時には比較部２６
及びＶＰＩフィルタ２４の両出力信号によりＡＮＤゲー
ト２７が開かれてカウンタ２８がその分だけ一つづつカ
ウントダウンされて行くようになっている。
【０００９】従って、このカウンタ２８のカウント値と
上記の図７(a) に示した存在可能なパケット数Ｘを発生
するポリシングパラメータ発生部２９からの値Ｘとを比
較してこのカウント値がＸを越えている時には廃棄制御
部３１でそのときの固定長パケットを廃棄するように制
御する。
上記の図７(a) に示した存在可能なパケット数Ｘを発生
するポリシングパラメータ発生部２９からの値Ｘとを比
較してこのカウント値がＸを越えている時には廃棄制御
部３１でそのときの固定長パケットを廃棄するように制
御する。
【００１０】
【発明が解決しようとする課題】このように従来のポリ
シング制御方式では、ブリッジメモリ２１からＶＰＩを
読み出すとき、１固定パケット時間にタップの個数分だ
けメモリアクセスを行う必要があり、メモリのアクセス
時間の制約から実現が困難であり、又ブリッジメモリや
カウンタのソフトエラーの履歴が有限時間内に消滅しな
いという問題があった。
シング制御方式では、ブリッジメモリ２１からＶＰＩを
読み出すとき、１固定パケット時間にタップの個数分だ
けメモリアクセスを行う必要があり、メモリのアクセス
時間の制約から実現が困難であり、又ブリッジメモリや
カウンタのソフトエラーの履歴が有限時間内に消滅しな
いという問題があった。
【００１１】従って、本発明は、メモリのアクセス時間
の制約を考慮する必要のないポリシング制御方式を実現
することを目的とする。
の制約を考慮する必要のないポリシング制御方式を実現
することを目的とする。
【００１２】
【課題を解決するための手段及び作用】本発明では上記
のＤＢ法に於ける時間Ｔとパケット数Ｘとの関係を逆転
させてポリシング制御を行おうとするものである。
のＤＢ法に於ける時間Ｔとパケット数Ｘとの関係を逆転
させてポリシング制御を行おうとするものである。
【００１３】即ち、本発明では、図１(a) に示すよう
に、Ｘ＋１個の固定長パケットが到着するのに要した時
間がＴを越えたような場合にはパケットの転送密度が少
なく正常なものと判定できるし、また逆にＸ＋１個のパ
ケットが到着するのに要した時間がＴ未満である場合に
はパケット転送密度が高く違反しているものと判定する
ことができる。
に、Ｘ＋１個の固定長パケットが到着するのに要した時
間がＴを越えたような場合にはパケットの転送密度が少
なく正常なものと判定できるし、また逆にＸ＋１個のパ
ケットが到着するのに要した時間がＴ未満である場合に
はパケット転送密度が高く違反しているものと判定する
ことができる。
【００１４】このように判定対象となる固定長パケット
の到着時間を監視し、この固定長パケットの現在の時刻
と所定の個数Ｘ前に到着した時刻との時間間隔を所定の
時間間隔Ｔと比較することによりこの所定の時間間隔Ｔ
内に通過する固定長パケットの個数を予め規定された所
定の個数Ｘ以下に制限する事が出来る。
の到着時間を監視し、この固定長パケットの現在の時刻
と所定の個数Ｘ前に到着した時刻との時間間隔を所定の
時間間隔Ｔと比較することによりこの所定の時間間隔Ｔ
内に通過する固定長パケットの個数を予め規定された所
定の個数Ｘ以下に制限する事が出来る。
【００１５】図１(a) に示すような原理を実施する手段
が同図(b) に示されており、判定対象となる固定長パケ
ットの到着時刻を蓄積するメモリ１と、このメモリ１に
蓄積された固定長パケットの現在の時刻と所定の個数Ｘ
前に到着した時刻との時間間隔を所定の時間間隔Ｔと比
較してその所定の時間間隔Ｔ内に通過する固定長パケッ
トの個数が規定された所定の個数Ｘを越えているか否か
を判定する比較手段２と、この比較手段２の出力信号
が、固定長パケットの個数が所定の個数Ｘを越えている
違反時を示している時にはその時の固定長パケットを廃
棄して所定の個数Ｘ以下に制限する手段３とを備えてい
る。
が同図(b) に示されており、判定対象となる固定長パケ
ットの到着時刻を蓄積するメモリ１と、このメモリ１に
蓄積された固定長パケットの現在の時刻と所定の個数Ｘ
前に到着した時刻との時間間隔を所定の時間間隔Ｔと比
較してその所定の時間間隔Ｔ内に通過する固定長パケッ
トの個数が規定された所定の個数Ｘを越えているか否か
を判定する比較手段２と、この比較手段２の出力信号
が、固定長パケットの個数が所定の個数Ｘを越えている
違反時を示している時にはその時の固定長パケットを廃
棄して所定の個数Ｘ以下に制限する手段３とを備えてい
る。
【００１６】従って、本発明では、固定長パケットの到
着時刻をメモリ１に蓄積しておき、比較手段２がこの固
定長パケットの現在の時刻と所定の個数Ｘ前に到着した
時刻との時間間隔を所定の時間間隔Ｔと比較することに
より、この所定の時間間隔Ｔ内に通過する固定長パケッ
トの個数が予め規定された所定の個数Ｘ以下になるよう
に廃棄手段３において制限する事が出来る。
着時刻をメモリ１に蓄積しておき、比較手段２がこの固
定長パケットの現在の時刻と所定の個数Ｘ前に到着した
時刻との時間間隔を所定の時間間隔Ｔと比較することに
より、この所定の時間間隔Ｔ内に通過する固定長パケッ
トの個数が予め規定された所定の個数Ｘ以下になるよう
に廃棄手段３において制限する事が出来る。
【００１７】従って、メモリタップの個数分アクセスす
るという必要は無くなりメモリのアクセス速度が大幅に
緩和される。
るという必要は無くなりメモリのアクセス速度が大幅に
緩和される。
【００１８】また、本発明では、該廃棄手段３が該固定
長パケットを廃棄するとき、該メモリ１に該到着時刻を
書き込むのを禁止することができ、以てネットワークに
流入するパケットの個数とメモリ内のパケットの個数と
が一致するようにしてより正確なポリシング制御を実現
している。
長パケットを廃棄するとき、該メモリ１に該到着時刻を
書き込むのを禁止することができ、以てネットワークに
流入するパケットの個数とメモリ内のパケットの個数と
が一致するようにしてより正確なポリシング制御を実現
している。
【００１９】また、上記においては固定長パケットの到
着時刻を監視しているが、メモリ１はこのような到着時
刻の変わりに隣接する固定長パケット間の到着時間間隔
を記憶し、比較手段２が所定の個数Ｘ前に到着した時刻
にその到着時間間隔を所定の個数Ｘ分だけ加えることに
より生成しても同様のポリシング制御を行うなう事が出
来る。
着時刻を監視しているが、メモリ１はこのような到着時
刻の変わりに隣接する固定長パケット間の到着時間間隔
を記憶し、比較手段２が所定の個数Ｘ前に到着した時刻
にその到着時間間隔を所定の個数Ｘ分だけ加えることに
より生成しても同様のポリシング制御を行うなう事が出
来る。
【００２０】上記の場合に、該到着時間間隔は、固定長
パケットの到着時にタイマカウンタをリセットすること
により該メモリ１に与えることもできる。
パケットの到着時にタイマカウンタをリセットすること
により該メモリ１に与えることもできる。
【００２１】また本発明では上記のメモリ１は、到着す
る固定長パケットの属性（例えばＶＰＩ、ＶＣ）毎に設
けることが出来、また上記の所定の時間間隔Ｔ及び所定
の個数Ｘのうち少なくとも一方が、それらの各属性毎に
異なるようにすることが出来る。
る固定長パケットの属性（例えばＶＰＩ、ＶＣ）毎に設
けることが出来、また上記の所定の時間間隔Ｔ及び所定
の個数Ｘのうち少なくとも一方が、それらの各属性毎に
異なるようにすることが出来る。
【００２２】
【実施例】図２は、本発明に係るポリシング制御方式の
実施例を示したもので、図中、１は判定対象となるＸ個
の固定長パケットの到着時刻を蓄積する例えばＲＡＭと
ポインタとによって構成される論理的なシフトレジスタ
等のメモリであり、２はこのメモリ１における最も古い
時刻ｔX と現在の時刻ｔとを比較する比較部であり、３
は入力する固定長パケットを比較部２からの比較結果に
基づいて出力又は廃棄制御部である。
実施例を示したもので、図中、１は判定対象となるＸ個
の固定長パケットの到着時刻を蓄積する例えばＲＡＭと
ポインタとによって構成される論理的なシフトレジスタ
等のメモリであり、２はこのメモリ１における最も古い
時刻ｔX と現在の時刻ｔとを比較する比較部であり、３
は入力する固定長パケットを比較部２からの比較結果に
基づいて出力又は廃棄制御部である。
【００２３】又、この実施例では、比較部２における時
間の基準値を与えるものとしてポリシングパラメータ発
生部５を設けており、更にメモリ１及び比較部２への時
刻を与える為、タイマーカウンタ６が設けられている。
尚、この実施例では、固定長パケットの属性としてＶＰ
Ｉを用い、所定のＶＰＩについてポリシング制御を行う
ものであり、その為、ＶＰＩフィルタ４を設けてある。
尚、固定長パケットの属性としてその他、ヘッダにおけ
るＶＣＩ(Virtual Channel Identification)等を用いて
もよい。
間の基準値を与えるものとしてポリシングパラメータ発
生部５を設けており、更にメモリ１及び比較部２への時
刻を与える為、タイマーカウンタ６が設けられている。
尚、この実施例では、固定長パケットの属性としてＶＰ
Ｉを用い、所定のＶＰＩについてポリシング制御を行う
ものであり、その為、ＶＰＩフィルタ４を設けてある。
尚、固定長パケットの属性としてその他、ヘッダにおけ
るＶＣＩ(Virtual Channel Identification)等を用いて
もよい。
【００２４】この様な実施例の動作においては、先ず固
定長パケットが入力すると、この中でＶＰＩ毎にポリシ
ング制御方式を行うため、先ずＶＰＩフィルタ４で所定
のＶＰＩが検出され、この時にフィルタ４からメモリ１
に対して書込制御のイネーブル信号が与えられ、この時
点での時刻がタイマーカウンタ６より与えられて到着時
刻ｔ1 として蓄積される。
定長パケットが入力すると、この中でＶＰＩ毎にポリシ
ング制御方式を行うため、先ずＶＰＩフィルタ４で所定
のＶＰＩが検出され、この時にフィルタ４からメモリ１
に対して書込制御のイネーブル信号が与えられ、この時
点での時刻がタイマーカウンタ６より与えられて到着時
刻ｔ1 として蓄積される。
【００２５】この様にして、所定のＶＰＩのパケットが
到着する度にメモリ１にその到着時刻が書き込まれて行
き、Ｘ個のパケットが到着するとメモリ１に全ての到着
時刻が蓄積され、その内の最も古い到着時刻であるＸ個
前の到着時刻ｔX が比較部２に与えられる。
到着する度にメモリ１にその到着時刻が書き込まれて行
き、Ｘ個のパケットが到着するとメモリ１に全ての到着
時刻が蓄積され、その内の最も古い到着時刻であるＸ個
前の到着時刻ｔX が比較部２に与えられる。
【００２６】この時、比較部２は現在の到着時刻ｔがタ
イマカウンタ６より与えられるので比較部２ではｔ−ｔ
X を計算し、この計算値がポリシングパラメータ発生部
５からの閾値であるＴより大きいか小さいかを比較す
る。
イマカウンタ６より与えられるので比較部２ではｔ−ｔ
X を計算し、この計算値がポリシングパラメータ発生部
５からの閾値であるＴより大きいか小さいかを比較す
る。
【００２７】この結果、ｔ−ｔX ≧Ｔであれば、Ｘ個の
パケットが到着するまでに所定の時間間隔Ｔ以上かかっ
たことになりパケットが正常に転送されていることが示
されているので比較部２は廃棄制御部３から固定長パケ
ットがそのまま転送されるように制御する。
パケットが到着するまでに所定の時間間隔Ｔ以上かかっ
たことになりパケットが正常に転送されていることが示
されているので比較部２は廃棄制御部３から固定長パケ
ットがそのまま転送されるように制御する。
【００２８】一方、ｔ−ｔX ＜Ｔであれば、Ｘ個のパケ
ットが到着するまでにかかった時間が所定の時間間隔Ｔ
以内であったことになりパケットが正常に転送されてい
ることが示されているので比較部２は廃棄制御部３から
固定長パケットが転送されないように廃棄処分を行うこ
ととなる。
ットが到着するまでにかかった時間が所定の時間間隔Ｔ
以内であったことになりパケットが正常に転送されてい
ることが示されているので比較部２は廃棄制御部３から
固定長パケットが転送されないように廃棄処分を行うこ
ととなる。
【００２９】上記の実施例では、メモリ１に各パケット
の到着時刻を書き込んだが、隣接するパケットの到着時
間間隔を書き込んでも同様にポリシング制御を行うこと
が出来、この場合の実施例が図３に示されている。
の到着時刻を書き込んだが、隣接するパケットの到着時
間間隔を書き込んでも同様にポリシング制御を行うこと
が出来、この場合の実施例が図３に示されている。
【００３０】即ち、この実施例では特にタイマカウンタ
６からの到着時刻を常に入力して前回に到着したパケッ
トの時刻としてラッチするラッチ部１１と、このラッチ
部１１にラッちされた前回の到着時刻と現在の時刻との
時間間隔を計算してメモリ１に与える差分計算部１２
と、メモリ１の各メモリーセル（この場合には上記の実
施例と異なり最初のメモリーセルｔ1 は必要なくな
る。）の各到着時刻を加算して比較部２へ伝える加算器
１３とを設けている。
６からの到着時刻を常に入力して前回に到着したパケッ
トの時刻としてラッチするラッチ部１１と、このラッチ
部１１にラッちされた前回の到着時刻と現在の時刻との
時間間隔を計算してメモリ１に与える差分計算部１２
と、メモリ１の各メモリーセル（この場合には上記の実
施例と異なり最初のメモリーセルｔ1 は必要なくな
る。）の各到着時刻を加算して比較部２へ伝える加算器
１３とを設けている。
【００３１】即ち、所定のＶＰＩのパケットが到着する
毎に、隣接するパケット間の時間間隔がメモリ１に蓄積
されていき、最も古い時間間隔ｔX が蓄積された時点で
メモリーセルｔ2 からｔX までの時間間隔を加算器１３
で加算することにより上記と同様のｔ−ｔX の時間間隔
が得られ、これを閾値Ｔと比較することにより同様の廃
棄制御を行うことが出来る。
毎に、隣接するパケット間の時間間隔がメモリ１に蓄積
されていき、最も古い時間間隔ｔX が蓄積された時点で
メモリーセルｔ2 からｔX までの時間間隔を加算器１３
で加算することにより上記と同様のｔ−ｔX の時間間隔
が得られ、これを閾値Ｔと比較することにより同様の廃
棄制御を行うことが出来る。
【００３２】また、このように隣接するパケット間の時
間間隔をメモリ１に蓄積する別の実施例が図４に示され
ており、この実施例では、各ＶＰＩ毎にタイマカウンタ
６を持ち、該当するＶＰＩの固定長パケットが到着した
時に、タイマカウンタ６の値をメモリ１に入力すると共
にタイマカウンタ６にリセットをかける。
間間隔をメモリ１に蓄積する別の実施例が図４に示され
ており、この実施例では、各ＶＰＩ毎にタイマカウンタ
６を持ち、該当するＶＰＩの固定長パケットが到着した
時に、タイマカウンタ６の値をメモリ１に入力すると共
にタイマカウンタ６にリセットをかける。
【００３３】これにより、該当ＶＰＩの固定長パケット
の到着時間間隔が必要個数だけメモリ１（シフトレジス
タ）に記憶されるので、その出力値を加算器１３で合計
することにより上記のように違反の有無を判定すること
が可能となる。この場合には、図３のようなラッチ部１
１や差分計算部１２が不要となる。
の到着時間間隔が必要個数だけメモリ１（シフトレジス
タ）に記憶されるので、その出力値を加算器１３で合計
することにより上記のように違反の有無を判定すること
が可能となる。この場合には、図３のようなラッチ部１
１や差分計算部１２が不要となる。
【００３４】また、上記のように違反パケットを廃棄し
た場合、そのパケットに関する到着時刻はメモリ１に書
き込まれてしまっているので、廃棄制御部３からネット
ワ−クに流入するパケットの個数とメモリ１内のパケッ
トの個数との間に誤差が生じ、正確なポリシング制御が
出来なくなってしまうことがある。
た場合、そのパケットに関する到着時刻はメモリ１に書
き込まれてしまっているので、廃棄制御部３からネット
ワ−クに流入するパケットの個数とメモリ１内のパケッ
トの個数との間に誤差が生じ、正確なポリシング制御が
出来なくなってしまうことがある。
【００３５】そこで、これを防止するために図５に示す
ような実施例を用いることが有効となる。
ような実施例を用いることが有効となる。
【００３６】即ち、この実施例では、比較部２から廃棄
制御部３への制御信号をノット回路１４に与え、このノ
ット回路１４で反転した信号をＡＮＤゲート１５に送る
ことによりＶＰＩフィルタ４で検出された所定のＶＰＩ
のパケットが到着しても、このパケットの到着が違反に
なる時にはノット回路１４及びＡＮＤゲート１５により
書込制御信号がメモリ１に与えられなくなるので、不必
要な到着時刻の書込が防止できることとなる。
制御部３への制御信号をノット回路１４に与え、このノ
ット回路１４で反転した信号をＡＮＤゲート１５に送る
ことによりＶＰＩフィルタ４で検出された所定のＶＰＩ
のパケットが到着しても、このパケットの到着が違反に
なる時にはノット回路１４及びＡＮＤゲート１５により
書込制御信号がメモリ１に与えられなくなるので、不必
要な到着時刻の書込が防止できることとなる。
【００３７】
【発明の効果】以上のように本発明に係るポリシング制
御方式によれば、判定対象となる固定長パケットの到着
時刻を蓄積するメモリに蓄積された固定長パケットの現
在の到着時刻と所定の個数前に到着した時刻との時間間
隔を所定の時間間隔と比較して該所定の時間間隔内に通
過する該固定長パケットの個数が規定された該所定の個
数を越えているか否かを判定し、該固定長パケットの個
数が該所定の個数を越えないように違反パケットを廃棄
制御するように構成したので、メモリのアクセス速度が
大幅に低減し、従来のＤＢ法によるポリシング制御が可
能となる。また、メモリソフトエラーの影響も有限時間
内に消滅させることが出来る。
御方式によれば、判定対象となる固定長パケットの到着
時刻を蓄積するメモリに蓄積された固定長パケットの現
在の到着時刻と所定の個数前に到着した時刻との時間間
隔を所定の時間間隔と比較して該所定の時間間隔内に通
過する該固定長パケットの個数が規定された該所定の個
数を越えているか否かを判定し、該固定長パケットの個
数が該所定の個数を越えないように違反パケットを廃棄
制御するように構成したので、メモリのアクセス速度が
大幅に低減し、従来のＤＢ法によるポリシング制御が可
能となる。また、メモリソフトエラーの影響も有限時間
内に消滅させることが出来る。
【図１】本発明に係るポリシング制御方式を原理的に説
明する図である。
明する図である。
【図２】本発明に係るポリシング制御方式の実施例を示
したブロック図である。
したブロック図である。
【図３】本発明に係るポリシング制御方式の別の実施例
（到着時間間隔制御）を示したブロック図である。
（到着時間間隔制御）を示したブロック図である。
【図４】本発明に係るポリシング制御方式の更に別の実
施例（到着時間間隔制御）を示したブロック図である。
施例（到着時間間隔制御）を示したブロック図である。
【図５】本発明に係るポリシング制御方式の更に別の実
施例（違反セルの書込禁止）を示したブロック図であ
る。
施例（違反セルの書込禁止）を示したブロック図であ
る。
【図６】ＡＴＭ固定パケットの基本構造を示した図であ
る。
る。
【図７】従来方式の原理を示した図である。
【図８】従来の技術を示したブロック図である。
１ メモリ ２ 比較手段 ３ 廃棄手段 ４ ＶＰＩフィルタ ５ ポリシングパラメータ発生部 ６ タイマカウンタ １１ ラッチ部 １２ 差分計算部 １３ 加算器 １４ ノット回路 １５ ＡＮＤゲート 図中、同一符号は同一又は相当部分を示す。
フロントページの続き (72)発明者 井口 一雄 神奈川県川崎市中原区上小田中1015番地 富士通株式会社内 (72)発明者 山中 直明 東京都千代田区内幸町一丁目１番６号 日 本電信電話株式会社内 (72)発明者 佐藤 陽一 東京都千代田区内幸町一丁目１番６号 日 本電信電話株式会社内
Claims (8)
- 【請求項１】 判定対象となる固定長パケットよりも所
定の値(X) の個数前に到着した固定長パケットの到着時
刻と現在の時刻を比較し、所定の時間間隔(T) 未満か否
かを判定し、所定時間未満の時は違反セルと判断するポ
リシング制御方式。 - 【請求項２】 判定対象となる固定長パケットの到着時
刻を蓄積するメモリ(1) と、 該メモリ(1) に蓄積された該固定長パケットの現在の到
着時刻と所定の個数(X) 前に到着した時刻との時間間隔
を所定の時間間隔(T) と比較して該所定の時間間隔(T)
内に通過する該固定長パケットの個数が規定された該所
定の個数(X) を越えているか否かを判定する比較手段
(2) と、 該比較手段の出力信号が、該固定長パケットの個数が該
所定の個数(X) を越えている違反時を示しているときに
はその時の固定長パケットを廃棄して該所定の個数(X)
以下に制限する手段(3) と、 を備えたことを特徴とするポリシング制御方式。 - 【請求項３】 該メモリ(1) が、ＲＡＭとポインタとに
よって構成される論理的なシフトレジスタであることを
特徴とした請求項２に記載のポリシング制御方式。 - 【請求項４】 該廃棄手段(3) が、該固定長パケットを
廃棄するとき、該メモリ(1) に該到着時刻を書き込むの
を禁止する手段を設けたことを特徴とする請求項２又は
３に記載のポリシング制御方式。 - 【請求項５】 該メモリ(1) が、該到着時刻の代わり
に、隣接する固定長パケット間の到着時間間隔を記憶
し、該比較手段(2) が該所定の個数(X) 前に到着した時
刻を該到着時間間隔を所定の個数(X) 分だけ加えること
により生成することを特徴とした請求項２乃至４のいず
れかに記載のポリシング制御方式。 - 【請求項６】 該到着時間間隔が、固定長パケットの到
着時に固定長パケットの属性毎に設けたタイマカウンタ
をリセットすることにより該メモリ(1) に与えられるこ
とを特徴とした請求項５に記載のポリシング制御方式。 - 【請求項７】 該メモリ(1) が、到着する固定長パケッ
トの属性毎に設けられていることを特徴とした請求項２
乃至６のいずれかに記載のポリシング制御方式。 - 【請求項８】 該所定の時間間隔(T) 及び該所定の個数
(X) のうち少なくとも一方が、各属性毎に異なっている
ことを特徴とした請求項７に記載のポリシング制御方
式。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34463191A JPH05183569A (ja) | 1991-12-26 | 1991-12-26 | ポリシング制御方式 |
| EP92122070A EP0548995A2 (en) | 1991-12-26 | 1992-12-28 | Usage parameter control circuit |
| US07/996,897 US5432713A (en) | 1991-12-26 | 1992-12-28 | Usage parameter control circuit for effecting policing control in an ATM network |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34463191A JPH05183569A (ja) | 1991-12-26 | 1991-12-26 | ポリシング制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05183569A true JPH05183569A (ja) | 1993-07-23 |
Family
ID=18370758
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP34463191A Withdrawn JPH05183569A (ja) | 1991-12-26 | 1991-12-26 | ポリシング制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05183569A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6549518B1 (en) | 1997-12-25 | 2003-04-15 | Nec Corporation | Policing method and apparatus with small access amount to cell data table for policing determination |
-
1991
- 1991-12-26 JP JP34463191A patent/JPH05183569A/ja not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6549518B1 (en) | 1997-12-25 | 2003-04-15 | Nec Corporation | Policing method and apparatus with small access amount to cell data table for policing determination |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990311 |