JPH0519110B2 - - Google Patents
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- Publication number
- JPH0519110B2 JPH0519110B2 JP10524587A JP10524587A JPH0519110B2 JP H0519110 B2 JPH0519110 B2 JP H0519110B2 JP 10524587 A JP10524587 A JP 10524587A JP 10524587 A JP10524587 A JP 10524587A JP H0519110 B2 JPH0519110 B2 JP H0519110B2
- Authority
- JP
- Japan
- Prior art keywords
- alarm
- circuit
- tester
- power
- power supply
- Prior art date
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- Testing Electric Properties And Detecting Electric Faults (AREA)
- Emergency Protection Circuit Devices (AREA)
Description
【発明の詳細な説明】
［概要］
本発明はプリント板の動作を試験するためのテ
スタにおいて、交流入力が瞬断したときにも、そ
の後の交流入力を完全に遮断してテスタの動作を
停止させるため、瞬断アラーム回路と状況記憶装
置とを具備するアラーム監視機能を持つプリント
板テスタである。
スタにおいて、交流入力が瞬断したときにも、そ
の後の交流入力を完全に遮断してテスタの動作を
停止させるため、瞬断アラーム回路と状況記憶装
置とを具備するアラーム監視機能を持つプリント
板テスタである。
［産業上の利用分野］
本発明はプリント板の動作テスタに関する。
従来プリント板の動作を試験するためのテスタ
において、テスト実行中に交流遮断が起こつたと
き、直流が供給されている動作回路部分に停電状
態と、稼動状態とが併存することがあり、そのと
き稼動状態にある部分を異常制御することがあつ
た。それを解決することが要望されている。
において、テスト実行中に交流遮断が起こつたと
き、直流が供給されている動作回路部分に停電状
態と、稼動状態とが併存することがあり、そのと
き稼動状態にある部分を異常制御することがあつ
た。それを解決することが要望されている。
［従来の技術］
第６図は従来のプリント板動作テスタにおける
電源供給システムを示す図である。第６図におい
てプリント板７と示す回路の動作をテストするた
め、動作テスタ３には交流電源１から交流電力制
御回路２を介して交流が供給されている。動作テ
スタ３には各種ユニツトを内蔵していて、プリン
ト板７に対しパターンを発生するためのユニツト
４、直流電力を供給するためのユニツト５、直流
電圧監視ユニツト６などである。第６図において
交流電源１は時に瞬断が起こつて直ぐ回復したと
き、テスタ３またはプリント板７の動作が部分的
に異常となることがあるが、従来は遮断について
の監視は行つていなかつた。
電源供給システムを示す図である。第６図におい
てプリント板７と示す回路の動作をテストするた
め、動作テスタ３には交流電源１から交流電力制
御回路２を介して交流が供給されている。動作テ
スタ３には各種ユニツトを内蔵していて、プリン
ト板７に対しパターンを発生するためのユニツト
４、直流電力を供給するためのユニツト５、直流
電圧監視ユニツト６などである。第６図において
交流電源１は時に瞬断が起こつて直ぐ回復したと
き、テスタ３またはプリント板７の動作が部分的
に異常となることがあるが、従来は遮断について
の監視は行つていなかつた。
［発明が解しようとする問題点］
第６図による動作テスタ３では交流電源１が停
電のため、電力供給が出来なくなつたときはテス
タ３またはプリント板７内が部分的に異常とはな
らず、動作停止となるため問題が少ない。しかし
瞬断のときは例えばプリント板７の内部におい
て、電力増幅部のような電力系が稼動状態を続
け、それを制御する制御系例えばＤ／Ａ変換器が
停電状態で動作停止となつた場合、プリント板７
内の物を電気的にまたは機械的に破壊することが
あつた。更に停止とならなくても、印加される信
号パターンが瞬断のため微小に変化したときなど
別異の信号が入力したと判断すれば、その信号に
対する出力を電力系に送出するから忽ち誤動作を
起こすことになる。
電のため、電力供給が出来なくなつたときはテス
タ３またはプリント板７内が部分的に異常とはな
らず、動作停止となるため問題が少ない。しかし
瞬断のときは例えばプリント板７の内部におい
て、電力増幅部のような電力系が稼動状態を続
け、それを制御する制御系例えばＤ／Ａ変換器が
停電状態で動作停止となつた場合、プリント板７
内の物を電気的にまたは機械的に破壊することが
あつた。更に停止とならなくても、印加される信
号パターンが瞬断のため微小に変化したときなど
別異の信号が入力したと判断すれば、その信号に
対する出力を電力系に送出するから忽ち誤動作を
起こすことになる。
また直流電圧監視ユニツト６はプリント板７に
供給する直流電圧を監視していて、異常発生を検
出したとき直流供給を停止するが、保守者がその
後に異常の原因、即ち交流から直流への整流部
か、プリント板側か等を知ることが難しかつた。
その原因を記録しているものがないからである。
供給する直流電圧を監視していて、異常発生を検
出したとき直流供給を停止するが、保守者がその
後に異常の原因、即ち交流から直流への整流部
か、プリント板側か等を知ることが難しかつた。
その原因を記録しているものがないからである。
本発明の目的は前述の欠点を改善し、回路動作
テスタに対す入力交流に瞬断が起こつたときも、
その状態を確実に検出し入力交流を停電状態とし
て、且つその状態を記憶装置に記録しておくよう
にした回路動作テスタを提供することにある。
テスタに対す入力交流に瞬断が起こつたときも、
その状態を確実に検出し入力交流を停電状態とし
て、且つその状態を記憶装置に記録しておくよう
にした回路動作テスタを提供することにある。
［問題点を解決するための手段］
第１図は本発明の原理構成を示す図である。第
１図において、１は入力交流電源、２は交流電力
制御回路、３は動作テスタ、４，５は動作テスタ
３内のユニツト、７はプリント板・LSIなど、８
はアラーム監視ユニツト、８１は瞬断アラーム回
路、８２は記憶装置、８３は蓄電池を示す。
１図において、１は入力交流電源、２は交流電力
制御回路、３は動作テスタ、４，５は動作テスタ
３内のユニツト、７はプリント板・LSIなど、８
はアラーム監視ユニツト、８１は瞬断アラーム回
路、８２は記憶装置、８３は蓄電池を示す。
電力制御回路２を介して交流電源１からの交流
が供給され、直流電源ユニツトなど複数のユニツ
ト４，５によりプリント板７の動作を試験する動
作テスタ３において、本発明は下記の構成として
いる。即ち 該動作テスタ３内にはアラーム監視ユニツト８
を具備し、該アラーム監視ユニツト８には少なく
とも交流電源１が瞬断したことを警報する瞬断ア
ラーム８１と、該瞬断アラーム回路８１の出力に
ついてその状況を格納するため蓄電池８３により
バツクアツプされた記憶装置８２とを内蔵し、且
つ瞬断アラーム回路８１出力により電力制御回路
２において交流電源１からの入力を断にすること
である。
が供給され、直流電源ユニツトなど複数のユニツ
ト４，５によりプリント板７の動作を試験する動
作テスタ３において、本発明は下記の構成として
いる。即ち 該動作テスタ３内にはアラーム監視ユニツト８
を具備し、該アラーム監視ユニツト８には少なく
とも交流電源１が瞬断したことを警報する瞬断ア
ラーム８１と、該瞬断アラーム回路８１の出力に
ついてその状況を格納するため蓄電池８３により
バツクアツプされた記憶装置８２とを内蔵し、且
つ瞬断アラーム回路８１出力により電力制御回路
２において交流電源１からの入力を断にすること
である。
［作用］
第１図において、入力交流電源１から電力制御
回路２を介しての交流を動作テスタ３内の直流電
力供給ユニツトで直流に変換し、必要な個所に直
流を供給して動作させる。入力交流電源１の交流
に瞬断が起こると、アラーム監視ユニツト８の瞬
断アラーム回路８１がそれを検出し、直ちに電力
制御回路２に通知し、入力交流電源１を直ぐ全面
的に遮断する。瞬断の次に直ぐ交流電源の状態が
復旧して交流の供給が続いたとしても、遮断する
ことに変わりがない。したがつて動作テスタ３と
プリント板７は完全に動作停止とする。また入力
交流電源１に瞬断のあつたことは瞬断アラーム回
路８１から記憶装置８２に通知される。記憶装置
８２は蓄電池８３によりバツクアツプされている
から、瞬断に基づく電源変動の有無に関係なく、
瞬断があつたことを必要に応じその時刻と共に記
憶する。プリント板７が動作停止となつてから保
守者が記憶装置８２をチエツクすると、入力交流
に瞬断のあつたことと、そのため全面停電となつ
たことが直ぐ判る。
回路２を介しての交流を動作テスタ３内の直流電
力供給ユニツトで直流に変換し、必要な個所に直
流を供給して動作させる。入力交流電源１の交流
に瞬断が起こると、アラーム監視ユニツト８の瞬
断アラーム回路８１がそれを検出し、直ちに電力
制御回路２に通知し、入力交流電源１を直ぐ全面
的に遮断する。瞬断の次に直ぐ交流電源の状態が
復旧して交流の供給が続いたとしても、遮断する
ことに変わりがない。したがつて動作テスタ３と
プリント板７は完全に動作停止とする。また入力
交流電源１に瞬断のあつたことは瞬断アラーム回
路８１から記憶装置８２に通知される。記憶装置
８２は蓄電池８３によりバツクアツプされている
から、瞬断に基づく電源変動の有無に関係なく、
瞬断があつたことを必要に応じその時刻と共に記
憶する。プリント板７が動作停止となつてから保
守者が記憶装置８２をチエツクすると、入力交流
に瞬断のあつたことと、そのため全面停電となつ
たことが直ぐ判る。
［実施例］
第２図は本発明の実施例の構成を示し、アラー
ム監視ユニツト８１内にアラーム制御回路８４を
具備し、また記憶装置８２には表示回路８８を具
備している。アラーム制御回路８４には瞬断アラ
ーム回路８１からの出力以外に、必要に応じ設け
た直流電源監視回路８５からの出力や、フアンな
どのアラーム監視回路８６からの出力が印加され
る。そのため各回路８５，８６から異常のアラー
ム信号が到来したとき動作する。交流電源の瞬断
があれば、交流電力の制御回路２を直ぐ制御して
復旧の有無に関係なく交流電源を断とする。同時
に記憶装置８２に通知し、記憶部８７で記憶する
と共に表示部８８に表示する。
ム監視ユニツト８１内にアラーム制御回路８４を
具備し、また記憶装置８２には表示回路８８を具
備している。アラーム制御回路８４には瞬断アラ
ーム回路８１からの出力以外に、必要に応じ設け
た直流電源監視回路８５からの出力や、フアンな
どのアラーム監視回路８６からの出力が印加され
る。そのため各回路８５，８６から異常のアラー
ム信号が到来したとき動作する。交流電源の瞬断
があれば、交流電力の制御回路２を直ぐ制御して
復旧の有無に関係なく交流電源を断とする。同時
に記憶装置８２に通知し、記憶部８７で記憶する
と共に表示部８８に表示する。
第３図は瞬断アラーム回路８１の具体的回路構
成を示す図である。第３図において、１４はフオ
トカプラ、１５は再トリガ可能な単安定マルチバ
イブレータ、１６はラツチ回路を示す。第４図は
第３図の各部動作の波形図を示す。第３図・第４
図においてvaが入力交流波形を示すと、電流制限
抵抗Ｒ１を介してフオトカプラ１４に印加されダ
イオードが発光し、出力側に得られたパルスvcに
より単安定マルチバイブレータ１５をトリガす
る。抵抗Ｒ２はプルアツプ抵抗を示し、単安定マ
ルチバイブレータ１５に対しトリガパルスを与え
るとき、交流波形と同期した周期τ1により、単安
定マルチバイブレータ１５を繰り返してトリガし
ている。そのため単安定マルチバイブレータ１５
の出力vQは“Ｈ”が続いている。また単安定マル
チバイブレータ１５やラツチ回路１６に対する直
流電圧VDはこのとき“Ｈ”が続く。次に時刻t1〜
t2において入力交流が瞬断したときは、単安定マ
ルチバイブレータ１５へのトリガが１〜２回無く
なるのでパルス周期τ2においてvQが“０”とな
る。そしてラツチ回路１６の出力vSは“０”から
“１”となり、図示しない電力制御回路２に対し
交流断という動作制御信号を与える。そのため時
刻t2において交流が復旧すると、トリガパルスの
ため単安定マルチバイブレータ１５の出力vQは
“１”となるが、ラツチ回路１６は復旧すること
なく、停電のあつたことを保持している。ラツチ
回路１６はリセツト端子に信号を与えたとき復旧
できる。このとき単安定マルチバイブレータ１５
のパルス周期τ2は入力交流の周期τ1と比較し、略
等しいか若干大きい値となるように、回路外付け
の抵抗・コンデンサ素子の値を選定する。なお直
流電圧VDは時間τ3の後に電圧降下するが、τ3＞τ2
と選定することが有効である。それは少なくとも
ラツチ回路１６の動作がラツチ動作と記憶装置へ
の通知が終わるまで維持されるためである。
成を示す図である。第３図において、１４はフオ
トカプラ、１５は再トリガ可能な単安定マルチバ
イブレータ、１６はラツチ回路を示す。第４図は
第３図の各部動作の波形図を示す。第３図・第４
図においてvaが入力交流波形を示すと、電流制限
抵抗Ｒ１を介してフオトカプラ１４に印加されダ
イオードが発光し、出力側に得られたパルスvcに
より単安定マルチバイブレータ１５をトリガす
る。抵抗Ｒ２はプルアツプ抵抗を示し、単安定マ
ルチバイブレータ１５に対しトリガパルスを与え
るとき、交流波形と同期した周期τ1により、単安
定マルチバイブレータ１５を繰り返してトリガし
ている。そのため単安定マルチバイブレータ１５
の出力vQは“Ｈ”が続いている。また単安定マル
チバイブレータ１５やラツチ回路１６に対する直
流電圧VDはこのとき“Ｈ”が続く。次に時刻t1〜
t2において入力交流が瞬断したときは、単安定マ
ルチバイブレータ１５へのトリガが１〜２回無く
なるのでパルス周期τ2においてvQが“０”とな
る。そしてラツチ回路１６の出力vSは“０”から
“１”となり、図示しない電力制御回路２に対し
交流断という動作制御信号を与える。そのため時
刻t2において交流が復旧すると、トリガパルスの
ため単安定マルチバイブレータ１５の出力vQは
“１”となるが、ラツチ回路１６は復旧すること
なく、停電のあつたことを保持している。ラツチ
回路１６はリセツト端子に信号を与えたとき復旧
できる。このとき単安定マルチバイブレータ１５
のパルス周期τ2は入力交流の周期τ1と比較し、略
等しいか若干大きい値となるように、回路外付け
の抵抗・コンデンサ素子の値を選定する。なお直
流電圧VDは時間τ3の後に電圧降下するが、τ3＞τ2
と選定することが有効である。それは少なくとも
ラツチ回路１６の動作がラツチ動作と記憶装置へ
の通知が終わるまで維持されるためである。
また記憶装置８２としては例えば第５図に示す
構成を使用する。第５図において、８７は記憶部
でCMOSを使用するような複数のフリツプフロ
ツプ、８８は液晶を使用するような表示部で、日
の字型表示部を例えばアラーム発生回路と同数準
備する。また２１はアラーム信号線例えば４ビツ
トデータ用のもの、２２はオア回路、２３は４ビ
ツトデータ線をオア回路で演算しクロツクとして
アラーム信号をフリツプフロツプ８７に印加させ
る。第２図に示すようなアラームを検出したユニ
ツト８１，８５，８６からのデータは第５図に示
すアラーム信号線２１から順次入力し、フリツプ
フロツプ８７を個別・順次にセツトする。セツト
されたフリツプフロツプに対応する表示部８８が
表示をする。
構成を使用する。第５図において、８７は記憶部
でCMOSを使用するような複数のフリツプフロ
ツプ、８８は液晶を使用するような表示部で、日
の字型表示部を例えばアラーム発生回路と同数準
備する。また２１はアラーム信号線例えば４ビツ
トデータ用のもの、２２はオア回路、２３は４ビ
ツトデータ線をオア回路で演算しクロツクとして
アラーム信号をフリツプフロツプ８７に印加させ
る。第２図に示すようなアラームを検出したユニ
ツト８１，８５，８６からのデータは第５図に示
すアラーム信号線２１から順次入力し、フリツプ
フロツプ８７を個別・順次にセツトする。セツト
されたフリツプフロツプに対応する表示部８８が
表示をする。
［発明の効果］
このようにして本発明によると、入力交流に瞬
断が発生したとき、たとえ直ぐ復旧しても入力交
流は確実に停電状態となるから、従来のプリント
板におけるような誤動作を起こすことがない。ま
た停電により動作停止となつたことを記憶装置に
記憶しておくから、保守者にとつて大変便利であ
る。
断が発生したとき、たとえ直ぐ復旧しても入力交
流は確実に停電状態となるから、従来のプリント
板におけるような誤動作を起こすことがない。ま
た停電により動作停止となつたことを記憶装置に
記憶しておくから、保守者にとつて大変便利であ
る。
第１図は本発明の原理構成を示す図、第２図は
本発明の実施例の構成を示す図、第３図は第１図
の瞬断アラーム回路の具体的構成を示す図、第４
図は第３図の動作説明図、第５図は第１図におけ
る記憶装置の構成例を示す図、第６図は従来の動
作テスタにおける電源供給システムを示す図であ
る。 １…入力交流電源、２…電力制御回路、３…回
路動作テスタ、４，５…ユニツト、７…プリント
板、８…アラーム監視ユニツト、８１…瞬断アラ
ーム回路、８２…記憶装置、８３…蓄電池。
本発明の実施例の構成を示す図、第３図は第１図
の瞬断アラーム回路の具体的構成を示す図、第４
図は第３図の動作説明図、第５図は第１図におけ
る記憶装置の構成例を示す図、第６図は従来の動
作テスタにおける電源供給システムを示す図であ
る。 １…入力交流電源、２…電力制御回路、３…回
路動作テスタ、４，５…ユニツト、７…プリント
板、８…アラーム監視ユニツト、８１…瞬断アラ
ーム回路、８２…記憶装置、８３…蓄電池。
Claims (1)
- 【特許請求の範囲】 １ 電力制御回路２を介して交流電源１からの交
流が供給され、直流電源ユニツトなど複数のユニ
ツト４，５…によりプリント板７の動作を試験す
る動作テスタ３において、 該動作テスタ３内にはアラーム監視ユニツト８
を具備し、 該アラーム監視ユニツト８には少なくとも交流
電源１が瞬断したことを警報する瞬断アラーム回
路８１と、 該瞬断アラーム回路８１の出力についてその状
況を格納するため蓄電池８３によりバツクアツプ
された記憶装置８２とを内蔵し、 且つ瞬断アラーム回路８１出力により電力制御
回路２において交流電源１からの入力を断にする
ことを特徴とするアラーム監視機能を持つプリン
ト板テスタ。 ２ アラーム監視ユニツトには、アラーム制御回
路を設け、該アラーム制御回路には瞬断アラーム
回路、電圧アラーム回路など複数のアラーム回路
からの出力が印加され、且つ記憶装置に記憶デー
タを出力することを特徴とする特許請求の範囲第
１項記載のテスタ。 ３ 瞬断アラーム回路は、交流で点灯するフオト
カプラと、該フオトカプラ出力によりトリガされ
る再トリガ可能な単安定マルチバイブレータとで
構成されることを特徴とする特許請求の範囲第１
項記載のテスタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10524587A JPS63271173A (ja) | 1987-04-28 | 1987-04-28 | アラ−ム監視機能を持つプリント板テスタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10524587A JPS63271173A (ja) | 1987-04-28 | 1987-04-28 | アラ−ム監視機能を持つプリント板テスタ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63271173A JPS63271173A (ja) | 1988-11-09 |
| JPH0519110B2 true JPH0519110B2 (ja) | 1993-03-15 |
Family
ID=14402263
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10524587A Granted JPS63271173A (ja) | 1987-04-28 | 1987-04-28 | アラ−ム監視機能を持つプリント板テスタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63271173A (ja) |
-
1987
- 1987-04-28 JP JP10524587A patent/JPS63271173A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS63271173A (ja) | 1988-11-09 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |