JPH05191919A - 電源オン・オフ・リレー回路 - Google Patents
電源オン・オフ・リレー回路Info
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- JPH05191919A JPH05191919A JP4002279A JP227992A JPH05191919A JP H05191919 A JPH05191919 A JP H05191919A JP 4002279 A JP4002279 A JP 4002279A JP 227992 A JP227992 A JP 227992A JP H05191919 A JPH05191919 A JP H05191919A
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Abstract
(57)【要約】
【目的】異常電流発生時の電源遮断をヒューズレスで実
現し、省スペースおよびコストダウンを図る。 【構成】メイン電源トランス４４の１次側に電源リレー
４０を設けるとともに常時的にアクティブとなる定電圧
電源３４を設ける。電源オン操作によって定電圧電源３
４から電源リレー４０に駆動電流を流して電源リレー４
０をオンにする。メイン電源トランス４４の２次側に負
荷電流の過剰を検出する過電流検出手段（比較部５０，
論理部５６）を設け、必要に応じて過電流時間判定手段
（時定数回路５８）を設け、過電流検出手段または過電
流時間判定手段が動作したときに電源リレー４０を自動
的にオフにする。
現し、省スペースおよびコストダウンを図る。 【構成】メイン電源トランス４４の１次側に電源リレー
４０を設けるとともに常時的にアクティブとなる定電圧
電源３４を設ける。電源オン操作によって定電圧電源３
４から電源リレー４０に駆動電流を流して電源リレー４
０をオンにする。メイン電源トランス４４の２次側に負
荷電流の過剰を検出する過電流検出手段（比較部５０，
論理部５６）を設け、必要に応じて過電流時間判定手段
（時定数回路５８）を設け、過電流検出手段または過電
流時間判定手段が動作したときに電源リレー４０を自動
的にオフにする。
Description
【０００１】
【産業上の利用分野】本発明は、オーディオ機器をはじ
めとして各種の民生機器に装備される電源オン・オフ・
リレー回路に関する。
めとして各種の民生機器に装備される電源オン・オフ・
リレー回路に関する。
【０００２】
【従来の技術】図４に従来の電源オン・オフ・リレー回
路の回路構成を示す。
路の回路構成を示す。
【０００３】コンセント２にサブトランス４，整流ダイ
オード６，平滑コンデンサ８を介して接続された定電圧
電源１０に、電源リレー１２のリレーコイルとリレー・
ドライブトランジスタ１４の直列回路が接続されてい
る。このリレー・ドライブトランジスタ１４のベースは
図示しないシステムマイコンの電源制御ポートに接続さ
れている。電源リレー１２は、タップ切換スイッチ１
６，電流ヒューズＦ１〜Ｆ４を介してメイン電源トラン
ス１８の１次巻線に接続されている。メイン電源トラン
ス１８の２次巻線は全波整流ダイオード２０に接続さ
れ、全波整流ダイオード２０の両端間に平滑コンデンサ
Ｃ１１，Ｃ１２の直列回路が接続され、両コンデンサＣ
１１，Ｃ１２の共通接続点が接地されている。一方のコ
ンデンサＣ１１の正極がプラスの直流電源（＋Ｂ）とな
っており、他方のコンデンサＣ１２の負極がマイナスの
直流電源（−Ｂ）となっている。
オード６，平滑コンデンサ８を介して接続された定電圧
電源１０に、電源リレー１２のリレーコイルとリレー・
ドライブトランジスタ１４の直列回路が接続されてい
る。このリレー・ドライブトランジスタ１４のベースは
図示しないシステムマイコンの電源制御ポートに接続さ
れている。電源リレー１２は、タップ切換スイッチ１
６，電流ヒューズＦ１〜Ｆ４を介してメイン電源トラン
ス１８の１次巻線に接続されている。メイン電源トラン
ス１８の２次巻線は全波整流ダイオード２０に接続さ
れ、全波整流ダイオード２０の両端間に平滑コンデンサ
Ｃ１１，Ｃ１２の直列回路が接続され、両コンデンサＣ
１１，Ｃ１２の共通接続点が接地されている。一方のコ
ンデンサＣ１１の正極がプラスの直流電源（＋Ｂ）とな
っており、他方のコンデンサＣ１２の負極がマイナスの
直流電源（−Ｂ）となっている。
【０００４】機器本体の電源スイッチまたはリモートコ
ントローラの電源キーをオン操作することで、システム
マイコンから“Ｈ”レベルをリレー・ドライブトランジ
スタ１４に出力して、このトランジスタ１４をオンに
し、定電圧電源１０から電源リレー１２のリレーコイル
に電流を流して電源リレー１２をオンにする。その結
果、コンセント２から電源リレー１２，タップ切換スイ
ッチ１６を介してメイン電源トランス１８の１次巻線に
電流が流れ、２次巻線に誘導された交流電流が全波整流
ダイオード２０と平滑コンデンサＣ１１、Ｃ１２によっ
て直流化され、直流電源（＋Ｂ），（−Ｂ）が発生す
る。
ントローラの電源キーをオン操作することで、システム
マイコンから“Ｈ”レベルをリレー・ドライブトランジ
スタ１４に出力して、このトランジスタ１４をオンに
し、定電圧電源１０から電源リレー１２のリレーコイル
に電流を流して電源リレー１２をオンにする。その結
果、コンセント２から電源リレー１２，タップ切換スイ
ッチ１６を介してメイン電源トランス１８の１次巻線に
電流が流れ、２次巻線に誘導された交流電流が全波整流
ダイオード２０と平滑コンデンサＣ１１、Ｃ１２によっ
て直流化され、直流電源（＋Ｂ），（−Ｂ）が発生す
る。
【０００５】上記とは逆に、機器本体の電源スイッチま
たはリモートコントローラの電源キーをオフ操作すれ
ば、電源リレー１２がオフとなり、直流電源（＋Ｂ），
（−Ｂ）は消失する。
たはリモートコントローラの電源キーをオフ操作すれ
ば、電源リレー１２がオフとなり、直流電源（＋Ｂ），
（−Ｂ）は消失する。
【０００６】電源リレー１２のオン状態において、何ら
かの原因で定格に比べて過大な異常電流が流れた場合、
電流ヒューズＦ１〜Ｆ４のうち使用中の電流ヒューズに
過電流が流れ、その電流ヒューズを溶断することで電源
供給を停止し、異常電流から回路各部を保護する。
かの原因で定格に比べて過大な異常電流が流れた場合、
電流ヒューズＦ１〜Ｆ４のうち使用中の電流ヒューズに
過電流が流れ、その電流ヒューズを溶断することで電源
供給を停止し、異常電流から回路各部を保護する。
【０００７】
【発明が解決しようとする課題】上記の従来例において
は、安全対策のための保護回路としてメイン電源トラン
ス１８の１次側に電流ヒューズを設けているが、１次側
であるために一定以上の沿面距離を確保しなければなら
ず、必要とするスペースが大きくなる。さらに、図示の
ようなマルチ電源対応の機器においては、１次巻線の各
タップごとに互いに定格を異にする電流ヒューズを設け
なければならず、コスト面で不利となりやすい。
は、安全対策のための保護回路としてメイン電源トラン
ス１８の１次側に電流ヒューズを設けているが、１次側
であるために一定以上の沿面距離を確保しなければなら
ず、必要とするスペースが大きくなる。さらに、図示の
ようなマルチ電源対応の機器においては、１次巻線の各
タップごとに互いに定格を異にする電流ヒューズを設け
なければならず、コスト面で不利となりやすい。
【０００８】１次側に設けることに代えて、メイン電源
トランス１８の２次側の点Ｐ，Ｑの箇所に電流ヒューズ
を挿入することも考えられるが、直流電源（＋Ｂ），
（−Ｂ）の電圧が高く平滑コンデンサＣ１１，Ｃ１２の
容量が大きい場合（例えばハイパワー・アンプの場
合）、電源リレー１２のオン時の平滑コンデンサＣ１
１，Ｃ１２への突入電流が大きくなり、その突入電流の
ために電流ヒューズが溶断してしまうおそれがあるので
好ましくない。
トランス１８の２次側の点Ｐ，Ｑの箇所に電流ヒューズ
を挿入することも考えられるが、直流電源（＋Ｂ），
（−Ｂ）の電圧が高く平滑コンデンサＣ１１，Ｃ１２の
容量が大きい場合（例えばハイパワー・アンプの場
合）、電源リレー１２のオン時の平滑コンデンサＣ１
１，Ｃ１２への突入電流が大きくなり、その突入電流の
ために電流ヒューズが溶断してしまうおそれがあるので
好ましくない。
【０００９】また、保護回路として電流ヒューズを用い
る場合、交換の必要上、その配置位置に制約を受ける。
つまり、機器本体ケーシングのうち外部に露出している
箇所または容易に露出させ得る箇所に配置しなければな
らない。
る場合、交換の必要上、その配置位置に制約を受ける。
つまり、機器本体ケーシングのうち外部に露出している
箇所または容易に露出させ得る箇所に配置しなければな
らない。
【００１０】本発明は、このような事情に鑑みて創案さ
れたものであって、異常電流発生時の電源遮断をヒュー
ズレスで実現することを目的とする。
れたものであって、異常電流発生時の電源遮断をヒュー
ズレスで実現することを目的とする。
【００１１】
【課題を解決するための手段】本発明に係る第１の電源
オン・オフ・リレー回路は、メイン電源トランスの１次
側に電源リレーを設けるとともに、常時的にアクティブ
となる定電圧電源を設け、電源オン操作によって前記定
電圧電源から前記電源リレーに駆動電流を流してこの電
源リレーをオンにするように構成してある電源オン・オ
フ・リレー回路において、前記メイン電源トランスの２
次側における電圧変化を利用して負荷電流の過剰を検出
する過電流検出手段を設け、この過電流検出手段が動作
したときに前記電源リレーを自動的にオフにするように
構成したことを特徴とするものである。
オン・オフ・リレー回路は、メイン電源トランスの１次
側に電源リレーを設けるとともに、常時的にアクティブ
となる定電圧電源を設け、電源オン操作によって前記定
電圧電源から前記電源リレーに駆動電流を流してこの電
源リレーをオンにするように構成してある電源オン・オ
フ・リレー回路において、前記メイン電源トランスの２
次側における電圧変化を利用して負荷電流の過剰を検出
する過電流検出手段を設け、この過電流検出手段が動作
したときに前記電源リレーを自動的にオフにするように
構成したことを特徴とするものである。
【００１２】また、本発明に係る第２の電源オン・オフ
・リレー回路は、メイン電源トランスの１次側に電源リ
レーを設けるとともに、常時的にアクティブとなる定電
圧電源を設け、電源オン操作によって前記定電圧電源か
ら前記電源リレーに駆動電流を流してこの電源リレーを
オンにするように構成してある電源オン・オフ・リレー
回路において、前記メイン電源トランスの２次側におけ
る電圧変化を利用して負荷電流の過剰を検出する過電流
検出手段を設けるとともに、この過電流検出手段が動作
したときにその過電流検出状態が所定時間以上継続する
かどうかを判定する過電流時間判定手段を設け、この過
電流時間判定手段が所定時間以上にわたる過電流検出状
態であると判定したときに前記電源リレーを自動的にオ
フにするように構成したことを特徴とするものである。
・リレー回路は、メイン電源トランスの１次側に電源リ
レーを設けるとともに、常時的にアクティブとなる定電
圧電源を設け、電源オン操作によって前記定電圧電源か
ら前記電源リレーに駆動電流を流してこの電源リレーを
オンにするように構成してある電源オン・オフ・リレー
回路において、前記メイン電源トランスの２次側におけ
る電圧変化を利用して負荷電流の過剰を検出する過電流
検出手段を設けるとともに、この過電流検出手段が動作
したときにその過電流検出状態が所定時間以上継続する
かどうかを判定する過電流時間判定手段を設け、この過
電流時間判定手段が所定時間以上にわたる過電流検出状
態であると判定したときに前記電源リレーを自動的にオ
フにするように構成したことを特徴とするものである。
【００１３】
【作用】第１の電源オン・オフ・リレー回路によれば、
メイン電源トランスの２次側に設けた過電流検出手段が
過電流を検出したときに１次側の電源リレーをオフにし
て電源供給を自動的に停止するから、つまり、電源リレ
ーを対過電流安全対策のための保護回路として兼用する
ように構成したので、メイン電源トランスの１次側また
は２次側に電流ヒューズを設ける必要がなくなる。
メイン電源トランスの２次側に設けた過電流検出手段が
過電流を検出したときに１次側の電源リレーをオフにし
て電源供給を自動的に停止するから、つまり、電源リレ
ーを対過電流安全対策のための保護回路として兼用する
ように構成したので、メイン電源トランスの１次側また
は２次側に電流ヒューズを設ける必要がなくなる。
【００１４】また、第２の電源オン・オフ・リレー回路
によれば、過電流検出手段による過電流検出状態が所定
時間以上にわたって継続したときには電源リレーをオフ
にするが、過電流検出状態が所定時間未満のときは電源
リレーのオン状態を保つように構成したので、異常に起
因した過電流検出と正常動作中での一時的な過大負荷に
起因した過電流検出とを明確に区別し、異常時にのみ電
源を遮断することになる。
によれば、過電流検出手段による過電流検出状態が所定
時間以上にわたって継続したときには電源リレーをオフ
にするが、過電流検出状態が所定時間未満のときは電源
リレーのオン状態を保つように構成したので、異常に起
因した過電流検出と正常動作中での一時的な過大負荷に
起因した過電流検出とを明確に区別し、異常時にのみ電
源を遮断することになる。
【００１５】
【実施例】以下、本発明に係る電源オン・オフ・リレー
回路の一実施例を図面に基づいて詳細に説明する。
回路の一実施例を図面に基づいて詳細に説明する。
【００１６】図１および図２は実施例に係る電源オン・
オフ・リレー回路の構成を示す回路図である。図１にお
ける接続点ａ〜ｅはそれぞれ図２の接続点ａ〜ｅに対応
している。
オフ・リレー回路の構成を示す回路図である。図１にお
ける接続点ａ〜ｅはそれぞれ図２の接続点ａ〜ｅに対応
している。
【００１７】図１において、３０はコンセント、３２は
リレー用サブトランス、Ｄ１は整流ダイオード、Ｃ１は
平滑コンデンサ、３４は定電圧電源、３６はシステムマ
イコン、３６ａは電源制御ポート、３８は電源スイッ
チ、Ｔｒ１はリレー制御トランジスタ、Ｔｒ２はリレー
・ドライブトランジスタである。４０は電源リレー、４
２はタップ切換スイッチ、４４はメイン電源トランス、
４６は全波整流ダイオード、Ｃ２，Ｃ３は平滑コンデン
サ、（＋Ｂ）はプラスの直流電源、（−Ｂ）はマイナス
の直流電源、Ｒ１，Ｒ２，Ｒ３，Ｒ４は分圧抵抗、４８
は全波整流ダイオード、Ｃ４，Ｃ５は平滑コンデンサ、
（＋Ｂ1 ）はプラスの直流電源、（−Ｂ1 ）はマイナス
の直流電源である。直流電源（＋Ｂ），（−Ｂ）は図示
しない負荷回路（例えばオーディオ・アンプ回路）に供
給されている。直流電源（＋Ｂ1 ），（−Ｂ1 ）は図２
に示す回路に供給されている。メイン電源トランス４４
の１次側にも２次側にも電流ヒューズは用いられていな
い。
リレー用サブトランス、Ｄ１は整流ダイオード、Ｃ１は
平滑コンデンサ、３４は定電圧電源、３６はシステムマ
イコン、３６ａは電源制御ポート、３８は電源スイッ
チ、Ｔｒ１はリレー制御トランジスタ、Ｔｒ２はリレー
・ドライブトランジスタである。４０は電源リレー、４
２はタップ切換スイッチ、４４はメイン電源トランス、
４６は全波整流ダイオード、Ｃ２，Ｃ３は平滑コンデン
サ、（＋Ｂ）はプラスの直流電源、（−Ｂ）はマイナス
の直流電源、Ｒ１，Ｒ２，Ｒ３，Ｒ４は分圧抵抗、４８
は全波整流ダイオード、Ｃ４，Ｃ５は平滑コンデンサ、
（＋Ｂ1 ）はプラスの直流電源、（−Ｂ1 ）はマイナス
の直流電源である。直流電源（＋Ｂ），（−Ｂ）は図示
しない負荷回路（例えばオーディオ・アンプ回路）に供
給されている。直流電源（＋Ｂ1 ），（−Ｂ1 ）は図２
に示す回路に供給されている。メイン電源トランス４４
の１次側にも２次側にも電流ヒューズは用いられていな
い。
【００１８】図２において、５０は比較部、５２，５４
はコンパレータ、５６は論理部、Ｔｒ３，Ｔｒ４はトラ
ンジスタ、Ｄ２，Ｄ３はスイッチングダイオード、５８
は時定数回路、Ｄ５は逆流防止ダイオード、Ｃ６は充放
電コンデンサ、Ｒ５は接地抵抗、Ｔｒ５はトランジス
タ、Ｒ６はトランジスタＴｒ５のベース抵抗、Ｒ７はエ
ミッタ接地抵抗、６０はインバータ回路、Ｔｒ６は反転
用のトランジスタ、６２は電源オン時にインバータ回路
６０を制御トランジスタＴｒ９から分離する回路、Ｔｒ
７はＰＮＰ型のトランジスタ、Ｔｒ８はトランジスタ、
Ｄ６，Ｄ７は逆流防止ダイオード、Ｒ８は積分抵抗、Ｃ
７は積分コンデンサ、６４は制御部、Ｔｒ９は制御トラ
ンジスタ、Ｔｒ１０はスイッチングトランジスタであ
る。
はコンパレータ、５６は論理部、Ｔｒ３，Ｔｒ４はトラ
ンジスタ、Ｄ２，Ｄ３はスイッチングダイオード、５８
は時定数回路、Ｄ５は逆流防止ダイオード、Ｃ６は充放
電コンデンサ、Ｒ５は接地抵抗、Ｔｒ５はトランジス
タ、Ｒ６はトランジスタＴｒ５のベース抵抗、Ｒ７はエ
ミッタ接地抵抗、６０はインバータ回路、Ｔｒ６は反転
用のトランジスタ、６２は電源オン時にインバータ回路
６０を制御トランジスタＴｒ９から分離する回路、Ｔｒ
７はＰＮＰ型のトランジスタ、Ｔｒ８はトランジスタ、
Ｄ６，Ｄ７は逆流防止ダイオード、Ｒ８は積分抵抗、Ｃ
７は積分コンデンサ、６４は制御部、Ｔｒ９は制御トラ
ンジスタ、Ｔｒ１０はスイッチングトランジスタであ
る。
【００１９】直流電源（＋Ｂ），（−Ｂ）が供給される
負荷回路（図示せず）における電流対電圧特性を図３に
示す。負荷電流が増加するにつれて、供給される電圧の
大きさ（絶対値）が次第に減少するような特性曲線とな
る。定格電流ｉ0 よりも少し大きめの電流ｉ1 を基準と
し、この基準の電流ｉ1 よりも大きな電流が所定時間Ｔ
0 以上にわたって継続するときを異常状態であるとす
る。すなわち、過電流が負荷回路に流れたものとする。
基準の電流ｉ1 に相当する電圧をプラス側でＶ1 、マイ
ナス側でＶ2 とする。それらの大きさはほぼ等しく、｜
Ｖ1 ｜≒｜Ｖ2 ｜である。
負荷回路（図示せず）における電流対電圧特性を図３に
示す。負荷電流が増加するにつれて、供給される電圧の
大きさ（絶対値）が次第に減少するような特性曲線とな
る。定格電流ｉ0 よりも少し大きめの電流ｉ1 を基準と
し、この基準の電流ｉ1 よりも大きな電流が所定時間Ｔ
0 以上にわたって継続するときを異常状態であるとす
る。すなわち、過電流が負荷回路に流れたものとする。
基準の電流ｉ1 に相当する電圧をプラス側でＶ1 、マイ
ナス側でＶ2 とする。それらの大きさはほぼ等しく、｜
Ｖ1 ｜≒｜Ｖ2 ｜である。
【００２０】比較部５０におけるコンパレータ５２の反
転入力端子（−）は分圧抵抗Ｒ１，Ｒ２の接続点に接続
されている。このコンパレータ５２に対する入力電圧が
ＶX である。コンパレータ５２の非反転入力端子（＋）
に与えられる比較基準電圧Ｖref1は、図３に示した基準
の電圧Ｖ1 との関係で次のように定めてある。
転入力端子（−）は分圧抵抗Ｒ１，Ｒ２の接続点に接続
されている。このコンパレータ５２に対する入力電圧が
ＶX である。コンパレータ５２の非反転入力端子（＋）
に与えられる比較基準電圧Ｖref1は、図３に示した基準
の電圧Ｖ1 との関係で次のように定めてある。
【００２１】Ｖref1＝｛Ｒ２／（Ｒ１＋Ｒ２）｝×Ｖ1 また、比較部５０におけるコンパレータ５４の非反転入
力端子（＋）は分圧抵抗Ｒ３，Ｒ４の接続点に接続され
ている。このコンパレータ５４に対する入力電圧がＶY
である。コンパレータ５４の反転入力端子（−）に与え
られる比較基準電圧Ｖref2は、図３に示した基準の電圧
Ｖ2 との関係で次のように定めてある。
力端子（＋）は分圧抵抗Ｒ３，Ｒ４の接続点に接続され
ている。このコンパレータ５４に対する入力電圧がＶY
である。コンパレータ５４の反転入力端子（−）に与え
られる比較基準電圧Ｖref2は、図３に示した基準の電圧
Ｖ2 との関係で次のように定めてある。
【００２２】Ｖref2＝｛Ｒ３／（Ｒ３＋Ｒ４）｝×Ｖ2 コンパレータ５２においては、入力電圧ＶX が比較基準
電圧Ｖref1よりも低いとき、すなわち、 ＶX ＜Ｖref1 のときに限って、コンパレータ５２の出力電圧が“Ｈ”
レベルとなる。これは、図３においてハッチングを施し
た部分に対応し、過電流検出状態に相当する。
電圧Ｖref1よりも低いとき、すなわち、 ＶX ＜Ｖref1 のときに限って、コンパレータ５２の出力電圧が“Ｈ”
レベルとなる。これは、図３においてハッチングを施し
た部分に対応し、過電流検出状態に相当する。
【００２３】コンパレータ５４においては、入力電圧Ｖ
Y が比較基準電圧Ｖref2よりも高いとき、すなわち、 ＶY ＞Ｖref2 のときに限って、コンパレータ５４の出力電圧が“Ｈ”
レベルとなる。これも、図３のハッチング部分に対応
し、過電流検出状態に相当する。
Y が比較基準電圧Ｖref2よりも高いとき、すなわち、 ＶY ＞Ｖref2 のときに限って、コンパレータ５４の出力電圧が“Ｈ”
レベルとなる。これも、図３のハッチング部分に対応
し、過電流検出状態に相当する。
【００２４】論理部５６における論理は次のようになっ
ている。入力電圧ＶX ，ＶY のうち少なくともいずれか
一方が図３のハッチング部分（過電流状態）に突入した
とき、すなわち、負荷回路においてプラス側またはマイ
ナス側のいずれかで過電流が発生したとき、論理部５６
の出力電圧ＶZ が“Ｌ”レベルとなるように構成されて
いる。まとめると、 となる。
ている。入力電圧ＶX ，ＶY のうち少なくともいずれか
一方が図３のハッチング部分（過電流状態）に突入した
とき、すなわち、負荷回路においてプラス側またはマイ
ナス側のいずれかで過電流が発生したとき、論理部５６
の出力電圧ＶZ が“Ｌ”レベルとなるように構成されて
いる。まとめると、 となる。
【００２５】次に、以上のように構成された電源オン・
オフ・リレー回路の動作を説明する。
オフ・リレー回路の動作を説明する。
【００２６】まず、電源リレー４０がオフとなっている
状態を説明する。
状態を説明する。
【００２７】コンセント３０から供給された交流電圧は
リレー用サブトランス３２によって降圧され、整流ダイ
オードＤ１によって整流され、平滑コンデンサＣ１によ
って平滑されて直流化され、これが定電圧電源３４に供
給されて、定電圧電源３４から一定の直流電源ＶDDがシ
ステムマイコン３６、電源リレー４０のリレーコイル、
リレー制御トランジスタＴｒ１のコレクタに供給されて
いる。ただし、システムマイコン３６の電源制御ポート
３６ａからは現在、“Ｈ”レベルが出力されており、リ
レー制御トランジスタＴｒ１は導通状態にあるため、リ
レー・ドライブトランジスタＴｒ２は非導通状態となっ
ており、したがって、電源リレー４０はオフ状態であ
る。
リレー用サブトランス３２によって降圧され、整流ダイ
オードＤ１によって整流され、平滑コンデンサＣ１によ
って平滑されて直流化され、これが定電圧電源３４に供
給されて、定電圧電源３４から一定の直流電源ＶDDがシ
ステムマイコン３６、電源リレー４０のリレーコイル、
リレー制御トランジスタＴｒ１のコレクタに供給されて
いる。ただし、システムマイコン３６の電源制御ポート
３６ａからは現在、“Ｈ”レベルが出力されており、リ
レー制御トランジスタＴｒ１は導通状態にあるため、リ
レー・ドライブトランジスタＴｒ２は非導通状態となっ
ており、したがって、電源リレー４０はオフ状態であ
る。
【００２８】電源スイッチ３８、または、図示しないリ
モートコントローラの電源キーを一度押し操作すると、
システムマイコン３６の電源制御ポート３６ａから
“Ｌ”レベルが出力され、さらにもう一度押し操作する
と、電源制御ポート３６ａからは“Ｈ”レベルが出力さ
れる。すなわち、電源制御ポート３６ａは“Ｈ”，
“Ｌ”を交互に繰り返すトグル動作をするようになって
いる。
モートコントローラの電源キーを一度押し操作すると、
システムマイコン３６の電源制御ポート３６ａから
“Ｌ”レベルが出力され、さらにもう一度押し操作する
と、電源制御ポート３６ａからは“Ｈ”レベルが出力さ
れる。すなわち、電源制御ポート３６ａは“Ｈ”，
“Ｌ”を交互に繰り返すトグル動作をするようになって
いる。
【００２９】さて、リレー・ドライブトランジスタＴｒ
２が非導通状態で、電源リレー４０がオフ状態になって
いるときに、電源スイッチ３８またはリモコンの電源キ
ーを押し操作すると、システムマイコン３６の電源制御
ポート３６ａから“Ｌ”レベルが出力され、リレー制御
トランジスタＴｒ１は非導通状態に反転するため、リレ
ー・ドライブトランジスタＴｒ２は導通状態に反転す
る。したがって、定電圧電源３４から電源リレー４０の
リレーコイルに電流が流れ、電源リレー４０がオン状態
となる。
２が非導通状態で、電源リレー４０がオフ状態になって
いるときに、電源スイッチ３８またはリモコンの電源キ
ーを押し操作すると、システムマイコン３６の電源制御
ポート３６ａから“Ｌ”レベルが出力され、リレー制御
トランジスタＴｒ１は非導通状態に反転するため、リレ
ー・ドライブトランジスタＴｒ２は導通状態に反転す
る。したがって、定電圧電源３４から電源リレー４０の
リレーコイルに電流が流れ、電源リレー４０がオン状態
となる。
【００３０】電源リレー４０がオン状態になると、コン
セント３０から電源リレー４０、タップ切換スイッチ４
２を介してメイン電源トランス４４の１次巻線に電流が
流れ、２次巻線に誘導され降圧された交流電流が全波整
流ダイオード４６と平滑コンデンサＣ２，Ｃ３によって
直流化されて直流電源（＋Ｂ），（−Ｂ）を発生すると
ともに、全波整流ダイオード４８と平滑コンデンサＣ
４，Ｃ５によって直流化されて直流電源（＋Ｂ1 ），
（−Ｂ1 ）を発生する。直流電源（＋Ｂ），（−Ｂ）は
図示しない負荷回路に供給される。直流電源（＋
Ｂ1 ），（−Ｂ1 ）は図２に示す比較部５０のコンパレ
ータ５２，５４の高電位側電源および低電位側電源とし
て供給されるとともに、直流電源（＋Ｂ1 ）は論理部５
６、時定数回路５８、インバータ回路６０、分離用回路
６２に供給される。
セント３０から電源リレー４０、タップ切換スイッチ４
２を介してメイン電源トランス４４の１次巻線に電流が
流れ、２次巻線に誘導され降圧された交流電流が全波整
流ダイオード４６と平滑コンデンサＣ２，Ｃ３によって
直流化されて直流電源（＋Ｂ），（−Ｂ）を発生すると
ともに、全波整流ダイオード４８と平滑コンデンサＣ
４，Ｃ５によって直流化されて直流電源（＋Ｂ1 ），
（−Ｂ1 ）を発生する。直流電源（＋Ｂ），（−Ｂ）は
図示しない負荷回路に供給される。直流電源（＋
Ｂ1 ），（−Ｂ1 ）は図２に示す比較部５０のコンパレ
ータ５２，５４の高電位側電源および低電位側電源とし
て供給されるとともに、直流電源（＋Ｂ1 ）は論理部５
６、時定数回路５８、インバータ回路６０、分離用回路
６２に供給される。
【００３１】負荷回路を流れる電流が正常である場合、
すなわち、図３の基準の電流ｉ1 よりも小さい場合（ハ
ッチング部分でないとき）、コンパレータ５２の入力電
圧ＶX は比較基準電圧Ｖref1よりも高く、かつ、コンパ
レータ５４の入力電圧ＶY は比較基準電圧Ｖref2よりも
低いので、両コンパレータ５２，５４の出力電圧はとも
に“Ｌ”レベルとなる。
すなわち、図３の基準の電流ｉ1 よりも小さい場合（ハ
ッチング部分でないとき）、コンパレータ５２の入力電
圧ＶX は比較基準電圧Ｖref1よりも高く、かつ、コンパ
レータ５４の入力電圧ＶY は比較基準電圧Ｖref2よりも
低いので、両コンパレータ５２，５４の出力電圧はとも
に“Ｌ”レベルとなる。
【００３２】このときは、論理部５６におけるトランジ
スタＴｒ３，Ｔｒ４が共に非導通状態であるから、スイ
ッチングダイオードＤ２，Ｄ３はともに非導通状態であ
る。
スタＴｒ３，Ｔｒ４が共に非導通状態であるから、スイ
ッチングダイオードＤ２，Ｄ３はともに非導通状態であ
る。
【００３３】したがって、論理部５６の出力電圧ＶZ は
“Ｈ”レベルとなっており、逆流防止ダイオードＤ５を
介して時定数回路５８の充放電コンデンサＣ６に充電が
行われている。そして、この充電電圧がトランジスタＴ
ｒ５のベースに印加されているから、このトランジスタ
Ｔｒ５は導通状態にあり、インバータ回路６０における
反転用のトランジスタＴｒ６も導通状態にあり、そのコ
レクタはトランジスタＴｒ６を介しての接地によって
“Ｌ”レベルとなっている。したがって、分離用回路６
２におけるトランジスタＴｒ７は非導通状態となってお
り、制御部６４における制御トランジスタＴｒ９は、そ
のベースがＧＮＤレベルであるため非導通状態であり、
スイッチングトランジスタＴｒ１０も非導通状態に保た
れている。
“Ｈ”レベルとなっており、逆流防止ダイオードＤ５を
介して時定数回路５８の充放電コンデンサＣ６に充電が
行われている。そして、この充電電圧がトランジスタＴ
ｒ５のベースに印加されているから、このトランジスタ
Ｔｒ５は導通状態にあり、インバータ回路６０における
反転用のトランジスタＴｒ６も導通状態にあり、そのコ
レクタはトランジスタＴｒ６を介しての接地によって
“Ｌ”レベルとなっている。したがって、分離用回路６
２におけるトランジスタＴｒ７は非導通状態となってお
り、制御部６４における制御トランジスタＴｒ９は、そ
のベースがＧＮＤレベルであるため非導通状態であり、
スイッチングトランジスタＴｒ１０も非導通状態に保た
れている。
【００３４】なお、電源リレー４０がオフ状態からオン
状態に切り換わった直後においては、分離用回路６２に
おけるトランジスタＴｒ８は非導通状態となるように設
計されている。すなわち、積分抵抗Ｒ８と積分コンデン
サＣ７とによる積分回路によって、トランジスタＴｒ８
のベース電位をゆっくりと立ち上げるようにしているか
らである。
状態に切り換わった直後においては、分離用回路６２に
おけるトランジスタＴｒ８は非導通状態となるように設
計されている。すなわち、積分抵抗Ｒ８と積分コンデン
サＣ７とによる積分回路によって、トランジスタＴｒ８
のベース電位をゆっくりと立ち上げるようにしているか
らである。
【００３５】もし、電源リレー４０のオン時にこのトラ
ンジスタＴｒ８が瞬時に導通状態になるのであれば、ト
ランジスタＴｒ７も導通状態となってしまい、制御トラ
ンジスタＴｒ９が導通し、スイッチングトランジスタＴ
ｒ１０が導通するので、システムマイコン３６の電源制
御ポート３６ａは、電源リレー４０をオンにするため
“Ｌ”レベルを出力した直後に、スイッチングトランジ
スタＴｒ１０の導通に基づくトグル動作により“Ｈ”レ
ベルを出力することとなり、電源リレー４０をオンする
ことができなくなってしまう。
ンジスタＴｒ８が瞬時に導通状態になるのであれば、ト
ランジスタＴｒ７も導通状態となってしまい、制御トラ
ンジスタＴｒ９が導通し、スイッチングトランジスタＴ
ｒ１０が導通するので、システムマイコン３６の電源制
御ポート３６ａは、電源リレー４０をオンにするため
“Ｌ”レベルを出力した直後に、スイッチングトランジ
スタＴｒ１０の導通に基づくトグル動作により“Ｈ”レ
ベルを出力することとなり、電源リレー４０をオンする
ことができなくなってしまう。
【００３６】電源リレー４０を確実にオン状態にするた
めに、積分抵抗Ｒ８と積分コンデンサＣ７およびトラン
ジスタＴｒ８を有する分離用回路６２をインバータ回路
６０と制御部６４との間に介挿してあるのである。イン
バータ回路６０のトランジスタＴｒ６が確実に導通状態
となってそのコレクタが“Ｌ”レベルになった後には、
分離用回路６２のトランジスタＴｒ８が非導通状態から
導通状態になっても、トランジスタＴｒ７は非導通状態
を保つので問題はない。
めに、積分抵抗Ｒ８と積分コンデンサＣ７およびトラン
ジスタＴｒ８を有する分離用回路６２をインバータ回路
６０と制御部６４との間に介挿してあるのである。イン
バータ回路６０のトランジスタＴｒ６が確実に導通状態
となってそのコレクタが“Ｌ”レベルになった後には、
分離用回路６２のトランジスタＴｒ８が非導通状態から
導通状態になっても、トランジスタＴｒ７は非導通状態
を保つので問題はない。
【００３７】次に、負荷回路において流れる電流が図３
の基準の電流ｉ1 よりも大きくなった場合（ハッチング
部分に入った場合）、すなわち、コンパレータ５２の入
力電圧ＶX が比較基準電圧Ｖref1よりも低くなるか、ま
たは、コンパレータ５４の入力電圧ＶY が比較基準電圧
Ｖref2よりも高くなった場合について考える。
の基準の電流ｉ1 よりも大きくなった場合（ハッチング
部分に入った場合）、すなわち、コンパレータ５２の入
力電圧ＶX が比較基準電圧Ｖref1よりも低くなるか、ま
たは、コンパレータ５４の入力電圧ＶY が比較基準電圧
Ｖref2よりも高くなった場合について考える。
【００３８】この場合、両コンパレータ５２，５４の出
力電圧のいずれかが“Ｈ”レベルとなり、論理部５６に
おけるトランジスタＴｒ３，Ｔｒ４のいずれかが導通状
態となるから、スイッチングダイオードＤ２，Ｄ３のい
ずれかが導通状態となる。したがって、論理部５６の出
力電圧ＶZ は“Ｌ”レベルとなるため、時定数回路５８
における充放電コンデンサＣ６に対する充電が停止す
る。
力電圧のいずれかが“Ｈ”レベルとなり、論理部５６に
おけるトランジスタＴｒ３，Ｔｒ４のいずれかが導通状
態となるから、スイッチングダイオードＤ２，Ｄ３のい
ずれかが導通状態となる。したがって、論理部５６の出
力電圧ＶZ は“Ｌ”レベルとなるため、時定数回路５８
における充放電コンデンサＣ６に対する充電が停止す
る。
【００３９】すると、充放電コンデンサＣ６の充電電荷
が接地抵抗Ｒ５とトランジスタＴｒ５のベース抵抗Ｒ６
およびエミッタ接地抵抗Ｒ７とを介して放電される。そ
の放電の時定数τは、接地抵抗Ｒ５の抵抗値をＲ5 と
し、ベース抵抗Ｒ６とエミッタ接地抵抗Ｒ７を含むトラ
ンジスタＴｒ５側の総合抵抗値をＲinとすると、これら
の並列抵抗の合成抵抗値が（Ｒ5 ＋Ｒin）／（Ｒ5 ・Ｒ
in）であるから、充放電コンデンサＣ６の静電容量をＣ
6 として、 τ＝Ｃ6 ・（Ｒ5 ＋Ｒin）／（Ｒ5 ・Ｒin） となる。
が接地抵抗Ｒ５とトランジスタＴｒ５のベース抵抗Ｒ６
およびエミッタ接地抵抗Ｒ７とを介して放電される。そ
の放電の時定数τは、接地抵抗Ｒ５の抵抗値をＲ5 と
し、ベース抵抗Ｒ６とエミッタ接地抵抗Ｒ７を含むトラ
ンジスタＴｒ５側の総合抵抗値をＲinとすると、これら
の並列抵抗の合成抵抗値が（Ｒ5 ＋Ｒin）／（Ｒ5 ・Ｒ
in）であるから、充放電コンデンサＣ６の静電容量をＣ
6 として、 τ＝Ｃ6 ・（Ｒ5 ＋Ｒin）／（Ｒ5 ・Ｒin） となる。
【００４０】負荷回路での過電流発生のために充放電コ
ンデンサＣ６からの放電の状態が所定時間Ｔ0 以上継続
すると、充放電コンデンサＣ６の充電電圧がトランジス
タＴｒ５の導通電圧を下回る結果となる。このときは、
このトランジスタＴｒ５が導通状態から非導通状態へと
反転する。すると、インバータ回路６０におけるトラン
ジスタＴｒ６が導通状態から非導通状態に反転し、その
コレクタは直流電源（＋Ｂ1 ）によって“Ｈ”レベルと
なる。分離用回路６２のトランジスタＴｒ８は導通状態
にあるから、トランジスタＴｒ６のコレクタが“Ｈ”レ
ベルに反転すると、トランジスタＴｒ７が導通し、制御
部６４における制御トランジスタＴｒ９も導通して、ス
イッチングトランジスタＴｒ１０のベース電位がＧＮＤ
レベルに落ちるために、このスイッチングトランジスタ
Ｔｒ１０が非導通状態から導通状態へと切り換えられ
る。
ンデンサＣ６からの放電の状態が所定時間Ｔ0 以上継続
すると、充放電コンデンサＣ６の充電電圧がトランジス
タＴｒ５の導通電圧を下回る結果となる。このときは、
このトランジスタＴｒ５が導通状態から非導通状態へと
反転する。すると、インバータ回路６０におけるトラン
ジスタＴｒ６が導通状態から非導通状態に反転し、その
コレクタは直流電源（＋Ｂ1 ）によって“Ｈ”レベルと
なる。分離用回路６２のトランジスタＴｒ８は導通状態
にあるから、トランジスタＴｒ６のコレクタが“Ｈ”レ
ベルに反転すると、トランジスタＴｒ７が導通し、制御
部６４における制御トランジスタＴｒ９も導通して、ス
イッチングトランジスタＴｒ１０のベース電位がＧＮＤ
レベルに落ちるために、このスイッチングトランジスタ
Ｔｒ１０が非導通状態から導通状態へと切り換えられ
る。
【００４１】すると、システムマイコン３６のトグル動
作により、それまで“Ｌ”レベルを出力していた電源制
御ポート３６ａが“Ｈ”レベルを出力することになる。
その結果、リレー制御トランジスタＴｒ１が導通状態と
なり、リレー・ドライブトランジスタＴｒ２のベース電
位がＧＮＤレベルに落ちるためこのリレー・ドライブト
ランジスタＴｒ２が非導通状態に切り換わり、電源リレ
ー４０がオフ状態となる。
作により、それまで“Ｌ”レベルを出力していた電源制
御ポート３６ａが“Ｈ”レベルを出力することになる。
その結果、リレー制御トランジスタＴｒ１が導通状態と
なり、リレー・ドライブトランジスタＴｒ２のベース電
位がＧＮＤレベルに落ちるためこのリレー・ドライブト
ランジスタＴｒ２が非導通状態に切り換わり、電源リレ
ー４０がオフ状態となる。
【００４２】すなわち、負荷回路において過電流が所定
時間Ｔ0 以上にわたって継続する異常状態が発生すれ
ば、電源リレー４０が自動的にオフにされ、負荷回路に
対する電源供給が自動的に遮断される。したがって、回
路各部を異常電流から保護することができる。また、電
流ヒューズの溶断といったことがなく、したがって、面
倒な電流ヒューズ交換の必要もない。
時間Ｔ0 以上にわたって継続する異常状態が発生すれ
ば、電源リレー４０が自動的にオフにされ、負荷回路に
対する電源供給が自動的に遮断される。したがって、回
路各部を異常電流から保護することができる。また、電
流ヒューズの溶断といったことがなく、したがって、面
倒な電流ヒューズ交換の必要もない。
【００４３】論理部５６の出力電圧ＶZ が“Ｌ”レベル
となるのは、負荷回路に異常電流が発生した場合だけと
は限らない。例えば、オーディオ機器においてミュージ
ック・ソースで一瞬大きな音が出力された場合にも、大
きな電流が流れ、出力電圧ＶZ が“Ｌ”レベルとなるこ
とがある。
となるのは、負荷回路に異常電流が発生した場合だけと
は限らない。例えば、オーディオ機器においてミュージ
ック・ソースで一瞬大きな音が出力された場合にも、大
きな電流が流れ、出力電圧ＶZ が“Ｌ”レベルとなるこ
とがある。
【００４４】しかし、それはミュージック・ソースが原
因であるので、出力電圧ＶZ が“Ｌ”レベルとなるのは
一瞬であり、再び“Ｈ”レベルに戻る。出力電圧ＶZ が
一瞬“Ｌ”レベルとなって、時定数回路５８における充
放電コンデンサＣ６から放電が行われたとしても、トラ
ンジスタＴｒ５を非導通状態に切り換えるまでには至ら
ず、出力電圧ＶZ が再び“Ｈ”レベルに戻って充放電コ
ンデンサＣ６を充電する。なお、Ｒ5 をＲinよりも充分
に大きく設定しておくことにより、充放電コンデンサＣ
６への充電を急速に行うことができる。
因であるので、出力電圧ＶZ が“Ｌ”レベルとなるのは
一瞬であり、再び“Ｈ”レベルに戻る。出力電圧ＶZ が
一瞬“Ｌ”レベルとなって、時定数回路５８における充
放電コンデンサＣ６から放電が行われたとしても、トラ
ンジスタＴｒ５を非導通状態に切り換えるまでには至ら
ず、出力電圧ＶZ が再び“Ｈ”レベルに戻って充放電コ
ンデンサＣ６を充電する。なお、Ｒ5 をＲinよりも充分
に大きく設定しておくことにより、充放電コンデンサＣ
６への充電を急速に行うことができる。
【００４５】このように、ミュージック・ソースが原因
で出力電圧ＶZ が一瞬“Ｌ”レベルとなったとしても、
時定数回路５８の存在により、不測に電源リレー４０を
オフ状態に切り換えてしまうといった誤動作を回避する
ことができる。
で出力電圧ＶZ が一瞬“Ｌ”レベルとなったとしても、
時定数回路５８の存在により、不測に電源リレー４０を
オフ状態に切り換えてしまうといった誤動作を回避する
ことができる。
【００４６】なお、負荷回路によっては、電流が基準の
電流ｉ1 を超えるときは必ず異常状態となっているもの
もある。このような負荷回路に対しては、時定数回路５
８を設ける必要はなく、論理部５６の出力電圧ＶZ をイ
ンバータ回路６０のトランジスタＴｒ６のベースに直接
入力するように構成する。
電流ｉ1 を超えるときは必ず異常状態となっているもの
もある。このような負荷回路に対しては、時定数回路５
８を設ける必要はなく、論理部５６の出力電圧ＶZ をイ
ンバータ回路６０のトランジスタＴｒ６のベースに直接
入力するように構成する。
【００４７】また、電源リレー４０としては、図示の電
磁リレーのほか、半導体素子を用いた無接点リレーであ
ってもよい。タップ切換スイッチ４２を設けないもので
もよい。
磁リレーのほか、半導体素子を用いた無接点リレーであ
ってもよい。タップ切換スイッチ４２を設けないもので
もよい。
【００４８】
【発明の効果】本発明に係る第１の電源オン・オフ・リ
レー回路によれば、電源リレーを対過電流安全対策のた
めの保護回路として兼用するように構成し、異常電流発
生時の電源遮断をヒューズレスで実現するようにしたの
で、回路の引き回しの自由度が増すとともに、省スペー
スおよびコストダウンを図ることができる。
レー回路によれば、電源リレーを対過電流安全対策のた
めの保護回路として兼用するように構成し、異常電流発
生時の電源遮断をヒューズレスで実現するようにしたの
で、回路の引き回しの自由度が増すとともに、省スペー
スおよびコストダウンを図ることができる。
【００４９】また、本発明に係る第２の電源オン・オフ
・リレー回路によれば、上記の効果に加えて、異常に起
因した過電流検出と正常動作中での一時的な過大負荷に
起因した過電流検出とを明確に区別し、異常時にのみ電
源リレーをオフするので、一時的な過大負荷のときの誤
動作を防止することができる。
・リレー回路によれば、上記の効果に加えて、異常に起
因した過電流検出と正常動作中での一時的な過大負荷に
起因した過電流検出とを明確に区別し、異常時にのみ電
源リレーをオフするので、一時的な過大負荷のときの誤
動作を防止することができる。
【図１】本発明の一実施例に係る電源オン・オフ・リレ
ー回路のうちの半分を示す回路図である。
ー回路のうちの半分を示す回路図である。
【図２】上記実施例の電源オン・オフ・リレー回路の残
りの半分を示す回路図である。
りの半分を示す回路図である。
【図３】実施例における負荷回路での電流対電圧特性曲
線図である。
線図である。
【図４】従来例に係る電源オン・オフ・リレー回路を示
す回路図である。
す回路図である。
３２ リレー用サブトランス ３４ 定電圧電源 ３６ システムマイコン ３６ａ 電源制御ポート ４０ 電源リレー ４４ メイン電源トランス ４６ 全波整流ダイオード ５０ 比較部 ５２ コンパレータ ５４ コンパレータ ５６ 論理部 ５８ 時定数回路 ６０ インバータ回路 ６２ 分離用回路 ６４ 制御部 Ｔｒ１ リレー制御トランジスタ Ｔｒ２ リレー・ドライブトランジスタ Ｔｒ９ 制御トランジスタ Ｔｒ１０ スイッチングトランジスタ Ｃ１ 平滑コンデンサ Ｃ２ 平滑コンデンサ Ｃ６ 充放電コンデンサ Ｃ７ 積分コンデンサ Ｒ１〜Ｒ４ 分圧抵抗 Ｒ５ 接地抵抗 Ｒ７ エミッタ接地抵抗 Ｒ８ 積分抵抗 ＶX ，ＶY 比較部への入力電圧 ＶZ 論理部の出力電圧
Claims (2)
- 【請求項１】 メイン電源トランスの１次側に電源リレ
ーを設けるとともに、常時的にアクティブとなる定電圧
電源を設け、電源オン操作によって前記定電圧電源から
前記電源リレーに駆動電流を流してこの電源リレーをオ
ンにするように構成してある電源オン・オフ・リレー回
路において、前記メイン電源トランスの２次側における
電圧変化を利用して負荷電流の過剰を検出する過電流検
出手段を設け、この過電流検出手段が動作したときに前
記電源リレーを自動的にオフにするように構成したこと
を特徴とする電源オン・オフ・リレー回路。 - 【請求項２】 メイン電源トランスの１次側に電源リレ
ーを設けるとともに、常時的にアクティブとなる定電圧
電源を設け、電源オン操作によって前記定電圧電源から
前記電源リレーに駆動電流を流してこの電源リレーをオ
ンにするように構成してある電源オン・オフ・リレー回
路において、前記メイン電源トランスの２次側における
電圧変化を利用して負荷電流の過剰を検出する過電流検
出手段を設けるとともに、この過電流検出手段が動作し
たときにその過電流検出状態が所定時間以上継続するか
どうかを判定する過電流時間判定手段を設け、この過電
流時間判定手段が所定時間以上にわたる過電流検出状態
であると判定したときに前記電源リレーを自動的にオフ
にするように構成したことを特徴とする電源オン・オフ
・リレー回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4002279A JPH05191919A (ja) | 1992-01-09 | 1992-01-09 | 電源オン・オフ・リレー回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4002279A JPH05191919A (ja) | 1992-01-09 | 1992-01-09 | 電源オン・オフ・リレー回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05191919A true JPH05191919A (ja) | 1993-07-30 |
Family
ID=11524933
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4002279A Pending JPH05191919A (ja) | 1992-01-09 | 1992-01-09 | 電源オン・オフ・リレー回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05191919A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5882956A (en) * | 1996-01-22 | 1999-03-16 | Texas Instruments Japan Ltd. | Process for producing semiconductor device |
| US6007920A (en) * | 1996-01-22 | 1999-12-28 | Texas Instruments Japan, Ltd. | Wafer dicing/bonding sheet and process for producing semiconductor device |
-
1992
- 1992-01-09 JP JP4002279A patent/JPH05191919A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5882956A (en) * | 1996-01-22 | 1999-03-16 | Texas Instruments Japan Ltd. | Process for producing semiconductor device |
| US6007920A (en) * | 1996-01-22 | 1999-12-28 | Texas Instruments Japan, Ltd. | Wafer dicing/bonding sheet and process for producing semiconductor device |
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