JPH05232902A - データ・ストリームを変更するシステム - Google Patents

データ・ストリームを変更するシステム

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JPH05232902A
JPH05232902A JP4244022A JP24402292A JPH05232902A JP H05232902 A JPH05232902 A JP H05232902A JP 4244022 A JP4244022 A JP 4244022A JP 24402292 A JP24402292 A JP 24402292A JP H05232902 A JPH05232902 A JP H05232902A
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data
driver
mpu
interface device
segment
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JP4244022A
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Harvey Wong
ハーベイ・ウォン
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Original Assignee
Motorola Inc
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Abstract

(57)【要約】 【目的】 ＬＣＤコントローラ／ドライバは、２方向の
データ・リングを利用して、迅速で簡単なデータの変更
と移動とを可能にする。 【構成】 コントローラ／ドライバは、縦続接続された
セグメント・ドライバを、行データ・シリアル・インタ
ーフェースに結合し、この行データ・シリアル・インタ
ーフェースは前記ドライバを制御回路にリンクする。行
データ・シリアル・インターフェースに結合された縦続
接続されたセグメント・ドライバにより、２方向のデー
タ・リングが規定される。セグメント・ドライバに入力
された表示データは、このデータをデータ・リングに移
動させたり、このようなデータを別のセグメント・ドラ
イバに転送するか、あるいは別のセグメント・ドライバ
を通じて行データ・シリアル・インターフェースに転送
することにより、変更することができる。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、一般的に、液晶表示装
置（ＬＣＤ）のためのグラフィック支援ユニットに関す
る。
【０００２】
【従来の技術および発明が解決しようとする課題】従
来、よいグラフィックを支援するには、複雑なＬＣＤコ
ントローラを必要とした。ＬＣＤスクリーン上に表示さ
れるグラフィックがますます複雑になるに従い、従来の
支援装置の数が増加した。グラフィック操作の複雑性が
増大して、グラフィック駆動装置の寸法が大きくなるに
つれて、蓄積された電力の消費も大きくなる。ＬＣＤ
が、バッテリに蓄積された電力で駆動されるハンドヘル
ドの電子装置の一部であるときは、電力の消費は大きな
問題となる。さらに、常に小型化が行われているハンド
ヘルド装置を構築する際には、ＬＣＤ支援装置の寸法を
慎重に考慮しなければならない。
【０００３】電子産業市場におけるもうひとつの流れ
は、装置の高速化と、装置の可能出力の増大化である。
装置の可能出力は、マイクロプロセッシング・ユニット
（ＭＰＵ）の負荷に依存することが多い。高速に対応す
る要素が、通常ＭＰＵに要求される機能の多くを実行す
ることができるならば、ＭＰＵが解放されて、さらに高
度な機能を実行するようになる。
【０００４】
【課題を解決するための手段】本発明により、ＬＣＤコ
ントローラ／ドライバは、２方向のデータ・リングを利
用して、迅速で簡単なデータの変更と移動とを可能にす
る。本コントローラ／ドライバは、縦続接続された（ca
scaded）セグメント・ドライバ群を、行データ・シリア
ル・インターフェースに結合させる。このインターフェ
ースは、ドライバ群を制御回路に接続させる。行データ
・シリアル・インターフェースに結合された、縦続接続
セグメント・ドライバにより、２方向のデータ・リング
が規定される。セグメント・ドライバに入力された表示
データは、データをデータ・リング内に移動したり、こ
のデータを別のセグメント・ドライバに送るか、あるい
は別のドライバを通じて、行データ・シリアル・インタ
ーフェースに送ることにより変更することができる。こ
のインターフェース内では、データは制御回路からの入
力により改変される。制御回路は、さらに横方向のポイ
ンタ・レジスタに結合される。横方向ポインタ／レジス
タは、ＭＰＵからの命令により、２カ所をデータ・リン
グのデータ・ストリーム内にラッチする。これらのポイ
ンタにより、ＭＰＵにより修正または置き換えられる領
域（能動領域）の境界が決まる。
【０００５】本発明の上記およびその他の特徴と利点と
は、以下の詳細な説明と添付の図面とにより、さらに良
く理解されるだろう。
【０００６】
【実施例】図１は、ＬＣＤ１２に結合されたＬＣＤコン
トローラ／ドライバ１０を示す。ＬＣＤコントローラ／
ドライバ１０は、セグメント制御インターフェース２
２，行データ・シリアル・インターフェース２４，ＬＣ
Ｄタイミング発生器２６およびＬＣＤドライバ２８によ
って構成される。セグメント制御インターフェース２２
と、行データ・シリアル・インターフェース２４と、タ
イミング信号を発生するＬＣＤタイミング発生器２６と
は、マイクロ制御ユニット（ＭＣＵ）２１の一部として
図示されている。
【０００７】制御回路２０は、マイクロプロセッシング
・ユニット（ＭＰＵ）１８に結合されており、ＭＰＵ１
８は図示されてはいないが、図１に番号が示されてい
る。コントローラ／ドライバ１０はＬＣＤグラフィック
制御のために用いられるので、情報はインターフェース
２２，２４，２６とＭＰＵ１８との間でやり取りされ
る。
【０００８】ＭＰＵ１８はタイミング信号をＬＣＤタイ
ミング発生器２６に送り、セグメント制御信号をインタ
ーフェース２２に送る。情報はＭＰＵ１８と行データ・
シリアル・インターフェース２４との間で両方向に送る
ことができる。
【０００９】情報はＬＣＤドライバ２８と行データ・シ
リアル・インターフェース２４との間で両方向に中継さ
れる。
【００１０】行データ・シリアル・インターフェース２
４は、ＬＣＤドライバ群２８とＭＰＵ１８との間での高
速のシリアル・ビット転送，ポインタ機能，可変ピッチ
選択，スクリーン幅定義およびその他のシリアル・デー
タの処理機能に対応するシリアル・インターフェースで
ある。以下にさらに詳細に説明するように、行データ・
シリアル・インターフェース２４と縦続接続されたセグ
メント・ドライバとが接続されて、データ・リング内の
データの流れが２方向であるようなデータ・リングを形
成する。表示データの行またはその部分は、ＭＰＵ１８
とドライバ群２８との間で、行データ・シリアル・イン
ターフェース２４を通じてやり取りされる。このような
情報の転送により、データに簡単にアクセスして、更新
や改変が可能になる。表示されるすべてのデータは、行
データ・シリアル・インターフェース２４を通じて送ら
れる。
【００１１】セグメント制御インターフェース２２は、
ドライバ群２８にコマンドを供給する。セグメント制御
インターフェース２２と行データ・シリアル・インター
フェース２４との相互の関係は、あとで図３に関連して
説明する。
【００１２】ＬＣＤタイミング発生器２６は、ドライバ
群２８の個々のドライバ間での表示の同期をとるための
タイミング信号を供給する。
【００１３】図２は、ＬＣＤドライバ２８の要素を分解
した、図１の回路を示す。ＬＣＤドライバ群２８は、バ
ックプレーン（または行）ドライバ（群）３０と（図２
では説明のために１台のドライバとして図示されてい
る）、セグメント（または列）ドライバ３２，３４とに
よって構成される。図２では２台のセグメント・ドライ
バのみが図示されているが、ＬＣＤ１２の幅に応じて、
ドライバ３２，３４と同様のセグメント・ドライバを任
意の数だけ直列に結合させることができる点を理解され
たい。
【００１４】バックプレーン・ドライバ３０は、８０個
の高電圧ＬＣＤ駆動信号よりなるＣＭＯＳチップである
ことが好ましい。バックプレーン・ドライバ３０は、３
２ないし２５６の多重比に対応する。複数のバックプレ
ーン・ドライバ３０を従属接続して、６５よりも大きな
ドライバ・カウントを達成することもできる。当業者で
あれば、バックプレーン・ドライバ３０は、ＬＣＤ１２
のための縦型表示制御であることが理解いただけよう。
バックプレーン・ドライバ３０はＬＣＤ１２の行を活動
させ、そこに表示データの行が表示される。
【００１５】バックプレーン・ドライバ３０は、ＬＣＤ
タイミング発生器２６に結合されている。
【００１６】セグメント・ドライバ３２，３４は、いず
れもセグメント制御インターフェース２２と、ＬＣＤタ
イミング発生器２６とに結合され、行データ・シリアル
・インターフェース２４とは２方向に結合されている。
さらにセグメント・ドライバ３２，３４は、互いに、２
方向結合されている。
【００１７】図１に関して説明されたデータ・リング
を、図２で容易に見ることができる。表示データは、１
ビット２方向のシリアル・ライン（３８）を通じて、行
データ・シリアル・インターフェース２４から、セグメ
ント・ドライバ３２，３４に入力される。セグメント制
御インターフェース２２からの信号線３６は、制御信号
をセグメント・ドライバ３２，３４に入力する。この表
示データは、一方のセグメント・ドライバから別のセグ
メント・ドライバに移動することができ、ＭＰＵ１８に
より更新され、あるいはＬＣＤ１２上に表示することが
できる。
【００１８】図３は、セグメント・ドライバ３２の要
素、ならびにセグメント・ドライバ３２とセグメント制
御インターフェース２２との関係と、データ・リングの
他の要素とを示している。
【００１９】セグメント・ドライバ３２は一般に、ＬＣ
Ｄタイミング発生器２６に結合されたタイミング論理４
０と、８ビットのバス・ライン３６を介してセグメント
制御インターフェース２２に結合された制御論理４２
と、ＬＣＤ１２に結合された高電圧ドライバ・アレイ４
４と、タイミング論理４０と高電圧ドライバ・アレイ４
４とに結合された表示データ・ラッチ・アレイ４６と、
表示データ・ラッチ・アレイ４６に結合されたランダム
・アクセス・メモリ（ＲＡＭ）４８とから構成される。
ＲＡＭ４８は、さらにタイミング論理４０と、制御論理
４２とに結合されている。セグメント・ドライバ３２は
さらに、制御論理４２とＲＡＭ４８とに結合され、デー
タ・リング３８内にリンクされているシフト・レジスタ
５０も含んでいる。
【００２０】ＲＡＭ４８はＮ行の高さと、１６０ビット
の幅を持つ。同様に、シフト・レジスタ５０と、表示デ
ータ・ラッチ・アレイ４６と、高電圧ドライバ・アレイ
４４も１６０ビットの幅を持つ。セグメント・ドライバ
３２，３４のように、２台のセグメント・ドライバが縦
続接続されると、ＬＣＤ１２は３２０ビットの幅を持
つ。本発明は、データ・リング内の縦続接続されたセグ
メント・ドライバの数を特に２台に制限するものではな
い。セグメント・ドライバの数の制約は、横方向のルー
プ・サイズ・レジスタ（以下に説明）の大きさに依存す
る。本実施例の１０ビットのループ・サイズが用いられ
ると、最大６台までのセグメント・ドライバを縦続接続
することができる。
【００２１】表示データは、データ・リング３８からシ
フト・レジスタ５０により受け取られる。シフト・レジ
スタ５０は、表示データをＲＡＭ４８内に入力すること
も、データ・リング３８上に移動することもできる。シ
フト・レジスタ５０からＲＡＭ４８への表示データの転
送は、ライン５２により示されるようなセグメント制御
インターフェース２２からの制御信号により制御され
る。データ・リング３８内の表示データがその指定され
た位置におかれると直ちに、ＭＰＵは制御論理４２を通
じて、すべてのセグメント・ドライバに対して、表示デ
ータをシフト・レジスタ５０からＲＡＭ４８に移動させ
るように命令する。
【００２２】制御論理４２からの制御信号により、タイ
ミング論理４０からのタイミング信号によって、ＲＡＭ
４８から表示データ・ドライバ・アレイ４６に移動され
るデータ行も支配される。表示データ・ドライバ・アレ
イ４６にラッチされたデータは、高電圧ドライバ・アレ
イ４４にクロックされ、その後ＬＣＤ１２上に表示され
る。
【００２３】ＭＰＵが制御論理４２に対して、表示デー
タをセグメント・ドライバのＲＡＭ４８に入れるように
命令することができるように、ＭＰＵはまた、制御論理
４２に対して、ＲＡＭ４８から表示データを回収してシ
フト・レジスタ５０に入れるように命令することもでき
る。これで、表示データはデータ・リングに戻る。デー
タ・リング３８から回収された表示データは、修正，入
れ替えあるいは別のスクリーンへの転送を行うことがで
きる。
【００２４】ＬＣＤコントローラ／ドライバ１０は、図
４に示されるようなＬＣＤ１２，１３を組み込む分割パ
ネルＬＣＤに結合することもできる。図４は、セグメン
ト・ドライバ３２／３４と３３／３５とにそれぞれ結合
されたＬＣＤ１２，１３を有する分割パネルを示す。Ｌ
ＣＤ１２，１３はいずれも、バックプレーン・ドライバ
３０に結合される。セグメント・ドライバ３２／３４，
３３／３５は、ＭＣＵ２１に結合される。この実施例に
おいては、２個のループがデータ・リングを形成してい
る。１つのループは、セグメント・ドライバ３２，３４
により動作し、もう一方のループはセグメント・ドライ
バ３３，３５により動作する。一般に、各ループは互い
に独立して動作する。しかし、両方のループを図５に示
されるように、パス・スイッチおよび組合せ論理（ＰＣ
Ｌ）６０により１個のデータ・リングに接続することも
できる。表示されるデータはすでにセグメント・ドライ
バのＲＡＭ内に記憶されているので、セグメント・ドラ
イバの異なるバンク間でデータを転送する手段があれ
ば、ＭＰＵ１８の監視を最低限に抑えることができる。
ＭＰＵ１８は、セグメント・ドライバのＲＡＭから得た
一方のスクリーンのためのデータを、データ・リング内
に入れることができる。次にＭＰＵ１８が、ＰＣＬ６０
で上部スクリーンと下部スクリーンのためのループを結
合させると、データは一方のスクリーンのセグメント・
ドライバから、もう一方のスクリーンのセグメント・ド
ライバに直接転送される。図５では１方向のデータの流
れを示しているが、データ・リングを２方向にすること
ができる、すなわちデータを両方向に転送することがで
きる点に留意されたい。さらに、データが一方のスクリ
ーンからもう一方のスクリーンに転送されているとき
に、データをビット・ストリームに入れることができ
る。スクリーン間でデータを転送するこの方法は、従来
の方法よりも速度が速く、ＭＰＵに対する負担を小さく
する。
【００２５】表示情報の制御は図６を参照することによ
り理解される。制御回路２０は、横方向ループ・サイズ
・レジスタ６２と、横方向ポインタ・レジスタ６４と、
横方向ピッチ・レジスタ６６と、モードおよび属性レジ
スタ６８と、ステータス・レジスタ７０とに結合されて
いる。制御回路２０は、ステータス・レジスタ７０を除
くすべてのレジスタから信号を受け取る。ステータス・
レジスタ７０では、制御回路２０がステータス信号をス
テータス・レジスタ７０に入力する。制御回路２０は、
パラレル・シリアル変換器７２に出力する。パラレル・
シリアル変換器７２の情報は、直接データ・リング３８
に出力されるか、あるいはＰＣＬ６０に出力される。Ｐ
ＣＬ６０から情報はデータ・リング３８に出力される。
パラレル・シリアル変換器７２，ＰＣＬ６０およびデー
タ・リング３８間での情報の転送は２方向である。
【００２６】パラレル・シリアル変換器７２は、直接Ｍ
ＰＵ１８に結合されて、表示データを受け取る。同様
に、横方向ループ・サイズ・レジスタ６２と、横方向ポ
インタ・レジスタ６４と、横方向ピッチ・レジスタ６６
と、モードおよび属性レジスタ６８と、ステータス・レ
ジスタ７０とはすべて、直接ＭＰＵ１８に結合してい
る。
【００２７】横方向ループ・サイズ・レジスタ６２は、
データ・リング３８内の縦続接続されたシフト・レジス
タのビット数を表す値を記憶する。この値は、（Ｓｎ
ＸＳｂ）−１である。ただし、Ｓｎは、共に縦続接続さ
れているシフタ・レジスタの数で、Ｓｂは、シフト・レ
ジスタの幅をビットで表したものである。セグメント・
ドライバ３２，３４に関しては、番号がゼロから始まる
ので、この値は（２Ｘ １６０）−１となる。横方向ル
ープ・サイズ・レジスタ６２は、動作当りのシフト・ク
ロックの数を制御する。
【００２８】横方向ポインタ・レジスタ６４は、（Ｓｎ
Ｘ Ｓｂ）−１のループ内で境界を形成する２個の横
方向ポインタをラッチする。これらのポインタは、左右
ポインタと呼ばれるが、入れ替えることもできる。ポイ
ンタにより、ＭＰＵ１８が表示データの改変，修正およ
び置き換えを行うループ全体の面積が決まる。２個のポ
インタにより境界が定められていないデータ・リング３
８内のデータ・ストリームの表示データ（能動領域と名
付けられたポインタ内のデータと、非能動領域と名付け
られていないデータ）は、ＭＰＵ１８により改変される
ことはない。
【００２９】横方向ピッチ・レジスタ６６は、データ・
ストリーム全体の能動領域内で、ＭＰＵ１８により修正
されるビット行列の幅を決める。
【００３０】モードおよび属性レジスタ６８は、動作の
種類を命令する。すなわち、動作を順次書き込み動作に
するか、順次読み込み動作にするか、または１ショット
の挿入または入れ替えにするかを命令する。モードおよ
び属性レジスタ６８は、また、表示スクリーンの属性を
指定する。言い換えれば、モードおよび属性レジスタ６
８は、背景の種類（黒地に白か、または白地に黒か）の
指示，重ね合わせの制御，ハイライト表示などを行う。
【００３１】ステータス・レジスタ７０には、行データ
・シリアル・インターフェース２４の現在のステータス
が含まれ、いくつかのフラッグを登録している。第１フ
ラッグが設定されている場合、これは、データ・リング
が現在データの移動を休止しており、ＭＰＵ１８がシフ
ト・レジスタにアクセスすることができることを示す。
第２フラッグが設定されている場合、これは、現在のビ
ットが能動領域内にあることを示す。第３フラッグは、
横方向ピッチ・レジスタ６６にオーバーフローが起こっ
たときに設定される。第４フラッグが明確であるとき
は、行データ・シリアル・インターフェース２４により
現在実行されている動作がないことを示す。
【００３２】ＲＡＭ４８内の表示データは、以下のよう
に改変または置き換えがなされる。ＭＰＵ１８は、横方
向ポインタ・レジスタ６４に値を書き込むことにより、
左右のポインタを設定する。これらのレジスタ値は、移
動されたビットの数と連続的に比較される。ポインタに
よりマークされたビット位置がパラレル・シリアル変換
器７２に到達すると、ＰＣＬ６０がそれに従って経路を
変更して、パラレル・シリアル変換器７２がループに組
み込まれるようにする。横方向ピッチ・レジスタ６６に
より指定されたサイクル数に到達しても、ループは停止
しない。順次動作（すなわち順次読み込み、または順次
書き込み）が選択されていると、ループはＭＰＵ１８の
アクセスのために停止する。１ショットの置き換えが選
択されていると、ループは停止せずに、ＰＣＬ６０が経
路を切り替えるだけで、パラレル・シリアル変換器７２
がループから排除される。１ショットの挿入が選択され
ていると、ループは前進を続けて、パラレル・シリアル
変換器７２はループ内に留まる。別のポインタによりマ
ークされたビット位置がパラレル・シリアル変換器７２
に到達すると、パラレル・シリアル変換器７２は、ルー
プから排除される。ポインタによりマークされたビット
がその元の位置に戻ると、ループの前進は停止する。
【００３３】順次動作を詳細に説明するために、図７な
いし図１１に順次書き込み動作をグラフとして示してあ
る。図７では、１ループのデータ・ストリームが、ＰＣ
Ｌ６０を通り移動される。さらに能動領域が、横方向ポ
インタ・レジスタ６４にラッチされて、左右のポインタ
により規定される。能動領域の表示データと入れ替わる
新しい情報が、パラレル・シリアル変換器７２にラッチ
される。左のポインタの位置がパラレル・シリアル変換
器７２に到達すると（図８）、データ・リング３８から
ＰＣＬ６０までのリンクが終了して、データ・リング３
８内の情報はパラレル・シリアル変換器７２に直接接続
される。次にパラレル・シリアル変換器７２はＰＣＬ６
０に結合される。図９では、左ポインタの位置がＰＣＬ
６０を通じて包み込まれて、新しい情報（Ｗ）が古い情
報（Ｚ）に置き替わっている。このときデータ・リング
３８の流れは止まり、ＭＰＵ１８は新しい情報をパラレ
ル・シリアル変換器７２に書き込むことができる。この
手順が続いて（図１０）、最後に能動領域のすべての表
示データが要求どおりに変更され、能動領域は元のシフ
ト・レジスタ５０に戻る（図１１）。その後、制御信号
が制御論理４２に対して、変更された表示データをシフ
ト・レジスタ５０からＲＡＭ４８に移動するように命令
する。
【００３４】上述のポインタは、説明されたシステムに
限られるものではない。順次書き込みおよび順次読み込
み動作がデータ・ストリーム上で行われるシステムであ
れば、どのようなシステムにも用いることができる。
【００３５】上述のＬＣＤコントローラ／ドライバ１０
により、セグメント・ドライバ内で表示データの行を迅
速に簡単に変更することができる。さらに、ポインタに
より能動領域の決定が簡単にでき、データ・ストリーム
の改変が迅速で効率的になる。
【００３６】以上、本発明により、上述の目的，目標お
よび利点を充分に満たすＬＣＤ支援システムのためのデ
ータ・ストリーム・ポインタが提供された。本発明は、
特定の実施例に関して説明されているが、多くの代替
例，修正および変形が可能であることは、上記の説明に
より当業者には明白であろう。従って、添付の請求項の
精神と広い範囲とに入るすべてのこのような代替例，修
正および変形を含むものとする。
【図面の簡単な説明】
【図１】本発明によるＬＣＤドライバおよび制御ユニッ
トの全体的な系統図である。
【図２】図１を部品に分解した系統図である。
【図３】図２のセグメント・ドライバの要素である。
【図４】本発明による分割スクリーンＬＣＤをもつＬＣ
Ｄコントローラ／ドライバの系統図である。
【図５】本発明による分割スクリーンＬＣＤ上のスクリ
ーン間でのデータ転送を示す。
【図６】本発明による図２の制御回路の系統図である。
【図７】本発明による順次書き込み動作の系統図であ
る。
【図８】本発明による順次書き込み動作の系統図であ
る。
【図９】本発明による順次書き込み動作の系統図であ
る。
【図１０】本発明による順次書き込み動作の系統図であ
る。
【図１１】本発明による順次書き込み動作の系統図であ
る。
【符号の説明】
１２ 液晶表示装置（ＬＣＤ） １８ マイクロプロセッサ・ユニット（ＭＰＵ） ２１ マイクロ制御ユニット（ＭＣＵ） ２２ セグメント制御インターフェース ２４ 行データ・シリアル・インターフェース ２６ タイミング発生器 ３０ バックプレーン・ドライバ ３２，３４ セグメント・ドライバ ３６ 信号線 ３８ シリアル・ライン

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】 データの列が繰り返し用いられ、前記デ
    ータ列の部分がマイクロプロセッシング・ユニット（Ｍ
    ＰＵ）などの中央制御装置により変更されるシステムに
    おいて、前記データ列はパラレル・シリアル変換器など
    の、しかしこれだけに限られないＭＰＵインターフェー
    ス装置に結合され、前記データ列が、データ列の流れの
    経路を制御する論理回路と、前記ＭＰＵインターフェー
    ス装置と、ポインタ・レジスタに結合された前記経路を
    制御する論理回路とにさらに結合されているシステムに
    おいて、変更される前記データ列内で領域を指定して、
    それによりデータ列の他の部分が前記ＭＰＵにより無視
    される方法であって：改変されるデータ列の部分の開始
    位置と、終了位置とを指定する段階；改変されるデータ
    列の開始位置を表す第１値をポインタ・レジスタに格納
    する段階；改変されるデータ列の終了位置を表す第２値
    をポインタ・レジスタに格納する段階；データの新しい
    ビットを前記ＭＰＵインターフェース装置に格納する段
    階；前記第１値により表される位置に到達するまで、論
    理回路内でデータ列をクロックする段階；データの前記
    新しいビットを前記ＭＰＵインターフェース装置からデ
    ータ列内に移動させる段階；データ列の第１ビットをデ
    ータ列から、前記ＭＰＵインターフェース装置を通じて
    移動させる段階；データ列の別のビットをクロックする
    段階；データの別の新しいビットを、前記ＭＰＵインタ
    ーフェース装置に格納する段階；データの別の新しいビ
    ットを、前記ＭＰＵインターフェース装置からデータ列
    に移動させる段階；データ列の第２ビットをデータ列か
    ら、前記ＭＰＵインターフェース装置を通じて移動させ
    る段階；および前記第２値により表される位置に到達す
    るまで、上述の段階を、後続のビットに対するデータ列
    の別のビットをクロックする段階から繰り返す段階；に
    よって構成されることを特徴とする方法。
JP4244022A 1991-08-23 1992-08-21 データ・ストリームを変更するシステム Pending JPH05232902A (ja)

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US749072 1991-08-23

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ID=25012129

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JP4244022A Pending JPH05232902A (ja) 1991-08-23 1992-08-21 データ・ストリームを変更するシステム

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EP (1) EP0529933B1 (ja)
JP (1) JPH05232902A (ja)
DE (1) DE69225446T2 (ja)
HK (1) HK1008156A1 (ja)
SG (1) SG46436A1 (ja)

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EP0529933A2 (en) 1993-03-03
DE69225446D1 (de) 1998-06-18
DE69225446T2 (de) 1998-12-03
EP0529933A3 (en) 1993-11-18
EP0529933B1 (en) 1998-05-13
SG46436A1 (en) 1998-02-20
HK1008156A1 (en) 1999-04-30

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