JPH05234840A - 半導体集積回路装置 - Google Patents

半導体集積回路装置

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Publication number
JPH05234840A
JPH05234840A JP4001115A JP111592A JPH05234840A JP H05234840 A JPH05234840 A JP H05234840A JP 4001115 A JP4001115 A JP 4001115A JP 111592 A JP111592 A JP 111592A JP H05234840 A JPH05234840 A JP H05234840A
Authority
JP
Japan
Prior art keywords
pattern
reading
amount
deviation
read
Prior art date
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Pending
Application number
JP4001115A
Other languages
English (en)
Inventor
Hiroshi Ishioka
浩 石岡
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP4001115A priority Critical patent/JPH05234840A/ja
Publication of JPH05234840A publication Critical patent/JPH05234840A/ja
Pending legal-status Critical Current

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Landscapes

  • Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Abstract

(57)【要約】 【目的】PR工程での目合せずれ量の読みとりの際、従
来、自工程に対する確認しか出来なかったθ方向のずれ
に対し、前工程との相対的なθずれ量が確認出来るよう
に読みとりパターンを配置し目合せ精度の向上を実現す
る。 【構成】半導体ペレット1の相対する2辺上の対向位置
に目合せずれ読みとりパターンを配置して、ウェハー上
に露光した時に読みとりパターン3,5のように隣接し
て形成されるようにし、ペレットの反対側のずれ量を比
較して前工程に対するθずれ量を求める。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は半導体集積回路装置に関
し、特に拡散工程で必要な目合せずれ量読取りパターン
を配置した半導体集積回路装置に関する。
【0002】
【従来の技術】従来、半導体集積回路装置の製造工程で
は、半導体ペレットのパターンニングをするためにPR
工程を通してフォトレジストを回路パターンの形に残
し、エッチングのマスク材として活用して来た。PR工
程では、ウェハース上に既に形成されている下地パター
ンと、これからエッチングを行うレジストパターンとが
設計どおりの関係で配置されパターンニングされる必要
があるため目合せ作業を必要とし、かつレジストパター
ン形成後には、目合せが正しく行われたかを確認する必
要がある。
【0003】目合せの確認のためには、ウェハースとこ
れに重なるマスクパターンとの間の3種のずれ量(X方
向,Y方向,θ方向)を読みとって許容範囲内に入って
いるかどうかを判定して合否を決定する。集積度の向
上,パターンの微細化に伴って許容される目合せずれ量
は小さくなっており、0.1μm以内のずれ量に押えな
いと不良が多発してしまう工程も出て来ている。このた
め半導体ペレットの内部又は周囲のスクライブ線内にノ
ギスパターンなど微小なずれ量を読み取るための専用パ
ターンを配置して、合否判定をしやすくしている。
【0004】このノギスパターンなどは、X方向,Y方
向の目合せずれ量を読み取るために図2(a)のように
ペレットの直交する2辺に1つずつ入っており、もう一
つのずれ量であるθ方向のずれを読むためには、ノギス
の主尺と副尺を別々にして、例えば、主尺をコンタクト
パターン用マスクに、また副尺をアルミニウムパターン
用マスクに形成してそれぞれペレットの反対側に配置
し、ウェハース上への露光後に主尺,副尺が合わさるよ
うにしている(図2(b))。θずれが発生すれば、マ
スクの中心を軸にしてペレットの相対する二辺は反対方
向に動くため、ノギスパターンのずれ量によってθずれ
の程度を判定できる。
【0005】
【発明が解決しようとする課題】この従来の目合せずれ
読みとりパターンの配置では、X,Yそれぞれの方向の
読みとりパターンを1個所ずつ読むため、読みとりパタ
ーンが配置された近辺の目合せ精度は確保されるが、θ
方向のずれが発生していると読みとりパターンの無い側
で大きなずれが生じてしま合うという欠点があった。さ
らにθずれを読みとるパターンも、同一工程での自分自
身のθずれ量は読みとることが出来ても、前工程での下
地パターンとの相対的なθずれ量を読み取ることはでき
ないという問題点があった。
【0006】また、各々のずれ量を読みとるために、何
度も視野を移動させて読みとりパターンをさがさなけれ
ばならないという煩わしさも伴っていた。
【0007】
【課題を解決するための手段】本発明の半導体集積回路
装置は、相対する2辺上の対向位置に目合せずれ読みと
りパターンを配置し、この読みとりパターンは露光後に
ウェハース上で隣接するペレットとの間でスクライブラ
インに対し対称になるように配置されている。また、一
ペレット上にはX方向,Y方向の2組のパターン対が配
置される。
【0008】
【実施例】次に本発明について図面を参照して説明す
る。図1は本発明の一実施例を示す半導体ペレットの平
面図である。図1(a)は半導体ペレット1の全体上の
読みとりパターンの配置を示している。2と4はY方向
のずれ量の読みとりパターンY1 ,Y2 であり、3と5
はX方向のずれ量の読みとりパターンX1 ,X2 であ
る。読みとりパターンを用いた読みとり方法を図1
(b)に示す。図1(b)は図1(a)の読みとりパタ
ーンX1 の付近を拡大した図面であり、ウェハース上に
露光したときに隣接するペレット6の読みとりパターン
X2 との関連をも示したものである。
【0009】図1(b)で解るように、同一の半導体ペ
レット1上では最も離れている読みとりパターンが隣接
ペレット6との間では最も近い配置となり、顕微鏡の一
視野で観測することができる。もし、パターンX1 とX
2 にずれ量が発生し、その目ずれ量読みとり値が同一な
らば下地パターンと目合せ工程とのθずれが無い事を示
しており、X方向のずれ分のみ補正をかけてやればよ
い。また、X1 とX2 の読みとり値に差があれば、下地
のパターンに対しθずれが発生していることを示してお
り、θずれの補正も行なわなければならないことが直ち
にわかる。
【0010】但し注意すべき点として、同一レチクル上
に複数のペレットを形成した「多面付け」レチクルを使
用する場合には、レチクルの端部に配置された読みとり
パターンを使わないとθずれの読みとりは出来ないの
で、配慮が必要である。
【0011】以上、実施例では、目ずれ量読みとりパタ
ーンとしてノギスパターンを例に挙げて説明したが、他
のパターンを挿入しても同等の効果があげられる事は言
うまでもない。
【0012】
【発明の効果】以上説明したように本発明は、半導体ペ
レットの相対する2辺上の対向位置に目合せずれ量読み
とりパターンを配置することにより、X方向またはY方
向の目合せずれ量と同時に、フォトマスクの装着時まで
に生じたθずれを容易に判別することが出来る効果を有
する。
【0013】しかも従来のノギス応用のθずれチェック
方法では、自工程だけのθずれ量のみを読みとっていた
のに対し、目合せ対象の前工程に対する相対的な目合せ
ずれ量を読みとることが出来るという効果を有してい
る。
【図面の簡単な説明】
【図1】本発明の一実施例を示す図で、同図(a)はペ
レット上での読みとりパターンの配置を示す平面図、同
図(b)はウェハース上での隣接ペレットとの関係を示
す読みとりパターンの詳細図である。
【図2】従来の読みとりパターンの配置を示す図で、同
図(a)は平面図、同図(b)は読みとりパターンの詳
細図である。
【符号の説明】
1 半導体ペレット 2,3,4,5 読みとりパターン 6 隣接ペレット

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 半導体集積回路装置ペレットの相対する
    2組の辺と各々平行に配置された目合せずれ量読みとり
    パターンを、相対する2辺上の対向位置に配置したこと
    を特徴とする半導体集積回路装置。
  2. 【請求項2】 前記目合せずれ量読みとりパターンが隣
    接するペレットとの間でスクライブラインに対し対称位
    置に配置されている請求項1記載の半導体集積回路装
    置。
JP4001115A 1992-01-08 1992-01-08 半導体集積回路装置 Pending JPH05234840A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP4001115A JPH05234840A (ja) 1992-01-08 1992-01-08 半導体集積回路装置

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JP4001115A JPH05234840A (ja) 1992-01-08 1992-01-08 半導体集積回路装置

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JPH05234840A true JPH05234840A (ja) 1993-09-10

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ID=11492465

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JP4001115A Pending JPH05234840A (ja) 1992-01-08 1992-01-08 半導体集積回路装置

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JP (1) JPH05234840A (ja)

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Legal Events

Date Code Title Description
A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 19981110