JPH0525044Y2 - - Google Patents
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- JPH0525044Y2 JPH0525044Y2 JP7392387U JP7392387U JPH0525044Y2 JP H0525044 Y2 JPH0525044 Y2 JP H0525044Y2 JP 7392387 U JP7392387 U JP 7392387U JP 7392387 U JP7392387 U JP 7392387U JP H0525044 Y2 JPH0525044 Y2 JP H0525044Y2
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- JP
- Japan
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- head
- erasing
- erase
- current
- recording
- Prior art date
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- Expired - Lifetime
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- Recording Or Reproducing By Magnetic Means (AREA)
Description
【考案の詳細な説明】
(産業上の利用分野)
本考案は口述録音機(以下デイクテータと記す
こともある)に関し、特に巻戻し高速消去時にテ
ープの始端部を消去できるデイクテータに関す
る。[Detailed Description of the Invention] (Industrial Application Field) The present invention relates to a dictator (hereinafter also referred to as a dictator), and particularly to a dictator that can erase the beginning of a tape during high-speed erasing during rewinding.
(従来の技術)
従来のデイクテータをその要部を示す第2図と
共に以下に説明する。(Prior Art) A conventional dictator will be described below with reference to FIG. 2 showing its main parts.
第2図に示す如く、従来のデイクテータは、録
音再生ヘツド1と第1の消去ヘツド2とが同一の
シールドケース内に収納されたスリーインワンヘ
ツド3と、このスリーインワンヘツド3と所定の
距離を隔てて配設された第2の消去ヘツドとを備
えている。 As shown in FIG. 2, the conventional dectator has a three-in-one head 3 in which a recording/playback head 1 and a first erasing head 2 are housed in the same shield case, and a predetermined distance from the three-in-one head 3. and a second, spaced apart erase head.
このデイクテータに、録音操作がなされると、
バイアス発振器(図示せず)から交流消去電流が
第1の消去ヘツド2に供給される。また、録音再
生ヘツドには信号電流が供給される。そして、テ
ープカセツトに収納されたテープ5は図中の矢印
A方向に走行し、そのテープ5に信号が記録され
る。このとき、第2の消去ヘツド4には消去電流
は供給されない。 When a recording operation is performed on this dectator,
An AC erase current is supplied to the first erase head 2 from a bias oscillator (not shown). Also, a signal current is supplied to the recording/playback head. Then, the tape 5 stored in the tape cassette runs in the direction of arrow A in the figure, and a signal is recorded on the tape 5. At this time, no erase current is supplied to the second erase head 4.
次に、巻戻し操作がなされると、第2の消去ヘ
ツド4に直流消去電流が供給される。そして、テ
ープ5は図中の矢印B方向に巻戻され、第2の消
去ヘツド4により、テープ5の記録内容が高速消
去される。このとき第1の消去ヘツド2には消去
電流は供給されない。 Then, when a rewinding operation is performed, a DC erase current is supplied to the second erase head 4. The tape 5 is then rewound in the direction of arrow B in the figure, and the recorded contents of the tape 5 are erased at high speed by the second erasing head 4. At this time, no erase current is supplied to the first erase head 2.
(考案が解決しようとする問題点)
上記従来のデイクテータでは、第2図に示すテ
ープ5の始端部aは、録音時、矢印A方向に走行
してスリーインワンヘツド3上を通過する。よつ
て、このスリーインワンヘツド3により始端部a
に信号が記録される。しかし、巻戻し時には、始
端部aは第2の消去ヘツド4上を通過しないた
め、その始端部aの記録内容が消去されずに残
り、秘密保持の点で問題があつた。(Problems to be Solved by the Invention) In the conventional dictator described above, the starting end a of the tape 5 shown in FIG. 2 travels in the direction of arrow A and passes over the three-in-one head 3 during recording. Therefore, by this three-in-one head 3, the starting end a
The signal is recorded. However, during rewinding, the starting edge a does not pass over the second erasing head 4, so the recorded content of the starting edge a remains unerased, posing a problem in terms of confidentiality.
(問題点を解決するための手段)
そこで、上記問題点を解決するために本考案
は、録音再生ヘツドと同一のシールドケース内に
収納され、録音時に交流消去電流が供給される第
1の消去ヘツドと、この第1の消去ヘツドと所定
の距離を隔てて配設され、テープ巻戻し時に直流
消去電流が供給される第2の消去ヘツドとを有す
る口述録音機であつて、巻戻し時に直流消去電流
を前記第1の消去ヘツド及び前記第2の消去ヘツ
ドに供給すると共に、録音時に交流消去電流を前
記第1の消去ヘツドに供給する消去電流供給手段
を設けたことを特徴とする口述録音機を提供する
ものである。(Means for Solving the Problems) Therefore, in order to solve the above problems, the present invention provides a first erasing head which is housed in the same shield case as the recording/playback head and is supplied with an alternating current erasing current during recording. A dictation recorder having a head and a second erasing head disposed at a predetermined distance from the first erasing head and to which a DC erasing current is supplied when rewinding the tape. A dictation recording device comprising an erasing current supply means for supplying an erasing current to the first erasing head and the second erasing head, and supplying an alternating current erasing current to the first erasing head during recording. It provides an opportunity for
(実施例)
本考案になるデイクテータを第1図と共に詳細
に説明する。第1図は本考案のデイクテータに設
けた消去電流供給回路の一実施例の要部を示す図
である。なお、従来例と同一の部分には同一の符
号を付し、その部分の具体的説明は省略する。(Example) The dictator according to the present invention will be explained in detail with reference to FIG. FIG. 1 is a diagram showing a main part of an embodiment of an erase current supply circuit provided in a dectator according to the present invention. Note that the same parts as in the conventional example are denoted by the same reference numerals, and a detailed explanation of the parts will be omitted.
まず、消去電流供給回路の回路構成について説
明する。第1の消去ヘツド2の端子6はエミツタ
接地のNPNトランジスタQ1のコレクタに接地さ
れている。このトランジスタQ1のベースには抵
抗R1を介してバイアス電圧が供給される。消去
ヘツド2の端子7はバイアス発振器8のコイル
L1に接続されている。第2の消去ヘツド4の端
子9は抵抗R2を介して、端子10は直接にそれ
ぞれコイルL1に接続されている。また、端子9
はNPNトランジスタQ2のエミツタに接続されて
いる。このトランジスタQ2のベースコレクタ間
には、抵抗R3とスイツチS1とが直列に接続され
ている。 First, the circuit configuration of the erase current supply circuit will be explained. The terminal 6 of the first erase head 2 is grounded to the collector of an NPN transistor Q1 whose emitter is grounded. A bias voltage is supplied to the base of this transistor Q 1 via a resistor R 1 . Terminal 7 of erase head 2 is connected to the coil of bias oscillator 8.
Connected to L1 . The terminal 9 of the second erasing head 4 is connected via a resistor R 2 and the terminal 10 directly to the coil L 1 . Also, terminal 9
is connected to the emitter of NPN transistor Q2 . A resistor R3 and a switch S1 are connected in series between the base and collector of this transistor Q2 .
次に回路動作について説明する。録音時には、
所定録音操作により、トランジスタQ1がONし、
かつ、バイアス発振器8がON状態となるので、
第1の消去ヘツド2に交流消去電流が供給され
る。トランジスタQ2は、所定録音操作によりス
イツチS1が開放となるのでOFFである。よつて
第2の消去ヘツド4には消去電流が供給されな
い。このとき、テープ5には、スリーインワンヘ
ツド3によつて信号が記録される。 Next, the circuit operation will be explained. When recording,
Due to the prescribed recording operation, transistor Q1 turns on,
And since the bias oscillator 8 is in the ON state,
The first erase head 2 is supplied with an alternating current erase current. Transistor Q2 is OFF because switch S1 is opened by a predetermined recording operation. Therefore, no erase current is supplied to the second erase head 4. At this time, signals are recorded on the tape 5 by the three-in-one head 3.
次に、巻戻し時には、所定巻戻し操作により、
スイツチS1が短絡となるので、トランジスタQ2
はONし、直流消去電流が第2の消去ヘツド4に
供給される。また、所定巻戻し操作により、バイ
アス発振器8はOFFし、トランジスタQ1はONす
るので、直流消去電流が第2の消去ヘツド4を介
して、第1の消去ヘツド2に供給される。 Next, when rewinding, by a predetermined rewinding operation,
Since switch S 1 is shorted, transistor Q 2
is turned on, and a DC erase current is supplied to the second erase head 4. Further, due to the predetermined rewinding operation, the bias oscillator 8 is turned off and the transistor Q1 is turned on, so that a DC erase current is supplied to the first erase head 2 via the second erase head 4.
これにより、巻き戻し時にテープ5の始端部a
以外の記録内容は、まず最初に第1の消去ヘツド
2により消去され、次に第2の消去ヘツド4によ
つて消去される。従つて、同一部分を2度消去で
きるので、より完全な消去ができる。 As a result, when rewinding, the starting end a of the tape 5
The other recorded contents are first erased by the first erase head 2 and then erased by the second erase head 4. Therefore, since the same portion can be erased twice, more complete erasure can be achieved.
さらに、第2図に示すテープ5の始端部aは、
巻戻し時、第2消去ヘツド4上は通過しないが、
第1の消去ヘツド2上を通過する。よつて、始端
部aの記録内容を第1の消去ヘツド2により消去
することができる。 Furthermore, the starting end a of the tape 5 shown in FIG.
When rewinding, it does not pass over the second erasing head 4, but
It passes over the first erase head 2. Therefore, the recorded content at the starting end a can be erased by the first erasing head 2.
(考案の効果)
以上の如く、本考案に係るデイクテータは、巻
戻し時に、テープの始端部を高速消去でき、さら
に、テープの始端部以外の部分を2つの消去ヘツ
ドにより2重に高速消去できるので、秘密保持の
効果が向上する。(Effects of the invention) As described above, the dictator according to the invention can erase the starting end of the tape at high speed during rewinding, and can also erase parts of the tape other than the starting end at double high speed using two erasing heads. Therefore, the effectiveness of confidentiality is improved.
第1図は本考案のデイクテータに設けた消去電
流供給回路の一実施例の要部を示す図、第2図は
従来のデイクテータの要部を示す図である。
1……録音再生ヘツド、2……第1の消去ヘツ
ド、3……スリーインワンヘツド、4……第2の
消去ヘツド、5……テープ、6,7,9,10…
…端子、8……バイアス発振器、C1,C2……コ
ンデンサ、L1……コイル、Q1,Q2……NPNトラ
ンジスタ、R1〜R3……抵抗、S1……スイツチ。
FIG. 1 is a diagram showing a main part of an embodiment of an erasing current supply circuit provided in a dectator of the present invention, and FIG. 2 is a diagram showing a main part of a conventional dectator. 1... Recording/playback head, 2... First erasing head, 3... Three-in-one head, 4... Second erasing head, 5... Tape, 6, 7, 9, 10...
... terminal, 8 ... bias oscillator, C 1 , C 2 ... capacitor, L 1 ... coil, Q 1 , Q 2 ... NPN transistor, R 1 to R 3 ... resistance, S 1 ... switch.
Claims (1)
納され、録音時に交流消去電流が供給される第1
の消去ヘツドと、この第1の消去ヘツドと所定の
距離を隔てて配設され、テープ巻戻し時に直流消
去電流が供給される第2の消去ヘツドとを有する
口述録音機であつて、 巻戻し時に直流消去電流を前記第1の消去ヘツ
ド及び前記第2の消去ヘツドに供給すると共に、
録音時に交流消去電流を前記第1の消去ヘツドに
供給する消去電流供給手段を設けたことを特徴と
する口述録音機。[Scope of claim for utility model registration] A first head that is housed in the same shield case as the recording/playback head and to which an AC erasing current is supplied during recording.
A dictation recorder comprising an erasing head and a second erasing head disposed at a predetermined distance from the first erasing head and to which a DC erasing current is supplied during tape rewinding, the dictation recorder comprising: supplying a DC erase current to the first erase head and the second erase head;
1. A dictation recorder comprising erasing current supply means for supplying an alternating current erasing current to the first erasing head during recording.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7392387U JPH0525044Y2 (en) | 1987-05-18 | 1987-05-18 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7392387U JPH0525044Y2 (en) | 1987-05-18 | 1987-05-18 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63184402U JPS63184402U (en) | 1988-11-28 |
| JPH0525044Y2 true JPH0525044Y2 (en) | 1993-06-24 |
Family
ID=30918683
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7392387U Expired - Lifetime JPH0525044Y2 (en) | 1987-05-18 | 1987-05-18 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0525044Y2 (en) |
-
1987
- 1987-05-18 JP JP7392387U patent/JPH0525044Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS63184402U (en) | 1988-11-28 |
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