JPH0525153B2 - - Google Patents
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- JPH0525153B2 JPH0525153B2 JP60021076A JP2107685A JPH0525153B2 JP H0525153 B2 JPH0525153 B2 JP H0525153B2 JP 60021076 A JP60021076 A JP 60021076A JP 2107685 A JP2107685 A JP 2107685A JP H0525153 B2 JPH0525153 B2 JP H0525153B2
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- voltage
- data
- card
- data memory
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Description
【発明の詳細な説明】
[発明の目的]
(産業上の利用分野)
この発明は、たとえばマイクロ・プロセツサ、
データメモリなどのICチツプを内蔵するICカー
ドなどの携帯可能媒体に関する。
データメモリなどのICチツプを内蔵するICカー
ドなどの携帯可能媒体に関する。
(従来の技術)
最近、データを書込むメモリカードとしてIC
カードが開発され、実用化されている。このIC
カードには、マイクロプロセツサ、PROMある
いはEEPROMで構成されるデータメモリ等のIC
チツプが内蔵されている。上記マイクロ・プロセ
ツサとカード表面の端子とがつながつており、こ
の端子を通して外部とのデータの入出力を行い、
マイクロ・プロセツサの制御下でデータメモリに
対するデータの書込み、読出しが行われるように
なつている。このようなICカードでは、データ
メモリへデータが正しく書込まれることがその機
能の重要な部分を占めている。特に、暗証照合等
により識別を要求するICカードでは、照合不一
致を示す証拠をデータメモリへ書込むことによ
り、カードの状態が初期化されても、不正の痕跡
が残るため、高い安全性を得ることができるよう
にしている。
カードが開発され、実用化されている。このIC
カードには、マイクロプロセツサ、PROMある
いはEEPROMで構成されるデータメモリ等のIC
チツプが内蔵されている。上記マイクロ・プロセ
ツサとカード表面の端子とがつながつており、こ
の端子を通して外部とのデータの入出力を行い、
マイクロ・プロセツサの制御下でデータメモリに
対するデータの書込み、読出しが行われるように
なつている。このようなICカードでは、データ
メモリへデータが正しく書込まれることがその機
能の重要な部分を占めている。特に、暗証照合等
により識別を要求するICカードでは、照合不一
致を示す証拠をデータメモリへ書込むことによ
り、カードの状態が初期化されても、不正の痕跡
が残るため、高い安全性を得ることができるよう
にしている。
ところが、上記のようなものでは、データメモ
リにデータを書込む場合、一般に通常の制御電圧
(再生電圧:5V)より高い電圧(21V)を特定の
端子に印加する必要があるが、その端子の印加電
圧について保証する手段を有していない。このた
め、突然、原因不明の書込不良が起こつたり、あ
るいは不正の痕跡が残らないため、カードの初期
化と暗証照合を繰返し行うことにより、そのカー
ドの暗証を知ることが可能になつたりする危険を
はらんでいた。
リにデータを書込む場合、一般に通常の制御電圧
(再生電圧:5V)より高い電圧(21V)を特定の
端子に印加する必要があるが、その端子の印加電
圧について保証する手段を有していない。このた
め、突然、原因不明の書込不良が起こつたり、あ
るいは不正の痕跡が残らないため、カードの初期
化と暗証照合を繰返し行うことにより、そのカー
ドの暗証を知ることが可能になつたりする危険を
はらんでいた。
したがつて、安全性の点で大変問題があつた。
(発明が解決しようとする問題点)
この発明は、安全性の点で問題があるという欠
点を除去するもので、昇圧手段を携帯可能媒体に
内蔵することによつて、不揮発性データメモリへ
の印加電圧を補償し、たとえば不正の痕跡がなく
なる等のデータメモリへの書込み不良の問題を解
決でき、安全性の高い携帯可能媒体を提供するこ
とを目的とする。
点を除去するもので、昇圧手段を携帯可能媒体に
内蔵することによつて、不揮発性データメモリへ
の印加電圧を補償し、たとえば不正の痕跡がなく
なる等のデータメモリへの書込み不良の問題を解
決でき、安全性の高い携帯可能媒体を提供するこ
とを目的とする。
[発明の構成]
(問題点を解決するための手段)
この発明の携帯可能媒体は、データが記憶され
る不揮発性データメモリと制御素子とを有するも
のにおいて、上記携帯可能媒体を駆動するための
駆動電圧が印加されるコネクト部、このコネクト
部に印加された駆動電圧に基づき制御素子を駆動
するための制御電圧を上記制御素子へ印加すると
ともに上記コネクト部に印加された駆動電圧を昇
圧して駆動電圧よりも高い書込み電圧を発生して
上記不揮発性データメモリへ印加する昇圧手段、
および上記データメモリへのデータの書込み動作
時に上記昇圧手段を作動させて昇圧手段にて発生
された書込み電圧を上記データメモリへ供給する
ように上記昇圧手段を制御する制御手段から構成
されている。
る不揮発性データメモリと制御素子とを有するも
のにおいて、上記携帯可能媒体を駆動するための
駆動電圧が印加されるコネクト部、このコネクト
部に印加された駆動電圧に基づき制御素子を駆動
するための制御電圧を上記制御素子へ印加すると
ともに上記コネクト部に印加された駆動電圧を昇
圧して駆動電圧よりも高い書込み電圧を発生して
上記不揮発性データメモリへ印加する昇圧手段、
および上記データメモリへのデータの書込み動作
時に上記昇圧手段を作動させて昇圧手段にて発生
された書込み電圧を上記データメモリへ供給する
ように上記昇圧手段を制御する制御手段から構成
されている。
(作用)
この発明は、データが記憶される不揮発性デー
タメモリと制御素子とを有する携帯可能媒体にお
いて、上記携帯可能媒体を駆動するための駆動電
圧が印加されるコネクト部と、このコネクト部に
印加された駆動電圧に基づき制御素子を駆動する
ための制御電圧を上記制御素子へ印加するととも
に上記コネクト部に印加された駆動電圧を昇圧し
て駆動電圧よりも高い書込み電圧を発生して上記
不揮発性データメモリへ印加する昇圧手段とを有
し、上記データメモリへのデータの書込み動作時
に上記昇圧手段を作動させて昇圧手段にて発生さ
れた書込み電圧を上記データメモリへ供給するよ
うに上記昇圧手段を制御するようにしたものであ
る。
タメモリと制御素子とを有する携帯可能媒体にお
いて、上記携帯可能媒体を駆動するための駆動電
圧が印加されるコネクト部と、このコネクト部に
印加された駆動電圧に基づき制御素子を駆動する
ための制御電圧を上記制御素子へ印加するととも
に上記コネクト部に印加された駆動電圧を昇圧し
て駆動電圧よりも高い書込み電圧を発生して上記
不揮発性データメモリへ印加する昇圧手段とを有
し、上記データメモリへのデータの書込み動作時
に上記昇圧手段を作動させて昇圧手段にて発生さ
れた書込み電圧を上記データメモリへ供給するよ
うに上記昇圧手段を制御するようにしたものであ
る。
(実施例)
以下、この発明の一実施例について、図面を参
照して説明する。
照して説明する。
第2図において、1は携帯可能媒体としての
ICカードである。このICカード1の表面にはコ
ネクト部2が設けられており、たとえば複数の端
子2a,…2hによつて構成されている。上記端
子2aは動作用の電源電圧(+5V)用、端子2
bは接地用、端子2cはクロツク信号用、端子2
dはリセツト信号用、端子2e〜2hはデータ入
出力用となつている。
ICカードである。このICカード1の表面にはコ
ネクト部2が設けられており、たとえば複数の端
子2a,…2hによつて構成されている。上記端
子2aは動作用の電源電圧(+5V)用、端子2
bは接地用、端子2cはクロツク信号用、端子2
dはリセツト信号用、端子2e〜2hはデータ入
出力用となつている。
また、上記ICカード1の内部には、第1図に
示すように、制御用のマイクロ・プロセツサ3、
制御プログラム、暗証番号(たとえば4桁)、お
よびデータなどが記録され、EEPROMあるいは
PROMで構成されるデータメモリ4、インター
フエイス回路5、および昇圧回路6によつて構成
されている。上記各部はICチツプで構成され、
1つの基板上に設けられている。また、上記イン
ターフエイス回路5とコネクト部2とは配線され
ている。
示すように、制御用のマイクロ・プロセツサ3、
制御プログラム、暗証番号(たとえば4桁)、お
よびデータなどが記録され、EEPROMあるいは
PROMで構成されるデータメモリ4、インター
フエイス回路5、および昇圧回路6によつて構成
されている。上記各部はICチツプで構成され、
1つの基板上に設けられている。また、上記イン
ターフエイス回路5とコネクト部2とは配線され
ている。
上記昇圧回路6は、コネクト部2の端子2aか
らの5Vの動作電圧(Vcc)に応じて21ボルト
(V)の書込電圧(Vpp)と5ボルト(V)の制
御電圧(Vcc′)とを発生するものであり、たと
えばDC−DCコンバータで構成されている。これ
により、書込電圧(Vpp)は上記データメモリ4
に印加され、制御電圧(Vcc′)は上記マイク
ロ・プロセツサ3、データメモリ4、およびイン
ターフエイス回路5の各部に印加されるようにな
つている。ただし、上記昇圧回路6によるデータ
メモリ4への書込電圧(Vpp)の印加は、データ
の書込時にマイクロ・プロセツサ3から供給され
る制御信号に応じて行うようになつている。
らの5Vの動作電圧(Vcc)に応じて21ボルト
(V)の書込電圧(Vpp)と5ボルト(V)の制
御電圧(Vcc′)とを発生するものであり、たと
えばDC−DCコンバータで構成されている。これ
により、書込電圧(Vpp)は上記データメモリ4
に印加され、制御電圧(Vcc′)は上記マイク
ロ・プロセツサ3、データメモリ4、およびイン
ターフエイス回路5の各部に印加されるようにな
つている。ただし、上記昇圧回路6によるデータ
メモリ4への書込電圧(Vpp)の印加は、データ
の書込時にマイクロ・プロセツサ3から供給され
る制御信号に応じて行うようになつている。
第3図および第4図は、この発明に係わる端末
機としてのICカード取扱機10の構成を示すも
のである。すなわち、11は全体を制御する
CPU(セントラル・プロセツシング・ユニツト)、
12はデータを入力するキーボード、13は
CRTデイスプレイ装置、14は制御プログラム
が格納されているROM(リード・オンリ・メモ
リ)、15はデータが記憶されるRAM(ランダ
ム・アクセス・メモリ)、16は種々の印字デー
タが出力されるドツトプリンタ、17はフロツピ
ーデイスク挿入口18から挿入されたフロツピー
デイスク19においてデータの記憶、再生を行う
フロツピーデイスク装置、20はカード挿入口2
1から挿入されたICカード1におけるメモリの
データを読取つたり、あるいはメモリ内にデータ
を書込むICカード読取書込部である。
機としてのICカード取扱機10の構成を示すも
のである。すなわち、11は全体を制御する
CPU(セントラル・プロセツシング・ユニツト)、
12はデータを入力するキーボード、13は
CRTデイスプレイ装置、14は制御プログラム
が格納されているROM(リード・オンリ・メモ
リ)、15はデータが記憶されるRAM(ランダ
ム・アクセス・メモリ)、16は種々の印字デー
タが出力されるドツトプリンタ、17はフロツピ
ーデイスク挿入口18から挿入されたフロツピー
デイスク19においてデータの記憶、再生を行う
フロツピーデイスク装置、20はカード挿入口2
1から挿入されたICカード1におけるメモリの
データを読取つたり、あるいはメモリ内にデータ
を書込むICカード読取書込部である。
上記ICカード読取書込部20は、カード取扱
機10本体とケーブル22によつて接続されるよ
うになつている。すなわち、第5図に示すよう
に、カード挿入口21から挿入されたICカード
1を搬送する搬送パス31が設けられている。こ
の搬送パス31にはICカード1を搬送する際に
これを上下から挟むように位置し、回転可能な搬
送ローラ32が対になつて複数個備えられてい
る。対になつて備えられている各搬送ローラ32
は搬送パス31に沿つて互いに等間隔に設けられ
ている。これらの各搬送ローラ32の中心から隣
合う搬送ローラ32の中心までの距離がカードの
搬送方向における幅の寸法を有している。それゆ
え、ICカード1の搬送パス31は、搬送ガイド
33によつて規定されている。
機10本体とケーブル22によつて接続されるよ
うになつている。すなわち、第5図に示すよう
に、カード挿入口21から挿入されたICカード
1を搬送する搬送パス31が設けられている。こ
の搬送パス31にはICカード1を搬送する際に
これを上下から挟むように位置し、回転可能な搬
送ローラ32が対になつて複数個備えられてい
る。対になつて備えられている各搬送ローラ32
は搬送パス31に沿つて互いに等間隔に設けられ
ている。これらの各搬送ローラ32の中心から隣
合う搬送ローラ32の中心までの距離がカードの
搬送方向における幅の寸法を有している。それゆ
え、ICカード1の搬送パス31は、搬送ガイド
33によつて規定されている。
また、上記搬送ガイド33上にはICカード1
内のマイクロ・プロセツサ3とデータの授受を行
う読取書込器34が配置されている。この読取書
込器34はコネクト部2と電気的に接続するよう
になつている。
内のマイクロ・プロセツサ3とデータの授受を行
う読取書込器34が配置されている。この読取書
込器34はコネクト部2と電気的に接続するよう
になつている。
次に、このような構成において、ICカードの
取扱いについて、第6図および第7図に示すフロ
ーチヤートを参照しつつ説明する。たとえば今、
利用客はICカード取扱機10のカード挿入口2
1にICカード1を挿入する。すると、ICカード
1はコネクト部2により読取書込器34と電気的
に接続される。これにより、コネクト部2の端子
2aを介して昇圧回路6に5Vの動作電圧(Vcc)
が印加される。すると、昇圧回路6は、21Vの書
込電圧(Vpp)と5Vの制御電圧(Vcc′)とを発
生する。この結果、制御電圧(Vcc′)は上記マ
イクロ・プロセツサ3、データメモリ4、および
インターフエイス回路5の各部に印加される。す
ると、マイクロ・プロセツサ3はインターフエイ
ス回路5、コネクト部2および読取書込器34を
介してCPU11に接続信号を出力する。
取扱いについて、第6図および第7図に示すフロ
ーチヤートを参照しつつ説明する。たとえば今、
利用客はICカード取扱機10のカード挿入口2
1にICカード1を挿入する。すると、ICカード
1はコネクト部2により読取書込器34と電気的
に接続される。これにより、コネクト部2の端子
2aを介して昇圧回路6に5Vの動作電圧(Vcc)
が印加される。すると、昇圧回路6は、21Vの書
込電圧(Vpp)と5Vの制御電圧(Vcc′)とを発
生する。この結果、制御電圧(Vcc′)は上記マ
イクロ・プロセツサ3、データメモリ4、および
インターフエイス回路5の各部に印加される。す
ると、マイクロ・プロセツサ3はインターフエイ
ス回路5、コネクト部2および読取書込器34を
介してCPU11に接続信号を出力する。
これにより、CPU11はCRTデイスプレイ装
置13で「暗証番号を投入して下さい」という案
内を行う。この案内に応じて、利用者はキーボー
ド12により暗証番号を入力する。この入力によ
り暗証番号に応じた信号および取扱機を示す信号
が、CPU11から読取書込器34、コネクト部
2およびインターフエイス回路5を介してマイク
ロ・プロセツサ3へ供給される。これにより、マ
イクロ・プロセツサ3は供給される利用者の暗証
番号を内部メモリに一時記憶する(ST1)。つい
で、マイクロ・プロセツサ3はデータメモリ4か
らあらかじめ書込まれている暗証番号を読出し
(ST2)、内部メモリに記録した暗証番号と比較す
る(ST3)。この比較結果が一致の場合、マイク
ロ・プロセツサ3は一致信号をCPU11へ出力
する(ST4)。また、上記ステツプで比較結果が、
不一致の場合、マイクロ・プロセツサ3は昇圧回
路6に制御信号を供給し、昇圧回路6から発生さ
れる21Vの書込電圧(Vpp)をデータメモリ4に
印加する(ST5)。これにより、マイクロ・プロ
セツサ3は、データメモリ4に設けた不一致カウ
ンタ(図示しない)をカウントアツプし(ST6)、
このカウント値が所定数(3回)以内の際、再投
入可の不一致信号をCPU11へ出力し、上記カ
ウント値が所定数となつた際、ICカード1が無
効の不一致信号をCPU11へ出力する(ST7)。
この結果、不一致信号が供給されるとCPU11
は、暗証番号の再投入、あるいはICカード取扱
機10による取引が不可と判断し、その旨を利用
者に報知する(ST11)。
置13で「暗証番号を投入して下さい」という案
内を行う。この案内に応じて、利用者はキーボー
ド12により暗証番号を入力する。この入力によ
り暗証番号に応じた信号および取扱機を示す信号
が、CPU11から読取書込器34、コネクト部
2およびインターフエイス回路5を介してマイク
ロ・プロセツサ3へ供給される。これにより、マ
イクロ・プロセツサ3は供給される利用者の暗証
番号を内部メモリに一時記憶する(ST1)。つい
で、マイクロ・プロセツサ3はデータメモリ4か
らあらかじめ書込まれている暗証番号を読出し
(ST2)、内部メモリに記録した暗証番号と比較す
る(ST3)。この比較結果が一致の場合、マイク
ロ・プロセツサ3は一致信号をCPU11へ出力
する(ST4)。また、上記ステツプで比較結果が、
不一致の場合、マイクロ・プロセツサ3は昇圧回
路6に制御信号を供給し、昇圧回路6から発生さ
れる21Vの書込電圧(Vpp)をデータメモリ4に
印加する(ST5)。これにより、マイクロ・プロ
セツサ3は、データメモリ4に設けた不一致カウ
ンタ(図示しない)をカウントアツプし(ST6)、
このカウント値が所定数(3回)以内の際、再投
入可の不一致信号をCPU11へ出力し、上記カ
ウント値が所定数となつた際、ICカード1が無
効の不一致信号をCPU11へ出力する(ST7)。
この結果、不一致信号が供給されるとCPU11
は、暗証番号の再投入、あるいはICカード取扱
機10による取引が不可と判断し、その旨を利用
者に報知する(ST11)。
また、CPU11からマイクロ・プロセツサ3
に対して書込データが供給される。すると、マイ
クロ・プロセツサ3は供給される書込データを内
部メモリ(図示しない)へ一時記憶する
(ST10)。ついで、マイクロ・プロセツサ3は、
昇圧回路6に制御信号を供給し、昇圧回路6から
発生される21Vの書込電圧(Vpp)をデータメモ
リ4に印加する(ST11)。これにより、マイク
ロ・プロセツサ3は、内部メモリに記憶されてい
る書込データを読出し、データメモリ4に書込む
(ST12)。そして、データメモリ4に書込んだデ
ータが正しいか否かをそのデータを読出してチエ
ツクし(ST13)、正しい場合、正常信号をCPU
11へ出力し(ST14)、異常の場合、異常信号を
CPU11へ出力する(ST15)。
に対して書込データが供給される。すると、マイ
クロ・プロセツサ3は供給される書込データを内
部メモリ(図示しない)へ一時記憶する
(ST10)。ついで、マイクロ・プロセツサ3は、
昇圧回路6に制御信号を供給し、昇圧回路6から
発生される21Vの書込電圧(Vpp)をデータメモ
リ4に印加する(ST11)。これにより、マイク
ロ・プロセツサ3は、内部メモリに記憶されてい
る書込データを読出し、データメモリ4に書込む
(ST12)。そして、データメモリ4に書込んだデ
ータが正しいか否かをそのデータを読出してチエ
ツクし(ST13)、正しい場合、正常信号をCPU
11へ出力し(ST14)、異常の場合、異常信号を
CPU11へ出力する(ST15)。
上記したように、ICカード内の各回路が正常
動作する電圧が印加され、制御系が正常動作して
いる際は、データの書込時にのみ、データメモリ
に確実に書込電圧が印加され、データの書込時以
外は、データメモリに再生用の制御電圧が印加さ
れているため、誤書込を防止することができる。
したがつて、書込時以外にデータメモリにデータ
の誤書込を行うことができないようになつてい
る。また、書込電圧を内部で発生しているため、
書込電圧に不良が生じることがなく、暗証の一致
あるいは不一致結果が出力される前に、確実に不
一致に対するデータをデータメモリに記憶するこ
とができる。したがつて、従来のように、書込電
圧不良が生じた場合に、暗証が誤つて入力された
際の不一致であつたことを証拠だてる痕跡をデー
タメモリ上に残すことができないものではなくな
る。これにより、読取書込部からICカードを一
旦抜くなどして初期化を行えば、暗証の不一致を
知る手掛りがなくなり、初期化と暗証入力の手順
を有限回繰返して暗証の一致をとれるという従来
の欠点を回避できる。このため、暗証番号が見破
られなくなり、高い安全性を得ることができる。
動作する電圧が印加され、制御系が正常動作して
いる際は、データの書込時にのみ、データメモリ
に確実に書込電圧が印加され、データの書込時以
外は、データメモリに再生用の制御電圧が印加さ
れているため、誤書込を防止することができる。
したがつて、書込時以外にデータメモリにデータ
の誤書込を行うことができないようになつてい
る。また、書込電圧を内部で発生しているため、
書込電圧に不良が生じることがなく、暗証の一致
あるいは不一致結果が出力される前に、確実に不
一致に対するデータをデータメモリに記憶するこ
とができる。したがつて、従来のように、書込電
圧不良が生じた場合に、暗証が誤つて入力された
際の不一致であつたことを証拠だてる痕跡をデー
タメモリ上に残すことができないものではなくな
る。これにより、読取書込部からICカードを一
旦抜くなどして初期化を行えば、暗証の不一致を
知る手掛りがなくなり、初期化と暗証入力の手順
を有限回繰返して暗証の一致をとれるという従来
の欠点を回避できる。このため、暗証番号が見破
られなくなり、高い安全性を得ることができる。
また、印加電圧不良時にカード不良と誤つて認
識され、この誤つた診断により、システムの復帰
に多大な障害を与えることを防止できるようにな
つている。
識され、この誤つた診断により、システムの復帰
に多大な障害を与えることを防止できるようにな
つている。
なお、前記実施例では、ICカード内における
マイクロ・プロセツサの内部メモリでデータ、暗
証番号を一時記憶したが、これに限らずデータ記
憶用のRAMを別にICカード内に設けるようにし
ても良い。また、ICカードを用いたが、これに
限らず、データメモリと制御素子とを有し、選択
的に外部から入出力を行うものであれば良く、形
状もカード状でなく、棒状など他の形状であつて
も良い。
マイクロ・プロセツサの内部メモリでデータ、暗
証番号を一時記憶したが、これに限らずデータ記
憶用のRAMを別にICカード内に設けるようにし
ても良い。また、ICカードを用いたが、これに
限らず、データメモリと制御素子とを有し、選択
的に外部から入出力を行うものであれば良く、形
状もカード状でなく、棒状など他の形状であつて
も良い。
[発明の効果]
以上詳述したようにこの発明によれば、昇圧手
段を携帯可能媒体に内蔵することによつて、不揮
発性データメモリへの印加電圧を補償し、たとえ
ば不正の痕跡がなくなる等のデータメモリへの書
込み不良の問題を解決でき、安全性の高い携帯可
能媒体を提供できる。
段を携帯可能媒体に内蔵することによつて、不揮
発性データメモリへの印加電圧を補償し、たとえ
ば不正の痕跡がなくなる等のデータメモリへの書
込み不良の問題を解決でき、安全性の高い携帯可
能媒体を提供できる。
図面はこの発明の一実施例を説明するためのも
ので、第1図はICカードの電気回路の構成を概
略的に示すブロツク図、第2図はICカードの外
観斜視図、第3図はカード取扱機の外観斜視図、
第4図はカード取扱機の概略構成ブロツク図、第
5図はICカード読取書込部の構成を示す断面図、
第6図および第7図は動作の要部を説明するため
のフローチヤートである。 1……ICカード(携帯可能媒体)、2……コネ
クト部、2a〜2h……端子、3……マイクロ・
プロセツサ、4……データメモリ、5……インタ
ーフエイス回路、6……昇圧回路、10……IC
カード取扱機、11……CPU、13……CRTデ
イスプレイ装置、20……ICカード読取書込部、
34……読取書込器、41……利用客入力部。
ので、第1図はICカードの電気回路の構成を概
略的に示すブロツク図、第2図はICカードの外
観斜視図、第3図はカード取扱機の外観斜視図、
第4図はカード取扱機の概略構成ブロツク図、第
5図はICカード読取書込部の構成を示す断面図、
第6図および第7図は動作の要部を説明するため
のフローチヤートである。 1……ICカード(携帯可能媒体)、2……コネ
クト部、2a〜2h……端子、3……マイクロ・
プロセツサ、4……データメモリ、5……インタ
ーフエイス回路、6……昇圧回路、10……IC
カード取扱機、11……CPU、13……CRTデ
イスプレイ装置、20……ICカード読取書込部、
34……読取書込器、41……利用客入力部。
Claims (1)
- 【特許請求の範囲】 1 データが記憶される不揮発性データメモリと
制御素子とを有する携帯可能媒体において、 上記携帯可能媒体を駆動するための駆動電圧が
印加されるコネクト部と、 このコネクト部に印加された駆動電圧に基づき
制御素子を駆動するための制御電圧を上記制御素
子へ印加するとともに上記コネクト部に印加され
た駆動電圧を昇圧して駆動電圧よりも高い書込み
電圧を発生して上記不揮発性データメモリへ印加
する昇圧手段と、 上記データメモリへのデータの書込み動作時に
上記昇圧手段を作動させて昇圧手段にて発生され
た書込み電圧を上記データメモリへ供給するよう
に上記昇圧手段を制御する制御手段と、 を具備したことを特徴とする携帯可能媒体。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60021076A JPS61182187A (ja) | 1985-02-06 | 1985-02-06 | 携帯可能媒体 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60021076A JPS61182187A (ja) | 1985-02-06 | 1985-02-06 | 携帯可能媒体 |
Related Child Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62189406A Division JPS63100589A (ja) | 1987-07-29 | 1987-07-29 | 携帯可能媒体 |
| JP8207642A Division JP2703534B2 (ja) | 1996-07-19 | 1996-07-19 | 携帯可能媒体及び携帯可能媒体用基板 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61182187A JPS61182187A (ja) | 1986-08-14 |
| JPH0525153B2 true JPH0525153B2 (ja) | 1993-04-12 |
Family
ID=12044796
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60021076A Granted JPS61182187A (ja) | 1985-02-06 | 1985-02-06 | 携帯可能媒体 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61182187A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03144879A (ja) * | 1989-10-31 | 1991-06-20 | Mitsubishi Electric Corp | 携帯型半導体記憶装置 |
| JP2703534B2 (ja) * | 1996-07-19 | 1998-01-26 | 株式会社東芝 | 携帯可能媒体及び携帯可能媒体用基板 |
Family Cites Families (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2401459A1 (fr) * | 1977-08-26 | 1979-03-23 | Cii Honeywell Bull | Support d'information portatif muni d'un microprocesseur et d'une memoire morte programmable |
| US4263664A (en) * | 1979-08-31 | 1981-04-21 | Xicor, Inc. | Nonvolatile static random access memory system |
| JPS58187857A (ja) * | 1982-04-26 | 1983-11-02 | Shimadzu Corp | ステビア葉の甘味成分分析法 |
| JPS58187857U (ja) * | 1982-06-07 | 1983-12-13 | セイコーインスツルメンツ株式会社 | デ−タ入出力カ−ド |
| JPS5977699A (ja) * | 1982-10-25 | 1984-05-04 | Dainippon Printing Co Ltd | Icカ−ド |
| JPS59107491A (ja) * | 1982-12-10 | 1984-06-21 | Nippon Telegr & Teleph Corp <Ntt> | Icカ−ド |
| JPS59212949A (ja) * | 1983-05-18 | 1984-12-01 | Dainippon Printing Co Ltd | Icカ−ドの処理方法および処理装置ならびにicカ−ド |
-
1985
- 1985-02-06 JP JP60021076A patent/JPS61182187A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61182187A (ja) | 1986-08-14 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |