JPH05274787A - 自動利得制御回路 - Google Patents
自動利得制御回路Info
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- JPH05274787A JPH05274787A JP4017401A JP1740192A JPH05274787A JP H05274787 A JPH05274787 A JP H05274787A JP 4017401 A JP4017401 A JP 4017401A JP 1740192 A JP1740192 A JP 1740192A JP H05274787 A JPH05274787 A JP H05274787A
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- 239000003990 capacitor Substances 0.000 abstract description 14
- 230000003321 amplification Effects 0.000 description 7
- 238000006243 chemical reaction Methods 0.000 description 7
- 238000003199 nucleic acid amplification method Methods 0.000 description 7
- 238000010586 diagram Methods 0.000 description 6
- 238000013016 damping Methods 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 238000007599 discharging Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000002452 interceptive effect Effects 0.000 description 1
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- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
Abstract
(57)【要約】
【目的】出力信号を直接断続する為のスイッチ回路をル
ープ内に含む自動利得制御回路において、スイッチ導通
時に過渡的な過大信号が出力される事を防止する。 【構成】ミュートパルス入力端子２０を介してミュート
パルスがミュートスイッチ７と電流源２１に共通に入力
される。ミュートパルスによりミュートスイッチ７が断
となている状態において、比較回路１６が出力する電流
に対して、絶対値が大きくかつ極性が逆の電流を電流源
２１は出力する。これによって、ホールドコンデンサＣ
２に発生する電圧は、第１の電圧制御増幅回路２の利得
が最小となる様設定される。ミュートパルスが無くなっ
た過渡的状態においては、第１の電圧制御増幅回路の利
得は最小から徐々に第１の制御信号入力端子に加えられ
た設定レベルに収束するので、過大な記録電流を記録電
流出力端子１２に出力する事はない。
ープ内に含む自動利得制御回路において、スイッチ導通
時に過渡的な過大信号が出力される事を防止する。 【構成】ミュートパルス入力端子２０を介してミュート
パルスがミュートスイッチ７と電流源２１に共通に入力
される。ミュートパルスによりミュートスイッチ７が断
となている状態において、比較回路１６が出力する電流
に対して、絶対値が大きくかつ極性が逆の電流を電流源
２１は出力する。これによって、ホールドコンデンサＣ
２に発生する電圧は、第１の電圧制御増幅回路２の利得
が最小となる様設定される。ミュートパルスが無くなっ
た過渡的状態においては、第１の電圧制御増幅回路の利
得は最小から徐々に第１の制御信号入力端子に加えられ
た設定レベルに収束するので、過大な記録電流を記録電
流出力端子１２に出力する事はない。
Description
【０００１】
【産業上の利用分野】本発明は、自動利得制御回路に関
し、特に磁気記録再生装置の記録増幅回路の自動利得制
御回路に関する。
し、特に磁気記録再生装置の記録増幅回路の自動利得制
御回路に関する。
【０００２】
【従来の技術】従来の磁気記録再生装置の記録増幅回路
の自動利得制御回路を図３に示す。第１の電圧制御増幅
回路２は、第１の入力端子１を介して与えらえる周波数
変調された輝度信号を増幅し、加算回路３に出力する。
第２の電圧制御増幅回路５は，第２の入力端子４を介し
て与えられる低域変換色信号を、第２の制御信号入力端
子６に与えられる制御電圧に応じた増幅率で増幅し、加
算回路３に出力する。加算回路３は、第１の電圧制御増
幅回路２の出力と、第２の電圧制御増幅回路５の出力を
加算し、ミュートパルス入力端子２０に与えられるミュ
ートパルスにより制御されるミュートスイッチ７を介し
て端子８に出力する。端子８は、第１のコンデンサＣ１
と第１の抵抗Ｒ１の直列回路から成る電圧−電流変換回
路９を介して端子１０に接続される。ここで、端子１０
は、電流増幅回路１１の入力に接続されているが、電流
増幅回路１１の入力インピーダンスは電圧−電流変換回
路９のインピーダンスに対して１０％のオーダーとなる
様低く設定されているので、端子８に出力された電圧
は、その電圧を電圧−電流変換回路９のインピーダンス
で割った値とほぼ等しい電流に変換されて、端子１０を
介して電流増幅回路１１に与えられる。電流増幅回路１
１は、端子１０に流入する電流を増幅し、記録電流出力
端子１２を介して記録ヘッドＬ１に出力する。ダンピン
グ抵抗Ｒ２は、電流増幅回路１１の出力容量、及び記録
ヘッドＬ１までの配線が有する浮遊容量等と、記録ヘッ
ドＬ１のインダクタンスとの共振よって生じる記録電流
の周波数に対する変動を緩和するために、記録電流出力
端子１２と接地間に接続される。記録ヘッドＬ１を流れ
る電流は記録電流検出端子１３を介して記録電流検出回
路１４を与えられて電圧に変換され、検波回路１５によ
り検波されて比較回路１６に与えられる。
の自動利得制御回路を図３に示す。第１の電圧制御増幅
回路２は、第１の入力端子１を介して与えらえる周波数
変調された輝度信号を増幅し、加算回路３に出力する。
第２の電圧制御増幅回路５は，第２の入力端子４を介し
て与えられる低域変換色信号を、第２の制御信号入力端
子６に与えられる制御電圧に応じた増幅率で増幅し、加
算回路３に出力する。加算回路３は、第１の電圧制御増
幅回路２の出力と、第２の電圧制御増幅回路５の出力を
加算し、ミュートパルス入力端子２０に与えられるミュ
ートパルスにより制御されるミュートスイッチ７を介し
て端子８に出力する。端子８は、第１のコンデンサＣ１
と第１の抵抗Ｒ１の直列回路から成る電圧−電流変換回
路９を介して端子１０に接続される。ここで、端子１０
は、電流増幅回路１１の入力に接続されているが、電流
増幅回路１１の入力インピーダンスは電圧−電流変換回
路９のインピーダンスに対して１０％のオーダーとなる
様低く設定されているので、端子８に出力された電圧
は、その電圧を電圧−電流変換回路９のインピーダンス
で割った値とほぼ等しい電流に変換されて、端子１０を
介して電流増幅回路１１に与えられる。電流増幅回路１
１は、端子１０に流入する電流を増幅し、記録電流出力
端子１２を介して記録ヘッドＬ１に出力する。ダンピン
グ抵抗Ｒ２は、電流増幅回路１１の出力容量、及び記録
ヘッドＬ１までの配線が有する浮遊容量等と、記録ヘッ
ドＬ１のインダクタンスとの共振よって生じる記録電流
の周波数に対する変動を緩和するために、記録電流出力
端子１２と接地間に接続される。記録ヘッドＬ１を流れ
る電流は記録電流検出端子１３を介して記録電流検出回
路１４を与えられて電圧に変換され、検波回路１５によ
り検波されて比較回路１６に与えられる。
【０００３】比較回路１６は、第１の制御信号入力端子
１７を介して与えられる制御電圧と、検波回路１５の出
力電圧との比較を、水平同期信号入力端子１８を介して
与えられる水平同期信号が存在する期間においてのみ行
なう。比較によって生じた差は、電流として制御電圧出
力端子１９を介してホールドコンデンサＣ２に出力され
る。比較回路１６の出力電流がホールドコンデンサに充
放電されて発生した電圧は、第１の電圧制御増幅回路２
の利得制御電圧として帰還される。
１７を介して与えられる制御電圧と、検波回路１５の出
力電圧との比較を、水平同期信号入力端子１８を介して
与えられる水平同期信号が存在する期間においてのみ行
なう。比較によって生じた差は、電流として制御電圧出
力端子１９を介してホールドコンデンサＣ２に出力され
る。比較回路１６の出力電流がホールドコンデンサに充
放電されて発生した電圧は、第１の電圧制御増幅回路２
の利得制御電圧として帰還される。
【０００４】次に、動作について説明を行なう。記録ヘ
ッドＬ１には、第１の入力端子１に与えられる周波数変
調された輝度信号と、第２の入力端子４に与えられる低
域変換色信号それぞれに比例した電流を重ね合わせた電
流が流れる。この記録電流の振幅は記録電流検出回路１
４，検波回路１５により検出され、第１の制御信号入力
端子１７に与えられる制御信号と比較回路１６により比
較される。比較回路１６は、水平同期信号入力端子１８
に水平同期信号が与えられている期間についてのみ比較
動作を行なうが、水平同期信号が存在する期間では、低
域変換色信号が存在しないため検波回路１５は周波数変
調された輝度信号成分だけから成る記録電流の振幅を検
出する。したがって比較回路１６は低域変換色信号には
全く干渉されずに、周波数変調された輝度信号のみの振
幅と、第１の制御信号入力端子に与えられた制御信号の
差を検出し、その差をホールドコンデンサＣ２の充放電
電流として出力する。検出された記録電流振幅が第１の
制御信号入力端子１７に与えられた電圧よりも小なら
ば、第１の電圧制御増幅回路２の利得が増大する様に、
逆に、検出された記録電流振幅が第１の制御信号入力端
子１７に与えられた電圧よりも大ならば、第１の電圧制
御増幅回路２の利得が減少する様に、比較回路１６の出
力電流は設定されている。したがって、常に記録電流振
幅と第１の制御信号入力端子１７の制御信号は一致する
様に第１の電圧制御増幅回路２の利得が制御される帰還
回路が形成される。これにより、第１の制御信号入力端
子に与えられる制御電圧に応じた記録電流振幅を有する
周波数変調された輝度信号が記録ヘッドＬ１に常に流れ
る様、自動利得制御が行なわれる。
ッドＬ１には、第１の入力端子１に与えられる周波数変
調された輝度信号と、第２の入力端子４に与えられる低
域変換色信号それぞれに比例した電流を重ね合わせた電
流が流れる。この記録電流の振幅は記録電流検出回路１
４，検波回路１５により検出され、第１の制御信号入力
端子１７に与えられる制御信号と比較回路１６により比
較される。比較回路１６は、水平同期信号入力端子１８
に水平同期信号が与えられている期間についてのみ比較
動作を行なうが、水平同期信号が存在する期間では、低
域変換色信号が存在しないため検波回路１５は周波数変
調された輝度信号成分だけから成る記録電流の振幅を検
出する。したがって比較回路１６は低域変換色信号には
全く干渉されずに、周波数変調された輝度信号のみの振
幅と、第１の制御信号入力端子に与えられた制御信号の
差を検出し、その差をホールドコンデンサＣ２の充放電
電流として出力する。検出された記録電流振幅が第１の
制御信号入力端子１７に与えられた電圧よりも小なら
ば、第１の電圧制御増幅回路２の利得が増大する様に、
逆に、検出された記録電流振幅が第１の制御信号入力端
子１７に与えられた電圧よりも大ならば、第１の電圧制
御増幅回路２の利得が減少する様に、比較回路１６の出
力電流は設定されている。したがって、常に記録電流振
幅と第１の制御信号入力端子１７の制御信号は一致する
様に第１の電圧制御増幅回路２の利得が制御される帰還
回路が形成される。これにより、第１の制御信号入力端
子に与えられる制御電圧に応じた記録電流振幅を有する
周波数変調された輝度信号が記録ヘッドＬ１に常に流れ
る様、自動利得制御が行なわれる。
【０００５】次に、ミュートスイッチ７の動作について
説明を行なう。ミュートスイッチ７は、図３に示す記録
増幅回路が動作状態の時、記録電流出力端子１２に信号
成分が出力されていない状態を得る様、ミュートパルス
入力端子２０に与えられるミュートパルスにより制御さ
れる。これは、既に記録済みの信号に対して、一時的に
重ね書きを行いながら、既に記録済の信号との連続性を
保って記録を行なうつなぎ撮りと呼ばれる記録等を行な
う為に、記録電流出力端子１２に流れる記録電流の断続
を高速に行なう為のものである。
説明を行なう。ミュートスイッチ７は、図３に示す記録
増幅回路が動作状態の時、記録電流出力端子１２に信号
成分が出力されていない状態を得る様、ミュートパルス
入力端子２０に与えられるミュートパルスにより制御さ
れる。これは、既に記録済みの信号に対して、一時的に
重ね書きを行いながら、既に記録済の信号との連続性を
保って記録を行なうつなぎ撮りと呼ばれる記録等を行な
う為に、記録電流出力端子１２に流れる記録電流の断続
を高速に行なう為のものである。
【０００６】
【発明が解決しようとする課題】この従来の記録増幅回
路の自動利得制御回路では、つなぎ撮り等を行なう為の
ミュートスイッチが自動利得制御回路の帰還ループ内に
入る事となる。これにより、周波数変調された輝度信号
が入力された状態で、ミュートスイッチが切れている場
合には、記録ヘッドには全く記録電流が現れないので、
自動利得制御を行なう電圧制御増幅回路に帰還される制
御電圧は、利得が最大となる様設定される。この状態か
ら、ミュートスイッチが導通状態となる過渡的状態で
は、周波数変調された輝度信号入力を最大の利得で増幅
してしまう為、一時的に記録ヘッドには過大な記録電流
が流れてしまう。この様な過大なヒゲ状の記録電流は、
記録に適した値と異なっており、再生時にはミュートス
イッチの切換ポイントの画面上にスジ状の白い線がでて
しまう。この為、つなぎ撮りによりテープに記録した画
像は、つなぎ撮りを開始した時点での画質が劣化してし
まっており、再生した場合には非常に見苦しいものとな
る欠点が有る。
路の自動利得制御回路では、つなぎ撮り等を行なう為の
ミュートスイッチが自動利得制御回路の帰還ループ内に
入る事となる。これにより、周波数変調された輝度信号
が入力された状態で、ミュートスイッチが切れている場
合には、記録ヘッドには全く記録電流が現れないので、
自動利得制御を行なう電圧制御増幅回路に帰還される制
御電圧は、利得が最大となる様設定される。この状態か
ら、ミュートスイッチが導通状態となる過渡的状態で
は、周波数変調された輝度信号入力を最大の利得で増幅
してしまう為、一時的に記録ヘッドには過大な記録電流
が流れてしまう。この様な過大なヒゲ状の記録電流は、
記録に適した値と異なっており、再生時にはミュートス
イッチの切換ポイントの画面上にスジ状の白い線がでて
しまう。この為、つなぎ撮りによりテープに記録した画
像は、つなぎ撮りを開始した時点での画質が劣化してし
まっており、再生した場合には非常に見苦しいものとな
る欠点が有る。
【０００７】
【課題を解決するための手段】本発明の自動利得制御回
路は、入力信号を増幅する電圧制御増幅回路と、第１の
制御信号入力を備え前記電圧制御増幅回路の出力を入力
とするスイッチ手段と、前記スイッチ手段の出力を入力
とする検波回路と、前記検波回路の出力を保持する容量
と、前記容量に発生した電圧を前記電圧制御増幅回路に
帰還する帰還路と、前記容量に出力を接続し、前記第１
の制御信号入力と共通接続した第２の制御信号入力を有
する電流源とを備えている。
路は、入力信号を増幅する電圧制御増幅回路と、第１の
制御信号入力を備え前記電圧制御増幅回路の出力を入力
とするスイッチ手段と、前記スイッチ手段の出力を入力
とする検波回路と、前記検波回路の出力を保持する容量
と、前記容量に発生した電圧を前記電圧制御増幅回路に
帰還する帰還路と、前記容量に出力を接続し、前記第１
の制御信号入力と共通接続した第２の制御信号入力を有
する電流源とを備えている。
【０００８】
【実施例】次に、本発明に図面を参照して説明する。図
１は本発明の第１の実施例のブロック図である。なお、
図３に示す従来例と同一機能を有する所は同一符号をつ
けることとし、かつ説明を省略する。
１は本発明の第１の実施例のブロック図である。なお、
図３に示す従来例と同一機能を有する所は同一符号をつ
けることとし、かつ説明を省略する。
【０００９】電流源２１は、ミュートパルス入力端子２
０に与えらえるミュートパルスが与えられるとともに、
その出力が比較回路１６の出力と共通に制御電圧出力端
子１９を介してホールドコンデンサＣ２に接続される。
電流源２１の出力電流は、ミュートパルスが加わった時
に出力され、その値はミュートパルス入力時に比較回路
１６が出力する電流値の絶対値よりも大きく、かつ符号
を逆に設定してある。これによりミュートパルスが入力
された時には比較回路１６が第１の電圧制御増幅回路２
の利得を最大にする様出力する電流を打ち消し、ホール
ドコンデンサＣ２に生ずる電圧は第１の電圧制御増幅回
路の利得を最小にする様に設定される。さらに、ミュー
トパルス入力が無くなった直後では、第１の電圧制御増
幅回路２の利得は最小であるので、記録ヘッドＬ１には
周波数変調された輝度信号成分が過大に流れる事はな
い。
０に与えらえるミュートパルスが与えられるとともに、
その出力が比較回路１６の出力と共通に制御電圧出力端
子１９を介してホールドコンデンサＣ２に接続される。
電流源２１の出力電流は、ミュートパルスが加わった時
に出力され、その値はミュートパルス入力時に比較回路
１６が出力する電流値の絶対値よりも大きく、かつ符号
を逆に設定してある。これによりミュートパルスが入力
された時には比較回路１６が第１の電圧制御増幅回路２
の利得を最大にする様出力する電流を打ち消し、ホール
ドコンデンサＣ２に生ずる電圧は第１の電圧制御増幅回
路の利得を最小にする様に設定される。さらに、ミュー
トパルス入力が無くなった直後では、第１の電圧制御増
幅回路２の利得は最小であるので、記録ヘッドＬ１には
周波数変調された輝度信号成分が過大に流れる事はな
い。
【００１０】さらに、図４を用いて本実施例中の電流源
２１を詳細に説明する。ＮＰＮトランジスタＱ１のベー
スはミュートパルス入力端子２０に、コレクタは制御電
圧出力端子１９に、エミッタは抵抗Ｒ３を介して接地に
それぞれ接続される。ミュートパルス入力端子２０に与
えられるミュート時の電圧をＥ、ＮＰＮトランジスタＱ
１のベースとエミッタ間電圧をＶBEとすれば、ＮＰＮト
ランジスタＱ１のコレクタにはミュート時においておよ
そ（Ｅ−ＶBE）／Ｒ３なる値の電流が出力される。よっ
てＲ３の値を選択する事により、図１に示した比較回路
１６がミュート時に出力する電流を打ち消す様電流源の
出力電流を容易に設定可能である。
２１を詳細に説明する。ＮＰＮトランジスタＱ１のベー
スはミュートパルス入力端子２０に、コレクタは制御電
圧出力端子１９に、エミッタは抵抗Ｒ３を介して接地に
それぞれ接続される。ミュートパルス入力端子２０に与
えられるミュート時の電圧をＥ、ＮＰＮトランジスタＱ
１のベースとエミッタ間電圧をＶBEとすれば、ＮＰＮト
ランジスタＱ１のコレクタにはミュート時においておよ
そ（Ｅ−ＶBE）／Ｒ３なる値の電流が出力される。よっ
てＲ３の値を選択する事により、図１に示した比較回路
１６がミュート時に出力する電流を打ち消す様電流源の
出力電流を容易に設定可能である。
【００１１】次に、本発明の第２の実施例について図面
を参照して説明する。図２は、本発明の第２の実施例の
ブロック図である。なお、図１に示す第１の実施例と同
一機能を有する所は同一符号をつけることとし、かつ、
説明を省略する。
を参照して説明する。図２は、本発明の第２の実施例の
ブロック図である。なお、図１に示す第１の実施例と同
一機能を有する所は同一符号をつけることとし、かつ、
説明を省略する。
【００１２】ブランキング回路２２は、ミュートパルス
入力端子２０に入力が接続されたインバーター２３と、
インバーター２３の出力及び水平同期信号入力端子が入
力に接続され、比較回路１６に出力が接続されるＡＮＤ
回路から成る。ブランキング回路２２は、ミュートパル
ス入力時において比較回路１６への水平同期信号の入力
を禁止するので、ミュート時には、ホールドコンデンサ
Ｃ２に対して電流を供給するのは電流源２１だけとな
る。つまり、第２の実施例においては電流源２１の出力
電流は、比較回路１６の出力電流と独立に、第１の電圧
制御増幅器２の利得を最小に保つことのできる範囲内で
適当な値に設定できる。したがって本実施例において
は、電流源２１の出力電流値の設定の自由度を広げる事
が可能であるという利点が有る。
入力端子２０に入力が接続されたインバーター２３と、
インバーター２３の出力及び水平同期信号入力端子が入
力に接続され、比較回路１６に出力が接続されるＡＮＤ
回路から成る。ブランキング回路２２は、ミュートパル
ス入力時において比較回路１６への水平同期信号の入力
を禁止するので、ミュート時には、ホールドコンデンサ
Ｃ２に対して電流を供給するのは電流源２１だけとな
る。つまり、第２の実施例においては電流源２１の出力
電流は、比較回路１６の出力電流と独立に、第１の電圧
制御増幅器２の利得を最小に保つことのできる範囲内で
適当な値に設定できる。したがって本実施例において
は、電流源２１の出力電流値の設定の自由度を広げる事
が可能であるという利点が有る。
【００１３】
【発明の効果】以上説明したように本発明は、自動利得
制御回路内に有る利得制御電圧を保持するホールドコン
デンサに対して、ミュートスイッチと連動する電流源に
より電流を供給する構成とする事にしたので、ミュート
スイッチが切れた状態でもホールドコンデンサに保持さ
れる利得制御電圧が利得を増大させる様変化する事を防
止でき、ミュートスイッチが導通状態に変化した過渡現
象として、過大な出力を生ずる事が無いという効果を有
する。特に磁気記録再生装置の記録増幅回路の自動利得
制御増幅回路として使用した場合には、つなぎ撮り等を
行なった場合の画像の劣化を防止できる。
制御回路内に有る利得制御電圧を保持するホールドコン
デンサに対して、ミュートスイッチと連動する電流源に
より電流を供給する構成とする事にしたので、ミュート
スイッチが切れた状態でもホールドコンデンサに保持さ
れる利得制御電圧が利得を増大させる様変化する事を防
止でき、ミュートスイッチが導通状態に変化した過渡現
象として、過大な出力を生ずる事が無いという効果を有
する。特に磁気記録再生装置の記録増幅回路の自動利得
制御増幅回路として使用した場合には、つなぎ撮り等を
行なった場合の画像の劣化を防止できる。
【図１】本発明の第１の実施例のブロック図である。
【図２】本発明の第２の実施例のブロック図である。
【図３】従来例のブロック図である。
【図４】図１に示した電流源２１の回路図である。
１ 第１の入力端子 ２ 第１の電圧制御増幅回路 ３ 加算回路 ４ 第２の入力端子 ５ 第２の電圧制御増幅回路 ６ 第２の制御信号入力端子 ７ ミュートスイッチ ８ 端子 ９ 電圧−電流変換回路 １０ 端子 １１ 電流増幅回路 １２ 記録電流出力端子 １３ 記録電流検出端子 １４ 記録電流検出回路 １５ 検波回路 １６ 比較回路 １７ 第１の制御信号入力端子 １８ 水平同期信号入力端子 １９ 制御電圧出力端子 ２０ ホールドコンデンサ ２１ 電流源
Claims (1)
- 【請求項１】 電圧制御増幅回路と、第１の制御信号入
力を有し、前記電圧制御増幅回路の出力を入力とするス
イッチ手段と、前記スイッチ手段の出力を入力とする検
波回路と、前記検波回路出力に接続され、前記検波回路
出力を保持する容量と、前記容量に発生する電圧を前記
電圧制御増幅回路に帰還する帰還路とを有する自動利得
制御回路において、前記容量に出力が接続され、前記第
１の制御信号入力と共通接続した第２の制御信号入力を
有する電流源を備える事を特徴とする自動利得制御回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4017401A JP2797809B2 (ja) | 1992-02-03 | 1992-02-03 | 自動利得制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4017401A JP2797809B2 (ja) | 1992-02-03 | 1992-02-03 | 自動利得制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05274787A true JPH05274787A (ja) | 1993-10-22 |
| JP2797809B2 JP2797809B2 (ja) | 1998-09-17 |
Family
ID=11942975
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4017401A Expired - Fee Related JP2797809B2 (ja) | 1992-02-03 | 1992-02-03 | 自動利得制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2797809B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0877701A (ja) * | 1994-09-07 | 1996-03-22 | Nec Corp | 記録装置 |
| JPH0878981A (ja) * | 1994-09-07 | 1996-03-22 | Nec Corp | 自動利得制御回路 |
| US6809572B2 (en) | 2002-09-18 | 2004-10-26 | Cirrus Logic, Incorporated | Integrated circuit with automatic polarity detection and configuration |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62158675U (ja) * | 1986-03-28 | 1987-10-08 |
-
1992
- 1992-02-03 JP JP4017401A patent/JP2797809B2/ja not_active Expired - Fee Related
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62158675U (ja) * | 1986-03-28 | 1987-10-08 |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0877701A (ja) * | 1994-09-07 | 1996-03-22 | Nec Corp | 記録装置 |
| JPH0878981A (ja) * | 1994-09-07 | 1996-03-22 | Nec Corp | 自動利得制御回路 |
| US6809572B2 (en) | 2002-09-18 | 2004-10-26 | Cirrus Logic, Incorporated | Integrated circuit with automatic polarity detection and configuration |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2797809B2 (ja) | 1998-09-17 |
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