JPH05342433A - データ処理装置 - Google Patents
データ処理装置Info
- Publication number
- JPH05342433A JPH05342433A JP4149179A JP14917992A JPH05342433A JP H05342433 A JPH05342433 A JP H05342433A JP 4149179 A JP4149179 A JP 4149179A JP 14917992 A JP14917992 A JP 14917992A JP H05342433 A JPH05342433 A JP H05342433A
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- JP
- Japan
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- card
- fitting
- electrode
- data processing
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Abstract
(57)【要約】
【目的】 ＩＣカードを補助装置とするデータ処理装置
において、カードの活線挿抜（本体装置の電源が入った
まま挿入、抜去する）の際に起きる、素子のラッチアッ
プ破壊、多大な貫通電流の発生を防止することを目的と
する。 【構成】 電極１１をもつＩＣカード９と、ＩＣカード
９が嵌合したときに電極１１に接する嵌合検出器１０
と、電極１１を検出したときに本体装置とＩＣカード９
を電気的に接続する緩衝回路１４を備える。電極１１と
嵌合検出器１０の接触はＩＣカード９の嵌合が少しでも
緩むと解かれるため、緩衝回路１４で、挿抜開始時には
ＩＣカードを遮断、嵌合完了時に遮断解除することがで
きる。
において、カードの活線挿抜（本体装置の電源が入った
まま挿入、抜去する）の際に起きる、素子のラッチアッ
プ破壊、多大な貫通電流の発生を防止することを目的と
する。 【構成】 電極１１をもつＩＣカード９と、ＩＣカード
９が嵌合したときに電極１１に接する嵌合検出器１０
と、電極１１を検出したときに本体装置とＩＣカード９
を電気的に接続する緩衝回路１４を備える。電極１１と
嵌合検出器１０の接触はＩＣカード９の嵌合が少しでも
緩むと解かれるため、緩衝回路１４で、挿抜開始時には
ＩＣカードを遮断、嵌合完了時に遮断解除することがで
きる。
Description
【０００１】
【産業上の利用分野】本発明はＩＣカードを補助装置と
して使用するデータ処理装置に関するものである。
して使用するデータ処理装置に関するものである。
【０００２】
【従来の技術】近年、データ処理装置は補助装置とし
て、携帯性、操作性がよく、汎用性も高いＩＣカードを
使用することが多い。こうしたデータ処理装置が使用す
るＩＣカードと、このＩＣカードに嵌合する本体装置側
のＩＣカードコネクタの一般的な構造について以下図を
用いて説明する。
て、携帯性、操作性がよく、汎用性も高いＩＣカードを
使用することが多い。こうしたデータ処理装置が使用す
るＩＣカードと、このＩＣカードに嵌合する本体装置側
のＩＣカードコネクタの一般的な構造について以下図を
用いて説明する。
【０００３】図３は従来のデータ処理装置のＩＣカード
コネクタ部の構造図である。図において、１はＩＣカー
ド６が嵌合する複数の入出力用端子を有するＩＣカード
コネクタ、２は入出力端子の中の電源ピン、３はグラン
ドピン、４はその他の信号ピン４である。この電源ピン
２およびグランドピン３は他の信号ピン４よりも長くな
るように設計されている。５はＩＣカード６の誤挿入防
止用の突起５であり、ＩＣカード６は突起５に嵌合する
切り欠き７を備えている。
コネクタ部の構造図である。図において、１はＩＣカー
ド６が嵌合する複数の入出力用端子を有するＩＣカード
コネクタ、２は入出力端子の中の電源ピン、３はグラン
ドピン、４はその他の信号ピン４である。この電源ピン
２およびグランドピン３は他の信号ピン４よりも長くな
るように設計されている。５はＩＣカード６の誤挿入防
止用の突起５であり、ＩＣカード６は突起５に嵌合する
切り欠き７を備えている。
【０００４】以上のように構成されたデータ処理装置の
ＩＣカードの挿抜動作に付いて以下に説明する。まず、
ＩＣカードを挿入する際には最初にＩＣカードコネクタ
１の電源ピン２とグランドピン３がＩＣカードと嵌合
し、完全に電気的に導通した後に他の信号ピン４が嵌合
する。そして、ＩＣカードを抜去する際には逆に他の信
号ピン４が最初に抜去され、その後電源ピン２とグラン
ドピン３が抜去される。これは活線挿抜（本体装置の電
源を入れたまま、ＩＣカードを挿入、抜去すること）の
際、電源ピン２とグランドピン３が、他の信号ピン４よ
り早く嵌合、遅く抜去されることを目的とし、ＩＣカー
ド６の内部素子の信号に電源電圧を越える電圧がかかっ
たり、グランド電圧を下回る電圧がかかる瞬間をなくす
ためである。これにより、ＩＣカード内部素子のラッチ
アップが回避される。
ＩＣカードの挿抜動作に付いて以下に説明する。まず、
ＩＣカードを挿入する際には最初にＩＣカードコネクタ
１の電源ピン２とグランドピン３がＩＣカードと嵌合
し、完全に電気的に導通した後に他の信号ピン４が嵌合
する。そして、ＩＣカードを抜去する際には逆に他の信
号ピン４が最初に抜去され、その後電源ピン２とグラン
ドピン３が抜去される。これは活線挿抜（本体装置の電
源を入れたまま、ＩＣカードを挿入、抜去すること）の
際、電源ピン２とグランドピン３が、他の信号ピン４よ
り早く嵌合、遅く抜去されることを目的とし、ＩＣカー
ド６の内部素子の信号に電源電圧を越える電圧がかかっ
たり、グランド電圧を下回る電圧がかかる瞬間をなくす
ためである。これにより、ＩＣカード内部素子のラッチ
アップが回避される。
【０００５】
【発明が解決しようとする課題】このような従来のデー
タ処理装置は、大別して２つの課題をもっている。まず
第一の課題は、上記したようにＩＣカードコネクタのピ
ンの長さに変化をつけてラッチアップを避ける工夫をし
たため、その対策自身が問題を引き起こす可能性をもつ
ものである。つまり、電源ピン、グランドピンが長いた
めに、挿抜の際、ＩＣカードに電源電圧がかかりながら
入力信号レベルが不定になる時間がミリ秒のオーダで発
生し、多大な貫通電流が流れ続ける現象である。これは
ＩＣカード自身の長期的信頼性を損うのみならず、本体
装置の電源回路でこの貫通電流を供給しきれない場合、
電源電圧に変動をもたらし、誤動作を誘発しうる。ＩＣ
カードによっては内部にプルアップもしくはプルダウン
抵抗をもって信号レベルを固定し、貫通電流を抑制する
ものもあるが、通常時の消費電力の増加につながって本
体装置が電池駆動の場合に不向きであったり、本体装置
の仕様に抵触して抵抗付加が許可されないことも多く、
こうした場合の解決策とならない。抜去時の根本的対策
は、信号ピンの抜去を前もって検出し、ＩＣカードと本
体装置間の電源および信号を同時かつ可及的速やかに遮
断すること、また、挿入時は信号ピンの嵌合完了を待っ
て電源、信号を接続することである。
タ処理装置は、大別して２つの課題をもっている。まず
第一の課題は、上記したようにＩＣカードコネクタのピ
ンの長さに変化をつけてラッチアップを避ける工夫をし
たため、その対策自身が問題を引き起こす可能性をもつ
ものである。つまり、電源ピン、グランドピンが長いた
めに、挿抜の際、ＩＣカードに電源電圧がかかりながら
入力信号レベルが不定になる時間がミリ秒のオーダで発
生し、多大な貫通電流が流れ続ける現象である。これは
ＩＣカード自身の長期的信頼性を損うのみならず、本体
装置の電源回路でこの貫通電流を供給しきれない場合、
電源電圧に変動をもたらし、誤動作を誘発しうる。ＩＣ
カードによっては内部にプルアップもしくはプルダウン
抵抗をもって信号レベルを固定し、貫通電流を抑制する
ものもあるが、通常時の消費電力の増加につながって本
体装置が電池駆動の場合に不向きであったり、本体装置
の仕様に抵触して抵抗付加が許可されないことも多く、
こうした場合の解決策とならない。抜去時の根本的対策
は、信号ピンの抜去を前もって検出し、ＩＣカードと本
体装置間の電源および信号を同時かつ可及的速やかに遮
断すること、また、挿入時は信号ピンの嵌合完了を待っ
て電源、信号を接続することである。
【０００６】第二の課題は、ＩＣカードの普及と外形の
標準化がもたらすもので、電気的仕様が全く異なるにも
拘らず、誤挿入防止用の切り欠きも含めた外形が一致す
ることに起因する。従来の誤挿入防止機構は、単にカー
ドの裏表の逆挿入を防止できればよかったが、ＩＣカー
ドが急速に普及しつつある今日、電気的仕様の異なるカ
ードの誤挿入に対する配慮が発生する。うまく嵌合する
カードであっても、本体装置で使用可能なものでない限
り、拒絶する仕組みが必要となる。
標準化がもたらすもので、電気的仕様が全く異なるにも
拘らず、誤挿入防止用の切り欠きも含めた外形が一致す
ることに起因する。従来の誤挿入防止機構は、単にカー
ドの裏表の逆挿入を防止できればよかったが、ＩＣカー
ドが急速に普及しつつある今日、電気的仕様の異なるカ
ードの誤挿入に対する配慮が発生する。うまく嵌合する
カードであっても、本体装置で使用可能なものでない限
り、拒絶する仕組みが必要となる。
【０００７】本発明のデータ処理装置は、本体装置で使
用可能なＩＣカードを識別し、かつ、このカードがＩＣ
カードコネクタと完全に嵌合しているときに限って電気
的接続を許可することで、上記課題を解決することを目
的とする。
用可能なＩＣカードを識別し、かつ、このカードがＩＣ
カードコネクタと完全に嵌合しているときに限って電気
的接続を許可することで、上記課題を解決することを目
的とする。
【０００８】
【課題を解決するための手段】上記目的を達成するため
に本発明は、接続される本体装置への入出力信号端子と
は別に、ＩＣカード内部で前記入出力端子の一部と接続
される電極を外面に備えたＩＣカード、およびＩＣカー
ドの外面に備えられた電極と接触して嵌合を電気的に検
出する嵌合検出器と、前記嵌合検出器でＩＣカードの嵌
合が検出されたときに、本体装置とＩＣカードを電気的
に接続する緩衝回路とを備えたデータ処理装置である。
に本発明は、接続される本体装置への入出力信号端子と
は別に、ＩＣカード内部で前記入出力端子の一部と接続
される電極を外面に備えたＩＣカード、およびＩＣカー
ドの外面に備えられた電極と接触して嵌合を電気的に検
出する嵌合検出器と、前記嵌合検出器でＩＣカードの嵌
合が検出されたときに、本体装置とＩＣカードを電気的
に接続する緩衝回路とを備えたデータ処理装置である。
【０００９】
【作用】本発明のデータ処理装置のＩＣカードは、外面
に電極をもつため、嵌合検出器でこの電極を電気的に検
出することにより、本体装置で使用可能なカードを識別
することができる。さらに、電極と嵌合検出器は、嵌合
が僅かでも緩むと接触が解かれる位置関係にあるため、
ＩＣカードの抜去に際しては信号ピンの抜去前、挿入に
際しては信号ピンの挿入後に、次段の緩衝回路でＩＣカ
ードと本体装置の電源および信号を接続することが可能
になる。
に電極をもつため、嵌合検出器でこの電極を電気的に検
出することにより、本体装置で使用可能なカードを識別
することができる。さらに、電極と嵌合検出器は、嵌合
が僅かでも緩むと接触が解かれる位置関係にあるため、
ＩＣカードの抜去に際しては信号ピンの抜去前、挿入に
際しては信号ピンの挿入後に、次段の緩衝回路でＩＣカ
ードと本体装置の電源および信号を接続することが可能
になる。
【００１０】
【実施例】以下、本発明の一実施例について図１及び図
２を用いて説明する。
２を用いて説明する。
【００１１】図１は本発明のデータ処理装置のＩＣカー
ドコネクタ部の構成図である。図において、８はＩＣカ
ード９が嵌合する複数の入出力用端子を有するＩＣカー
ドコネクタ、ＩＣカードコネクタ８は側面部が延長され
ている。この延長部分には、ＩＣカード９の側面に滑ら
かに接触する嵌合検出器１０が設置され、ＩＣカード９
が嵌合している場合に、ＩＣカード９の側面に設けられ
た電極１１に接触する。電極１１はＩＣカード９の内部
で入出力端子のグランドと接続されている。
ドコネクタ部の構成図である。図において、８はＩＣカ
ード９が嵌合する複数の入出力用端子を有するＩＣカー
ドコネクタ、ＩＣカードコネクタ８は側面部が延長され
ている。この延長部分には、ＩＣカード９の側面に滑ら
かに接触する嵌合検出器１０が設置され、ＩＣカード９
が嵌合している場合に、ＩＣカード９の側面に設けられ
た電極１１に接触する。電極１１はＩＣカード９の内部
で入出力端子のグランドと接続されている。
【００１２】嵌合検出器１０に結線された電気信号１２
は、抵抗１３によって本体装置の電源にプルアップさ
れ、緩衝回路１４を構成する複数のアナログスイッチ１
５を制御する。緩衝回路１４は、本体装置側信号１６と
ＩＣカード側信号１７、および本体装置側電源１８とＩ
Ｃカード側電源１９の間に直列に入れられており、両者
を電気的に接続または遮断する。本体装置側グランド２
０とＩＣカード側グランド２１は、緩衝回路１４を経由
せず直接接続されている。なお、アナログスイッチ１５
は、電気信号１２がローレベルでオン（すなわち導
通）、ハイレベルでオフ（遮断）するタイプで、反応時
間がナノ秒のオーダのものを使用する。
は、抵抗１３によって本体装置の電源にプルアップさ
れ、緩衝回路１４を構成する複数のアナログスイッチ１
５を制御する。緩衝回路１４は、本体装置側信号１６と
ＩＣカード側信号１７、および本体装置側電源１８とＩ
Ｃカード側電源１９の間に直列に入れられており、両者
を電気的に接続または遮断する。本体装置側グランド２
０とＩＣカード側グランド２１は、緩衝回路１４を経由
せず直接接続されている。なお、アナログスイッチ１５
は、電気信号１２がローレベルでオン（すなわち導
通）、ハイレベルでオフ（遮断）するタイプで、反応時
間がナノ秒のオーダのものを使用する。
【００１３】図２は、ＩＣカード９が嵌合しているとき
の嵌合検出器１０と電極１１の接触の様子を拡大したも
ので、点ｐは嵌合検出器１０の先端、ｘは抜去方向の接
触余裕である。ｘの値は、ＩＣカード９とＩＣカードコ
ネクタ８のピンの嵌合長をｙとしたとき、ｘ＜ｙを満た
す範囲で決定される。
の嵌合検出器１０と電極１１の接触の様子を拡大したも
ので、点ｐは嵌合検出器１０の先端、ｘは抜去方向の接
触余裕である。ｘの値は、ＩＣカード９とＩＣカードコ
ネクタ８のピンの嵌合長をｙとしたとき、ｘ＜ｙを満た
す範囲で決定される。
【００１４】以上のように構成された本発明のデータ処
理装置及びＩＣカードについて以下その動作を説明す
る。
理装置及びＩＣカードについて以下その動作を説明す
る。
【００１５】図２は前述の通り、ＩＣカード９が嵌合し
た状態である。このとき、本体装置側グランド２０とＩ
Ｃカード側グランド２１は接続されているので、電極１
１とそれに接触する嵌合検出器１０もローレベルにな
り、アナログスイッチ１５はオンとなる。これで緩衝回
路１４が導通になり、ＩＣカード９は通常動作状態に置
かれる。
た状態である。このとき、本体装置側グランド２０とＩ
Ｃカード側グランド２１は接続されているので、電極１
１とそれに接触する嵌合検出器１０もローレベルにな
り、アナログスイッチ１５はオンとなる。これで緩衝回
路１４が導通になり、ＩＣカード９は通常動作状態に置
かれる。
【００１６】この状態を起点とし、カードの抜去を考え
る。抜去の開始に伴い、電極１１が図の右方向に移動す
る。移動距離がｘを越える瞬間、嵌合検出器１０は電極
１１と離れ、電気信号１２は抵抗１３のプルアップだけ
でハイレベルへ移行、アナログスイッチ１５がオフとな
り、緩衝回路１４が本体装置側信号１６とＩＣカード側
信号１７、および本体装置側電源１８とＩＣカード側電
源１９を遮断する。前述のｘ＜ｙの関係は、この遮断が
ＩＣカード９のピンの抜去前に完了する保証を与えるも
のである。
る。抜去の開始に伴い、電極１１が図の右方向に移動す
る。移動距離がｘを越える瞬間、嵌合検出器１０は電極
１１と離れ、電気信号１２は抵抗１３のプルアップだけ
でハイレベルへ移行、アナログスイッチ１５がオフとな
り、緩衝回路１４が本体装置側信号１６とＩＣカード側
信号１７、および本体装置側電源１８とＩＣカード側電
源１９を遮断する。前述のｘ＜ｙの関係は、この遮断が
ＩＣカード９のピンの抜去前に完了する保証を与えるも
のである。
【００１７】逆にＩＣカード９の挿入時の様子は、上記
の抜去に関する一連の動作を時間的に反転させて見れば
よい。この場合、抜去開始のタイミングは挿入完了のタ
イミングに相当するから、ピンの嵌合完了後に緩衝回路
１４が導通となる。
の抜去に関する一連の動作を時間的に反転させて見れば
よい。この場合、抜去開始のタイミングは挿入完了のタ
イミングに相当するから、ピンの嵌合完了後に緩衝回路
１４が導通となる。
【００１８】アナログスイッチ１５はオン、オフが速い
ため、挿抜の際に発生する貫通電流を非常に小さな値に
抑えることができる。このときＩＣカード９の劣化を考
える必要はなく、本体装置電源回路にも負担をかけない
ことから、電源電圧変動を誘発することもない。また、
ラッチアップに関しても、ＩＣカード側信号１７とＩＣ
カード側電源１９のオン、オフがナノ秒という短時間内
でいっせいに行われるため、事実上、配慮は不要とな
る。以上により、本発明は従来の課題の第一点を解決す
る。第二点に関しても、仮に予期せぬＩＣカードが挿入
されたところで、それは本発明のＩＣカードに特徴的な
電極をもたず、緩衝回路は遮断状態のままとなり、他の
ＩＣカードは使用できないため誤挿入防止という第二の
課題は解決される。
ため、挿抜の際に発生する貫通電流を非常に小さな値に
抑えることができる。このときＩＣカード９の劣化を考
える必要はなく、本体装置電源回路にも負担をかけない
ことから、電源電圧変動を誘発することもない。また、
ラッチアップに関しても、ＩＣカード側信号１７とＩＣ
カード側電源１９のオン、オフがナノ秒という短時間内
でいっせいに行われるため、事実上、配慮は不要とな
る。以上により、本発明は従来の課題の第一点を解決す
る。第二点に関しても、仮に予期せぬＩＣカードが挿入
されたところで、それは本発明のＩＣカードに特徴的な
電極をもたず、緩衝回路は遮断状態のままとなり、他の
ＩＣカードは使用できないため誤挿入防止という第二の
課題は解決される。
【００１９】なお、本実施例では、ＩＣカードの側面に
電極を設けたが、これはＩＣカードのいずれの面に置い
てもよい。また緩衝回路のアナログスイッチは、トライ
ステイトオフ状態をもつバッファＩＣ、もしくはトラン
シーバＩＣで構成することも可能である。本体装置の回
路構成上、こうしたＩＣがもともと存在する場合には特
に有効である。さらに本発明のＩＣカードは、その構成
上、誤挿入防止に関する機構を一切必要とせず、切り欠
きを全くもたないものでよい。このとき、切り欠きの存
在を想定する従来のデータ処理装置に、切り欠きのない
本発明のＩＣカードが誤挿入される懸念はない。
電極を設けたが、これはＩＣカードのいずれの面に置い
てもよい。また緩衝回路のアナログスイッチは、トライ
ステイトオフ状態をもつバッファＩＣ、もしくはトラン
シーバＩＣで構成することも可能である。本体装置の回
路構成上、こうしたＩＣがもともと存在する場合には特
に有効である。さらに本発明のＩＣカードは、その構成
上、誤挿入防止に関する機構を一切必要とせず、切り欠
きを全くもたないものでよい。このとき、切り欠きの存
在を想定する従来のデータ処理装置に、切り欠きのない
本発明のＩＣカードが誤挿入される懸念はない。
【００２０】
【発明の効果】以上の実施例からわかるように、本発明
のデータ処理装置の嵌合検出器は、本体装置で使用可能
なＩＣカードを識別するのみならず、カードの抜去開始
と挿入完了のタイミングも示すもので、次段の緩衝回路
とともに、挿抜を受動的に待つ他ない従来システムの課
題に基本的解決を与えるものである。さらに本発明のＩ
Ｃカードは、上記のように誤挿入防止用の切り欠きをな
くすことで、従来のデータ処理装置に対する誤挿入を自
ら回避することができる。
のデータ処理装置の嵌合検出器は、本体装置で使用可能
なＩＣカードを識別するのみならず、カードの抜去開始
と挿入完了のタイミングも示すもので、次段の緩衝回路
とともに、挿抜を受動的に待つ他ない従来システムの課
題に基本的解決を与えるものである。さらに本発明のＩ
Ｃカードは、上記のように誤挿入防止用の切り欠きをな
くすことで、従来のデータ処理装置に対する誤挿入を自
ら回避することができる。
【００２１】このように本発明のデータ処理装置によれ
ば、単純な構造、回路にして、ラッチアップと貫通電流
の対策という従来の二律背反を解消して装置全体の信頼
性を向上させ、同時に、今後増加が予想されるＩＣカー
ドの誤挿入の問題を、本体装置、ＩＣカードの両面から
解決するものである。
ば、単純な構造、回路にして、ラッチアップと貫通電流
の対策という従来の二律背反を解消して装置全体の信頼
性を向上させ、同時に、今後増加が予想されるＩＣカー
ドの誤挿入の問題を、本体装置、ＩＣカードの両面から
解決するものである。
【図１】本発明の一実施例のデータ処理装置のＩＣカー
ド嵌合部の構成図
ド嵌合部の構成図
【図２】本発明の一実施例のデータ処理装置の嵌合検出
器と電極の拡大図
器と電極の拡大図
【図３】従来のデータ処理装置のＩＣカード嵌合部の構
造図
造図
【符号の説明】 ８ ＩＣカードコネクタ ９ ＩＣカード １０ 嵌合検出器 １１ 電極 １４ 緩衝回路
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.5 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｇ０６Ｋ 17/00 Ｃ 7459−5Ｌ
Claims (2)
- 【請求項１】 接続される本体装置への入出力信号端子
とは別に、ＩＣカード内部で前記入出力端子の一部と接
続される電極を外面に備えたことを特徴とするＩＣカー
ド。 - 【請求項２】請求項１記載のＩＣカードの外面に備えら
れた電極と接触して嵌合を電気的に検出する嵌合検出器
と、前記嵌合検出器でＩＣカードの嵌合が検出されたと
きに、本体装置とＩＣカードを電気的に接続する緩衝回
路とを備えたことを特徴とするデータ処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4149179A JPH05342433A (ja) | 1992-06-09 | 1992-06-09 | データ処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4149179A JPH05342433A (ja) | 1992-06-09 | 1992-06-09 | データ処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05342433A true JPH05342433A (ja) | 1993-12-24 |
Family
ID=15469528
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4149179A Pending JPH05342433A (ja) | 1992-06-09 | 1992-06-09 | データ処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05342433A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2001009826A1 (en) * | 1999-08-02 | 2001-02-08 | Sony Corporation | Cartridge and memory medium comprising cartridge and plate memory |
| JP2001306177A (ja) * | 2000-04-19 | 2001-11-02 | Sharp Corp | ペン入力電子機器 |
| JP2009112111A (ja) * | 2007-10-30 | 2009-05-21 | Toshiba Corp | 電池パック、充電器及び電池パックシステム |
| CN110956244A (zh) * | 2019-12-27 | 2020-04-03 | 深圳市几米物联有限公司 | 内置电池学生卡片机超常待机电路及学生卡片机 |
-
1992
- 1992-06-09 JP JP4149179A patent/JPH05342433A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2001009826A1 (en) * | 1999-08-02 | 2001-02-08 | Sony Corporation | Cartridge and memory medium comprising cartridge and plate memory |
| JP2001306177A (ja) * | 2000-04-19 | 2001-11-02 | Sharp Corp | ペン入力電子機器 |
| JP2009112111A (ja) * | 2007-10-30 | 2009-05-21 | Toshiba Corp | 電池パック、充電器及び電池パックシステム |
| US8432136B2 (en) | 2007-10-30 | 2013-04-30 | Kabushiki Kaisha Toshiba | Battery pack, battery charger, and battery pack system |
| CN110956244A (zh) * | 2019-12-27 | 2020-04-03 | 深圳市几米物联有限公司 | 内置电池学生卡片机超常待机电路及学生卡片机 |
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