JPH0548979B2 - - Google Patents

Info

Publication number
JPH0548979B2
JPH0548979B2 JP60085572A JP8557285A JPH0548979B2 JP H0548979 B2 JPH0548979 B2 JP H0548979B2 JP 60085572 A JP60085572 A JP 60085572A JP 8557285 A JP8557285 A JP 8557285A JP H0548979 B2 JPH0548979 B2 JP H0548979B2
Authority
JP
Japan
Prior art keywords
signal
clock signal
polarity
sampling
time interval
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP60085572A
Other languages
English (en)
Other versions
JPS60235563A (ja
Inventor
Yan Uuda Korunerisu
Yosefusu Maria Re Uiruherumusu
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Koninklijke Philips NV
Original Assignee
Philips Gloeilampenfabrieken NV
Koninklijke Philips Electronics NV
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Philips Gloeilampenfabrieken NV, Koninklijke Philips Electronics NV filed Critical Philips Gloeilampenfabrieken NV
Publication of JPS60235563A publication Critical patent/JPS60235563A/ja
Publication of JPH0548979B2 publication Critical patent/JPH0548979B2/ja
Granted legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L7/00Arrangements for synchronising receiver with transmitter
    • H04L7/02Speed or phase control by the received code signals, the signals containing no special synchronisation information
    • H04L7/033Speed or phase control by the received code signals, the signals containing no special synchronisation information using the transitions of the received signal to control the phase of the synchronising-signal-generating means, e.g. using a phase-locked loop
    • H04L7/0334Processing of samples having at least three levels, e.g. soft decisions
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00Baseband systems
    • H04L25/38Synchronous or start-stop systems, e.g. for Baudot code
    • H04L25/40Transmitting circuits; Receiving circuits
    • H04L25/49Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
    • H04L25/4904Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using self-synchronising codes, e.g. split-phase codes

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Physics & Mathematics (AREA)
  • Spectroscopy & Molecular Physics (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)
  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
  • Dc Digital Transmission (AREA)

Description

【発明の詳細な説明】 本発明は、制御可能なクロツク信号源を具え
て、受信したバイフエイズ変調信号からクロツク
信号を発生するための装置に関するものである。
かかる形式のクロツク信号発生装置は、例え
ば、デイジタル電話システムの加入者電話機にお
いて使用されるデイジタル信号を受信する装置に
おいて用いるのに好適である。
デイジタルベースバンド伝送システムにおいて
クロツク信号を再生するため、受信信号を適宜等
化した後、ビツト繰り返し周波数におけるスペク
トル成分を発生させるため受信信号の非直線性処
理がしばしば使用される。このようにして得た信
号によつて位相ロツクループ(PLL)を駆動す
ることができる。
量子化帰還等化が使用される場合又は時間離散
エコーキヤンセル(打消し)システムが適用され
る場合には、クロツク信号を発生させるために使
用すべき信号はローカルクロツクによつて発生し
た信号成分を含む。その場合、受信装置の時間離
散部が適切に高いサンプリング周波数で作動する
ときは上述したクロツク信号発生方法を依然使用
することができるが、バイフエイズ符号化信号の
場合処理周波数はビツト繰り返し周波数の4倍に
なる。
本発明の目的は、時間離散的な〈time−
discrete〉受信システムに対して可能な限り最低
の処理速度でクロツク信号を発生させる装置を提
供することに在り、その目標は処理速度をビツ
ト・レートの2倍に限定することである。
かかる目的を達成するため本発明のクロツク信
号発生装置は、前記受信した信号の極性は、1つ
の記号時間間隔〈symbol interval〉中の2つの
異なる時点でのみサンプリングされ、クロツク信
号源の周波数と位相とを再調整して、そこからサ
ンプリング瞬時と所望のクロツク信号とを導出す
る目的で、得られた極性サンプルを互いに比較し
て、もし両方の極性サンプルが等しいならば一方
(正)の制御信号を発生し、もし両方の極性サン
プルが等しくないならば他方(負)の制御信号を
発生することを特徴とする。
次に図面につき本発明の実施例を説明する。
第1図においてtB及びtFは記号(シンボル)
時間間隔T内において相互時間間隔がT/4のサ
ンプリング瞬時を示す。実際上、この相互時間間
隔は約T/3から約T/4まで変化し得ることを
見出した。瞬時tB及びtFはローカルクロツク信
号源から導出され、受信した波形と同期して、第
1図に示すように、tFが特性アイパターンのゼ
ロ交さ点aと一致するようにする必要がある。こ
の同期状態に達する以前に瞬時tB及びtFを受信
波形に対し推移することができる。
第2図のブロツク図に示したように、電圧制御
発振器(VCO)1により調整可能割算器2に信
号を供給し、この割算器からサンプリング瞬時
tB及びtFを導出する。判定回路3により瞬時tB
及びtFに、受信したバイフエイズ符号化信号に
対する信号入力端子4における瞬時信号レベルが
ゼロボルトより大きいか又は小さいかが判定され
る。この判定結果はサンプリング瞬時tBに対し
てはデイジタル信号Bとして格納され、かつサン
プリング瞬時tFに対してはデイジタル信号Fと
して格納され、判定結果“正”及び“負”がそれ
ぞれ“1”及び“0”として格納される。同期状
態においては出力端子5におけるデイジタル信号
Bが各記号時間間隔における送信された情報の値
を示す。
信号B及びFの組合わせから位相検波器6によ
り、受信したバイフエイズ符号化信号に対するサ
ンプリング瞬時tB及びtFの位置に関する情報を
導出する。tFがゼロ交さ点aの直前に生起した
場合、信号BおよびFは等しくなる(双方共
“1”又は双方共“0”)。tF(第1図)がゼロ交
さ点aの直後に生起した場合には、信号B及びF
は異なる。各記号時間間隔に信号B及びFのモジ
ユロ2加算を行うことにより制御電圧Vrを得る
ことができ、この制御電圧を直接使用するか、又
は低域通過フイルタ7を設けた場合にはフイルタ
リング後に使用して電圧制御発振器1の周波数及
び位相を再調整することができる。
第3図は、サンプリング瞬時tB及びtFが受信
信号に対し緩慢に推移される場合の位相検波器6
の出力信号を示す。信号時間間隔T(第1図)は
番号1〜12を付した12個の副時間間隔に分割され
ている。第3図におけるこれらの番号は記号時間
間隔内の瞬時tFの位置を示す。tFが副時間間隔
4,5又は6内にある場合には信号B及びFは等
しく、BF=0が成立つ(ここではモジユロ
2加算を示す。)tFが副時間間隔7,8又は9内
にある場合には、BF≠0が成立つ。tFが副
時間間隔1,2又は3内にある場合には、BF
の値は受信信号のパターンに依存し即ち受信信号
の“1”及び“0”の系列に依存する。送信前に
信号にスクランブルを施した場合“1”及び
“0”は同じ確率で生起し、著しく多数の記号時
間間隔にわたる平均化の後制御信号Vrの値は
“1/2”になる。
電圧制御発振器の周波数及び位相を制御電圧
Vrにより安定化してtFが副時間間隔6及び7の
間の境界線に配置されるようにする必要がある。
その場合サンプリング瞬時tBは、記号時間間隔
に送信された情報を決定するのに好適な特性アイ
パターン(第1図)の部分に入る。
tFが副時間間隔12及び1(第3図)の間の境界
線に位置する場合には、副時間間隔6及び7の間
の境界線に位置する場合と同様な状態が起こり、
特に両方の場合において制御信号Vrは低レベル
から高レベルへの遷移を呈する。従つて電圧制御
発振器のサンプリング瞬時tFが副時間間隔12及
び1の間の境界線における制御電圧Vrによつて
安定化されることが起こり得る。この境界線にお
ける遷移に安定化されるのを防止する対策を以下
に実施例につき詳細に説明する。
第4図においては受信し濾波された2相符号化
信号を、第2図の入力端子4に対応する入力端子
8に供給し、この入力端子から判定回路9に供給
する。
電圧制御発振器(VCO)12によつて駆動さ
れるプログラマブルカウンタ11に接続した復号
回路10は各記号時間間隔に12個の互に位相推移
されたクロツク信号LFR1……LFR12を発生し、
各クロツク信号は同一番号を有する副時間間隔
(第3図)に関連する。
それぞれのサンプリング瞬時tB及びtFを決定
するクロツク信号LFR4及びLFR7をORゲート1
3を介して判定回路9に供給する。判定回路9の
出力端子はそのクロツク入力端子におけるクロツ
ク信号LFR5及びLFR8によつて駆動される2個
のフリツプフロツプ14及び15に接続し、これ
らクロツク信号に応動してこれらフリツプフロツ
プの出力端子には信号B(n+1)及びF(n+
1)がそれぞれ発生し、ここでn+1は現在の記
号時間間隔を示し、かつnは先の記号時間間隔を
示す。
信号B及びFはモジユロ2加算器(排他的論理
和ゲート)16においてモジユロ2加算され、そ
の加算結果はクロツク信号LFR9によつて駆動さ
れるフリツプフロツプ17に供給する。フリツプ
フロツプ17の出力信号BF(n+1)は電圧制御
発振器12に直接供給するか、又は低域通過フイ
ルタ18を設けた場合にはこのフイルタによるフ
イルタリング後に供給する。フリツプフロツプ1
7の出力端子に接続した遷移検出器19は信号
BF(n+1)の各遷移においてパルスを発生し、
このパルスはクロツク信号LFR10によつて駆動
され32までの計数を行うカウンタ20をリセツト
する。従つて信号BF(n+1)が少なくとも32個
の記号時間間隔に当り変化しない場合カウンタ2
0が出力パルスを発生し、この出力パルスは2個
のANDゲート21及び22に一方の駆動信号と
して供給され、これらANDゲートには他方駆動
信号として信号BF(n+1)及びその反転信号
BF(n+1)(インバータ23により反転)を供
給する。
信号BF(n+1)が高レベル(即ち“1”)で
ある場合には、通常電圧制御発振器12の12個の
クロツクパルスを含むプログラマブルカウンタ1
1のサイクルが一度だけ11クロツクパルスに低減
され、一方、信号BF(n+1)が低レベルである
場合には、プログラマブルカウンタのサイクルが
一度だけ13クロツクパルスに増大される。その結
果、復号回路10の出力端子におけるクロツク信
号の位相の小さい推移が起こるのでサンプリング
瞬時tFが信号BF(n+1)において期待又は予期
される、近傍の低レベルから高レベルへの遷移に
向かつて推移する。
最後の遷移は副時間間隔6及び7(第2図)の
間の遷移即ち“所望遷移”、又は副時間間隔12及
び1の間の遷移即ち“不所望遷移”となる。サン
プリング瞬時tFが副時間間隔6及び7間の遷移
において安定化された場合、出力端子24即ちフ
リツプフロツプ14の出力端子であつて、第2図
の出力端子5に対応する出力端子に復号されたデ
ータが現れる。
サンプリング瞬時tFが副時間間隔12及び1間
の不所望遷移に同期されるのを防止又は打消すた
め誤同期検出器を構成する多数の付加的部品が設
けてあり、これら部品として特に2個のフリツプ
フロツプ25及び26並びに64まで計数するカ
ウンタ27を備えている。
誤同期検出器の動作は、副時間間隔6及び7間
の遷移並びに12及び1間の遷移の周りでのFn≠
Bnの場合、後者の場合に対してはデータとは無
関係にBn=B(n+1)が成立ち、前者の場合に
は、ランダムデータに対するB(n+1)がBnに
等しくなくとも平均するとしばしばBnに等しく
なることを認識しこれを基礎としている。
信号B(n+1)はモジユロ2の加算器(排他
的論理和ゲート)28及びクロツク信号LFR5に
より駆動されるフリツプフロツプ25に供給され
る。クロツク信号の生起に先立つて信号Bnはこ
のフリツプフロツプに格納されており、ゲート2
8でこの信号が信号B(n+1)にモジユロ2で
加算される。その結果としてゲート28の出力信
号は: B(n+1)≠Bnのときには“1”, B(n+1)=Bnのときには“0” となる。
信号BF(n+1)はクロツク信号LFR9によつ
て駆動されるフリツプフロツプ26に供給する。
このクロツク信号が発生する前に信号Bnがこの
フリツプフロツプに格納される。フリツプフロツ
プ26の出力信号は2個のANDゲート29及び
30に供給し、またこれらANDゲートにはゲー
ト28の出力信号を直接及びその反転信号に変換
(インバータ31を介して)した後それぞれ供給
する。ゲート30には駆動信号としてクロツク信
号LFR10も供給する。
ゲート30の出力端子はカウンタ27の計数入
力端子に接続し、ゲート29の出力端子はカウン
タ27のリセツト入力端子に接続する。その結
果、B(n+1)=Bnの場合クロツク信号LFR10
によつて決まる瞬時にカウンタ27の内容が1だ
けインクリメントされる。これに対しB(n+1)
≠Bnの場合には、カウンタ27はゲート29の
出力信号によりその初期値ヘリセツトされる。リ
セツトパルスを供給されることなくカウンタ27
の内容が1ずつ64回インクリメントされた場合に
は、カウンタ27がプログラマブルカウンタ11
にリセツトパルスを供給する。このリセツトパル
スによりカウンタ11の内容の最上位ビツト
(MSB)が反転され、これに応動して復号回路1
0の出力端子におけるクロツク信号の位相の推移
が生じ、この推移は約半周期の持続時間を有す
る。その結果サンプリング瞬時tFが副時間間隔
12及び1間の遷移の領域から副時間間隔6及び7
間の遷移の領域へ推移する。然る後サンプリング
瞬時tFは、上述した態様において、フリツプフ
ロツプ17の出力端子における信号BF(n+1)
により上記の最後の遷移において安定化される。
【図面の簡単な説明】
第1図はナイキストフイルタの出力端子にお
けるバイフエイズ符号化信号の特性アイパターン
を示す図、第2図はバイフエイズ符号化信号用受
信機のブロツク図、第3図は第2図の作動説明
図、第4図は本発明の実施例のブロツク図であ
る。 1……電圧制御発振器、2……調整可能割算
器、3……判定回路、4……入力端子、5……出
力端子、6……位相検波器、7……低域通過フイ
ルタ、8……入力端子、9……判定回路、10…
…復号回路、11……プログラマブルカウンタ、
12……電圧制御発振器、14,15……フリツ
プフロツプ、17……フリツプフロツプ、18…
…低域通過フイルタ、19……遷移検出器、20
……カウンタ、25,26……フリツプフロツ
プ、27……カウンタ。

Claims (1)

  1. 【特許請求の範囲】 1 制御可能なクロツク信号源を具えて、受信し
    たバイフエイズ変調信号からクロツク信号を発生
    するための装置において、 前記受信した信号の極性は、1つの記号時間間
    隔中の2つの異なる時点でのみサンプリングさ
    れ、 クロツク信号源の周波数と位相とを再調整し
    て、そこからサンプリング瞬時と所望のクロツク
    信号とを導出する目的で、得られた極性サンプル
    を互いに比較して、もし両方の極性サンプルが等
    しいならば一方(正)の制御信号を発生し、もし
    両方の極性サンプルが等しくないならば他方
    (負)の制御信号を発生することを特徴とするク
    ロツク信号発生装置。 2 前記2つのサンプリング瞬時は、記号時間間
    隔の約1/3ないし約1/4(T/3−T/4)だけの
    間隔を相互に有していることを特徴とする特許請
    求の範囲第1項に記載のクロツク信号発生装置。 3 2つの継起的な記号時間間隔中で、相対的に
    同じサンプリング瞬時の極性サンプルが相互に比
    較されて、連続的にそれらが等しいことが検出さ
    れた時には、同期誤りの状態を表示する信号が発
    生することを特徴とする特許請求の範囲第1項に
    記載のクロツク信号発生装置。 4 各記号時間間隔中の1番目のサンプリング瞬
    時に受信信号の極性をサンプリングするための手
    段、及び各記号時間間隔中の2番目のサンプリン
    グ瞬時に受信信号の極性をサンプリングするため
    の手段が設けられて成り、 この2番目のサンプリング瞬時は1番目のサン
    プリング瞬時から一定の距離に存り、 また、クロツク信号源の周波数と位相とを再調
    整するための制御信号を発生するために、得られ
    た極性サンプルをモジユロ2で加算する手段が設
    けられて成ることを特徴とする特許請求の範囲第
    1項に記載のクロツク信号発生装置。
JP60085572A 1984-04-24 1985-04-23 クロツク信号発生装置 Granted JPS60235563A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
NL8401310A NL8401310A (nl) 1984-04-24 1984-04-24 Inrichting voor het opwekken van een kloksignaal.
NL8401310 1984-04-24

Publications (2)

Publication Number Publication Date
JPS60235563A JPS60235563A (ja) 1985-11-22
JPH0548979B2 true JPH0548979B2 (ja) 1993-07-23

Family

ID=19843849

Family Applications (1)

Application Number Title Priority Date Filing Date
JP60085572A Granted JPS60235563A (ja) 1984-04-24 1985-04-23 クロツク信号発生装置

Country Status (7)

Country Link
US (1) US4709378A (ja)
EP (1) EP0162505B1 (ja)
JP (1) JPS60235563A (ja)
AU (1) AU4161385A (ja)
CA (1) CA1258101A (ja)
DE (1) DE3574657D1 (ja)
NL (1) NL8401310A (ja)

Families Citing this family (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2598868A1 (fr) * 1986-05-15 1987-11-20 Rault Jean Christophe Procede et dispositif de recuperation du rythme et de la phase d'un signal numerique, utilisant la derivee du signal, et systeme de reception de ce signal utilisant le dispositif
US4808937A (en) * 1986-07-15 1989-02-28 Hayes Microcomputer Products, Inc. Phase-locked loop for a modem
US4888790A (en) * 1987-10-14 1989-12-19 National Semiconductor Corp. Timing recovery system using bipolar-pattern center estimator
IT1228877B (it) * 1989-03-24 1991-07-05 Sits Soc It Telecom Siemens Procedimento e dispositivo di ricupero della temporizzazione per la ricezione di segnali numerici di banda base.
NL9100065A (nl) * 1991-01-16 1992-08-17 Philips Nv Werkwijze en inrichting voor het opwekken van een kloksignaal uit een biphase gemoduleerd digitaal signaal.
DE69207509T2 (de) * 1991-08-20 1996-08-22 Philips Electronics Nv Telekommunikationssystem mit einer Leitung für digitalen Verkehr mit einer Anordnung zum Abzweigen des digitalen Duplexverkehrs, und Anordnung zur Anwendung in dem Telekommunikationssystem
US5479456A (en) * 1993-05-19 1995-12-26 U.S. Philips Corporation Automatic false synchronization correction mechanism for biphase-modulated signal reception
EP0625837A3 (en) * 1993-05-19 1995-05-24 Philips Electronics Nv Automatic mechanism for correcting incorrect synchronization for receiving a biphase modulated signal.
JP3037201B2 (ja) * 1997-05-23 2000-04-24 埼玉日本電気株式会社 誤同期検出装置
GB2370205B (en) * 1997-05-23 2002-08-14 Nec Corp False-synchronization detection device for a bit-synchronous circuit of a pi/4-shift DQPSK demodulator
DE60319832D1 (de) * 2003-10-13 2008-04-30 St Microelectronics Srl Verfahren und System zur Phasenrückgewinnung und Dekodierung

Family Cites Families (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3973212A (en) * 1975-08-28 1976-08-03 Rockwell International Corporation Phase detection in phase lock loop circuit
US4017803A (en) * 1976-01-29 1977-04-12 Sperry Rand Corporation Data recovery system resistant to frequency deviations
US4146743A (en) * 1976-08-09 1979-03-27 Hewlett-Packard Company Adaptive sampling decoder-encoder apparatus and method
US4176248A (en) * 1977-12-23 1979-11-27 Bell Telephone Laboratories, Incorporated System for identifying and correcting the polarity of a data signal
US4167760A (en) * 1978-03-28 1979-09-11 Ampex Corporation Bi-phase decoder apparatus and method
NL7903099A (nl) * 1979-04-20 1980-10-22 Philips Nv Inrichting voor kloksignaalopwekking.
NL7903100A (nl) * 1979-04-20 1980-10-22 Philips Nv Inrichting voor het controleren van de synchronisatie van een ontvanger.
GB2099262B (en) * 1981-04-29 1984-11-14 Philips Electronic Associated Arrangement for checking the synchronisation of a receiver
US4376309A (en) * 1981-05-29 1983-03-08 Bell Telephone Laboratories, Incorporated Method and apparatus for signal-eye tracking in digital transmission systems
US4385396A (en) * 1981-06-05 1983-05-24 Phillips Petroleum Company NRZ Digital data recovery
US4412339A (en) * 1981-09-24 1983-10-25 Advanced Micro Devices, Inc. Zero-crossing interpolator to reduce isochronous distortion in a digital FSK modem
SE439083B (sv) * 1981-11-30 1985-05-28 Ellemtel Utvecklings Ab Sett att bringa en oscillator i fas med en inkommande signal jemte anordning for genomforandet av settet
US4457005A (en) * 1981-12-07 1984-06-26 Motorola, Inc. Digital coherent PSK demodulator and detector

Also Published As

Publication number Publication date
CA1258101A (en) 1989-08-01
EP0162505B1 (en) 1989-12-06
AU4161385A (en) 1985-10-31
NL8401310A (nl) 1985-11-18
JPS60235563A (ja) 1985-11-22
US4709378A (en) 1987-11-24
DE3574657D1 (de) 1990-01-11
EP0162505A1 (en) 1985-11-27

Similar Documents

Publication Publication Date Title
US5319679A (en) Method and apparatus for recovering data from a radio signal
JP2510827B2 (ja) 適応スレショルド装置
US5754587A (en) Method and apparatus for bias suppression in a VCO based FM transmission system
EP0425302B1 (en) Digital phase lock loop decoder suitable for Manchester codes
EP0311973A2 (en) Quotient phase-shift processor for digital phase-licked-loops
US5475705A (en) Demodulator for Manchester-coded FM signals
US5239672A (en) Synchronization method and apparatus for simulcast transmission system
JPH0548979B2 (ja)
US4472817A (en) Non-PLL concurrent carrier clock synchronization
US4941151A (en) Predictive clock recovery circuit
IL47894A (en) Apparatus for producing baud timing signal
US4276650A (en) Method of synchronizing a quadphase receiver and clock synchronization device for carrying out the method
JPH069359B2 (ja) 位相変調データ復調装置
EP0335346A2 (en) Digital signal magnetic recording and playback apparatus employing quadrature amplitude modulation
EP0290851A2 (en) Synchronizing clock signal generator
US4292593A (en) Method of demodulating a quadphase coded data signal and receiver for carrying out the method
US5999577A (en) Clock reproducing circuit for packet FSK signal receiver
US4393273A (en) FM-Receiver with transmitter characterization
US4362997A (en) Quadriphase differential demodulator
JP3425767B2 (ja) バイフェーズ変調ディジタル信号からクロック信号を発生する方法及び装置
US6617917B2 (en) Caller-ID demodulation apparatus and method using multiple thresholds
US5479456A (en) Automatic false synchronization correction mechanism for biphase-modulated signal reception
US4415933A (en) Carrier wave recovery circuit
EP0625837A2 (en) Automatic false synchronization correction mechanism for biphase-modulated signal reception
EP0090462B1 (en) Demodulator circuit