JPH0564431A - 安定化直流電源回路 - Google Patents
安定化直流電源回路Info
- Publication number
- JPH0564431A JPH0564431A JP25475091A JP25475091A JPH0564431A JP H0564431 A JPH0564431 A JP H0564431A JP 25475091 A JP25475091 A JP 25475091A JP 25475091 A JP25475091 A JP 25475091A JP H0564431 A JPH0564431 A JP H0564431A
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- Japan
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- voltage
- output
- pulse
- circuit
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Abstract
(57)【要約】
【目的】温度変化による、変動を少なくした安定化直流
電源回路を得る。 【構成】出力電圧ｅを基準電圧ｆに比較して誤差電圧ｇ
を作り、一定時間間隔で上記誤差電圧ｇの大きさに応じ
たパルス幅を持つスイッチングパルスＬを生成し、この
スイッチングパルスＬにより、安定化直流電源回路に設
けたスイッチング素子を制御するようにする。
電源回路を得る。 【構成】出力電圧ｅを基準電圧ｆに比較して誤差電圧ｇ
を作り、一定時間間隔で上記誤差電圧ｇの大きさに応じ
たパルス幅を持つスイッチングパルスＬを生成し、この
スイッチングパルスＬにより、安定化直流電源回路に設
けたスイッチング素子を制御するようにする。
Description
【０００１】
【産業上の利用分野】本発明は安定した直流出力電圧を
発生させる安定化電源回路に係わり、特にパルス幅の大
きさで電圧を制御する安定化直流電源回路に関するもの
である。
発生させる安定化電源回路に係わり、特にパルス幅の大
きさで電圧を制御する安定化直流電源回路に関するもの
である。
【０００２】
【従来の技術】図３は従来の安定化直流電源回路の構成
を示すものである。図３において、出力端子Ｔ０の出力
電圧ｅに変動が生ずると、誤差電圧検出回路７が上記出
力電圧ｅを基準電圧発生器８からの基準電圧ｆと比較し
て、誤差電圧ｇを発生する。
を示すものである。図３において、出力端子Ｔ０の出力
電圧ｅに変動が生ずると、誤差電圧検出回路７が上記出
力電圧ｅを基準電圧発生器８からの基準電圧ｆと比較し
て、誤差電圧ｇを発生する。
【０００３】一方、三角波発生器２３にはコンデンサ２
４と抵抗２５を接続し、この三角波発生器２３より三角
波ｎを発生させる。そしてこの三角波ｎは上記誤差電圧
ｇと共に、コンパレータ２１に供給する。
４と抵抗２５を接続し、この三角波発生器２３より三角
波ｎを発生させる。そしてこの三角波ｎは上記誤差電圧
ｇと共に、コンパレータ２１に供給する。
【０００４】その結果、図４に示すように三角波ｎが誤
差電圧ｇと基準電圧ｆの双方よりも小さい間だけ、スイ
ッチングトランジスタ３をＯＮにするようなパルスＬを
ドライバ２２と抵抗１５を通してトランジスタ３に供給
する。そして、入力端子Ｔ１より供給される入力電圧ａ
は上記トランジスタ３でスイッチングされ、チョークコ
イル５とコンデンサ６によるフィルタを通り、出力電圧
ｅとなって出力端子Ｔ０より出力される。尚、１は入力
端子Ｔ１とトランジスタ３をデカップリングするコンデ
ンサであり、２は出力電圧ｅを制御する抵抗であり、４
はフライホイールダイオードである。
差電圧ｇと基準電圧ｆの双方よりも小さい間だけ、スイ
ッチングトランジスタ３をＯＮにするようなパルスＬを
ドライバ２２と抵抗１５を通してトランジスタ３に供給
する。そして、入力端子Ｔ１より供給される入力電圧ａ
は上記トランジスタ３でスイッチングされ、チョークコ
イル５とコンデンサ６によるフィルタを通り、出力電圧
ｅとなって出力端子Ｔ０より出力される。尚、１は入力
端子Ｔ１とトランジスタ３をデカップリングするコンデ
ンサであり、２は出力電圧ｅを制御する抵抗であり、４
はフライホイールダイオードである。
【０００５】
【発明が解決しようとする課題】上記従来の回路におい
ては、スイッチングトランジスタを制御するスイッチン
グパルスの発生の基準を三角波によっているため、温度
等によりＣＲの素子値が変化し、三角波の波形が変化す
ると、パルス出力がその影響を直接受けてることがあ
り、パルスの精度を高めることができにくく、その結果
安定した出力を得にくいという問題があった。
ては、スイッチングトランジスタを制御するスイッチン
グパルスの発生の基準を三角波によっているため、温度
等によりＣＲの素子値が変化し、三角波の波形が変化す
ると、パルス出力がその影響を直接受けてることがあ
り、パルスの精度を高めることができにくく、その結果
安定した出力を得にくいという問題があった。
【０００６】
【課題を解決するための手段】本発明は上記の問題を解
決するため、出力電圧を基準電圧と比較して誤差電圧を
作り、該誤差電圧に応じて入力端子と出力端子間に設け
たスイッチング素子を制御し、出力電圧を基準電圧に安
定化させる安定化直流電源回路において、上記誤差電圧
をコンデンサの放電時間に変換する積分回路と、該積分
回路の出力の大きさをスイッチングパルスのデューティ
比に変換するデジタルカウンタと、上記積分回路及びデ
ジタルカウンタを制御するタイミング信号発生回路と、
上記デジタルカウンタからのデューティ比が制御された
スイッチングパルスで、上記スイッチング素子を制御し
て、誤差電圧をデジタルパルスにより処理するようにし
た構成にする。
決するため、出力電圧を基準電圧と比較して誤差電圧を
作り、該誤差電圧に応じて入力端子と出力端子間に設け
たスイッチング素子を制御し、出力電圧を基準電圧に安
定化させる安定化直流電源回路において、上記誤差電圧
をコンデンサの放電時間に変換する積分回路と、該積分
回路の出力の大きさをスイッチングパルスのデューティ
比に変換するデジタルカウンタと、上記積分回路及びデ
ジタルカウンタを制御するタイミング信号発生回路と、
上記デジタルカウンタからのデューティ比が制御された
スイッチングパルスで、上記スイッチング素子を制御し
て、誤差電圧をデジタルパルスにより処理するようにし
た構成にする。
【０００７】
【作用】上記の構成によれば、出力電圧が変動した場
合、この出力電圧を基準電圧と比較して誤差電圧を作
り、該誤差電圧の大きさを積分回路に入力して、コンデ
ンサの放電時間に置き換え、さらにデジタルカウンタで
上記コンデンサの放電時間をカウントして、パルス幅の
大きさに置き換え、できたスイッチングパルスをトラン
ジスタに入力してレギュレート動作を行わせる。
合、この出力電圧を基準電圧と比較して誤差電圧を作
り、該誤差電圧の大きさを積分回路に入力して、コンデ
ンサの放電時間に置き換え、さらにデジタルカウンタで
上記コンデンサの放電時間をカウントして、パルス幅の
大きさに置き換え、できたスイッチングパルスをトラン
ジスタに入力してレギュレート動作を行わせる。
【０００８】
【実施例】図１は本発明の一実施例のブロック図であ
り、図３に示す従来例に対応する部分は同一符号を付し
説明を省略する。以下図１に示す本発明の実施例を図２
に示す動作説明図と共に詳細に説明する。
り、図３に示す従来例に対応する部分は同一符号を付し
説明を省略する。以下図１に示す本発明の実施例を図２
に示す動作説明図と共に詳細に説明する。
【０００９】図１において、９は抵抗、１０はコンデン
サ、１１は差動増幅器であり、この抵抗９、コンデンサ
１０及び差動増幅器１１で積分回路を構成する。１２は
タイミング信号発生回路１４からのタイミング信号によ
り上記積分回路の充電電圧を放電するトランジスタより
成るスイッチング素子、１３は上記積分回路の放電中動
作し、上記タイミング信号発生回路１４からのタイミン
グパルスをカウントして、カウントした時間に比例した
デューティ比のスイッチングパルスを発生させるデジタ
ルカウンタである。
サ、１１は差動増幅器であり、この抵抗９、コンデンサ
１０及び差動増幅器１１で積分回路を構成する。１２は
タイミング信号発生回路１４からのタイミング信号によ
り上記積分回路の充電電圧を放電するトランジスタより
成るスイッチング素子、１３は上記積分回路の放電中動
作し、上記タイミング信号発生回路１４からのタイミン
グパルスをカウントして、カウントした時間に比例した
デューティ比のスイッチングパルスを発生させるデジタ
ルカウンタである。
【００１０】従って、レギュレータ回路が動作した状態
では、入力端子Ｔ１に入力電圧ａが印加され、出力端子
Ｔ０より出力電圧ｅが出力される。出力電圧ｅが変動す
ると、誤差電圧検出回路７から、基準電圧発生器８から
の基準電圧と、上記出力電圧ｅとの差が図２に示すよう
な誤差電圧ｇとして導出される。
では、入力端子Ｔ１に入力電圧ａが印加され、出力端子
Ｔ０より出力電圧ｅが出力される。出力電圧ｅが変動す
ると、誤差電圧検出回路７から、基準電圧発生器８から
の基準電圧と、上記出力電圧ｅとの差が図２に示すよう
な誤差電圧ｇとして導出される。
【００１１】この誤差電圧ｇが抵抗９、コンデンサ１０
及び差動増幅器１１より成る積分回路に供給された状態
で、タイミング信号発生回路１４より図２に示すような
サンプルパルスｋが出力されスイッチング素子１２をオ
フにすると、パルスが立ち上がった時点の誤差電圧ｇの
大きさに応じてコンデンサ１０が充電され、積分回路出
力ｊは急激に負の電位になる。
及び差動増幅器１１より成る積分回路に供給された状態
で、タイミング信号発生回路１４より図２に示すような
サンプルパルスｋが出力されスイッチング素子１２をオ
フにすると、パルスが立ち上がった時点の誤差電圧ｇの
大きさに応じてコンデンサ１０が充電され、積分回路出
力ｊは急激に負の電位になる。
【００１２】タイミング信号発生回路１４からのサンプ
ルパルスｋが”Ｈ”になり、スイッチング素子１２がオ
ンになると、差動増幅器１１の入力部は上記スイッチン
グ素子１２によりグランドレベルｂに接地され、コンデ
ンサ１０に充電されている電荷は電流一定で放電され、
誤差電圧ｇの大きさに比例した時間をかけて積分回路の
出力ｊが図２に示すようにゼロに近ずいていく。
ルパルスｋが”Ｈ”になり、スイッチング素子１２がオ
ンになると、差動増幅器１１の入力部は上記スイッチン
グ素子１２によりグランドレベルｂに接地され、コンデ
ンサ１０に充電されている電荷は電流一定で放電され、
誤差電圧ｇの大きさに比例した時間をかけて積分回路の
出力ｊが図２に示すようにゼロに近ずいていく。
【００１３】積分回路が放電すると、その放電時間の
間、デジタルカウンタ１３が動作し、該カウンタ１３で
計った時間に比例したデューティ比の図２に示すスイッ
チングパルスＬを生成し、次にサンプルパルスｋが立ち
下がったときにデータとしてトランジスタより成るスイ
ッチング素子３に出力する。デジタルカウンタ１３のク
ロックｊはタイミング信号発生回路１４で発生させる。
間、デジタルカウンタ１３が動作し、該カウンタ１３で
計った時間に比例したデューティ比の図２に示すスイッ
チングパルスＬを生成し、次にサンプルパルスｋが立ち
下がったときにデータとしてトランジスタより成るスイ
ッチング素子３に出力する。デジタルカウンタ１３のク
ロックｊはタイミング信号発生回路１４で発生させる。
【００１４】こうして出来たスイッチングパルスＬは、
そのデューティ比が誤差電圧ｇの大きさに比例して変化
するので、このスイッチングパルスＬでトランジスタよ
り成るスイッチング素子３をスイッチングすることによ
り、出力電圧を基準電圧に等しくなるように制御するこ
とができる。
そのデューティ比が誤差電圧ｇの大きさに比例して変化
するので、このスイッチングパルスＬでトランジスタよ
り成るスイッチング素子３をスイッチングすることによ
り、出力電圧を基準電圧に等しくなるように制御するこ
とができる。
【００１５】
【発明の効果】本発明は以上の構成より成り、誤差電圧
の大きさを測るのに積分回路のコンデンサの放電期間を
用いるため、温度等の変化によるＣＲの値の変動の影響
を受けず、またパルスの生成のためにデジタルカウンタ
を用いるため、スイッチングパルスをより正確に作成す
ることができ、高精度の安定化直流電源回路を提供する
ことができる。
の大きさを測るのに積分回路のコンデンサの放電期間を
用いるため、温度等の変化によるＣＲの値の変動の影響
を受けず、またパルスの生成のためにデジタルカウンタ
を用いるため、スイッチングパルスをより正確に作成す
ることができ、高精度の安定化直流電源回路を提供する
ことができる。
【図１】 本発明の一実施例のブロック図。
【図２】 図１の動作説明図。
【図３】 従来例のブロック図。
【図４】 図３の動作説明図。
３ スイッチング素子 ９ 抵抗 １０ コンデンサ １１ 差動増幅器 １３ デジタルカウンタ １４ タイミング信号発生回路
Claims (1)
- 【請求項１】出力電圧を基準電圧と比較して誤差電圧を
作り、該誤差電圧に応じて、入力端子と出力端子間に設
けたスイッチング素子を制御し、出力電圧を基準電圧に
安定化させる安定化直流電源回路において、上記誤差電
圧をコンデンサの放電時間に変換する積分回路と、該積
分回路の出力の大きさをスイッチングパルスのデューテ
ィ比に変換するデジタルカウンタと、上記積分回路及び
デジタルカウンタを制御するタイミング信号発生回路
と、上記デジタルカウンタからのデューティ比が制御さ
れたスイッチングパルスで、上記スイッチング素子を制
御して、誤差電圧をデジタルパルスにより処理するよう
にしたことを特徴とする安定化直流電源回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25475091A JPH0564431A (ja) | 1991-09-04 | 1991-09-04 | 安定化直流電源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25475091A JPH0564431A (ja) | 1991-09-04 | 1991-09-04 | 安定化直流電源回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0564431A true JPH0564431A (ja) | 1993-03-12 |
Family
ID=17269361
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25475091A Pending JPH0564431A (ja) | 1991-09-04 | 1991-09-04 | 安定化直流電源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0564431A (ja) |
-
1991
- 1991-09-04 JP JP25475091A patent/JPH0564431A/ja active Pending
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